微电子工艺制程
微电子工艺概论
做layout，对工艺的了解至关重要，以下是本人在拜读前辈门的心血后，自己总结的内容，由于不知怎么的不能插图片，所以略有遗憾，还请个位高手指教！我将分几篇文章将其叙述完毕。
1扩散工艺
A扩散是掺杂的一种工艺
B半导体中常用的杂质有：受主杂质（P型）：硼施主杂质（N型）：磷，砷，锑
C 扩散三步曲
（1）预淀积扩散：在扩散过程中，硅片表面杂质浓始终不变，又称恒表面源扩散。
（2）推进扩散：除表面以外的任何地方的初始杂质浓度均为0。
（3）激活：激活杂质原子，改变了硅的导电率。
D 杂质扩散种类
替代扩散和间隙扩散，现今流行的是替位扩散
2 离子注入工艺
A 离子注入工艺是掺杂工艺中最重要的一项，各方面都明显优于扩散。
B 离子在注入时有2种能量损失的类型
（1）电子碰撞（与核外电子作用）：离子质量比电子质量大很多，每次碰撞后离子能量损失小，产生小角度散射。
（2）原子碰撞（同核碰撞）：由于两者质量相当，能量损失大，产生大角度的散射。
C 沟道效应
离子注入时，离子即未与电子也未与原子核发生碰撞而是穿过了晶格间隙使得该离子比那些发生碰撞的原子穿透得更深。他的控制方法主要有以下几种：
（1）倾斜硅片，偏离垂直方向7度已大于临界角注入。
（2）屏蔽氧化层
（3）硅预非晶化，预先注入点不活泼粒子si+
（4）用质量较大的原子
D 退火
（1）分类：高温炉退火；快速热退火（RTA）
（2）退火作用：修复硅晶格结构并激活杂质——硅键。
（3）退火时间越长，温度越高，杂质的激活就越充分。
3 热氧化工艺
一始，先讲一下SiO2的问题，这有助于理解以后的内容
A SiO2薄膜结构：其基本单元是一个由Si——O原子组成的正四面体（图插不进，就略了）
B SiO2的化学性质：它不溶于水和酸，但溶于HF
C SiO2的作用：
（1）作为杂质选择扩散的掩蔽膜
（2）作为器件表面的保护和钝化膜
首先，可以避免硅表面被镊子划伤以及蒸发，烧结，封装中可能
带来的杂质玷污，起了保护硅的作用。
其次，它可以使硅片表面，p-n结与外界气氛隔离开来，从而减
弱了环境气氛对硅片表面性质的影响。
（3）作为集成电路的隔离介质和绝缘介质
（4）作为电容器，栅氧或储存器单元结构中的介质材料
（5）作为MOS场效应管的绝缘栅材料。
现在，再来讲氧化物生长
D 热氧化方法
（1）干氧法：用氧作为氧化剂
（2）湿氧法：用氧和水的混合剂作为氧化剂
E 影响氧化物生长的因素（速率影响）
（1）掺杂效应：重掺杂的硅要比轻掺杂的氧化速度快
（2）晶向：（111）面的硅原子密度比（100）面大，因此，在线性阶段（111）硅单晶的氧化速率比（100）稍快，但电荷堆积要多（3）压力：生长速率将随电压增大而增大。
最后，我们来看一下热氧化工艺中最重要的一个问题，局部腰花
F 用淀积氮化物（Si3N4）作为氧化阻挡层，因此这不能被氧化，所以刻蚀后的区域可用来选择性氧化（局部氧化）
G 鸟嘴效应
在局部氧化时，氧化剂穿过SiO2层横向扩散，在Si3N4掩膜层的边缘附近形成“鸟嘴”区域。
（1）若Si3N4加厚，则“鸟嘴”就见效，缺陷就要增加。
（2）若SiO2膜加厚，则可减小缺陷，但“鸟嘴”就增大。
（3）较高的氧化温度可以获得较小的“鸟嘴”
（4）采用（111）晶向的P沟工艺比采用（100）晶向的N沟工艺有更短的“鸟嘴”
（5）为了减小氧化物掩膜和硅之间的应力，在他们之间热生长一层薄氧化层，称之为垫氧。
4 光刻工艺
A 光刻的基本步骤
（1）脱水烘
（2）打底膜
（3）涂胶
（4）前烘（软烘）
（5）显影
（6）后烘（坚膜）
（7）腐蚀
（8）去胶
B 光刻胶类型
（1）正胶：不溶于显影药水，曝光后溶于显影药水。
（2）负胶：溶于显影药水，曝光后不溶于显影药水。
C 曝光方式（光学曝光）
光源均采用紫外线
（1）接触式曝光
（2）接近式曝光
（3）投影式曝光
5 刻蚀工艺
通常在光刻工艺中结合使用此项工艺，当光刻胶溶解于药水后将SiO2露在外面然后进行刻蚀，而光刻胶便起到了保护的作用。
一工艺分类
1 干法刻蚀
1）将硅片暴露在气态中产生的等离子体，等离子体与硅片发生物理或化学反应，从而去掉暴露在表面的材料。
2）优点：横向腐蚀小，无化学废液，分辨率高，湿线条。
缺点：成本高，设备复杂
2 湿法刻蚀
1）用液体化学试剂以化学方式去除硅片表面的材料。
2）用时短，成本低，操作简单
3 以上2种方法经常结合使用
6 化学气相淀积工艺
淀积工艺其实就薄膜淀积的过程，常用的材料有SiO2和Si3N4，金属和金属化合物薄膜。
一薄膜生长的3个过程
1 晶体形成
2 聚集成束，也称岛生长
3 形成连续的膜
二CVD化学过程
化学气相淀积是通过气体混合的化学反应在硅片淀积一层固体膜的工艺，主要过程是：1高温分解 2 光分解 3 还原反应 4 氧化反应 5 氧化还原反应。
三CVD分类
1 APCVD 常压CVD
2 LPCVD 低压CVD
3 PECVD 等离子体增强CVD
4 HDCVD 高密度等离子CVD
四不同物质薄膜作用
1 SiO2：在VLSI多层金属中，可以做ILD，浅槽隔离的填充无和侧墙等
2 Si3N4：被用作硅片最终的钝化保护层
以上2个不能阻碍注入，但可以使其注入较浅，形成active
3 多 3 多晶硅：在MOS器件中，掺杂的多晶硅作为栅电极，也能阻碍注入，
也就是所谓的自对准工艺。
4 氧化硅：成为光刻掩膜中有用的抗反射层。
半导体全制程介绍
《晶圆处理制程介绍》 基本晶圆处理步骤通常是晶圆先经过适当的清洗（Cleaning）之后，送到热炉管 （Furnace）内，在含氧的环境中，以加热氧化（Oxidation）的方式在晶圆的表面 形成一层厚约数百个的二氧化硅层，紧接着厚约1000到2000的氮化硅层 将以化学气相沈积Chemical Vapor Deposition；CVP）的方式沈积（Deposition）在刚刚长成的二氧化硅上，然后整个晶圆将进行微影（Lithography）的制程，先在 晶圆上上一层光阻（Photoresist），再将光罩上的图案移转到光阻上面。接着利用蚀刻（Etching）技术，将部份未被光阻保护的氮化硅层加以除去，留下的就是所需要的线路图部份。接着以磷为离子源（Ion Source），对整片晶圆进行磷原子的植入（Ion Implantation），然后再把光阻剂去除（Photoresist Scrip）。制程进行至此，我们已将构成集成电路所需的晶体管及部份的字符线（Word Lines），依光罩所提供的设计图案，依次的在晶圆上建立完成，接着进行金属化制程（Metallization），制作金属导线，以便将各个晶体管与组件加以连接，而在每一道步骤加工完后都必须进行一些电性、或是物理特性量测，以检验加工结果是否在规格内（Inspection and Measurement）；如此重复步骤制作第一层、第二层．．．的电路部份，以在硅晶圆上制造晶体管等其它电子组件；最后所加工完成的产品会被送到电性测试区作电性量测。 根据上述制程之需要，FAB厂内通常可分为四大区： 1）黄光本区的作用在于利用照相显微缩小的技术，定义出每一层次所需要的电路图，因为采用感光剂易曝光，得在黄色灯光照明区域内工作，所以叫做「黄光区」。 2）蚀刻经过黄光定义出我们所需要的电路图，把不要的部份去除掉，此去除的步骤就> 称之为蚀刻，因为它好像雕刻，一刀一刀的削去不必要不必要的木屑，完成作品，期间又利用酸液来腐蚀的，所 以叫做「蚀刻区」。 3）扩散本区的制造过程都在高温中进行，又称为「高温区」，利用高温给予物质能量而产生运动，因为本区的机台大都为一根根的炉管，所以也有人称为「炉管区」，每一根炉管都有不同的作用。 4）真空
半导体行业：芯片设计企业的光罩成本大幅上升
半导体行业：芯片设计企业的光罩成本大幅上升 本周重点 面板级扇出型封装技术(FO on substrate)在异质整合趋势下的投资机遇 透过台积电看半导体趋势-成也萧何,败也萧何 核心观点 虽然SoC 将更多的功能整合到单颗芯片,在大幅提升芯片性能的同时降低了功耗,但是缺点就是需要更加先进制程工艺的支撑。随着芯片制程向 7nm,5nm 甚至3nm 发展,芯片设计企业的光罩成本大幅上升。而通过系统级封装技术如面板级扇出型封装可以在提升芯片性能的同时大大降低企业的设计 和制造成本,这种异质整合的封装技术有望成为芯片行业新的发展趋势。为了 满足电子产品轻薄短小的发展趋势,未来对于基板的要求更薄,因此封装材料中 的薄基板技术(coreless,ETS 和embedded)值得关注。另外在高性能性能的封装中会大量采用TSV(硅通孔)工艺,这种工艺在封装过程中芯片容易出现细微的 损坏,因此未来细微缺陷检测设备也是行业值得关注的一个发展方向在所有苹果产业链公司从去年11 月初陆续下修其营收预期后,台积电 终于挡不住大趋势,公布低于市场预期的一季度销售环比衰退21.9%-22.9%,43- 45%的毛利预期(vs. 市场预期的47.5%),及31-33%的营业利润率预期(vs. 市场预期的36.8%)。台积电提出2019 年全球晶圆代工达0%同比成长,我们预估证券分析师对世界先进,华虹,长电科技,通富微电,华天科技2019 年营收同比成长的预估将明显下修到0%,+/-5%。虽然7 纳米短期需求不振,但台积电公布其2019 资本开支同比持平,维持100-110 亿美元,其中80%是用在7/5/3 纳米(大多用在5 和3 纳米),另外超过10%用在光掩片及先进封装的投资,剩下的用在特 殊制程。这对全球及中国半导体设备大厂而言,相对有利。
LED芯片的制造工艺流程简介
LED芯片的制造工艺流程简介 LED 芯片的制造过程可概分为晶圆处理工序（Wafer Fabrication）、晶圆针测工序（Wafer Probe）、构装工序（Packaging）、测试工序（Initial Test andFi nal Test）等几个步骤。其中晶圆处理工序和晶圆针测工序为前段（Front End）工序，而构装工序、测试工序为后段（Back End）工序。 1、晶圆处理工序 本工序的主要工作是在晶圆上制作电路及电子元件（如晶体管、电容、逻辑开关等），其处理程序通常与产品种类和所使用的技术有关，但一般基本步骤是先将晶圆适当清洗，再在其表面进行氧化及化学气相沉积，然后进行涂膜、曝光、显影、蚀刻、离子植入、金属溅镀等反复步骤，最终在晶圆上完成数层电路及元件加工与制作。 2、晶圆针测工序 经过上道工序后，晶圆上就形成了一个个的小格，即晶粒，一般情况下，为便于测试，提高效率，同一片晶圆上制作同一品种、规格的产品；但也可根据需要制作几种不同品种、规格的产品。在用针测（Probe）仪对每个晶粒检测其电气特性，并将不合格的晶粒标上记号后，将晶圆切开，分割成一颗颗单独的晶粒，再按其电气特性分类，装入不同的托盘中，不合格的晶粒则舍弃。 3、构装工序 就是将单个的晶粒固定在塑胶或陶瓷制的芯片基座上，并把晶粒上蚀刻出的一些引接线端与基座底部伸出的插脚连接，以作为与外界电路板连接之用，最后盖上塑胶盖板，用胶水封死。其目的是用以保护晶粒避免受到机械刮伤或高温破坏。到此才算制成了一块集成电路芯片（即我们在电脑里可以看到的那些黑色或褐色，两边或四边带有许多插脚或引线的矩形小块）。 4、测试工序 芯片制造的最后一道工序为测试，其又可分为一般测试和特殊测试，前者是将封装后的芯片置于各种环境下测试其电气特性，如消耗功率、运行速度、耐压度等。经测试后的芯片，依其电气特性划分为不同等级。而特殊测试则是根据客户特殊需
半导体封装制程简介
（Die Saw） 晶片切割之目的乃是要將前製程加工完成的晶圓上一顆顆之芯片（Die）切割分離。首先要在晶圓背面貼上蓝膜（blue tape）並置於鋼 製的圆环上，此一動作叫晶圓粘片（wafer mount），如圖一，而後再 送至晶片切割機上進行切割。切割完後，一顆顆之芯片井然有序的排 列在膠帶上，如圖二、三，同時由於框架之支撐可避免蓝膜皺摺而使 芯片互相碰撞，而圆环撐住膠帶以便於搬運。 圖一 圖二
（Die Bond） 粘晶（装片）的目的乃是將一顆顆分離的芯片放置在导线框架（lead frame）上並用銀浆（epoxy ）粘着固定。引线框架是提供芯片一個粘着的位置+ （芯片座die pad），並預設有可延伸ＩＣ芯片電路的延伸腳（分為內 引腳及外引腳inner lead/outer lead）一個引线框架上依不同的設計可以有 數個芯片座，這數個芯片座通常排成一列，亦有成矩陣式的多列排法 。引线框架經傳輸至定位後，首先要在芯片座預定粘着芯片的位置上点
上銀浆（此一動作稱為点浆），然後移至下一位置將芯片置放其上。 而經過切割的晶圓上的芯片則由焊臂一顆一顆地置放在已点浆的晶 粒座上。装片完後的引线框架再由传输设备送至料盒（magazine） 。装片后的成品如圖所示。 引线框架装片成品 胶的烧结 烧结的目的是让芯片与引线框晶粒座很好的结合固定，胶可分为银浆（导电胶）和绝缘胶两种，根据不同芯片的性能要求使用不同的胶，通常导电胶在200度烤箱烘烤两小时；绝缘胶在150度烤箱烘烤两个半小时。 （Wire Bond） 焊线的目的是將芯片上的焊点以极细的金或铜线（18~50um）連接到引线框架上的內引腳，藉而將ＩＣ芯片的電路訊號傳輸到外界。當
半导体制造基本概念
半导体制造基本概念 晶圆（Wafer） 晶圆（Wafer）的生产由砂即（二氧化硅）开始，经由电弧炉的提炼还原成冶炼级的硅，再经由盐酸氯化，产生三氯化硅，经蒸馏纯化后，透过慢速分解过程，制成棒状或粒状的「多晶硅」。一般晶圆制造厂，将多晶硅融解后，再利用硅晶种慢慢拉出单晶硅晶棒。一支85公分长，重76.6公斤的8?? 硅晶棒，约需2天半时间长成。经研磨、??光、切片后，即成半导体之原料晶圆片。 光学显影 光学显影是在光阻上经过曝光和显影的程序，把光罩上的图形转换到光阻 下面的薄膜层或硅晶上。光学显影主要包含了光阻涂布、烘烤、光罩对准、曝光和显影等程序。小尺寸之显像分辨率，更在IC 制程的进步上，扮演着最关键的角色。由于光学上的需要，此段制程之照明采用偏黄色的可见光。因此俗称此区为黄光区。 干式蚀刻技术 在半导体的制程中，蚀刻被用来将某种材质自晶圆表面上移除。干式蚀刻（又称为电浆蚀刻）是目前最常用的蚀刻方式，其以气体作为主要的蚀刻媒介，并藉由电浆能量来驱动反应。 电浆对蚀刻制程有物理性与化学性两方面的影响。首先，电浆会将蚀刻气体分子分解，产生能够快速蚀去材料的高活性分子。此外，电浆也会把这些化学成份离子化，使其带有电荷。 晶圆系置于带负电的阴极之上，因此当带正电荷的离子被阴极吸引并加速向阴极方向前进时，会以垂直角度撞击到晶圆表面。芯片制造商即是运用此特性来获得绝佳的垂直蚀刻，而后者也是干式蚀刻的重要角色。 基本上，随着所欲去除的材质与所使用的蚀刻化学物质之不同，蚀刻由下列两种模式单独或混会进行：
1. 电浆内部所产生的活性反应离子与自由基在撞击晶圆表面后，将与某特定成份之表面材质起化学反应而使之气化。如此即可将表面材质移出晶圆表面，并透过抽气动作将其排出。 2. 电浆离子可因加速而具有足够的动能来扯断薄膜的化学键，进而将晶圆表面材质分子一个个的打击或溅击（sputtering）出来。 化学气相沉积技术 化学气相沉积是制造微电子组件时，被用来沉积出某种薄膜(film)的技术，所沉积出的薄膜可能是介电材料(绝缘体)(dielectrics)、导体、或半导体。在进行化学气相沉积制程时，包含有被沉积材料之原子的气体，会被导入受到严密控制的制程反应室内。当这些原子在受热的昌圆表面上起化学反应时，会在晶圆表面产生一层固态薄膜。而此一化学反应通常必须使用单一或多种能量源(例如热能或无线电频率功率)。 CVD制程产生的薄膜厚度从低于0.5微米到数微米都有，不过最重要的是其厚度都必须足够均匀。较为常见的CVD薄膜包括有： ■二气化硅（通常直接称为氧化层） ■氮化硅 ■多晶硅 ■耐火金属与这类金属之其硅化物 可作为半导体组件绝缘体的二氧化硅薄膜与电浆氮化物介电层（plasmas nitride dielectrics）是目前CVD技术最广泛的应用。这类薄膜材料可以在芯片内部构成三种主要的介质薄膜：内层介电层（ILD）、内金属介电层（IMD）、以及保护层。此外、金层化学气相沉积（包括钨、铝、氮化钛、以及其它金属等）也是一种热门的CVD应用。 物理气相沉积技术 如其名称所示，物理气相沉积（Physical Vapor Deposition）主要是一种物理制程而非化学制程。此技术一般使用氩等钝气，藉由在高真空中将氩离子加速以撞击溅镀靶材后，可将靶材原子一个个溅击出来，并使被溅击出来的材质（通常为铝、钛或其合金）如雪片般沉积在晶圆表面。制程反应室内部的高温与高真空环境，可使这些金属原子结成晶粒，再透过微影图案化（patterned）与蚀刻，来得到半导体组件所要的导电电路。 解离金属电浆（IMP）物理气相沉积技术
半导体各工艺简介5
Bubbler Wet Thermal Oxidation Techniques
Film Deposition Deposition is the process of depositing films onto a substrate. There are three categories of these films: * POLY * CONDUCTORS * INSULATORS (DIELECTRICS) Poly refers to polycrystalline silicon which is used as a gate material, resistor material, and for capacitor plates. Conductors are usually made of Aluminum although sometimes other metals such as gold are used. Silicides also fall under this category. Insulators refers to materials such as silicon dioxide, silicon nitride, and P-glass (Phosphorous-doped silicon dioxide) which serve as insulation between conducting layers, for diffusion and implantation masks,and for passivation to protect devices from the environment.
半导体的生产工艺流程
半导体的生产工艺流程 微机电制作技术，尤其是最大宗以硅半导体为基础的微细加工技术 (silicon-basedmicromachining)，原本就肇源于半导体组件的制程技术，所以必须先介绍清楚这类制程，以免沦于夏虫语冰的窘态。 一、洁净室 一般的机械加工是不需要洁净室(cleanroom)的，因为加工分辨率在数十微米以上，远比日常环境的微尘颗粒为大。但进入半导体组件或微细加工的世界，空间单位都是以微米计算，因此微尘颗粒沾附在制作半导体组件的晶圆上，便有可能影响到其上精密导线布局的样式，造成电性短路或断路的严重后果。为此，所有半导体制程设备，都必须安置在隔绝粉尘进入的密闭空间中，这就是洁净室的来由。洁净室的洁净等级，有一公认的标准，以class10为例，意谓在单位立方英呎的洁净室空间内，平均只有粒径0.5微米以上的粉尘10粒。所以class后头数字越小，洁净度越佳，当然其造价也越昂贵。为营造洁净室的环境，有专业的建造厂家，及其相关的技术与使用管理办法如下： 1、内部要保持大于一大气压的环境，以确保粉尘只出不进。所以需要大型 鼓风机，将经滤网的空气源源不绝地打入洁净室中。 2、为保持温度与湿度的恒定，大型空调设备须搭配于前述之鼓风加压系统 中。换言之，鼓风机加压多久，冷气空调也开多久。 3、所有气流方向均由上往下为主，尽量减少突兀之室内空间设计或机台摆 放调配，使粉尘在洁净室内回旋停滞的机会与时间减至最低程度。 4、所有建材均以不易产生静电吸附的材质为主。 5、所有人事物进出，都必须经过空气吹浴(airshower)的程序，将表面粉尘 先行去除。 6、人体及衣物的毛屑是一项主要粉尘来源，为此务必严格要求进出使用人 员穿戴无尘衣，除了眼睛部位外，均需与外界隔绝接触(在次微米制程技术的工厂内，工作人员几乎穿戴得像航天员一样。)当然，化妆是在禁绝之内，铅笔等也禁止使用。 7、除了空气外，水的使用也只能限用去离子水(DIwater,de-ionizedwater)。 一则防止水中粉粒污染晶圆，二则防止水中重金属离子，如钾、钠离子污染金氧半(MOS)晶体管结构之带电载子信道(carrierchannel)，影响半导体组件的工作特性。去离子水以电阻率(resistivity)来定义好坏，一般要求至 17.5MΩ-cm以上才算合格；为此需动用多重离子交换树脂、RO逆渗透、与 UV紫外线杀菌等重重关卡，才能放行使用。由于去离子水是最佳的溶剂与清洁剂，其在半导体工业之使用量极为惊人！ 8、洁净室所有用得到的气源，包括吹干晶圆及机台空压所需要的，都得使 用氮气(98%)，吹干晶圆的氮气甚至要求99.8%以上的高纯氮！以上八点说明是最基本的要求，另还有污水处理、废气排放的环保问题，再再需要大笔
半导体制程气体介绍
一、半導體製程氣體介紹: A.Bulk gas: ---GN2 General Nitrogen : 只經過Filter -80℃ ---PN2 Purifier Nitrogen ---PH2 Purifier Hydrgen (以紅色標示) ---PO2 Purifier Oxygen ---He Helium ---Ar Argon ※“P”表示與製程有關 ※台灣三大氣體供應商: 三福化工(與美國Air Products) 亞東氣體(與法國Liquid合作) 聯華氣體(BOC) 中普Praxair B.Process gas : Corrosive gas (腐蝕性氣體) Inert gas (鈍化性氣體) Flammable gas (燃燒性氣體) Toxic gas (毒性氣體) C.General gas : CDA : Compressor DryAir (與製程無關，只有Partical問題)。 ICA : Instrument Compressor Air (儀表用壓縮空氣)。 BCA: Breathinc Compressor Air (呼吸系統用壓縮空氣)。 二、氣體之物理特性: A.氣體分類: 1.不活性氣體: N2、Ar、He、SF6、CO2、CF4 , ….. (惰性氣體) 2.助燃性氣體: O2、Cl2、NF3、N2O ,….. 3.可燃性氣體: H2、PH3、B2H6、SiH2Cl2、NH3、CH4 ,….. 4.自燃性氣體: SiH4、SC2H6 ,….. 5.毒性氣體: PH3、Cl2、AsH3、B2H6、HCl、SiH4、Si2H6、NH3 ,…..
半导体全制程介绍
半导体全制程介绍 《晶圆处理制程介绍》 基本晶圆处理步骤通常是晶圆先经过适当的清洗 （Cleaning）之后，送到热炉管（Furnace）内，在含氧的 环境中，以加热氧化（Oxidation）的方式在晶圆的表面形 成一层厚约数百个的二氧化硅层，紧接着厚约1000到 2000的氮化硅层将以化学气相沈积Chemical Vapor Deposition；CVP）的方式沈积（Deposition）在刚刚长成的二氧化硅上，然后整个晶圆将进行微影（Lithography）的制程，先在晶圆上上一层光阻（Photoresist），再将光罩上的图案移转到光阻上面。接着利用蚀刻（Etching）技术，将部份未被光阻保护的氮化硅层加以除去，留下的就是所需要的线路图部份。接着以磷为离子源（Ion Source），对整片晶圆进行磷原子的植入（Ion Implantation），然后再把光阻剂去除（Photoresist Scrip）。制程进行至此，我们已将构成集成电路所需的晶体管及部份的字符线（Word Lines），依光罩所提供的设计图案，依次的在晶圆上建立完成，接着进行金属化制程（Metallization），制作金属导线，以便将各个晶体管与组件加以连接，而在每一道步骤加工完后都必须进行一些电性、或是物理特性量测，以检验加工结果是否在规格内（Inspection and Measurement）；如此重复步骤制作第一层、第二层的电路部份，以在硅晶圆上制造晶体管等其它电子组件；最后所加工完成的产品会被送到电性测试区作电性量测。 根据上述制程之需要，FAB厂内通常可分为四大区： 1）黄光本区的作用在于利用照相显微缩小的技术，定义出每一层次所需要的电路图，因为采用感光剂易曝光，得在黄色灯光照明区域内工作，所以叫做「黄光区」。
半导体工艺(精)
半导体的生产工艺流程 -------------------------------------------------------------------------------- 一、洁净室 一般的机械加工是不需要洁净室(clean room)的，因为加工分辨率在数十微米以上，远比日常环境的微尘颗粒为大。但进入半导体组件或微细加工的世界，空间单位都是以微米计算，因此微尘颗粒沾附在制作半导体组件的晶圆上，便有可能影响到其上精密导线布局的样式，造成电性短路或断路的严重后果。 为此，所有半导体制程设备，都必须安置在隔绝粉尘进入的密闭空间中，这就是洁净室的来由。洁净室的洁净等级，有一公认的标准，以class 10为例，意谓在单位立方英呎的洁净室空间内，平均只有粒径0.5微米以上的粉尘10粒。所以class后头数字越小，洁净度越佳，当然其造价也越昂贵。 为营造洁净室的环境，有专业的建造厂家，及其相关的技术与使用管理办法如下： 1、内部要保持大于一大气压的环境，以确保粉尘只出不进。所以需要大型鼓风机，将经滤网的空气源源不绝地打入洁净室中。 2、为保持温度与湿度的恒定，大型空调设备须搭配于前述之鼓风加压系统中。换言之，鼓风机加压多久，冷气空调也开多久。 3、所有气流方向均由上往下为主，尽量减少突兀之室内空间设计或机台摆放调配，使粉尘在洁净室内回旋停滞的机会与时间减至最低程度。 4、所有建材均以不易产生静电吸附的材质为主。 5、所有人事物进出，都必须经过空气吹浴(air shower) 的程序，将表面粉尘先行去除。 6、人体及衣物的毛屑是一项主要粉尘来源，为此务必严格要求进出使用人员穿戴无尘衣，除了眼睛部位外，均需与外界隔绝接触(在次微米制程技术的工厂内，工作人员几乎穿戴得像航天员一样。) 当然，化妆是在禁绝之内，铅笔等也禁止使用。 7、除了空气外，水的使用也只能限用去离子水(DI water, de-ionized water)。一则防止水中粉粒污染晶圆，二则防止水中重金属离子，如钾、钠离子污染金氧半(MOS) 晶体管结构之带电载子信道(carrier channel)，影响半导体组件的工作特性。去离子水以电阻率(resistivity) 来定义好坏，一般要求至17.5MΩ-cm以上才算合格；为此需动用多重离子交换树脂、RO逆渗透、与UV紫外线杀菌等重重关卡，才能放行使用。由于去离子水是最佳的溶剂与清洁剂，其在半导体工业之使用量极为惊人！ 8、洁净室所有用得到的气源，包括吹干晶圆及机台空压所需要的，都得使用氮气(98%)，吹干晶圆的氮气甚至要求99.8%以上的高纯氮！以上八点说明是最基本的要求，另还有污水处理、废气排放的环保问题，再再需要大笔大笔的建造与维护费用! 二、晶圆制作 硅晶圆(silicon wafer) 是一切集成电路芯片的制作母材。既然说到晶体，显然是经过纯炼与结晶的程序。目前晶体化的制程，大多是采「柴可拉斯基」(Czycrasky) 拉晶法(CZ 法)。拉晶时，将特定晶向(orientation) 的晶种(seed)，浸入过饱和的纯硅熔汤(Melt) 中，并同时旋转拉出，硅原子便依照晶种晶向，乖乖地一层层成长上去，而得出所谓的晶棒(ingot)。晶棒的阻值如果太低，代表其中导电杂质(impurity dopant) 太多，还需经过FZ悬浮区熔法法(floating-zone) 的再结晶(re-crystallization)，将杂质逐出，提高纯度与阻值。
《芯片制造-半导体工艺制程实用教程》学习笔记
《芯片制造－半导体工艺制程实用教程》 学习笔记 整理：Anndi 来源：电子胶水学习指南（https://www.360docs.net/doc/013229304.html,） 本人主要从事IC封装化学材料（电子胶水）工作，为更好的理解IC封装产业的动态和技术，自学了《芯片制造－半导体工艺制程实用教程》，貌似一本不错的教材，在此总结出一些个人的学习笔记和大家分享。此笔记原发在本人的“电子胶水学习指南”博客中，有兴趣的朋友可以前去查看一起探讨之！ 前言及序言（点击链接查看之）-----------------------------------1第1章半导体工业-----------------------------------------2—3第2章半导体材料和工艺化学品---------------------------4—5第3章晶圆制备-----------------------------------------------6第4章芯片制造概述---------------------------------------7—8第5章污染控制-------------------------------------------9—10第6章工艺良品率----------------------------------------11—12第7章氧化-----------------------------------------------13—14第8章基本光刻工艺流程—从表面准备到曝光------------15—17第9章基本光刻工艺流程—从曝光到最终检验------------18—20第10章高级光刻工艺-------------------------------------21—23第11章掺杂----------------------------------------------24—26第12章淀积----------------------------------------------27—29第13章金属淀积-----------------------------------------30—31第14章工艺和器件评估----------------------------------32—33第15章晶圆加工中的商务因素---------------------------34—35第16章半导体器件和集成电路的形成-------------------------36第17章集成电路的类型----------------------------------37—38第18章封装----------------------------------------------39—41 个人感慨----------------------------------------------------------41
半导体技术-半导体制程
半导体制程 一、洁净室 一般的机械加工是不需要洁净室(clean room)的，因为加工分辨率在数十微米以上，远比日常环境的微尘颗粒为大。但进入半导体组件或微细加工的世界，空间单位都是以微米计算，因此微尘颗粒沾附在制作半导体组件的晶圆上，便有可能影响到其上精密导线布局的样式，造成电性短路或断路的严重后果。 为此，所有半导体制程设备，都必须安置在隔绝粉尘进入的密闭空间中，这就是洁净室的来由。洁净室的洁净等级，有一公认的标准，以class 10为例，意谓在单位立方英呎的洁净室空间内，平均只有粒径0.5微米以上的粉尘10粒。所以class后头数字越小，洁净度越佳，当然其造价也越昂贵。 为营造洁净室的环境，有专业的建造厂家，及其相关的技术与使用管理办法如下： 1．内部要保持大于一大气压的环境，以确保粉尘只出不进。所以需要大型鼓风机，将经滤网的空气源源不绝地打入洁净室中。 2．为保持温度与湿度的恒定，大型空调设备须搭配于前述之鼓风加压系统中。换言之，鼓风机加压多久，冷气空调也开多久。 3．所有气流方向均由上往下为主，尽量减少突兀之室内空间设计或机台摆放调配，使粉尘在洁净室内回旋停滞的机会与时间减至最低程度。 4．所有建材均以不易产生静电吸附的材质为主。 5．所有人事物进出，都必须经过空气吹浴 (air shower) 的程序，将表面粉尘先行去除。 6．人体及衣物的毛屑是一项主要粉尘来源，为此务必严格要求进出使用人员穿戴无尘衣，除了眼睛部位外，均需与外界隔绝接触(在次微米制程技术的工厂内，工作人员几乎穿戴得像航天员一样。) 当然，化妆是在禁绝之内，铅笔等也禁止使用。 7．除了空气外，水的使用也只能限用去离子水 (DI water, de-ionized water)。一则防止水中粉粒污染晶圆，二则防止水中重金属离子，如钾、钠离子污染MOS晶体管的载子信道（channel），影响半导体组件的工作特性。去离子水以电阻率 (resistivity) 来定义好坏，一般要求至17.5M?-cm以上才算合格；为此需动用多重离子交换树脂、RO逆渗透、与UV紫外线杀菌等重重关卡，才能放行使用。由于去离子水是最佳的溶剂与清洁剂，其在半导体工业之使用量极为惊人！ 8．洁净室所有用得到的气源，包括吹干晶圆及机台空压所需要的，都得使用氮气 (98%)，吹干晶圆的氮气甚至要求99.8%以上的高纯氮！以上八点说明是最基本的要求，另还有污水处理、废气排放的环保问题，再再需要大笔大笔的建造与维护费用! 二、晶圆制作 硅晶圆 (silicon wafer) 是一切集成电路芯片的制作母材。既然说到晶体，显然是经过纯炼与结晶的程序。目前晶体化的制程，大多是采用「柴可拉斯基」(Czycrasky) 拉晶法 (CZ法)。拉晶时，将特定晶向 (orientation) 的晶种 (seed)，浸入过饱和的纯硅熔汤 (Melt) 中，并同时旋转拉出，硅原子便依照晶种晶向，乖乖地一层层成长上去，而得出所谓的晶棒 (ingot)。晶棒的阻值如果太低，代表其中导电杂质 (impurity dopant) 太多，还需经过FZ法 (floating-zone) 的再结晶 (re-crystallization)，将杂质逐出，提高纯度与阻值。辅拉出的晶棒，外缘像椰子树干般，外径不甚一致，需予以机械加工修边，然后以X光绕射法，定出主切面 (primary flat) 的所在，磨出该平面；再以内刃环锯，削下一片片的硅晶圆。最后经过粗磨 (lapping)、化学蚀平 (chemical etching) 与拋光 (polishing) 等程序，得出表面粗糙度在0.3微米以下拋光面之晶圆。(至于晶圆厚度，与其外径有关) 三、半导体制程设备 半导体制程概分为三类：(1)薄膜成长 (2)微影罩幕 (3)蚀刻成型。设备也跟着分为四类：(a)高温炉管 (b)微影机台 (c)化学清洗蚀刻台 (d)电浆真空腔室。其中(a)~(c)机台依序对应(1)~(3)制程，而新近发展的第(d)项机台，则分别应用于制程(1)与(3)。
LED芯片制程资料全
LED芯片制程 LED的发光原理 发光二极管是由Ⅲ-Ⅳ族化合物，如GaAs（砷化镓）、GaP（磷化镓）、GaAsP（磷砷化镓）等半导体制成的，其核心是PN结。因此它具有一般P-N结的I-N特性，即正向导通，反向截止、击穿特性。此外，在一定条件下，它还具有发光特性。在正向电压下，电子由N区注入P区，空穴由P区注入N区。进入对方区域的少数载流子（少子）一部分与多数载流子 （多子）复合而发光，如图1所示。 假设发光是在P区中发生的，那么注入的电子与价带空穴直接复合而发光，或者先被发光中心捕获后，再与空穴复合发光。除了这种发光复合外，还有些电子被非发光中心（这个中心介于导带、介带中间附近）捕获，而后再与空穴复合，每次释放的能量不大，不能形成可见光。发光的复合量相对于非发光复合量的比例越大，光量子效率越高。由于复合是在少子扩散区内发光的，所以光仅在靠近PN结面数μm以内产生。 理论和实践证明，光的峰值波长λ与发光区域的半导体材料禁带宽度Ｅg有关，即λ≈1240/Eg（mm） 式中Eg的单位为电子伏特（eV）。若能产生可见光（波长在380nm紫光～780nm红光），半导体材料的Eg应在3.26～1.63eV之间。比红光波长长的光为红外光。现在已有红外、红、黄、绿及蓝光发光二极管，但其中蓝光二极管成本、价格很高，使用不普遍。
2．芯片： ⑴芯片的结构：芯片的结构为五个部分，分别为正电极、负电极、P 层、N 层和PN 结，如下图： 单電極 P 电极 P 层 P/N 结合层 N 层 N 电极 双电极 ⑵芯片的生产工艺： （１）长晶（CRYSTAL GROWTH ）： 长晶是从硅沙中(二氧化硅)提炼成单晶硅，制造过 程是将硅石(Silica)或硅酸盐 (Silicate) 如同冶金一样，放入炉中熔解提炼，形成冶金级硅。冶金级硅中 尚含有杂质，接下来用分馏及还原的方法将其纯化，形成电子级硅。虽然电子级硅所含的電極 層 接合層 層 電極
半导体制程简史
半导体制程简史 当线宽远高于10 微米时，纯净度还不像今天的器件生产中那样至关 紧要。旦随着器件变得越来越集成，超净间也变得越来越干净。今天，工厂 内是加压过滤空气，来去除哪怕那些可能留在芯片上并形成缺陷的最小的粒子。 半导体制造车间里的工人被要求着超净服来保护器件不被人类污染。 在利润增长的推动下，在1960 年代半导体器件生产遍及得克萨斯州和 加州乃至全世界，比如爱尔兰、以色列、日本、台湾、韩国、新加坡和中国， 且在今天已是一个全球商业。 半导体生产商的领袖大都在全世界拥有生产车间。英特尔，世界最大的 生产商，以及在美其他顶级生产商包括三星(韩国)、德州仪器(美国)、AMD(超 微半导体)(美国)、东芝(日本)、NEC 电子(日本)、意法半导体(欧洲)、英飞凌 (欧洲)、瑞萨(日本)、台积电(台湾，参见TSMC 网站)、索尼(日本)，以及恩智 浦半导体(欧洲)在欧洲和亚洲都有自己的设备。 在2006 年，在美国有大约5000 家半导体和电子零件生产商，营业额达1650 亿美元(摘自Barnes 报告《2006 美国工业和市场展望》)。 以下为各半导体工艺节点出现时间和主要代表产品 ITRS : International Technology Roadmap for Semiconductors(国际半导体技术蓝图) ITRS 是由欧洲、日本、韩国、台湾、美国五个主要的芯片制造地区发起 的。发起组织分别是European Semiconductor IndustryAssociation(ESIA，欧洲半导体工业协会)，the Japan Electronics and InformationTechnology Industries
半导体工艺制程之挥发性有机废气净化技术_图文(精)
鄭石治，朱小蓉 / 華懋科技股份有限公司 蔡尤溪 / 台北科技大學冷凍空調工程系(台灣台北 有機溶劑被廣泛的應用於各工業製程中，隨著使用製程條件的不同，形成濃度不一的揮發性有機氣體(Volatile Organic Compounds，簡稱VOCs，隨著製程排氣排放於大氣中，造成自然生態環境的破壞及對人體的危害，世界各先進國家為防止生態環境的繼續惡化及保護人體的健康，先後對VOCs的排放定了排放標準，並且互相約定，逐年遞減降低其排放量，而達成總量管制的目標。 目前市面上提供之揮發性有氣體處理設備種類極多，但一般而言，其處理方法，均不出洗滌法、冷凝法、吸附法、焚化法、生物處理法…等(見表一所示。且由於處理廢氣多為混合之複雜氣體，為達經濟效益，常綜合兩種以上處理方法共同使用者。由於每種處理方法均有其適用的範圍及優、缺點，在設置前最好能先瞭解待處理廢氣之組成濃度、排放週期，欲達到的處理效益及可設置之地點、空間大小，再行選擇適當處理系統。 [表一：市面上常見的處理設備] 半導體工業製程廢氣處理規劃 一般而言，半導體及其相關產業之製程廢氣，大都具有大風量(風量＞10,000CMH 以上及低濃度(濃度＜500ppm as CH4的特性，但其中幾個製程所排放之廢氣濃度特別高，例如去光阻製程中，有些操作通常在60℃以上，不但造成排放的廢氣濃度特別高，去光阻劑中某些高沸點的化學品，例如二甲基亞砜(Dimethyl sulfoxide，單乙醇胺(Monoethynol amine；PGMEA等，均隨之溢散出，極易造成後續處理系統中的吸附劑快速失去活性。因此，在規劃廢氣處理系統時，最好能先釐清那些製程單元必需先以現場單點處理設備(point of use，簡稱POU處理者，採分流處理後，再併入主廢氣風管。由於廢氣的風量相當大，濃度又不高，直接以焚化的方法操作成本相當高。而廢氣的組成中又含有沸點高、低差異大的化學品，例如，IPA、Acetone、MEA、HMDS、DMSO、PGM…等 (見表二，造成處理的難度增加。IPA及Acetone的沸點極低，採洗滌法時，溶於水中之溶劑反而有被氣提出來的可能，並不適用。而HMDS亦有分解為二氧化矽而將吸附劑孔洞阻塞的可能。此外，其中某些化學品的閃點極低，操作的安全性亦是不可忽略的因素。因此，較為經濟有效的方法是先將廢氣的風量下降，及濃度提升以降低處理成本，再就濃縮後的廢氣選擇適當的處理方法，表三所示為可能的組合方式及特性分析。其它之組合方式例如以固定床、纖維碳床等為濃縮裝置均因工安問題 (因處理溶劑大都為含有氧的化合物，例如：IPA、Acetone…等，易造成碳床著火的困擾，或因再生需求頻繁，又無法線上再生，不但作業上不便，且不易符合目前環保法規的規定而較不適用。
半导体制程基本简介说明
(基本觀念) IC製程說明介紹 半導體的產品很多，應用的場合非常廣泛，圖一是常見的幾種半導體元件外型。半導體元件一般是以接腳形式或外型來劃分類別，圖一中不同類別的英文縮寫名稱原文為 PDID：Plastic Dual Inline Package SOP：Small Outline Package SOJ：Small Outline J-Lead Package PLCC：Plastic Leaded Chip Carrier QFP：Quad Flat Package PGA：Pin Grid Array BGA：Ball Grid Array (圖一) 不同外形半導體元件(圖二)EPROM內部晶片 (圖三)EPROM晶片接腳放大圖(圖四)LED 燈
(圖五)LED內部晶片放大圖(圖六)LED通電時因晶片發亮而發光 雖然半導體元件的外型種類很多，在電路板上常用的組裝方式有二種: 一種是插入電路板的銲孔或腳座，如PDIP、PGA 一種是貼附在電路板表面的銲墊上，如SOP、SOJ、PLCC、QFP、BGA 從半導體元件的外觀，只看到從包覆的膠體或陶瓷中伸出的接腳，而半導體元件真正的的核心，是包覆在膠體或陶瓷內一片非常小的晶片，透過伸出的接腳與外部做資訊傳輸。圖二是一片EPROM元件，從上方的玻璃窗可看到內部的晶片，圖三是以顯微鏡將內部的晶片放大，可以看到晶片以多條銲線連接四周的接腳，這些接腳向外延伸並穿出膠體，成為晶片與外界通訊的道路。請注意圖三中有一條銲線從中斷裂，那是使用不當引發過電流而燒毀，致使晶片失去功能，這也是一般晶片遭到損毀而失效的原因之一。 圖四是常見的LED，也就是發光二極體，其內部也是一顆晶片，圖五是以顯微鏡正視LED的頂端，可從透明的膠體中隱約的看到一片方型的晶片及一條金色的銲線，若以LED二支接腳的極性來做分別，晶片是貼附在負極的腳上，經由銲線連接正極的腳。當LED通過正向電流時，晶片會發光而使LED發亮，如圖六所示。 半導體元件的製作分成兩段的製造程序: 前一段是先製造元件的核心─晶片，稱為晶圓製造 後一段是將晶中片加以封裝成最後產品，稱為IC封裝製程，又可細分成晶圓切割、黏晶、銲線、封膠、印字、剪切成型等加工步驟，在本章節中將簡介這兩段 的製造程序。
(工艺流程)最简易的半导体制造工艺流程
半导体制造工艺流程 N型硅：掺入V族元素--磷P、砷As、锑Sb P型硅：掺入III族元素—镓Ga、硼B PN结： 半导体元件制造过程可分为 前段（FrontEnd）制程 晶圆处理制程（WaferFabrication；简称WaferFab）、 晶圆针测制程（WaferProbe）； 後段（BackEnd） 构装（Packaging）、 测试制程（InitialTestandFinalTest） 一、晶圆处理制程 晶圆处理制程之主要工作为在矽晶圆上制作电路与电子元件（如电晶体、电容体、逻辑闸等），为上述各制程中所需技术最复杂且资金投入最多的过程，以微处理器（Microprocessor）为例，其所需处理步骤可达数百道，而其所需加工机台先进且昂贵，动辄数千万一台，其所需制造环境为为一温度、湿度与含尘（Particle）均需控制的无尘室（Clean-Room），虽然详细的处理程序是随著产品种类与所使用的技术有关；不过其基本处理步骤通常是晶圆先经过适当的清洗（Cleaning）之後，接著进行氧化（Oxidation）及沈积，最後进行微影、蚀刻及离子植入等反覆步骤，以完成晶圆上电路的加工与制作。 二、晶圆针测制程 经过WaferFab之制程後，晶圆上即形成一格格的小格，我们称之为晶方或是晶粒（Die），在一般情形下，同一片晶圆上皆制作相同的晶片，但是也有可能在同一片晶圆上制作不同规格的产品；这些晶圆必须通过晶片允收测试，晶粒将会一一经过针测（Probe）仪器以测试其电气特性，而不合格的的晶粒将会被标上记号（InkDot），此程序即称之为晶圆针测制程（WaferProbe）。然後晶圆将依晶粒为单位分割成一粒粒独立的晶粒 三、IC构装制程 IC構裝製程（Packaging）：利用塑膠或陶瓷包裝晶粒與配線以成積體電路目的：是為了製造出所生產的電路的保護層，避免電路受到機械性刮傷或是高溫破壞。 半导体制造工艺分类 半导体制造工艺分类 一双极型IC的基本制造工艺： A在元器件间要做电隔离区（PN结隔离、全介质隔离及PN结介质混合隔离）ECL（不掺金）（非饱和型）、TTL/DTL（饱和型）、STTL（饱和型）B在元器件间自然隔离 I2L（饱和型） 半导体制造工艺分类 二MOSIC的基本制造工艺： 根据栅工艺分类 A铝栅工艺 B硅栅工艺
晶圆(Wafer) 制程工艺学习
晶圆（Wafer）制程工藝學習 晶圆（Wafer）的生产由砂即（二氧化硅）开始，经由电弧炉的提炼还原成冶炼级的硅，再经由盐酸氯化，产生三氯化硅，经蒸馏纯化后，透过慢速分解过程，制成棒状或粒状的「多晶硅」。一般晶圆制造厂，将多晶硅融解后，再利用硅晶种慢慢拉出单晶硅晶棒。一支85公分长，重76.6公斤的8吋硅晶棒，约需2天半时间长成。经研磨、拋光、切片后，即成半导体之原料晶圆片。 光学显影 光学显影是在光阻上经过曝光和显影的程序，把光罩上的图形转换到光阻下面的薄膜层或硅晶上。光学显影主要包含了光阻涂布、烘烤、光罩对准、曝光和显影等程序。小尺寸之显像分辨率，更在 IC 制程的进步上，扮演着最关键的角色。由于光学上的需要，此段制程之照明采用偏黄色的可见光。因此俗称此区为黄光区。 干式蚀刻技术 在半导体的制程中，蚀刻被用来将某种材质自晶圆表面上移除。干式蚀刻（又称为电浆蚀刻）是目前最常用的蚀刻方式，其以气体作为主要的蚀刻媒介，并藉由电浆能量来驱动反应。 电浆对蚀刻制程有物理性与化学性两方面的影响。首先，电浆会将蚀刻气体分子分解，产生能够快速蚀去材料的高活性分子。此外，电浆也会把这些化学成份离子化，使其带有电荷。 晶圆系置于带负电的阴极之上，因此当带正电荷的离子被阴极吸引并加速向阴极方向前进时，会以垂直角度撞击到晶圆表面。芯片制造商即是运用此特性来获得绝佳的垂直蚀刻，而后者也是干式蚀刻的重要角色。 基本上，随着所欲去除的材质与所使用的蚀刻化学物质之不同，蚀刻由下列两种模式单独或混会进行： 1. 电浆内部所产生的活性反应离子与自由基在撞击晶圆表面后，将与某特定成份之表面材质起化学反应而使之气化。如此即可将表面材质移出晶圆表面，并透过抽气动作将其排出。 2. 电浆离子可因加速而具有足够的动能来扯断薄膜的化学键，进而将晶圆表面材质分子一个个的打击或溅击（sputtering）出来。 化学气相沉积技术 化学气相沉积是制造微电子组件时，被用来沉积出某种薄膜(film)的技术，所沉积出的薄膜可能是介电材料(绝缘体)(dielectrics)、导体、或半导体。在进行化学气相沉积制程时，包含有被沉积材料之原子的气体，会被导入受到严密控制的制程反应室内。当这些原子在受热的昌圆表面上起化学反应时，会在晶圆表面产生一层固态薄膜。而此一化学反应通常必须使用单一或多种能量源(例如热能或无线电频率功率)。 CVD制程产生的薄膜厚度从低于0.5微米到数微米都有，不过最重要的是其厚度都必须足够均匀。较为常见的CVD薄膜包括有： ■二气化硅（通常直接称为氧化层） ■氮化硅