触发器试卷练习题
触发器单元测试试卷
班级： 姓名: 得分：
一、填空题：（20分）
1. 触发器有两个输出端_______和________，正常工作时两端的状态
互补，以_________端的状态表示触发器的状态。
2. 按结构形式的不同，RS 触发器可分为两大类：一类是没有时钟控
制的____________触发器,另一类是具有时钟控制端的__________触
发器。
3. 按逻辑功能划分，触发器可以分为________触发器、 ___________触发器、__________触发器和________触发器四种类型。
4. 钟控触发器也称同步触发器，其状态的变化不仅取决于
___________信号的变化，还取决于___________信号的作用。
5. 钟控触发器按结构和触发方式分，有电位触发器、_________触发
器、_________触发器和主从触发器四种类型。
6. 在CP 脉冲和输入信号作用下,JK 触发器能够具有______ 、
_________ 、____________ 和_____________ 的逻辑功能.
7. 在CP 脉冲和输入信号作用下,D 触发器能够具有______ 和
_____________ 的逻辑功能.
8. 边沿控制触发的触发器的触发方式为有( )、（ ）两种。
二、选择题：（20分）
1.能够存储 0、1 二进制信息的器件是 （ ）
A.TTL 门
B.CMOS 门
C.触发器
D.译码器
2.触发器是一种（ ）
Ａ．单稳态电路 Ｂ. 无稳态电路 Ｃ. 双稳态电路 Ｄ. 三稳态电路 3.用与非门构成的基本RS 触发器处于置 1 状态时，其输入信号
S 、R 应为（ ） A.00=S R Ｂ.01=S R C.10=S R D. 11=S R
4.用与非门构成的基本RS 触发器，当输入信号 S = 0、R = 1
时，其逻辑功能为( )
A.置1
B.置0
C.保持
D.不定
5.下列触发器中，输入信号直接控制输出状态的是 （ ）
A ．基本RS 触发器 B. 钟控RS 触发器
C. 主从JK 触发器
D. 维持阻塞D 触发器
6.具有直接复位端 d R 和置位端d S 的触发器，当触发器处于受
CP 脉冲控制的情况下工作时，这两端所加的信号为 ( )
A. 00d d =S R
B. 01d d =S R
C. 10d d =S R
D. 11d d =S R
7.输入信号高电平有效的 RS 触发器中，不允许的输入是（ ）
A.RS=00
B.RS=01
C.RS=10
D.RS=11
8.下列触发器中，具有置0、置1、保持、翻转功能的是( )
A. RS 触发器
B. D 触发器
C.JK 触发器
D. T 触发器
9.时钟触发器产生空翻现象的原因是因为采用了（ ）
A.主从触发方式
B.上升沿触发方式
C.下降沿触发方式
D.点位触发方式
10.当输入J = K = 1时，JK 触发器所具有的功能是( )
A.置0
B.置1
C.保持
D.翻转
三、判断题(20分)
1、1个触发器可以存放2个二进制数( )
2、D 触发器只有时钟脉冲上升沿有效的品种。（ ）
3、同步D 触发器的Q 端和D 端的状态在任何时刻都是相同的。( )
4、同一逻辑功能的触发器,其电路结构一定相同。( )
5、对边沿JK 触发器,在CP 为高电平期间,当J=K=1时,状态会翻转一次。( )
6、JK 触发器只要J,K 端同时为1,则一定引起状态翻转。( )
7、将D 触发器的Q 端与D 端连接就可构成T’触发器。( )
8、JK 触发器在CP 作用下,若J=K=1,其状态保持不变。( )
9、JK 触发器在CP 作用下,若J=K=1,其状态变反。 ( )
10、JK 触发器在CP 作用下,若J=K=0,其状态保持不变。 ( )
四、画图题：（40分）
1.如图，设Q初始状态为0，画出Q的波形(5分)
Q
2.如图，设Q初始状态为0，画出Q的波形（5分）
CP
Q
3.如图，设Q 初始状态为0，画出Q 的波形(10分)
Q
CP
A
B
Q
期末考试试卷_1_
职中东校区2014年下期高二电子技术试卷 姓名： 学号： 班级： 得分： 一、 填空题（每空2分，共82分） 1. 逻辑代数的三种基本逻辑运算是 、 和 ，在电路上，分别用 门、 门和 门来实现。 2. 逻辑变量和逻辑函数的取值只有 和 两种可能。 3. 逻辑函数的表示方法有 、 、 、 、 五种。 4. 101ABC =时，函数C B AB Y +=之值为Y = 。 5. 在二-十进制码中，1位十进制数用 位二进制码表示，8421BCD 码从高位到低位的权值依次为 。 6.（93）10=（ ）2，（93）10=（ ）8421BCD 7. 编码器的功能是将输入信号转化为 。 8．JK 触发器具有 、 、 和 的功能。 9. 对于时序逻辑电路来说，某一时刻电路的输出不仅取决于当时的 ，而且还取决于电路 。所以时序电路具有 功能。 10. 用来累计和寄存输入脉冲数目的部件称为 。 11. 寄存器可分成 寄存器和 寄存器。 12. 在计数器中，当计数脉冲输入时，所有触发器同时翻转，即各触发器状态的改变是同时进行的，这种计数器称为 。 13. 施密特触发器有 个稳态，单稳态触发器有 个稳态，
多谐振荡器有 个稳态。 14. 施密特触发器的主要用有 、 、 、 等。 15.将模拟信号转换为数字信号，需要经过 、 、 、 四个步骤。 二、 选择题（每空3分，共60分） 1. 下列几种逻辑门中，能用作反相器的是 。 A. 与门 B. 或门 C. 与非门 2. 以下各种接法不正确的是 。 A. 与非门闲置输入端接1 B. 或非门闲置输入端接地 C. TTL 与非门闲置输入端悬空 D. CMOS 门闲置输入端悬空 3. Y ABC AC BC =++，当1A C ==时， 。 A. Y B = B. B Y = C. 0=Y D. 1=Y 4. 3个逻辑变量的取值组合共有 种。 A. 3 B. 6 C. 8 D. 16 5. 下列逻辑函数属于与非式的是 。 A. Y AB = B. Y AB = C. Y ABC = D. Y ABC = 6. 与++AB AC BC 相等的式子是 。 A. +AB C B. +AB AC C. +AB BC D. +AB AB 7. 组合逻辑电路通常由 组成。 A. 门电路 B. 编码器 C. 译码器 D. 数据选择器 8.优先编码器同时有两个或两个以上信号输入时，是按 给输入
集成触发器及其应用电路设计
华中科技大学 电子线路设计、测试与实验》实验报告 实验名称：集成运算放大器的基本应用 院（系）：自动化学院 地点：南一楼东306 实验成绩： 指导教师：汪小燕 2014 年6 月7 日
、实验目的 1）了解触发器的逻辑功能及相互转换的方法。 2）掌握集成JK 触发器逻辑功能的测试方法。 3）学习用JK 触发器构成简单时序逻辑电路的方法。 4）熟悉用双踪示波器测量多个波形的方法。 （5）学习用Verliog HDL描述简单时序逻辑电路的方法，以及EDA技术 、实验元器件及条件 双JK 触发器CC4027 2 片； 四2 输入与非门CC4011 2 片； 三3 输入与非门CC4023 1 片； 计算机、MAX+PLUSII 10.2集成开发环境、可编程器件实验板及专用电缆 三、预习要求 （1）复习触发器的基本类型及其逻辑功能。 （2）掌握D触发器和JK触发器的真值表及JK触发器转化成D触发器、T触发器、T 触发器的基本方法。 （3）按硬件电路实验内容（4）（5），分别设计同步3 分频电路和同步模4 可逆计数器电路。 四、硬件电路实验内容 （1）验证JK触发器的逻辑功能。 （2）将JK触发器转换成T触发器和D触发器，并验证其功能。 （3）将两个JK触发器连接起来，即第二个JK触发器的J、K端连接在一起， 接到第一个JK触发器的输出端Q两个JK触发器的时钟端CP接在一起，并输入1kHz 正方波，用示波器分别观察和记录CP Q、Q的波形（注意它们之间的时序关系），理解2分频、4分频的概念。 （4）根据给定的器件，设计一个同步3分频电路，其输出波形如图所示。然后组装电路，并用示波器观察和记录CP Q、Q的波形。 （5）根据给定器件，设计一个可逆的同步模4 计数器，其框图如图所示。图中，M为控制变量，当M=0时，进行递增计数，当M=1时，进行递减计数；Q、 Q为计数器的状态输出，Z为进位或借位信号。然后组装电路，并测试电路的输入、输出
触发器和时序逻辑电路习题答案
第21章 触发器和时序逻辑电路 191、触发器按其工作状态是否稳定可分为( b )。 (a)RS 触发器，JK 触发器，D 触发器，T 触发器； (b)双稳态触发器，单稳态触发器，无稳态触发器； (c)主从型触发器，维持阻塞型触发器。 192、逻辑电路如图所示，当A=“1”时，基本RS 触发器( c )。 (a)置“1”； (b)置“0”； (c)保持原状态。 ≥1A ""1R D Q Q S D 193、 逻辑电路如图所示，分析C ，S ，R 的波形，当初始状态为“0”时，输出Q 是“0”的瞬间为( c )。 (a)1t ； (b)2t ； (c)3t 。 C S R t 1t 2t 3S C R D R S D Q Q 194、 某主从型JK 触发器，当J=K=“1”时，C 端的频率f=200Hz ，则Q 的频率为( c )。 (a)200Hz ； (b)400Hz ； (c)100Hz 。 195、逻辑电路如图所示，当A=“1”时，C 脉冲来到后JK 触发器( a )。 (a)具有计数功能； (b)置“0”； (c)置“1”。 ≥1 A J C R D K S D Q Q "" 1""1 196、 逻辑电路如图所示，A=“0”时，C 脉冲来到后D 触发器( b )。 (a)具有计数器功能； (b)置“0”； (c)置“1”。
D C Q Q & A 197、逻辑电路如图所示，分析C 的波形，当初始状态为“0”时，输出Q 是“0”的瞬间为( a )。 (a) 1t ； (b)2t ； (c)3t 。 D C Q Q C t 1t 2t 3 198、逻辑电路如图所示，它具有( a )。 (a)D 触发器功能； (b)T 触发器功能； (c)T'触发器功能。 J C R D K S D Q Q 1 199、逻辑电路如图所示，它具有( b )。 (a)D 触发器功能； (b)T 触发器功能； (c)T'触发器功能。 J C R D K S D Q Q 200、时序逻辑电路与组合逻辑电路的主要区别是( c )。 (a)时序电路只能计数，而组合电路只能寄存； (b)时序电路没有记忆功能，组合电路则有； (c)时序电路具有记忆功能，组合电路则没有。 201、寄存器与计数器的主要区别是( b )。 (a)寄存器具有记忆功能，而计数器没有； (b)寄存器只能存数，不能计数，计数器不仅能连续计数，也能存数； (c)寄存器只能存数，计数器只能计数，不能存数。 202、移位寄存器与数码寄存器的区别是( a )。 (a)前者具有移位功能，后者则没有； (b)前者不具有移位功能，后者则有； (c)两者都具有移位功能和计数功能。
-第九章作业参考答案
第九章作业 专业 学号 姓名 等级 第九章 脉冲波形的产生与变换 9.1 图题9.1是用两个555定时器接成的延时报警器。当开关S 断开后，经过一定的延迟时间后，扬声器开始发声。如果在延迟时间内开关S 重新闭合，扬声器不会发出声音。在图中给定参数下，试求延迟时间的具体数值和扬声器发出声音的频率。图中G 1是CMOS 反相器，输出的高、低电平分别为V OH =12V ，V OL ≈0V 。 图题9.1 解：1.工作原理： 图题9.1由两级555电路构成，第一级是施密特触发器，第二级是多谐振荡器。施密特触发器的输入由R 1、C 1充放电回路和开关S 控制。 当S 闭合时，V C =0V ，施密特触发器输出高电平。施密特触发器的输出经反相器去控制多谐振荡器的R D 端，当施密特触发器的输出为高电平时，R D =0，多谐振荡器复位，扬声器不会发出声音。 当开关S 断开后，R 1、C 1充放电回路开始充电，V C 随之上升，但在达到CC T 3 2 V V =+之前， 施密特触发器的输出仍为高电平时，R D =0，扬声器仍不会发出声音。这一段时间即为延迟时间。 一旦V C 达到CC T 32 V V =+，施密特触发器触发翻转，输出低电平，R D =1，多谐振荡器工作，扬 声器开始发声报警。 2.求延迟时间： 延迟时间由R 1、C 1充放电回路的充电过程决定： τ t e v v v v -+∞-+∞=)]()0([)(C C C C 将 V 12)(CC C ==∞V v )0(C +v =0V τ=R 1C 1代入上式，得： )1(1 1CC C C R t e V v --= t=t 1时，CC C 3 2 V v =代入上式，整理得延迟时间： t 1= R 1C 1ln3≈1.1 R 1C 1=1.1×106+10×10-6=11S 扬声器发声频率：MHz 95.01 1≈== f
数电实验触发器及其应用
数电实验触发器及其应用 数字电子技术实验报告 实验三: 触发器及其应用 一、实验目的: 1、熟悉基本RS触发器，D触发器的功能测试。 2、了解触发器的两种触发方式（脉冲电平触发和脉冲边沿触发）及触发特点 3、熟悉触发器的实际应用。 二、实验设备: 1 、数字电路实验箱; 2、数字双综示波器; 3、指示灯; 4、74LS00、74LS74。 三、实验原理: 1、触发器是一个具有记忆功能的二进制信息存储器件，是构成多种时序 电路的最基本逻辑单元，也是数字逻辑电路中一种重要的单元电路。在数字系统和计算机中有着广泛的应用。触发器具有两个稳定状态，即“0”和“ 1 ”，在一定的外界信号作用下，可以从一个稳定状态翻转到另一个稳定状态。触发器有集成触发器和门电路（主要是“与非门” ）组成的触发器。 按其功能可分为有RS触发器、JK触发器、D触发器、T功能等触发器。触发方式有电平触发和边沿触发两种。 2、基本RS触发器是最基本的触发器，可由两个与非门交叉耦合构成。 基本RS触发器具有置“ 0”、置“ 1”和“保持”三种功能。基本RS触发器
也可以用二个“或非门”组成，此时为高电平触发有效。 3、D触发器在CP的前沿发生翻转，触发器的次态取决于CP脉冲上升沿n+1来到之前D端的状态，即Q = D。因此，它具有置“ 0”和“T两种功能。由于在CP=1期间电路具有阻塞作用，在CP=1期间，D端数据结构变RS化，不会影响触发器的输出状态。和分别是置“ 0”端和置“ 1” DD 端，不需要强迫置“ 0”和置“ 1”时，都应是高电平。74LS74(CC4013, 74LS74(CC4042均为上升沿触发器。以下为74LS74的引脚图和逻辑图。 馬LD 1CP 1云IQ LQ GM) 四、实验原理图和实验结果： 设计实验： 1、一个水塔液位显示控制示意图，虚线表示水位。传感器A、B被水浸沿时
第5章触发器题(含答案)
第五章触发器 5.1 画出如题图5.1所示的基本RS触发器输出端、 Q Q的电压波形图。S和R的电压波形如图5.1(b)所示。 题图5.1 解：波形如图： 5.2 或门组成的基本RS触发器电路如题图5.2(a)所示，已知S和R的波形如题图5.2(b)所示。试画出、 Q Q的波形图。设触发器的初态Q=0。 题图5.2 解：波形如图：
5.3 题图5.3所示为一个防抖动输出开关电路。当拨动开关K时，由于开关接通瞬间发生振颤，R 和S的波形如图中所示，请画出和 Q Q端的对应波形。 题图5.3 解：波形如图： 5.4有一时钟RS触发器如题图5.4所示，试画出它的输出端的波形。初态 Q Q=0。 题图5.4 解：波形如图：
5.5 设具有异步端的主从JK 触发器的初始状态Q = 0，输入波形如题图5.5所示，试画出输出端Q 的 波形。 题图5.5 解：波形如图： 5.6 设题图5.6的初始状态为2Q 1Q 0Q = 000，在脉冲CLK 作用下，画出、、的波形（所用 器件都是CD4013）。S 0Q 1Q 2Q D 、R D 分别是CD4013高电平有效的异步置1端，置0端。 题图5.6 解：波形如图：
5.7 设题图5.7电路两触发器初态均为0，试画出、波形图。 1Q 2Q 题图5.7 解：波形如图： 5.8 已知CMOS 边沿触发结构JK 触发器CD4207各输入端的波形如题图5.8所示，试画出、Q Q 端 的对应波形，设初态Q = 0。S D 为高电平置1端，R D 为高电平置0端，电路为CLK 上升沿触发。 题图5.8 解：波形如图：
触发器作业
银行的取款机系统 问题： 1、解决银行取款问题：当向交易信息表(transInfo)中插入一条交易信息时，我们应自动更新对应帐户的余额。create trigger trig_transInfo on transInfo For Insert AS declare@type char(4),@outMoney MONEY declare@myCardID char(10),@balance MONEY select@type=transType,@outMoney= transMoney,@myCardID=cardID from inserted If(@type='支取') update bank set CurrentMoney=CurrentMoney -@outMoney where cardID=@myCardID else update bank set
currentMoney=currentMoney+@outMoney where card=@mycardID go 2、当删除交易信息表时，要求自动备份被删除的数据到表backupTable中。 create trigger trig_delete_transInfo on transInfo for delete AS print'开始备份数据，请稍后···' if not exists(select*from sysobjects where name='backupTable') select*INTO bactkupTable from deleted else insert INTO backupTable select*from deleted print'备份数据成功，备份表中的数据为：' select*from backupTable go
触发器及其应用实验报告 - 图文-
实验报告 一、实验目的和任务 1. 掌握基本RS、JK、T和D触发器的逻辑功能。 2. 掌握集成触发器的功能和使用方法。 3. 熟悉触发器之间相互转换的方法。 二、实验原理介绍 触发器是能够存储1位二进制码的逻辑电路,它有两个互补输出端,其输出状态不仅与输入有关,而且还与原先的输出状态有关。触发器有两个稳定状态,用以表示逻辑状态"1"和"0飞在二定的外界信号作用下,可以从一个稳定状态翻转到另一个稳定状态,它是一个具有记忆功能的二进制信息存储器件,是构成各种时序电路的最基本逻辑单元。 1、基本RS触发器 图14-1为由两个与非门交叉祸合构成的基本RS触发器,它是无时钟控制低电平直接触发的触发器。 基本RS触发器具有置"0"、置"1"和保持三种功能。通常称s为置"1"端,因为 s=0时触发器被置"1"; R为置"0"端,因为R=0时触发器被置"0"。当S=R=1时状态保持,当S=R=0时为不定状态,应当避免这种状态。
基本RS触发器也可以用两个"或非门"组成,此时为高电平有效。 S Q S Q Q 卫R Q (a(b 图14-1 二与非门组成的基本RS触发器 (a逻辑图(b逻辑符号 基本RS触发器的逻辑符号见图14-1(b,二输入端的边框外侧都画有小圆圈,这是因为置1与置。都是低电平有效。 2、JK触发器 在输入信号为双端的情况下,JK触发器是功能完善、使用灵活和通用性较强的一种触发器。本实验采用74LS112双JK触发器,是下降边沿触发的边沿触发器。引脚逻辑图如图14-2所示;JK触发器的状态方程为: Q,,+1=J Q"+K Q 3 5
J Q CLK K B Q 图14-2JK触发器的引脚逻辑图 其中,J和IK是数据输入端,是触发器状态更新的依据,若J、K有两个或两个以上输入端时,组成"与"的关系。Q和Q为两个互补输入端。通常把Q=O、Q=1的状态定为触发器"0"状态;而把Q=l,Q=0 定为"}"状态。 JK触发器常被用作缓冲存储器,移位寄存器和计数器。 CC4027是CMOS双JK触发器,其功能与74LS112相同,但采用上升沿触发,R、S端为高电平
触发器试卷练习题
触发器单元测试试卷 班级： 姓名: 得分： 一、填空题：（20分） 1. 触发器有两个输出端_______和________，正常工作时两端的状态 互补，以_________端的状态表示触发器的状态。 2. 按结构形式的不同，RS 触发器可分为两大类：一类是没有时钟控 制的____________触发器,另一类是具有时钟控制端的__________触 发器。 3. 按逻辑功能划分，触发器可以分为________触发器、 ___________触发器、__________触发器和________触发器四种类型。 4. 钟控触发器也称同步触发器，其状态的变化不仅取决于 ___________信号的变化，还取决于___________信号的作用。 5. 钟控触发器按结构和触发方式分，有电位触发器、_________触发 器、_________触发器和主从触发器四种类型。 6. 在CP 脉冲和输入信号作用下,JK 触发器能够具有______ 、 _________ 、____________ 和_____________ 的逻辑功能. 7. 在CP 脉冲和输入信号作用下,D 触发器能够具有______ 和 _____________ 的逻辑功能. 8. 边沿控制触发的触发器的触发方式为有( )、（ ）两种。 二、选择题：（20分） 1.能够存储 0、1 二进制信息的器件是 （ ） A.TTL 门 B.CMOS 门 C.触发器 D.译码器 2.触发器是一种（ ） Ａ．单稳态电路 Ｂ. 无稳态电路 Ｃ. 双稳态电路 Ｄ. 三稳态电路 3.用与非门构成的基本RS 触发器处于置 1 状态时，其输入信号 S 、R 应为（ ） A.00=S R Ｂ.01=S R C.10=S R D. 11=S R 4.用与非门构成的基本RS 触发器，当输入信号 S = 0、R = 1 时，其逻辑功能为( ) A.置1 B.置0 C.保持 D.不定 5.下列触发器中，输入信号直接控制输出状态的是 （ ） A ．基本RS 触发器 B. 钟控RS 触发器 C. 主从JK 触发器 D. 维持阻塞D 触发器
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触发器时序逻辑电路 习题答案
第4章 触发器 4.3 若在图4.5电路中的CP 、S 、R 输入端，加入如图4.27所示波形的信号，试画出其 Q 和Q 端波形，设初态Q =0。 S R CP 图4.27 题4.3图 解：图4.5电路为同步RS 触发器，分析作图如下： S R Q 4.5 设图4.28中各触发器的初始状态皆为Q =0，画出在CP 脉冲连续作用下个各触发器输出端的波形图。 Q 1 1CP Q 3 CP CP Q 2Q 6 Q 4 Q 5 CP
图4.28 题4.5图 解： Q Q n n 11 1 =+ Q Q n n 212=+ Q Q n n 313=+ Q Q n n 414=+ Q Q n n 515=+ Q Q n n 616=+ Q 1CP Q 2Q 3Q 4Q 5Q 6 4.6 试写出 图4.29(a)中各触发器的次态函数（即Q 1 n+1 、 Q 2 n+1与现态和输入变量之间的函数式），并画出在图4.29（b ）给定信号的作用下Q 1 、Q 2的波形。假定各触发器的初始状态均为Q =0。 1 A B CP ＞1D C1 =1 A B Q 1 Q 2 Q 2 (a) B A (b) 图4.29 题4.6图 解：由图可见： Q B A AB Q n n 111)(++=+ B A Q n ⊕=+1 2
B A Q 2 Q 1 4.7 图4.30（a ）、（b ）分别示出了触发器和逻辑门构成的脉冲分频电路，CP 脉冲如图4.30（c ）所示，设各触发器的初始状态均为0。 （1）试画出图（a ）中的Q 1、Q 2和F 的波形。 （2）试画出图（b ）中的Q 3、Q 4和Y 的波形。 Y （b ） （c ） CP Q 1 Q 2 （a ） 图4.30 题4.7图 解： （ a ） Q Q n n 211 =+ Q Q n n 1 12=+ Q F 1CP ⊕= R 2 = Q 1 低电平有效 CP Q 1Q 2F （b ） Q Q Q n n n 431 3 =+ Q Q Q n n n 4314=+ Q Q Y n n 43= CP 3= CP 上降沿触发 CP 4= CP 下降沿触发
数字电子技术练习题及答案
数字电子技术练习题及答案 一、填空题 1、(238)10＝( )2 ＝( EE )16。(110110.01)2＝( 36.4 )16＝( 54.25 )10。 2、德?摩根定理表示为 B A +＝( B A ? ) , B A ?＝( B A + )。 3、数字信号只有（ 两 ）种取值，分别表示为（ 0 ）和（ 1 ）。 4、异或门电路的表达式是( B A B A B A +=⊕ )；同或门的表达式是( B A AB B A ?+=⊙ ) 。 5、组成逻辑函数的基本单元是（ 最小项 ）。 6、与最小项C AB 相邻的最小项有( C B A )、( C B A ? ) 和 ( ABC ) 。 7、基本逻辑门有（ 与门 ）、（ 或门 ）和（ 非门 ）三种。复合门有（ 与非门 ）、（ 或非门 ）、（ 与或非门 ）和（ 异或门 ）等。 8、 9、 10、最简与或式的定义是乘积项的（ 个数最少 ），每个乘积项中相乘的（ 变量个数也最少）的与或表达式。 11、在正逻辑的约定下，“1”表示（ 高电平 ），“0”表示（ 低电平 ）。在负逻辑的约定下，“1”表示（ 低电平 ），“0”表示（ 高电平 ）。 12、一般TTL 门电路输出端( 不能 )直接相连，实现线与。(填写“能”或“不能”) 13、三态门的三种可能的输出状态是( 高电平 )、( 低电平 )和( 高阻态 )。 14、实现基本和常用逻辑运算的(电子电路)，称为逻辑门电路，简称门电路。 15、在TTL 三态门、OC 门、与非门、异或门和或非门电路中，能实现“线与”逻辑功能的门为（OC 门），能实现总线连接方式的的门为（三态门）。 16、T TL 与非门的多余输入端不能接（ 低 ）电平。 17、 18、真值表是将输入逻辑变量的（ 所有可能取值 ）与相应的（ 输出变量函数值 ）排列在一起而组成的表格。 19、组合逻辑电路是指任何时刻电路的稳定输出，仅仅只决定于（该时刻各个输入变量的取值）。 20、用文字、符号或者数码表示特定对象的过程叫做（ 编码 ）。把代码的特定含义翻译出来的过程叫（ 译码 ）。 在几个信号同时输入时，只对优先级别最高的进行编码叫做（ 优先编码 ）。 21、两个1位二进制数相加，叫做（半加器）。两个同位的加数和来自低位的进位三者相加，叫做（全加器）。 22、比较两个多位二进制数大小是否相等的逻辑电路，称为(数值比较器)。 23、半导体数码显示器的内部接法有两种形式：共(阳)极接法和共(阴)极接法。对于共阳接法的发光二极管数码显示器，应采用(低)电平驱动的七段显示译码器。 24、能够将（ 1个 ）输入数据，根据需要传送到（ m 个 ）输出端的任意一个输出端的电路，叫做数据分配器。 25、在多路传输过程中，能够根据需要将（ 其中任意一路挑选出来 ）的电路，叫做数据选择器，也称为多路选择器或多路开关。 26、触发器又称为双稳态电路，因为它具有（ 两个 ）稳定的状态。 27、根据逻辑功能不同，触发器可分为（ RS 触发器 ）、（ D 触发器 ）、（ JK 触发器 ）、（ T 触发器 ）和（ T ’触发器 ）等。根据逻辑结构不同，触发器可分为（ 基本触发器 ）、（ 同步触发器 ）和（ 边沿触发器 ）等。 28、JK 触发器在JK ＝00时，具有（ 保持 ）功能，JK ＝11时；具有（ 翻转 ）功能；JK ＝01时，具有（ 置0 ）功能；JK ＝10时，具有（ 置1 ）功能。 29、JK 触发器具有（ 保持 ）、（ 置0 ）、（ 置1 ）和（ 翻转 ）的逻辑功能。D 触发器具有（ 置0 ）和（ 置1 ）的逻辑功能。RS 触发器具有（ 保持 ）、（ 置0 ）和（ 置1 ）的逻辑功能。 T 触发器具有（ 保持 ）和（ 翻转 ）的逻辑功能。T ’触发器具有（ 翻转 ）的逻辑功能。 30、边沿触发器具有共同的动作特点，即触发器的次态仅取决于CP 信号（ 上升沿或下降沿 ）到来时刻输入的逻辑状态，而在这时刻之前或之后，输入信号的变化对触发器输出的状态没有影响。 31、基本RS 触发器的特性方程是（ n n Q R S Q +=+1 ）；其约束条件是（ 0=RS ）。JK 触发器的特性方程是（ n n n Q K Q J Q +=+1 ）；D 触发器的特性方程是（ D Q n =+1 ）；T 触发器的特性方程是（ n n n Q T Q T Q +=+1 ）； T ’触发器的特性方程是（ n n Q Q =+1 ）。
数字电子技术试卷试题答案汇总(完整版)
数字电子技术基础 试题库及答案汇总 一、 填空题（每空1分，共20分） 1、逻辑代数中3种基本运算是 ， ， 。 2、逻辑代数中三个基本运算规则 ， ， 。 3、逻辑函数的化简有 ， 两种方法。 4、A+B+C= 。 5、TTL 与非门的u I ≤U OFF 时，与非门 ，输出 ，u I ≥U ON 时，与非门 ，输出 。 6、组合逻辑电路没有 功能。 7、竞争冒险的判断方法 ， 。 8、触发器它有 稳态。主从RS 触发器的特性方程 ， 主从JK 触发器的特性方程 ，D 触发器的特性方程 。 二、 选择题（每题1分，共10分） 1、相同为“0”不同为“1”它的逻辑关系是 （ ） A 、或逻辑 B 、与逻辑 C 、异或逻辑 2、Y （A ，B ，C ，）=∑m （0，1，2，3）逻辑函数的化简式 （ ） A 、Y=AB+BC+ABC B 、Y=A+B C 、Y=A 3、 A 、Y=A B B 、Y 处于悬浮状态 C 、Y=B A + 4、下列图中的逻辑关系正确的是 （ ） A.Y=B A + B.Y=B A + C.Y=AB 5、下列说法正确的是 （ ） A 、主从JK 触发器没有空翻现象 B 、JK 之间有约束 C 、主从JK 触发器的特性方程是CP 上升沿有效。 6、下列说法正确的是 （ ） A 、同步触发器没有空翻现象 B 、同步触发器能用于组成计数器、移位寄存器。 C 、同步触发器不能用于组成计数器、移位寄存器。 7、下列说法是正确的是 （ ） A 、异步计数器的计数脉冲只加到部分触发器上 B 、异步计数器的计数脉冲同
时加到所有触发器上 C、异步计数器不需要计数脉冲的控制8、下列说法是正确的是（） A、施密特触发器的回差电压ΔU=U T+-U T- B、施密特触发器的回差电压越大，电 路的抗干扰能力越弱 C、施密特触发器的回差电压越小，电路的抗干扰能力越强 9、下列说法正确的是（） A、多谐振荡器有两个稳态 B、多谐振荡器有一个稳态和一个暂稳态 C、多谐振荡器有两个暂稳态 10、下列说法正确的是（） A、555定时器在工作时清零端应接高电平 B、555定时器在工作时清零端应接低电平 C、555定时器没有清零端 三、判断题（每题1分，共10分） 1、A+AB=A+B （） 2、当输入9个信号时，需要3位的二进制代码输出。（） 3、单稳态触发器它有一个稳态和一个暂稳态。（） 4、施密特触发器有两个稳态。（） 5、多谐振荡器有两个稳态。（） 6、D/A转换器是将模拟量转换成数字量。（） 7、A/D转换器是将数字量转换成模拟量。（） 8、主从JK触发器在CP=1期间，存在一次性变化。（） 9、主从RS触发器在CP=1期间，R、S之间不存在约束。（） 10、所有的触发器都存在空翻现象。（） 四、化简逻辑函数（每题5分，共10分） 1、 2、Y（A，B，C，）=∑m（0，1，2，3，4，6，8，9，10，11，14） 五、画波形图（每题5分，共10分） 1、 2、 六、设计题（每题10分，共20分）
第四章 集成触发器
第四章集成触发器 [题4.1] 选择题 1.N个触发器可以构成能寄存位二进制数码的寄存器。 A.N-1 B.N C.N+1 D.2N 2．在下列触发器中，有约束条件的是。 A.主从J K 触发器 B.主从D触发器 C.同步R S 触发器 D.边沿D触发器 3．一个触发器可记录一位二进制代码，它有个稳态。 A.0 B.1 C.2 D.3 4．存储8位二进制信息要个触发器。 A.2 B.3 C.4 D.8 5．下列触发器中，没有约束条件的是。 A.基本R S触发器 B.主从R S触发器 C.同步R S触发器 D.边沿D触发器 6．描述触发器的逻辑功能的方法有。 A.状态转换真值表 B.特性方程 C.状态转换图 D.状态转换卡诺图 7．对于D触发器，欲使Q n+1=Q n，应使输入D= 。 A.0 B.1 C.Q D.Q 8．对于JK触发器，若J=K，则可完成触发器的逻辑功能。 A.RS B.D C.T D.Tˊ 9．欲使J K触发器按Q n+1=Q n工作，可使J K触发器的输入 端。 A.J=K=0 B.J=Q,K=Q C.J=Q,K=Q D.J=Q,K=0 10．欲使J K触发器按Q n+1=Q n工作，可使J K触发器的输入 端。 A.J=K=1 B.J=Q,K=Q C.J=Q,K=Q D.J=Q,K=1 11．欲使D触发器按Q n+1=Q n工作，应使输入D= 。 A.0 B.1 C.Q D.Q
12．下列触发器中，克服了空翻现象的有。 A.边沿D触发器 B.主从R S触发器 C.同步R S触发器 D.主从J K触发器 13．对于T触发器，若原态Q n=0，欲使新态Q n+1=1，应使输入T= 。 A.0 B.1 C.Q 14．对于T触发器，若原态Q n=1，欲使新态Q n+1=1，应使输入T= 。 A.0 B.1 C.Q 15．欲使JK触发器按Q n+1=0工作，可使JK触发器的输入端。 A.J=K=1 B.J=0,K=0 C.J=1,K=0 D.J=0,K=1 16．欲使JK触发器按Q n+1=1工作，可使JK触发器的输入端。 A.J=K=1 B.J=1,K=0 C.J=K=0 D.J=0 ,K=1 17．描述触发器的逻辑功能的方法有。 A.状态转换真值表 B.特性方程 C.状态转换图 D.状态转换卡诺图 18．为实现将JK触发器转换为D触发器，应使。 A.J=D,K=1 B. K=D,J=1 C.J=K=D D.J=K=1 19.边沿式D触发器是一种稳态电路。 A.无 B.单 C.双 D.多 [题4.2] 判断题（正确打√，错误的打×） 1. D触发器的特性方程为Q n+1=D，与Q n无关，所以它没有记忆功能。 （）2.RS触发器的约束条件R S=0表示不允许出现R=S=1的输入。 （）3.同步触发器存在空翻现象，而边沿触发器和主从触发器克服了空翻。（） 4.主从J K触发器、边沿J K触发器和同步J K触发器的逻辑功能完全相同。（） 5.对边沿J K触发器，在C P为高电平期间，当J=K=1时，状态会翻转一次。（） [题4.3] 填空题
电工资格证考试触发器及其应用练习题集锦附参考答案解析(精品)
触发器及其应用 习题参考答案 一、填空题： 1．时序逻辑电路的特点是：输出不仅取决于当时 输入 的状态 还与电路 原来 的状态有关。 2．欲使JK 触发器实现的功能，则输入端J 应接 “1” ， K 应接 “1” 。 3．组合逻辑电路的基本单元是 门电路 ，时序逻辑电路的基本 单元是 触发器 。 4．两个与非门构成的基本RS 触发器的功能有 置0 、 置1 和 保持 。电路中不允许两个输入端同时为 0 ，否则将出现逻辑混乱。 5．钟控RS 触发器具有“空翻”现象，且属于 电平 触发方式 的触发器；为抑制“空翻”，人们研制出了 边沿 触发方式的JK 触发器和D 触发器。 6．JK 触发器具有 保持 、 翻转 、 置0 和 置1 的功能。 7．D 触发器具有 置0 和 置1 的功能。 二、选择题： 1．描述时序逻辑电路功能的两个重要方程式是（ B ）。 A 、 状态方程和输出方程 B 、状态方程和驱动方程 C 、 驱动方程和特性方程 D 、驱动方程和输出方程 2．由与非门组成的RS 触发器不允许输入的变量组合为 （ D ）。 A 、00 B 、 01 C 、 10 D 、 11 3. 双稳态触发器的类型有（ D ） A 、基本RS 触发器； B 、同步RS 触发器； C 、主从式触发 器； D 、前三种都有。 4. 存在空翻问题的触发器是（ B ） A 、D 触发器； B 、同步RS 触发器； C 、主从JK 触发 器。 三、简述题 1、时序逻辑电路和组合逻辑电路的区别有哪些？ 答：主要区别有两点：时序逻辑电路的基本单元是触发器，组 合逻辑电路的基本单元是门电路；时序逻辑电路的输出只与现时输入有关，不具有记忆性，组合逻辑电路的输出不仅和现时输入有关，还和现时状态有关，即具有记忆性。 2、何谓“空翻”现象？抑制“空翻”可采取什么措施？ n n Q Q =+1R S ?
第四章逻辑门电路作业题(参考答案)
第四章逻辑门电路 （Logic Gates Circuits） 1．知识要点 CMOS逻辑电平和噪声容限；CMOS逻辑反相器、与非门、或非门、非反相门、与或非门电路的结构； CMOS逻辑电路的稳态电气特性：带电阻性负载的电路特性、非理想输入时的电路特性、负载效应、不用的输入端及等效的输入/输出电路模型； 动态电气特性：转换时间、传输延迟、电流尖峰、扇出特性； 特殊的输入/输出电路结构：CMOS传输门、三态输出结构、施密特触发器输入结构、漏极开路输出结构。 重点： 1．CMOS逻辑门电路的结构特点及与逻辑表达式的对应关系； 2．CMOS逻辑电平的定义和噪声容限的计算； 3．逻辑门电路扇出的定义及计算； 4．逻辑门电路转换时间、传输延迟的定义。 难点： 1．CMOS互补网络结构的分析和设计； 2．逻辑门电路对负载的驱动能力的计算。 （1）PMOS和NMOS场效应管的开关特性 MOSFET管实际上由4部分组成：Gate，Source，Drain和Backgate，Source和Drain之间由Backgate连接，当Gate对Backgate的电压超过某个值时，Source和Drain之间的电介质就会形成一个通道，使得两者之间产生电流，从而导通管子，这个电压值称为阈值电压。对PMOS管而言，阈值电压是负值，而对NMOS管而言，阈值电压是正值。也就是说，在逻辑电路中，NMOS管和PMOS管均可看做受控开关，对于高电平1，NMOS导通，PMOS截断；对于低电平0，NMOS截断，PMOS导通。 （2）CMOS门电路的构成规律 每个CMOS门电路都由NMOS电路和PMOS电路两部分组成，并且每个输入都同时加到一个NMOS管和一个PMOS管的栅极（Gate）上。 对正逻辑约定而言，NMOS管的串联（Series Connection）可实现与操作（Implement AND Operation），并联（Parallel Connection）可实现或操作（Implement OR Operation）。 PMOS电路与NMOS电路呈对偶关系，即当NMOS管串联时，其相应的PMOS管一定是并联的；而当NMOS管并联时，其相应的PMOS管一定需要串联。 基本逻辑关系体现在NMOS管的网络上，由于NMOS网络接地，输出需要反相（取非）。 （3）CMOS逻辑电路的稳态电气特性 一般来说，器件参数表中用以下参数来说明器件的逻辑电平定义： V OHmin输出为高电平时的最小输出电压 V IHmin能保证被识别为高电平时的最小输入电压 V OLmax能保证被识别为低电平时的最大输入电压 V ILmax输出为低电平时的最大输出电压 不同逻辑种类对应的参数值不同。输入电压主要由晶体管的开关门限电压决定，而输出电压主要由晶体管的“导通”电阻决定。 噪声容限是指芯片在最坏输出电压情况下，多大的噪声电平会使得输出电压被破坏成不可识别的输入值。对于输出是高电平的情况，其最坏的输出电压是V OHmin，如果要使该电压能在输入端被正确识别为高电平，即被噪
数字电路触发器试卷练习题
2016学年 德清职业中专《数字电路》第二次月考试卷第一学期 （适用15计网3+2） 班级：姓名: 得分： 一、填空题：（30分） 1.触发器有两个输出端_______和________，正常工作时两端的状态互补，以_________端的状态表示触发器的状态。 2.按结构形式的不同，RS触发器可分为两大类：一类是没有时钟控制的____________触发器,另一类是具有时钟控制端的__________触发器。 3. 按逻辑功能划分，触发器可以分为________触发器、___________触发器、__________触发器和________触发器四种类型。 4.钟控触发器也称同步触发器，其状态的变化不仅取决于___________信号的变化，还取决于___________信号的作用。 5.钟控触发器按结构和触发方式分，有电位触发器、_________触发器、_________触发器和主从触发器四种类型。 6.各种时钟控触发器中不需具备时钟条件的输入信号是________和_______。 二、选择题：（20分） 1.能够存储0、1 二进制信息的器件是（） A.TTL门 B.CMOS门 C.触发器 D.译码器 2.触发器是一种（） Ａ．单稳态电路Ｂ.无稳态电路Ｃ.双稳态电路Ｄ.三稳态电路3.用与非门构成的基本RS触发器处于置1 状态时，其输入信号R应为（） S、 A.00 R D. 11 S = = S R RＢ.01 = S = R C.10 S 4.用与非门构成的基本RS触发器，当输入信号S= 0、R= 1
时，其逻辑功能为( ) A.置1 B.置0 C.保持 D.不定 5.下列触发器中，输入信号直接控制输出状态的是 （ ） A ．基本RS 触发器 B. 钟控RS 触发器 C. 主从JK 触发器 D. 维持阻塞D 触发器 6.具有直接复位端 d R 和置位端d S 的触发器，当触发器处于受 CP 脉冲控制的情况下工作时，这两端所加的信号为 ( ) A. 00d d =S R B. 01d d =S R C. 10d d =S R D. 11d d =S R 7.输入信号高电平有效的 RS 触发器中，不允许的输入是（ ） A.RS=00 B.RS=01 C.RS=10 D.RS=11 8.下列触发器中，具有置0、置1、保持、翻转功能的是( ) A. RS 触发器 B. D 触发器 C.JK 触发器 D. T 触发器 9.时钟触发器产生空翻现象的原因是因为采用了（ ） A.主从触发方式 B.上升沿触发方式 C.下降沿触发方式 D.点位触发方式 10.当输入J = K = 1时，JK 触发器所具有的功能是( ) A.置0 B.置1 C.保持 D.翻转 三、画图题：（40分） 1. 如图，设Q 初始状态为0，画出Q 的波形(5分)
数字电子——考试题库及答案
触发器有两个互补的输出，且输出不仅与输入有关，还和电路原状态：收藏 A. 无关 B. 无法确定 C. 有关 回答错误!正确答案： C 单稳态触发器可以用于： 收藏 A. 定时 B. 编码 C. 译码 回答错误!正确答案： A 存储矩阵由许多存储单元组成。每个存储单元可存放（）位二进制数。收藏 A. 1 B.
4 C. 2 回答错误!正确答案： A n个逻辑变量，共有（）个最小项。 收藏 A. 2的n次方 B. n C. 2n 回答错误!正确答案： A 二进制计数器每经一级触发器，输出脉冲的频率：收藏 A. 降低一倍 B. 不会改变 C. 增大一倍 回答错误!正确答案： A
（）电路，具有回差，抗干扰强。 收藏 A. 单稳态触发器 B. 多谐振荡器 C. 施密特触发器 回答错误!正确答案：C （）电路可用于幅度的鉴别。 收藏 A. 施密特触发器 B. 单稳态触发器 C. 多谐振荡器 回答错误!正确答案： A D/A转换器是可以实现（）转换的电路。收藏 A. 数字信号向模拟信号 B.
模拟信号向数字信号 C. 数字信号向二进制信号 回答错误!正确答案： A RS触发器的触发输入信号之间： 收藏 A. 无约束 B. 有约束 C. 无法确定 回答错误!正确答案：B 当JK触发器的J＝K＝1时，所构成的触发器为：收藏 A. 置0型的触发器 B. 置1型的触发器 C. 翻转型的触发器 回答错误!正确答案：C
半导体存储器可以用来存放数据、资料等（）信息。 收藏 A. 10进制 B. 12进制 C. 2进制 回答错误!正确答案： C 存储器的存储容量是指所包含的： 收藏 A. 存储器字长 B. 所存放的字数 C. 总存储单元数 回答错误!正确答案： C 若要对100个信息进行编码，则在输出端至少需要（）位二进制代码。收藏 A. 4 B.
数字电子技术试卷试的题目答案详解汇总情况
数字电子技术基础试卷试题答案汇总 一、 填空题（每空1分，共20分） 1、逻辑代数中3种基本运算是（与运算、或运算、非运算） 2、逻辑代数中三个基本运算规则 （代入规则、反演规则、对偶规则） 3、逻辑函数的化简有 公式法 ， 卡诺图 两种方法。 4、A+B+C= A ’B ’C ’ 。 5、TTL 与非门的u I ≤U OFF 时，与非门 关闭 ，输出 高电平 ，u I ≥ U ON 时，与非门 导通 ，输出 低电平 。 6、组合逻辑电路没有 记忆 功能。 7、竞争冒险的判断方法 代数方法 ， 卡诺图法 。 8、触发器它2 稳态,主从RS 触发器的特性方程Q ’’=S+RQ ’ SR=0 ， 主从JK 触发器的特性方Q ’’=JQ ’+K ’Q ，D 触发器的特性方程 Q ’’=D 。 二、 选择题（每题1分，共10分） 1、相同为“0”不同为“1”它的逻辑关系是 （ C ） A 、或逻辑 B 、与逻辑 C 、异或逻辑 2、Y （A ，B ，C ，）=∑m （0，1，2，3）逻辑函数的化简式 （ C ） A 、Y=AB+BC+ABC B 、Y=A+B C 、Y=A （A) 3、 A 、Y=A B B 、Y 处于悬浮状态 C 、Y=B A + 4、下列图中的逻辑关系正确的是 （ A ） A.Y=B A + B.Y=B A + C.Y=AB 5、下列说法正确的是 （ A ）
A、主从JK触发器没有空翻现象 B、JK之间有约束 C、主从JK触发器的特性方程是CP上升沿有效。 6、下列说法正确的是（ C ） A、同步触发器没有空翻现象 B、同步触发器能用于组成计数器、移位寄存器。 C、同步触发器不能用于组成计数器、移位寄存器。 7、下列说法是正确的是（ A ） A、异步计数器的计数脉冲只加到部分触发器上 B、异步计数器的计数脉冲同时加到所有触发器上 C、异步计数器不需要计数脉冲的控制 8、下列说法是正确的是（A ） A、施密特触发器的回差电压ΔU=U T+-U T- B、施密特触发器的回差电压越大，电路的抗干扰能力越弱 C、施密特触发器的回差电压越小，电路的抗干扰能力越强 9、下列说法正确的是（ C ） A、多谐振荡器有两个稳态 B、多谐振荡器有一个稳态和一个暂稳态 C、多谐振荡器有两个暂稳态 10、下列说法正确的是（ A ） A、555定时器在工作时清零端应接高电平 B、555定时器在工作时清零端应接低电平 C、555定时器没有清零端 三、判断题（每题1分，共10分） 1、A+AB=A+B （错） 2、当输入9个信号时，需要3位的二进制代码输出。（错） 3、单稳态触发器它有一个稳态和一个暂稳态。（对） 4、施密特触发器有两个稳态。（对） 5、多谐振荡器有两个稳态。（错） 6、D/A转换器是将模拟量转换成数字量。（错） 7、A/D转换器是将数字量转换成模拟量。（错） 8、主从JK触发器在CP=1期间，存在一次性变化。（对） 9、主从RS触发器在CP=1期间，R、S之间不存在约束。（错） 10、所有的触发器都存在空翻现象。（错）