数字电子技术期末考试试题含答案
数电期末考试题库及答案
数电期末考试题库及答案一、单项选择题（每题2分，共20分）1. 在数字电路中，最基本的逻辑运算是：A. 与运算B. 或运算C. 非运算D. 异或运算答案：A2. 下列哪个不是TTL逻辑门的类型？A. 与非门B. 或非门C. 与门D. 异或门答案：D3. 一个D触发器的输出Q在时钟脉冲的上升沿时：A. 翻转B. 保持不变C. 变为高电平D. 变为低电平答案：A4. 在数字电路中，一个4位二进制计数器的最大计数是：A. 8B. 16C. 15D. 145. 一个简单的RS触发器具有：A. 一个稳定的输出B. 两个稳定的输出C. 一个不稳定的输出D. 两个不稳定的输出答案：A6. 以下哪个是同步时序电路的特点？A. 存储单元的时钟输入是独立的B. 存储单元的时钟输入是共享的C. 存储单元的时钟输入是异步的D. 存储单元的时钟输入是随机的答案：B7. 在数字电路设计中，使用布尔代数的目的是：A. 简化逻辑表达式B. 增加电路复杂性C. 减少电路的功耗D. 提高电路的可靠性答案：A8. 一个8位移位寄存器可以存储多少位二进制数？A. 4B. 8C. 16D. 32答案：B9. 在数字电路中，一个三态输出门可以处于以下哪种状态？B. 低电平C. 高阻态D. 所有上述状态答案：D10. 一个二进制计数器在计数过程中，如果遇到一个无效的输入，它将：A. 停止计数B. 继续计数C. 重置为零D. 跳转到下一个有效状态答案：A二、多项选择题（每题3分，共15分）1. 下列哪些是数字电路中常用的逻辑门？A. 与门B. 或门C. 非门D. 异或门E. 与非门答案：ABCDE2. 数字电路中的触发器可以用于：A. 存储数据B. 计数C. 产生时钟信号D. 作为逻辑门E. 以上都不是答案：ABC3. 下列哪些是数字电路的优点？A. 高速度B. 高可靠性C. 易于集成D. 低功耗E. 以上都不是答案：ABCD4. 在数字电路中，同步电路与异步电路的区别在于：A. 同步电路的时钟信号是共享的B. 异步电路的时钟信号是独立的C. 同步电路的时钟信号是独立的D. 异步电路的时钟信号是共享的E. 以上都不是答案：AB5. 以下哪些因素会影响数字电路的性能？A. 温度B. 电源电压C. 信号传输延迟D. 噪声E. 以上都不是答案：ABCD三、简答题（每题5分，共20分）1. 简述数字电路与模拟电路的主要区别。
数字电子技术期末考试题含答案
.z."数字电子技术"考试试卷〔第一套〕课程号2904025035考试时间 100 分钟一、填空题〔共28分〕1、〔2分〕〔5E.8〕H ＝〔 94.5 〕D ＝〔 10010100.0101 〕8421BCD 。
2、〔2分〕逻辑函数L =+ A+ B+ C +D =〔 1 〕。
3、〔2分〕由传输门构成的电路如以下图所示，当A=0时，输出L= B 。
4、〔2分〕三态门可能输出的三种状态是 低电平 、高电平和 高阻态_。
5、〔3分〕A/D 转换器一般要经过_ 采样__、保持、量化和__编码__这4个步骤，A/D 转换器的转换速度主要取决于转换类型。
对双积分型A/D 转换器、并行比拟型A/D 转换器和逐次比拟型A/D 转换器的相对速度进展比拟，转换速度最快的是_并行比拟型A/D 转换器__。
6、〔2分〕集成优先编码器CD4532〔功能表见后〕正常接电源和地，且待编码信号输入端I 0 =I 2 = I 6 = I 7 = 1，输入使能端EI=1，其余输入端为0，其输出Y 2Y 1Y 0为 111 。
7、〔3分〕集成数据选择器74HC151构成的电路如以下图所示，则其输出Y= ABC BC A C B A ++⋅⋅ 。
〔注：不需化简〕8、〔3分〕*PLA 电路如以下图所示，其输出逻辑函数表达式*=适用专业年级〔方向〕： 应用物理、电信科技2010级考试方式及要求：闭卷笔试题 号 一二三四五六七 总分 得 分 阅卷人. z. 6分L D ABC=+4分四、〔16分〕在举重比赛中有A、B、C三名裁判，A为主裁判，B、C 为副裁判。
当两名或两名以上裁判〔且必须包括A在〕认为运发动上举杠铃合格时，按动电钮可发出裁决合格信号〔即输出Z为1〕。
请设计该三输入的组合逻辑电路。
要求：〔1〕列出真值表；〔2〕写出逻辑函数的最简与或式；〔3〕用与非门实现该电路，画出电路图；〔4〕用3线8线译码器74HC138实现该电路，画出电路图。
数字电子技术期末考试试题含答案
.《数字电子技术》考试一试卷（第一套）课程号2904025035考试时间100分钟合用专业年级（方向）：应用物理、电信科技2010级考试方式及要求：闭卷笔试题号一二三四五六七总分得分阅卷人(注：集成电路CD4532、74HC138、74HC151的功能见附表)一、填空题（共28分）1、（2分）（）H＝（）D＝（）8421BCD。
2、（2分）逻辑函数L=+A+B+C+D=（1）。
3、（2分）由传输门组成的电路以以下图所示，当A=0时，输出L=B。
4、（2分）三态门可能输出的三种状态是低电平、高电平易高阻态_。
5、（3分）A/D变换器一般要经过_采样__、保持、量化和__编码__这4个步骤，A/D变换器的变换速度主要取决于变换种类。
对双积分型A/D变换器、并行比较型A/D变换器和逐次比较型A/D变换器的相对速度进行比较，变换速度最快的是_并行比较型A/D变换器__。
.西南石油大学试卷第2页共11页6、（2分）集成优先编码器CD4532（功能表见后）正常接电源和地，且 待编码信号输入端I 0 2 6 7，输入使能端 EI=1 ，其他输入端为 ， =I =I =I =10 其输出Y 21Y 0为 111。
Y7、（3分）集成数据选择器74HC151组成的电路以以下图所示，则其输出Y=ABCABCABC 。
（注：不需化简）Y0 ABE YS2S174HC151CS0D0D1 D2D3D4 D5D6D70 18、（3分）某PLA 电路以以下图所示，其输出逻辑函数表达式 X=ABC A BC A BC 。
ABC×× ×× ×× × ×××× ×××××××X Y9、（2分）某单极性输出的 8位D/A 变换器正常工作，当输入数字量为 （10101010）B 时，其输出电压为，当输入数字量为（10101100） 时，其输出电压为V 。
数字电子技术期末考试题及答案(经典)
xxx~xxx学年第x学期《数字电子技术》期末复习题第一部分题目一、判断题（每题2分,共30分。
描述正确的在题号前的括号中打“√”，错误的打“×”）【】1、二进制有0 ~ 9十个数码，进位关系为逢十进一。
【】2、（325）8 ＞（225）10【】3、十进制数整数转换为二进制数的方法是采用“除2取余法”。
【】4、在二进制与十六进制的转换中，有下列关系：（100111010001）2=（9D1）16【】5、8421 BCD码是唯一能表示十进制数的编码。
【】6、十进制数85的8421 BCD码是101101。
【】7、格雷码为无权码，8421 BCD为有权码。
【】8、数字电路中用“1”和“0”分别表示两种状态,二者无大小之分。
【】9、逻辑变量的取值，１比０大。
【】10、在逻辑代数中，逻辑变量和函数均只有0和1两个取值，且不表示数量的大小。
【】11、逻辑运算1+1=1【】12、逻辑运算A+1+0=A【】13、因为逻辑表达式A+B+AB=A+B成立，所以AB=0成立。
【】14、在时间和幅度上均不连续的信号是数字信号，所以语音信号是数字信号。
【】15、逻辑函数的运算次序为：先算括号内，后算括号外；先求与，再求或，最后求非。
【】16、AB A C BC AB A C++=+【】17、逻辑函数表达式的化简结果是唯一的。
【】18、逻辑真值表、逻辑表达式、逻辑图均是逻辑关系的描述方法。
【】19、n个变量组成的最小项总数是2n个。
【】20、逻辑函数的化简方法主要有代数化简法和卡诺图化简法。
【】21、逻辑函数化简过程中的无关项一律按取值为0处理。
【】22、数字电路中晶体管工作在开关状态，即不是工作在饱和区，就是工作在截止区。
【】23、TTL或非门的多余输入端可以接高电平。
【】24、某一门电路有三个输入端A、B、C，当输入A、B、C不全为“1”时，输出Y为“0”，输入A、B、C全为高电平“1”时，输出Y为“1”，此门电路是或门电路。
期末考试数字电子技术试题及答案(DOC)
数字电子技术基础试题（一）一、填空题 : （每空1分，共10分）1． (30.25) 10 = ( ) 2 = ( ) 16 。
2 . 逻辑函数L = + A+ B+ C +D = 。
3 . 三态门输出的三种状态分别为：、和。
4 . 主从型JK触发器的特性方程= 。
5 . 用4个触发器可以存储位二进制数。
6 . 存储容量为4K×8位的RAM存储器，其地址线为条、数据线为条。
二、选择题： (选择一个正确的答案填入括号内，每题3分，共30分 )1.设图1中所有触发器的初始状态皆为0，找出图中触发器在时钟信号作用下,输出电压波形恒为0的是：（）图。
图 12.下列几种TTL电路中，输出端可实现线与功能的电路是（）。
A、或非门B、与非门C、异或门D、OC门3.对CMOS与非门电路，其多余输入端正确的处理方法是（）。
A、通过大电阻接地（>1.5KΩ）B、悬空C、通过小电阻接地（<1KΩ）D、通过电阻接V CC4.图2所示电路为由555定时器构成的（）。
A、施密特触发器B、多谐振荡器C、单稳态触发器D、T触发器5.请判断以下哪个电路不是时序逻辑电路（）。
图2A、计数器B、寄存器C、译码器D、触发器6．下列几种A/D转换器中，转换速度最快的是（）。
图2A、并行A/D转换器B、计数型A/D转换器C、逐次渐进型A/D转换器D、双积分A/D转换器7．某电路的输入波形 u I 和输出波形 u O 如图 3所示，则该电路为（）。
图3A、施密特触发器B、反相器C、单稳态触发器D、JK触发器8．要将方波脉冲的周期扩展10倍，可采用（）。
A、10级施密特触发器B、10位二进制计数器C、十进制计数器D、10位D/A转换器9、已知逻辑函数与其相等的函数为（）。
A、B、C、D、10、一个数据选择器的地址输入端有3个时，最多可以有（）个数据信号输出。
A、4B、6C、8D、16三、逻辑函数化简（每题5分，共10分）1、用代数法化简为最简与或式Y= A +2、用卡诺图法化简为最简或与式Y= + C +A D，约束条件：A C + A CD+AB=0四、分析下列电路。
数字电子技术试题库及答案
数字电子技术期末试题库一、选择题：A组：1.如果采用偶校验方式，下列接收端收到的校验码中，（ A ）是不正确的A、00100B、10100C、11011D、11110２、某一逻辑函数真值表确定后，下面描述该函数功能的方法中，具有唯一性的是（B）A、逻辑函数的最简与或式B、逻辑函数的最小项之和C、逻辑函数的最简或与式D、逻辑函数的最大项之和３、在下列逻辑电路中，不是组合逻辑电路的是（D）A、译码器B、编码器C、全加器D、寄存器４、下列触发器中没有约束条件的是（D）A、基本RS触发器B、主从RS触发器C、同步RS触发器D、边沿D触发器５、555定时器不可以组成D。
A.多谐振荡器B.单稳态触发器C.施密特触发器D.J K触发器６、编码器（A）优先编码功能，因而（C）多个输入端同时为１。
A、有B、无C、允许D、不允许７、（D）触发器可以构成移位寄存器。
A、基本RS触发器B、主从RS触发器C、同步RS触发器D、边沿D触发器８、速度最快的A/D转换器是（A）电路A、并行比较型B、串行比较型C、并－串行比较型D、逐次比较型9、某触发器的状态转换图如图所示，该触发器应是( C )A. J-K触发器B. R-S触发器C. D触发器D. T触发器10.（电子专业作）对于VHDL以下几种说法错误的是（A ）A VHDL程序中是区分大小写的。
B 一个完整的VHDL程序总是由库说明部分、实体和结构体等三部分构成C VHDL程序中的实体部分是对元件和外部电路之间的接口进行的描述，可以看成是定义元件的引脚D 结构体是描述元件内部的结构和逻辑功能B组：1、微型计算机和数字电子设备中最常采用的数制是--------------------------------（ A ）A.二进制B.八进制C. 十进制D.十六进制2、十进制数6在8421BCD码中表示为-------------------------------------------------（ B ）A.0101B.0110C. 0111D. 10003、在图1所示电路中，使__AY 的电路是---------------------------------------------（ A ）A. ○1B. ○2C. ○3D. ○44、接通电源电压就能输出矩形脉冲的电路是------------------------------------------（ D ）A. 单稳态触发器B. 施密特触发器C. D触发器D. 多谐振荡器5、多谐振荡器有-------------------------------------------------------------------------------（ C ）A. 两个稳态B. 一个稳态C. 没有稳态D. 不能确定6、已知输入A、B和输出Y的波形如下图所示，则对应的逻辑门电路是-------（ D ）A. 与门B. 与非门C. 或非门D. 异或门7、下列电路中属于时序逻辑电路的是------------------------------------------------------（ B ）A. 编码器B. 计数器C. 译码器D. 数据选择器8、在某些情况下，使组合逻辑电路产生了竞争与冒险，这是由于信号的---------（ A ）A. 延迟B. 超前C. 突变D. 放大9、下列哪种触发器可以方便地将所加数据存入触发器，适用于数据存储类型的时序电路--------------------------------------------------------------------------------（ C ）A. RS触发器B. JK触发器C. D触发器D. T触发器10、电路和波形如下图，正确输出的波形是-----------------------------------------------（ A ）A. ○1B. ○2C. ○3D. ○4C组：1．十进制数25用8421BCD码表示为 A 。
数电期末考试题及答案
数电期末考试题及答案一、单项选择题（每题2分，共20分）1. 在数字电路中，最基本的逻辑运算是（）。
A. 与运算B. 或运算C. 非运算D. 异或运算答案：C2. 一个触发器可以存储（）位二进制信息。
A. 1B. 2C. 3D. 4答案：A3. 以下哪个不是组合逻辑电路的特点？（）A. 输出只依赖于当前输入B. 输出与输入之间存在时延C. 没有记忆功能D. 任何时刻输出仅由该时刻的输入决定答案：B4. 一个4位二进制计数器可以计数到（）。
A. 8B. 16C. 15D. 14答案：B5. 一个D触发器的特点是（）。
A. 有两个稳定状态B. 只有一个稳定状态C. 没有稳定状态D. 以上都不是答案：A6. 在数字电路中，以下哪个不是基本的门电路？（）。
A. 与门B. 或门C. 非门D. 异或门答案：D7. 一个3线-8线译码器可以译码（）种不同的输入。
A. 3B. 8C. 6D. 7答案：B8. 一个8位寄存器可以存储（）位二进制数。
A. 8B. 16C. 32D. 64答案：A9. 以下哪个是同步时序电路的特点？（）A. 电路的输出仅依赖于当前的输入B. 电路的输出依赖于当前的输入和电路的历史状态C. 电路的输出不依赖于输入D. 电路的输出仅依赖于电路的历史状态答案：B10. 一个JK触发器可以表示（）种不同的状态。
A. 1B. 2C. 3D. 4答案：B二、填空题（每题2分，共20分）1. 在数字电路中，一个基本的与门电路有_____个输入端和一个输出端。
答案：22. 一个4位二进制计数器的计数范围是从0到_____。
答案：153. 一个D触发器在时钟信号的上升沿到来时，其输出Q将与输入D保持_____。
答案：一致4. 在数字电路中，一个3线-8线译码器的输出是_____进制的。
答案：二5. 一个8位寄存器可以存储的最大十进制数是_____。
答案：2556. 一个JK触发器在J=0，K=0时，其状态将保持_____。
数字电子技术期末试卷含答案
《数字电子技术基础》(第一套)一、填空题：（每空1分，共15分）=+的两种标准形式分别为（）、（）。
1．逻辑函数Y AB C2．将2004个“1”异或起来得到的结果是（）。
3．半导体存储器的结构主要包含三个部分，分别是（）、（）、（）。
4．8位D/A转换器当输入数字量为5v。
若只有最低位为高电平，则输出电压为（）v；当输入为，则输出电压为（）v。
5．就逐次逼近型和双积分型两种A/D转换器而言，（）的抗干扰能力强，（）的转换速度快。
6．由555定时器构成的三种电路中，（）和（）是脉冲的整形电路。
7．与PAL相比，GAL器件有可编程的输出结构，它是通过对（）进行编程设定其（）的工作模式来实现的，而且由于采用了（）的工艺结构，可以重复编程，使它的通用性很好，使用更为方便灵活。
二、根据要求作题：（共15分）1．将逻辑函数P=AB+AC写成“与或非”表达式，并用“集电极开路与非门”来实现。
2．图1、2中电路均由CMOS门电路构成，写出P、Q 的表达式，并画出对应A、B、C的P、Q波形。
三、分析图3所示电路：（10分）1）试写出8选1数据选择器的输出函数式；2）画出A2、A1、A0从000~111连续变化时，Y的波形图；3）说明电路的逻辑功能。
四、设计“一位十进制数”的四舍五入电路（采用8421BCD码）。
要求只设定一个输出，并画出用最少“与非门”实现的逻辑电路图。
（15分）五、已知电路及CP、A的波形如图4(a) (b)所示，设触发器的初态均为“0”，试画出输出端B和C的波形。
（8分）BC六、用T触发器和异或门构成的某种电路如图5(a)所示，在示波器上观察到波形如图5(b)所示。
试问该电路是如何连接的？请在原图上画出正确的连接图，并标明T的取值。
（6分）七、图6所示是16*4位ROM和同步十六进制加法计数器74LS161组成的脉冲分频电路。
ROM中的数据见表1所示。
试画出在CP信号连续作用下的D3、D2、D1、D0输出的电压波形，并说明它们和CP 信号频率之比。
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《数字电子技术》考试试卷（第一套）
课程号
2904025035
考试时间
100 分钟
(注：集成电路CD4532、74HC138、74HC151的功能见附表)
一、填空题（共28分）
1、（2分）（5E.8）H ＝（ 94.5 ）D ＝（ 10010100.0101 ）8421BCD 。
2、（2分）逻辑函数L =
+ A+ B+ C +D = （ 1 ）。
3、（2分）由传输门构成的电路如下图所示，当A=0时，输出L= B 。
4、（2分）三态门可能输出的三种状态是 低电平 、高电平和 高阻态_。
5、（3分）A/D 转换器一般要经过_ 采样__、保持、量化和__编码__这4个步骤，A/D 转换器的转换速度主要取决于转换类型。
对双积分型A/D 转换器、并行比较型A/D 转换器和逐次比较型A/D 转换器的相对速度进行比较，转换速度最快的是_并行比较型A/D 转换器__。
适用专业年级（方向）： 应用物理、电信科技2010级
考试方式及要求：
闭卷笔试
题 号 一
二
三
四 五 六 七 总分 得 分 阅卷人
6、（2分）集成优先编码器CD4532（功能表见后）正常接电源和地，且待编码信号输入端I 0 =I 2 = I 6 = I 7 = 1，输入使能端EI=1，其余输入端为0，其输出Y 2Y 1Y 0为 111 。
7、（3分）集成数据选择器74HC151构成的电路如下图所示，则其输出 Y= ABC BC A C B A ++⋅⋅ 。
（注：不需化简）
01
8、（3分）某PLA 电路如下图所示，其输出逻辑函数表达式X=
C B A C B A ABC +⋅+ 。
9、（2分）某单极性输出的8位D/A 转换器正常工作，当输入数字量为
（10101010）B 时，其输出电压为3.4V ，当输入数字量为（10101100）
B
时，其输出电压为 3.44 V 。
10、（2分）一个存储容量为4K ×4的存储器有 214 个存储单元，若用该存储器构成32K ×8的存储系统，则需 16 片4K ×4的存储器。
11、（3分）对于JK 触发器，当1J K ==时，n+1Q = 1 ，当1
J K ==
时，n+1Q = n Q ，当0J K ==时，n+1Q = n Q 。
二、用公式法将下列逻辑函数化简为最简与或式 （12分）
(,,,)F A B C D ABCD ABD BC BCD ABC =++++
F=AB(C+D)+B(C +D )+C B A 2分 =ABC+ABD+ B D + B C +C B A 2分 = ABC+ABD+ B D + B C 2分
=B(AC+C +AD+D ) 2分 =B(A+C +D ) 2分 =AB+B C +B D 2分
三、用卡诺图法将下列逻辑函数化简为最简与或式 （10分）
L （A,B,C,D ）＝∑m （0,1,3,5,7, 9）＋∑d （10~15） 解:
6分
L D ABC =+ 4分 四、（16分）在举重比赛中有A 、B 、C 三名裁判，A 为主裁判，B 、C 为副裁判。
当两名或两名以上裁判（且必须包括A 在内）认为运动员上举杠铃合格时，按动电钮可发出裁决合格信号（即输出Z 为1）。
请设计该三输入的组合逻辑电路。
要求： （1）列出真值表；
（2）写出逻辑函数的最简与或式；
（3）用与非门实现该电路，画出电路图；
（4）用3线8线译码器74HC138实现该电路，画出电路图。
74HC138的符号
解：（1）真值表见表1，设输入为A、B、C，输出为F
（2）逻辑函数的最简与或式；
AC
AB
ABC
C
AB
C
B
A
F+
=
+
+
=
（3）用与非门实现
AC
AB
AC
AB
F⋅
=
+
=
用与非门实现该电路的逻辑图如图（a）所示。
（4）用74HC138实现
A、B、C从A
2、A
1
、A
输入，令0
,11
2
3
=
=
=E
E
E
7
6
5
7
6
5
7
6
5
Y
Y
Y
m
m
m
m
m
m
ABC
C
AB
C
B
A
F⋅
⋅
=
⋅
⋅
=
+
+
=
+
+
=
用74HC138实现该电路的逻辑图如图（b）所示。
表1 真值表
A B C F
0000
0010
0100
0110
1
000
1
011
1101
1111
图（a）图（b）
五、（20分）分析下图所示时序电路，写出其驱动方程、状态方程和输
出方程，画出其状态转换表、状态转换图，检查电路能否自启动，并说明电路实现的逻辑功能。
解：驱动方程：
⎩
⎨
⎧
=
=
=
=
n
XQ
K
J
X
K
J
1
1
状态方程：
⎪⎩
⎪
⎨
⎧
⋅
⋅
+
⋅
⋅
=
⋅
+
⋅
=
+
+
n
n
n
n
n
n
n
n
Q
Q
X
Q
Q
X
Q
Q
X
Q
X
Q
1
1
1
1
1
输出方程：n
n Q
Q
X
Z
1
⋅
⋅
=
状态表：
n
Q
1
n
Q
1
1
+
n
Q1
+
n
Q/ Z
状态图：
10
00
01
11
1/0
0/0
0/0
0/0
1/1
1/0
0/0
1/0
Q 1Q
X/Z
自启动能力：具有自启动能力。
逻辑功能：X=0时，电路处于维持状态；
X=1时，电路为四进制加法计数器。
六、（10分）使用4位同步二进制加计数器74LVC161构成模值为10的计
数器，要求画出接线图和状态转换图。
注：D 3、Q 3为高位，D 0、Q 0为低位。
解：N ＝10，N<16，所以只需一片74LVC161。
方法一：反馈清零法，计数状态为0000－1009；
方法二：反馈置数法，计数状态为0000－1009；
方法一方法二状态转换图：
方法一
方法二
七、（10分）请绘制由555定时器构成的施密特触发器的电路图。
若输入U i 的波形如下图所示，又知V CC =15V ，5脚不外加控制电压。
求正向閾值电压V T+ ，负向閾值电压V T- ，并画出该电路输出Uo 的波形。
555定时器的符号
2
3
4
5
678
1
555
15V
Ui
Uo
t
t
解： V
V V V
V V CC T CC T 53
1
103
2
====-+
555定时器构成的施密特触发器的电路及输出Uo 的波形如下图。
附表
附表1：集成优先编码器CD4532功能表
输入 输出
EI I 7 I 6 I 5 I 4 I 3 I 2 I 1 I 0 Y 2 Y 1 Y 0 GS EO
附表2 集成3线8线译码器74HC138的功能表
附表3 集成同步四位二进制加计数器74LVC161的功能表
注：D N*表示 CP 脉冲上升沿之前瞬间D N的电平，#表示只有当CET为高电平且计数器状态为HHHH 时输出为高电平，其余均为低电平。
附表4 555定时器的功能表
可编辑
注：5脚悬空（或经电容接地）时
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