《数字电子技术》课期末考试复习题
数电期末考试题库及答案
数电期末考试题库及答案一、单项选择题（每题2分，共20分）1. 在数字电路中，最基本的逻辑运算是：A. 与运算B. 或运算C. 非运算D. 异或运算答案：A2. 下列哪个不是TTL逻辑门的类型？A. 与非门B. 或非门C. 与门D. 异或门答案：D3. 一个D触发器的输出Q在时钟脉冲的上升沿时：A. 翻转B. 保持不变C. 变为高电平D. 变为低电平答案：A4. 在数字电路中，一个4位二进制计数器的最大计数是：A. 8B. 16C. 15D. 145. 一个简单的RS触发器具有：A. 一个稳定的输出B. 两个稳定的输出C. 一个不稳定的输出D. 两个不稳定的输出答案：A6. 以下哪个是同步时序电路的特点？A. 存储单元的时钟输入是独立的B. 存储单元的时钟输入是共享的C. 存储单元的时钟输入是异步的D. 存储单元的时钟输入是随机的答案：B7. 在数字电路设计中，使用布尔代数的目的是：A. 简化逻辑表达式B. 增加电路复杂性C. 减少电路的功耗D. 提高电路的可靠性答案：A8. 一个8位移位寄存器可以存储多少位二进制数？A. 4B. 8C. 16D. 32答案：B9. 在数字电路中，一个三态输出门可以处于以下哪种状态？B. 低电平C. 高阻态D. 所有上述状态答案：D10. 一个二进制计数器在计数过程中，如果遇到一个无效的输入，它将：A. 停止计数B. 继续计数C. 重置为零D. 跳转到下一个有效状态答案：A二、多项选择题（每题3分，共15分）1. 下列哪些是数字电路中常用的逻辑门？A. 与门B. 或门C. 非门D. 异或门E. 与非门答案：ABCDE2. 数字电路中的触发器可以用于：A. 存储数据B. 计数C. 产生时钟信号D. 作为逻辑门E. 以上都不是答案：ABC3. 下列哪些是数字电路的优点？A. 高速度B. 高可靠性C. 易于集成D. 低功耗E. 以上都不是答案：ABCD4. 在数字电路中，同步电路与异步电路的区别在于：A. 同步电路的时钟信号是共享的B. 异步电路的时钟信号是独立的C. 同步电路的时钟信号是独立的D. 异步电路的时钟信号是共享的E. 以上都不是答案：AB5. 以下哪些因素会影响数字电路的性能？A. 温度B. 电源电压C. 信号传输延迟D. 噪声E. 以上都不是答案：ABCD三、简答题（每题5分，共20分）1. 简述数字电路与模拟电路的主要区别。
数字电子技术期末考试题含答案
.z."数字电子技术"考试试卷〔第一套〕课程号2904025035考试时间 100 分钟一、填空题〔共28分〕1、〔2分〕〔5E.8〕H ＝〔 94.5 〕D ＝〔 10010100.0101 〕8421BCD 。
2、〔2分〕逻辑函数L =+ A+ B+ C +D =〔 1 〕。
3、〔2分〕由传输门构成的电路如以下图所示，当A=0时，输出L= B 。
4、〔2分〕三态门可能输出的三种状态是 低电平 、高电平和 高阻态_。
5、〔3分〕A/D 转换器一般要经过_ 采样__、保持、量化和__编码__这4个步骤，A/D 转换器的转换速度主要取决于转换类型。
对双积分型A/D 转换器、并行比拟型A/D 转换器和逐次比拟型A/D 转换器的相对速度进展比拟，转换速度最快的是_并行比拟型A/D 转换器__。
6、〔2分〕集成优先编码器CD4532〔功能表见后〕正常接电源和地，且待编码信号输入端I 0 =I 2 = I 6 = I 7 = 1，输入使能端EI=1，其余输入端为0，其输出Y 2Y 1Y 0为 111 。
7、〔3分〕集成数据选择器74HC151构成的电路如以下图所示，则其输出Y= ABC BC A C B A ++⋅⋅ 。
〔注：不需化简〕8、〔3分〕*PLA 电路如以下图所示，其输出逻辑函数表达式*=适用专业年级〔方向〕： 应用物理、电信科技2010级考试方式及要求：闭卷笔试题 号 一二三四五六七 总分 得 分 阅卷人. z. 6分L D ABC=+4分四、〔16分〕在举重比赛中有A、B、C三名裁判，A为主裁判，B、C 为副裁判。
当两名或两名以上裁判〔且必须包括A在〕认为运发动上举杠铃合格时，按动电钮可发出裁决合格信号〔即输出Z为1〕。
请设计该三输入的组合逻辑电路。
要求：〔1〕列出真值表；〔2〕写出逻辑函数的最简与或式；〔3〕用与非门实现该电路，画出电路图；〔4〕用3线8线译码器74HC138实现该电路，画出电路图。
数电期末考试试题及答案
数电期末考试试题及答案一、选择题（每题2分，共20分）1. 在数字电路中，最基本的逻辑运算是以下哪三种？A. 与、或、非B. 与、异或、同或C. 与、或、异或D. 与、同或、非答案：A2. 下列哪个不是组合逻辑电路的特点？A. 有记忆功能B. 输出只依赖于当前输入C. 结构简单D. 响应速度快答案：A3. 触发器的主要用途是什么？A. 存储信息B. 放大信号C. 转换信号D. 滤波答案：A4. 以下哪个不是数字电路的优点？A. 抗干扰能力强B. 可靠性高C. 集成度高D. 功耗大答案：D5. 一个4位二进制计数器的最大计数范围是多少？A. 8B. 16C. 32D. 64答案：B6. 以下哪个是同步时序逻辑电路的特点？A. 电路中存在多个时钟信号B. 电路中的触发器是异步的C. 电路中的触发器是同步的D. 电路中的触发器是无关紧要的答案：C7. 一个D触发器的输出Q与输入D的关系是？A. Q = DB. Q = ¬ DC. Q = D + ¬ DD. Q = D * ¬ D答案：A8. 以下哪个是数字电路设计中常用的优化方法？A. 增加冗余B. 减少冗余C. 增加噪声D. 减少噪声答案：B9. 布尔代数的基本运算有哪些？A. 与、或、非B. 加、减、乘C. 同或、异或、非D. 乘、除、模答案：A10. 以下哪个是数字电路中常用的存储元件？A. 电容B. 电感C. 电阻D. 二极管答案：A二、简答题（每题10分，共30分）1. 简述数字电路与模拟电路的区别。
答案：数字电路处理的是离散的数字信号，而模拟电路处理的是连续的模拟信号。
数字电路具有更高的抗干扰能力，可靠性高，易于集成，功耗相对较低。
模拟电路则在信号处理方面更为灵活，但容易受到噪声干扰，集成度相对较低。
2. 解释什么是时序逻辑电路，并给出一个例子。
答案：时序逻辑电路是一种具有存储功能的数字电路，其输出不仅取决于当前的输入，还取决于电路的历史状态。
数字电子技术期末复习题库及答案
数字电子技术期末复习题库及答案第1单元能力训练检测题一、填空题1、由二值变量所构成的因果关系称为逻辑关系。
能够反映和处理逻辑关系的数学工具称为逻辑代数。
2、在正逻辑的约定下，“1”表示高电平，“0”表示低电平。
3、数字电路中，输入信号和输出信号之间的关系是逻辑关系，所以数字电路也称为逻辑电路。
在逻辑关系中，最基本的关系是与逻辑、或逻辑和非逻辑。
4、用来表示各种计数制数码个数的数称为基数，同一数码在不同数位所代表的权不同。
十进制计数各位的基数是10，位权是10的幂。
5、8421 BCD码和2421码是有权码；余3码和格雷码是无权码。
6、进位计数制是表示数值大小的各种方法的统称。
一般都是按照进位方式来实现计数的，简称为数制。
任意进制数转换为十进制数时，均采用按位权展开求和的方法。
7、十进制整数转换成二进制时采用除2取余法；十进制小数转换成二进制时采用乘2取整法。
8、十进制数转换为八进制和十六进制时，应先转换成二进制，然后再根据转换的二进数，按照三个数码一组转换成八进制；按四个数码一组转换成十六进制。
9、逻辑代数的基本定律有交换律、结合律、分配律、反演律和非非律。
10、最简与或表达式是指在表达式中与项中的变量最少，且或项也最少。
13、卡诺图是将代表最小项的小方格按相邻原则排列而构成的方块图。
卡诺图的画图规则：任意两个几何位置相邻的最小项之间，只允许一位变量的取值不同。
14、在化简的过程中，约束项可以根据需要看作1或0。
二、判断正误题1、奇偶校验码是最基本的检错码，用来使用PCM方法传送讯号时避免出错。
（对）2、异或函数与同或函数在逻辑上互为反函数。
（对）3、8421BCD码、2421BCD码和余3码都属于有权码。
（错）4、二进制计数中各位的基是2，不同数位的权是2的幂。
（对）3、每个最小项都是各变量相“与”构成的，即n个变量的最小项含有n个因子。
（对）4、因为逻辑表达式A+B+AB=A+B成立，所以AB=0成立。
数字电子技术基础期末复习试题
数字电子技术基础期末复习试题一、填空题:1、（48）10=（）16=（）2。
2、对于ttl与非门的闲置输入端可接，ttl或非门不使用的闲置输入端应接。
3、格雷码的特点是任意两组相邻代码之间有位不同。
4、在以下jk触发器、rs触发器、d触发器和t触发器四种触发器中，同时具备维持、复置1、复置0和滑动功能的触发器就是。
5、oc门可以实现功能，cmos门电路中的门也可以实现该功能。
6、一只四输入端与非门，使其输出为0的输入变量取值组合有种。
7、常见的组合逻辑电路有编码器、和。
8、逻辑函数f?ab?ac?bd的反函数为，对偶函数为。
9、一个同步时序逻辑电路可以用、、三组函数表达式叙述。
10、加法器的位次方式存有和两种。
11、16挑选1的数据选择器有个地址输出端的。
12、存储器的种类包括和。
13、在时钟脉冲cp促进作用下，具备和功能的触发器称作t触发器，其特性方程为。
14、三态门输入的三种状态分别为：、和。
15、用4个触发器可以存储位二进制数。
16、逻辑电路中，高电平用1表示，低电平用0表示，则成为逻辑。
17、把jk触发器改成t触发器的方法是。
18、女团逻辑电路就是指电路的输入仅由当前的同意。
19、5个地址输出端的译码器，其译码输入信号最多理应个。
20、输入信号的同时跳变引起输出端产生尖峰脉冲的现象叫做。
21、一个rom存有10根地址线，8根数据输入线，rom共计个存储单元。
22、n个触发器共同组成的计数器最多可以共同组成十进制的计数器。
23、基本rs触发器的约束条件就是。
24、逻辑代数中3种基本运算就是、和。
25、逻辑代数中三个基本运算规则、和。
26、如果对键盘上108个符号展开二进制编码，则至少必须位二进制数码。
27、将一个包含有32768个基本存储单元的存储电路设计16位为一个字节的rom。
该rom有根地址线，有根数据输出线。
28、74ls138是3线―8线译码器，译码输出低电平有效，若输入为a2a1a0=110时，输出y7'y6'y5'y4'y3'y2'y1'y0'y1=。
期末考试数字电子技术试题及答案(DOC)
数字电子技术基础试题（一）一、填空题 : （每空1分，共10分）1． (30.25) 10 = ( ) 2 = ( ) 16 。
2 . 逻辑函数L = + A+ B+ C +D = 。
3 . 三态门输出的三种状态分别为：、和。
4 . 主从型JK触发器的特性方程= 。
5 . 用4个触发器可以存储位二进制数。
6 . 存储容量为4K×8位的RAM存储器，其地址线为条、数据线为条。
二、选择题： (选择一个正确的答案填入括号内，每题3分，共30分 )1.设图1中所有触发器的初始状态皆为0，找出图中触发器在时钟信号作用下,输出电压波形恒为0的是：（）图。
图 12.下列几种TTL电路中，输出端可实现线与功能的电路是（）。
A、或非门B、与非门C、异或门D、OC门3.对CMOS与非门电路，其多余输入端正确的处理方法是（）。
A、通过大电阻接地（>1.5KΩ）B、悬空C、通过小电阻接地（<1KΩ）D、通过电阻接V CC4.图2所示电路为由555定时器构成的（）。
A、施密特触发器B、多谐振荡器C、单稳态触发器D、T触发器5.请判断以下哪个电路不是时序逻辑电路（）。
图2A、计数器B、寄存器C、译码器D、触发器6．下列几种A/D转换器中，转换速度最快的是（）。
图2A、并行A/D转换器B、计数型A/D转换器C、逐次渐进型A/D转换器D、双积分A/D转换器7．某电路的输入波形 u I 和输出波形 u O 如图 3所示，则该电路为（）。
图3A、施密特触发器B、反相器C、单稳态触发器D、JK触发器8．要将方波脉冲的周期扩展10倍，可采用（）。
A、10级施密特触发器B、10位二进制计数器C、十进制计数器D、10位D/A转换器9、已知逻辑函数与其相等的函数为（）。
A、B、C、D、10、一个数据选择器的地址输入端有3个时，最多可以有（）个数据信号输出。
A、4B、6C、8D、16三、逻辑函数化简（每题5分，共10分）1、用代数法化简为最简与或式Y= A +2、用卡诺图法化简为最简或与式Y= + C +A D，约束条件：A C + A CD+AB=0四、分析下列电路。
数字电子技术期末考试试题及答案(试卷一)
、 代入规则 对偶规则 反
演规则
、
。
5、为 了 实 现 高 的 频 率 稳 定 度 ， 常 采 用 石英晶体
振荡
器 ； 单 稳 态 触 发 器 受 到 外 触 发 时 进 入 暂稳态 态
6、同步 RS 触发器中 R、S 为 高 电平有效，基本 R、S 触发器中 R、S
为低
电平有效
7、在进行 A/D 转换时，常按下面四个步骤进行， 采样 保持 量化 编
码、
、
、。Βιβλιοθήκη 二、选择题（每题 1 分，共 10 分）
1、有八个触发器的二进制计数器，它们最多有（
）种计数状态。
A、8； B、16； C、256； D、64
2、下列触发器中上升沿触发的是（ ）。
A、主从 RS 触发器；B、JK 触发器；C、T 触发器；D、D 触发器
3、下式中与非门表达式为（ d ），或门表达式为（a ）。
数字电子技术期末考试试题及答案（试卷一）
目录
数字电子技术期末考试试题及答案（试卷一） ........................................................................... 1 一、填空题（每空 1 分，共 20 分）.............................................................................................2 二、选择题（每题 1 分，共 10 分）.............................................................................................2 三、判断（每题 1 分，共 10 分）：...............................................................................................3 四、数制转化（每题 2 分，共 10 分）：.......................................................................................3 五、逻辑函数化简（每题 5 分，共 10 分）：...............................................................................3 六、分析电路：（每题 10 分，共 20 分）.....................................................................................4 七、设计电路（共 10 分）.............................................................................................................4 试题答案（一）...............................................................................................................................5
数字电子技术期末考试试题
数字电子技术期末考试试题数字电子技术期末考试试题期末考试试题课程名称《数字电子技术》适用专业自动化、测控考试时间 ( 120 )分钟一、填空题(22分每空2分)A,0,A,1,1、 , 。
2、JK触发器的特性方程为: 。
3、单稳态触发器中,两个状态一个为态，另一个为态.多谐振荡器两个状态都为态，施密特触发器两个状态都为态.4、组合逻辑电路的输出仅仅只与该时刻的有关，而与无关。
5、某数/模转换器的输入为8位二进制数字信号(~D)，输出为D0~25.5V的模拟电压。
若数字信70号的最低位是“1”其余各位是“0”，则输出的模拟电压为。
6、一个四选一数据选择器，其地址输入端有个。
二、化简题(15分每小题5分)用卡诺图化简逻辑函数，必须在卡诺图上画出卡诺圈1) Y(A,B,C,D)=?m(0,1,2,3,4,5,6,7,13,15)2)L(A,B,C,D),m(0,13,14,15)，d(1,2,3,9,10,11) ,,利用代数法化简逻辑函数，必须写出化简过程__________________________________________________3) F(A,B,C),AB，ABC，A(B，AB)三、画图题(10分每题5分)据输入波形画输出波形或状态端波形(触发器的初始状态为0). 1、2、四、分析题(17分)1、分析下图，并写出输出逻辑关系表达式，要有分析过程(6分)2、电路如图所示，分析该电路，画出完全的时序图，并说明电路的逻辑功能，要有分析过程(11分)五、设计题(28分)1、用红、黄、绿三个指示灯表示三台设备的工作情况:绿灯亮表示全部正常;红灯亮表示有一台不正常;黄灯亮表示两台不正常;红、黄灯全亮表示三台都不正常。
列出控制电路真值表，要求用74LS138和适当的与非门实现此电路(20分)2、中规模同步四位二进制计数器74LS161的功能表见附表所示;请用反馈预置回零法设计一个六进制加法计数器。
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一、填空题(每小题△△分,共△△分)(1)逻辑代数中的三种基本的逻辑运算就是(与)运算、(或)运算与(非)运算。
(2)逻辑变量与逻辑函数的取值只有(0)与(1)两种取值。
它们表示两种相反的逻辑状态。
(3)与逻辑运算规则可以归纳为有0出(0),全1出(1)。
(4)或逻辑运算规则可以归纳为有1出(1),全0出(0)。
(5)与非逻辑运算规则可以归纳为有(0)出1,全(1)出0。
(6)或非逻辑运算规则可以归纳为有(1)出0,全(0)出1。
(7)二极管从导通到截止所需时间称为(开通)时间。
(8)OC门就是集电极(开路)门,使用时必须在电源VCC与输出端之间外接(电阻)。
(9)在数字电路中,三极管工作在(饱与)状态与(截止)状态。
(10)三态输出门输出的三个状态分别为(低电平)、(高电平)、(高阻态)。
(11)逻辑代数中三条重要的规则就是(代入)规则、(对偶)规则与(反演)规则。
(12)化简逻辑函数的主要方法有(代数)化简法与(卡诺图)化简法。
(13)逻辑函数的表示方法主要有(函数表达式)、(真值表)、(逻辑)、卡诺图与波形图。
(31)编码器按功能不同分为(二进制)编码器、(二-十进制)编码器与优先编码器。
(32)译码器按功能不同分为(二进制)译码器、(二-十进制)译码器与显示译码器。
(33)8选1数据选择器在所有输入数据都为1时,其输出标准与或表达式共有( 8 )个最小项。
(34)输入3位二进制代码的二进制译码器应有( 8 )个输出端,共输出( 8 )个最小项。
(35)共阳极LED数码管应由输出( 低 )电平的七段显示译码器来驱动点亮。
而共阴极LED数码管应由输出( 高 )电平的七段显示译码器来驱动点亮。
(41)二进制数就是以( 2 )为基数的计数体制,十进制数就是以( 10 )为基数的计数体制,十六进制就是以( 16 )为计数体制。
(42)十进制数转换为二进制数的方法就是:整数部分用(除2取余),小数部分用(乘2取整)法。
(43)二进制数转换为十进制数的方法就是(各位按权展开相加)。
(44)全加器有三个输入端,它们分别为(被加数)、( 加数)与相邻低位进位;输出端有两个,分别为本位与、进位数。
(45)数值比较器的功能就是比较两组二进制数的大小或相等的电路,当输入A=1111与B=1101时,则它们比较得结果为(A>B )。
(51)触发器具有两个稳定状态,在外信号作用下这(两个稳定状态)可相互转换。
(52)边沿JK触发器具有(置0 )、( 置1 )、( 保持)与翻转功能。
(55)在一个CP脉冲作用下,引起触发器两次或多次翻转的现象称为触发器的空翻,触发方式为主从式或边沿式的触发器不会出现这种现象。
(61)对于时序逻辑电路来说,某时刻电路的输出状态不仅取决于该时刻的(输入信号),而且还取决电路的(原有状态),因此,时序逻辑电路具有(记忆)性。
(62)时序逻辑电路由(组合逻辑)电路与(存储)电路两部分组成,(存储)电路必不可少。
(63)计数器按进制分:有二进制计数器、( 十 )进制计数器与任意进制计数器。
(64)集成计数器的清零方式分为(异步置零)与(同步置零);置数方式分为(同步置数)与(同步置数)。
(65)一个4位二进制加法计数器的起始计数状态Q3Q2Q1Q0=1010,当最低位接收到4个计数脉冲时,输出的(1110)。
(72)多谐振荡器没有(稳定)状态,只有两个暂稳态状态,其振荡周期T取决于(RC的值)。
(71)常见的脉冲产生电路有(多谐振荡器),常见的脉冲整形电路有(单稳态触发器)、(施密特触发器)。
(73)施密特触发器具有回差现象,又称(电压滞后)特性;单稳触发器最重要的参数为(脉宽)。
(74)在由555定时器组成的多谐振荡器中,其输出脉冲的周期T 为(0、7(R1+R2)C))。
(75)在由555定时器组成的单稳态触发器中,其输出脉冲宽度t W 为(1、1RC)。
(81)将模拟信号转换为数字信号,需要经过(采用)、(保持)、(量化)、(编码)四个过程。
(82)D ／A 转换器用以将输入的二进制代码转换为相应(模拟电压)输出的电路。
(83)R-2R 倒T 型网络D ／A 转换器主要由(电子模拟开关)、(基准电压)、(R-2R 倒T 型电阻网络) 与(求与运算放大器)等部分组成。
(84)A ／D 转换器从转换过程瞧可分为两类(直接A/D 转换器)与(间接A/D 转换器)两类。
(85)A/D 转换器的位数越多,能分辨最小模拟电压的值就(越小)。
二、判断题(每小题△△分,共△△分;对的打“∨”,错的打“×”)(1)二极管可组成与门电路,但不能组成或门电路。
( × )(2)三态输出门可实现“线与”功能。
( × )(3)二端输入与非门的一个输入端接高电平时,可构成反相器。
( × )(4)74LS00就是2输入端4与非门。
( √ )(5)二端输入或非门的一个输入端接低电平时,可构成反相器。
( √ )(21)逻辑函数的标准与－或表达式又称为最小项表达式,它就是唯一的。
( √ )(22)卡诺图化简逻辑函数的实质时合并相邻最小项。
( √ )(23)因为A AB A =+,所以0=AB 。
( × )(24)因为A B A A =+)(,所以0=+B A 。
( × )(25)逻辑函数BC A Y +=又可以写成))((C A B A Y ++=。
( √ ) (31)优先编码器的编码信号就是相互排斥的,不允许多个编码信号同时有效。
( × )(32)编码与译码就是互逆的过程。
( √ )(33)二进制译码器相当于就是一个最小项发生器,便于实现组合逻辑电路。
(√ )(34)共阴接法发光二极管数码显示器需选用有效输出为高电平的七段显示译码器来驱动。
( √ )(35)数据选择器与数据分配器的功能正好相反,互为逆过程。
( √ )(41)一个n 为二进制数,最高位的权值就是2n-1。
( √ )(42)十进制数45的8421BCD 码就是101101。
( × )(43)余3BCD 码就是用3位二进制数表示一位十进制数。
( × )(44)半加器只考虑1位二进制数相加,不考虑来自低位的进位数。
( √ )(45)数值比较器就是用于比较两组二进制数大小的电路。
( × )(51)RS 触发器的约束条件RS=0表示不允许出现R=S=1的输入。
( √ )(52)主从JK 触发器、边沿JK 触发器与同步JK 触发器的逻辑功能完全相同。
( √ )(53)对边沿JK 触发器,在CP 为高电平期间,当J=K=1时,状态会翻转一次。
( × )(54)若要实现一个可暂停的一位二进制计数器,控制信号A =0计数,A=1保持,可选用T 触发器,且令T=A 。
( × )(55)同步D 触发器在CP =1期间,D 端输入信号变化时,对输出Q 端没有影响。
( × )(61)同步时序电路具有统一的时钟CP 控制。
( √ )(62)十进制计数器由十个触发器组成。
( √ )(63)异步计数器的计数速度最快。
( × )(64)4位二进制计数器也就是一个十六分频电路。
( √ )(65)双向移位寄存器可同时执行左移与右移功能。
( × )(71)施密特触发器可用于将三角波变换成正弦波。
( × )(72)施密特触发器有两个稳态。
( √ )(73)多谐振荡器的输出信号的周期与阻容元件的参数成正比。
( √ )(74)石英晶体多谐振荡器的振荡频率与电路中的R 、C 成正比。
( × )(75)单稳态触发器的暂稳态时间与输入触发脉冲宽度成正比。
( × )(81)D/A 转换器的位数越多,转换精度越高。
( √ )(82)双积分型A/D 转换器的转换精度高、抗干扰能力强,因此常用于数字式仪表中。
( √ )(3)采样定理的规定就是为了能不失真地恢复原模拟信号,而又不使电路过于复杂。
( √ )(84)A / D 转换器完成一次转换所需的时间越小,转换速度越慢。
( × )(85)A/D 转换器的二进制数的位数越多,量化单位△越小。
( √ )三、单项选择题(每小题△△分,共△△分,将对的序号填入括号内,每小题只有一个选项就是对的,多选无效)(1)要使与门输出恒为0,可将与门的一个输入端( A )。
A 、 接0B 、 接1C 、接0、1都可以D 、输入端并联(2)要使或门输出恒为1,可将或门的一个输入端( B )。
A 、 接0B 、 接1C 、接0、1都可以D 、输入端并联(3)要使异或门成为反相器时,则另一个输入端应接( B )。
A 、 接0B 、 接1C 、接0、1都可以D 、两输入端并联(4)集电极开路门(OC 门)在使用时,输出端通过电阻接( B )。
A 、 地B 、 电源C 、 输入端D 、 都不对(5)以下电路中常用于总线应用的有( D )。
A 、 O C 门B 、C M O S 与非门 C 、 漏极开路门D 、 T S L 门(21)指出下列各式中哪个就是3变量ABC 的最小项(B)。
A. AB B 、 ABC C 、 AC D 、 A+B(22)逻辑项D BC A 的逻辑相邻项为( A )A 、 D ABCB 、 ABCDC 、 CD B A D 、 D C AB(23)实现逻辑函数CD AB Y ⋅=需要用( B )A 、 两个与非门B 、 三个与非门C 、 两个或非门D 、 三个或非门(24)使逻辑函数取值)(B A C B A Y +⋅+=为1的变量取值就是( C )A 、 001B 、 101C 、 011D 、 111(25)函数AC BC AB Y +==1与C A C B B A Y ++=2,( D )A 、 互为对偶式B 、 互为反函数C 、 相等D 、 A 、B 、C 都不对(31)若在编码器中有50个编码对象,则要求输出二进制代码位数为( B )位。
A 、5 B.6 C 、10 D 、50(32)一个16选一的数据选择器,其地址输入(选择控制输入)端有( C )个。
A 、1 B.2 C 、4 D 、16(34)用四选一数据选择器实现函数Y =0101A A A A ,应使( A )。
A 、D 0=D 2=0,D 1=D 3=1B 、D 0=D 2=1,D 1=D 3=0C 、D 0=D 1=0,D 2=D 3=1 D 、D 0=D 1=1,D 2=D 3=0(35)八路数据分配器,其地址输入端有( C )个。
A 、1 B.2 C 、3 D 、4 E 、8(41)1010的基数就是( B )A 、10B 、2C 、16D 、任意数(42)二进制数的权值就是( D )A 、10的幂B 、8的幂C 、16的幂D 、2的幂(43)与4位串行进位加法器相比,使用4位超前进位加法器的目的就是(B)A 、完成4位加法运算B 、提高加法运算速度C 、完成串并行加法运算D 、完成加法运算自动进位(44)能对二进制数进行比较的电路就是( A )A 、数值比较器B 、数据分配器C 、数据选择器D 、编码器(45)8位串行进位加法器由( A )A 、8个全加器组成B 、8个半加器组成C 、4个全加器与4个半加器组成D 、16个全加器组成(51)存储8位二进制信息要 D 个触发器。