成贤数字电路实验习题答案
数字电路习题及解答(触发器及时序逻辑电路)
1第8章 触发器和时序逻辑电路——基本习题解答8.4如果D 触发器外接一个异或门，则可把D 触发器转换成T 触发器，试画出其逻辑图。
解：Q n +1=D=T ⊕Q n 故D =T ⊕Q n 如题8.4图所示。
题8.4.图8.5试用T 触发器和门电路分别构成D 触发器和JK 触发器。
解：（1）T 触发器构成D 触发器Q n +1=D =T ⊕Q n ∴T =D ⊕Q n 如题8.5（a ）图所示。
题8.5（a ）图（2）T 触发器构成JK 触发器Q n +1=n n n n Q K Q J Q T Q T +=+=T ⊕Q n ∴T =n n n n n KQ Q J Q Q K Q J +=⊕+)(如题8.5（b ）图所示。
题8.5（b ）图8.6逻辑电路如题8.6图（a ）所示，设初始状态Q 1=Q 2=0，试画出Q 1和Q 2端的输出波形。
时钟脉冲C 的波形如题8.6图（b ）所示，如果时钟频率是4000Hz ，那么Q 1和Q 2波形的频率各为多少？题8.6图（a ） 题8.6图（b ）解：JK 触发器构成了T ′触发器，逻辑电路为异步加法计数，Q 1和Q 2端的输出波形如题CP228.6图（c ）所示。
Q 1输出波形为CP 脉冲的二分频，Q 2输出波形为CP 脉冲的四分频。
如果CP 脉冲频率为4000Hz ，则Q 1波形的频率是2000Hz ；Q 2波形的频率是1000Hz 。
题8.6图（c ）8.8试列出题8.8图所示计数器的状态表，从而说明它是一个几进制计数器。
题8.8图解：F 0：J 0=21Q Q ，K 0=1F 1：J 1=Q 0，K 1=20=Q 0+Q 2 F 2：QJ 2=K 2=1假设初态均为0，分析结果如题8.8图（a ）所示，Q 2Q 1Q 0经历了000-001-010-011-100-101-110七种状态，因此构成七进制异步加法计数器。
题8.8图（a ）8.9试用主从型JK 触发器组成两位二进制减法计数器，即输出状态为“11”、“10”、“01”、Q Q Q3“00”。
数电实验答案及指导
实验一、常用电子仪器的使用一、实验目的1、学习电子技术实验中常用电子仪器的主要技术指标、性能和正确使用方法。
2、初步掌握用示波器观察正弦信号波形和读取波形参数的方法。
电路实验箱的结构、基本功能和使用方法。
二、实验原理在模拟电子电路实验中，要对各种电子仪器进行综合使用，可按照信号流向，以接线简捷，调节顺手，观察与读数方便等原则进行合理布局。
接线时应注意，为防止外界干扰，各仪器的公共接地端应连接在一起，称共地。
1．信号发生器信号发生器可以根据需要输出正弦波、方波、三角波三种信号波形。
输出信号电压频率可以通过频率分挡开关、频率粗调和细调旋钮进行调节。
输出信号电压幅度可由输出幅度调节旋钮进行连续调节。
操作要领：1）按下电源开关。
2）根据需要选定一个波形输出开关按下。
3）根据所需频率，选择频率范围（选定一个频率分挡开关按下）、分别调节频率粗调和细调旋钮，在频率显示屏上显示所需频率即可。
4）调节幅度调节旋钮，用交流毫伏表测出所需信号电压值。
注意：信号发生器的输出端不允许短路。
2．交流毫伏表交流毫伏表只能在其工作频率范围内，用来测量300伏以下正弦交流电压的有效值。
操作要领：1）为了防止过载损坏仪表，在开机前和测量前（即在输入端开路情况下）应先将量程开关置于较大量程处，待输入端接入电路开始测量时，再逐档减小量程到适当位置。
2）读数：当量程开关旋到左边首位数为“1”的任一挡位时，应读取0～10标度尺上的示数。
当量程开关旋到左边首位数为“3”的任一挡位时，应读取0～3标度尺上的示数。
3）仪表使用完后，先将量程开关置于较大量程位置后，才能拆线或关机。
3．双踪示波器示波器是用来观察和测量信号的波形及参数的设备。
双踪示波器可以同时对两个输入信号进行观测和比较。
操作要领：1）时基线位置的调节开机数秒钟后，适当调节垂直（↑↓）和水平（←→）位移旋钮，将时基线移至适当的位置。
2）清晰度的调节适当调节亮度和聚焦旋钮，使时基线越细越好（亮度不能太亮，一般能看清楚即可）。
数电习题册答案
数电习题册答案数字电子技术是电子工程领域中的一个重要分支，它主要研究数字信号的产生、处理和应用。
在数字电子技术的学习过程中，解决习题是巩固理论知识和提高实践能力的重要手段。
以下是一些数字电子技术习题的解答示例，供学习参考。
习题一：逻辑门的实现题目：使用基本逻辑门实现一个逻辑表达式A+B（A OR B）。
解答：要实现逻辑表达式A+B，我们可以使用一个或门（OR gate）。
或门的特点是只要输入端中至少有一个为高电平（1），输出端就为高电平。
因此，将A和B分别作为或门的输入端，输出端即为A+B的结果。
电路图：```A B| | 1| | |-- 1```习题二：组合逻辑电路设计题目：设计一个组合逻辑电路，其输出Z只有在输入A、B、C三个变量中至少有两个为1时才为1。
解答：要实现这个逻辑功能，我们可以使用与门（AND gate）和或门（OR gate）的组合。
首先，我们分别计算A和B、B和C、A和C的与，然后将这三个结果通过一个或门来实现最终的输出。
电路图：```A B A C| | -| | || | | | |-- -- 1B C B C| | | || | | |-- --```习题三：触发器的应用题目：使用D触发器设计一个二进制计数器，使其能够实现模4计数。
解答：D触发器是一种基本的存储单元，其输出在时钟信号的上升沿时与输入D相等。
要设计一个模4计数器，我们可以使用两个D触发器，通过反馈连接实现计数功能。
电路图：```++| | Q1| D | || | || | +-(与非门)-+++ | |++ | || | Q0 +-(与非门)-+| D | | | || | | | |++ ++ ++ ++| | | | | | || | | | | | |A B C D E FG```习题四：时序逻辑电路分析题目：分析以下JK触发器构成的时序逻辑电路的输出序列，假设初始状态为00。
```J1 K1 Q1| | | || | | |-- | |J0 K0 Q0```解答：JK触发器的输出Q在下一个时钟周期由J和K的组合决定。
数字电路习题答案-第三章
ABCD F
1000 1 1001 1 1010 Ø 1011 Ø 1100 Ø 1101 Ø 1110 Ø 1111 Ø
CD
AB
00
01
11
10
00
01
1
1
1
11
φ
φ
φ
φ
10
1
1
φ
φ
F = A + BD + BC=A · BD · BC (3)画逻辑电路，如下图所示：
D
&
B
&
C
所以，此时电路中存在功能冒险。
2.当 ABCD 从 1000 向 1101 变化时： 先判断是否有功能冒险，函数 F 的卡诺图如下图所
ABCD00 01 11 10 00 1
01 1
1
11 1 1 1 1
10 1 1 1
示： (1) F(1,0,0,0)=F(1,1,0,1)； (2) 有 2 个变量同时变化； (3) AC对应的卡诺圈中全部为“1”； 所以，此时电路中不存在功能冒险。 再判断是否有逻辑冒险：
10 1 1 Ø = ABC·CD·AB·AD
画逻辑电路，如下图所示：
C&
D
A&
B
A&
D
A B
&
C
&
F
3.9 人的血型有 A、B、AB、O 四种。输血时输血者的血型与受血者的血型必须符合图 P3.4 中箭头指示的授受关系。试设计一个逻辑电路，判断输血者与受血者的血型是否符合上述规 定。 解：设00代表血型A、01代表血型B、10代表血型AB、11代表血型O。输血者的血型用逻辑 变量WX表示，受血者的血型用YZ表示，则由图中所指示的授受关系，列真值表：
数字电路(逻辑函数及其化简)单元测试与答案
一、单选题1、当反相器的输入为高电平1时，输出是A.高电平或者0B.高电平或者1C.低电平或者1D.低电平或者0正确答案：D2、反相器执行的运算称为A.确定B.求反码或者反相C.反相D.求反码正确答案：B3、与门的输入为A、B、C，输出何时为1（高电平）。
A.A=1，B=0, C=0B.A=1，B=0, C=1C.A=1，B=1, C=1D.A=0，B=0, C=0正确答案：C4、或门的输入为A、B、C，输出何时为1（高电平）。
A.A=1，B=1，C=1B.A̅=1，B=0，C=0C.（A=0，B=0，C=1）或者（A=0，B=0，C=1）或者（A=0，B=0，C=0）D.A=0，B=0，C̅=1正确答案：A5、能够实现“有0出1，全1为0”规律的运算是A.或非运算B.与运算C.或运算D.与非运算正确答案：D6、0⊕X=?A. X̅B.0C.XD.1正确答案：C7、八位信号10110010的偶校验码为A.0B.8C.不能确定D.1正确答案：A8、X̅+XY̅满足( )定律的形式。
A.反演律B.吸收律C.结合律D.交换律正确答案：B9、“0换成1,1换成0，与换成或，或换成与，变量不变”是( )规则的口诀。
A.都不是B.代入规则C.反演规则D.对偶规则正确答案：D10、“0换成1,1换成0，与换成或，或换成与，原变量换成反变量，反变量换成原变量”是( )规则的口诀。
A.代入规则B.都不是C.对偶规则D.反演规则正确答案：D11、Y=A⊕B实现至少需使用( )个两输入与非门。
A.3B.4C.5D.6正确答案：B12、Y=A⊕B实现至少需使用（）个两输入或非门。
A.3B.4C.5D.6正确答案：C̅̅̅̅̅̅̅+AC+BC可以化简为13、L=A+BA.已经最简，不能再简化B.L=A̅∙B̅+C̅̅̅̅+CC. L=ABD.L=AB+AC+BC正确答案：B14、L(A,B,C,D)=B⊙D+A+C+C̅∙D̅+A̅∙B̅可以化简为A.L=ABCDB.L=A+B+C+DC.1D.0正确答案：C15、L(C,A,B)的最小项m6是A.A̅BCB. A̅CB̅C. ABC̅D. AB̅C正确答案：D16、下列数量的最小项，有可能合并成一项的是A.6B.3C.5D.4正确答案：D17、逻辑函数L（D,B,A,C）的变量C̅在其卡诺图的什么位置A.右边两列B.左边两列C.两边两列D.中间两列正确答案：C18、四变量逻辑函数的m13对应卡诺图中的哪一格A.第三行第二列B.第四行第二列C.第一行第三列D.第二行第四列正确答案：A19、有可能合并化简的情况是A.9个小方格B.4个小方格C.6个小方格D.以上都对正确答案：B20、卡诺图中的圈之间应A.相与非B.相或C.相与D.相异或正确答案：B21、化简时，能够作出更大的圈时，无关项应看作A.1B.0C.两者皆不可D.两者皆可正确答案：A22、L(A,B,C,D)=∑(2,5,6,13,14)m +∑(7,9,10,15)m的卡诺图中有( )个无关项A.5B.2C.4D.15正确答案：C二、多选题1、一个三输入A、B、C与门，若输出为0，可能的输入为A.A=1，B=1，C=0B.A=1，B=1，C=1C.A=0，B=0，C=1D.A=0，B=0，C=0正确答案：A、C、D2、一个三输入A、B、C或门，若输出为1，可能的输入为A.A=1，B=1，C=0B.A=0，B=0，C=0C.A=1，B=1，C=1D.A=0，B=0，C=1正确答案：A、C、D3、常用的复合逻辑运算有A.与非运算B.异或运算C.非运算D.或非运算正确答案：A、B、D4、下列命题中，正确的有A.逻辑运算没有优先级B.非运算的优先级最高C.或运算的优先级高于与运算D.与运算的优先级高于异或运算正确答案：B、D5、逻辑函数的常用表示方法有A.逻辑图B.表达式C.真值表D.伏安特性曲线正确答案：A、B、C6、A和B互补的充分必要条件是A.AB=1B.AB=0C.A+B=1D.A+B=0正确答案：B、C7、利用反演规则求反函数时，应注意A.原函数中的反变量换成原变量，原变量则保持不变B.多个变量之上的非号位置不变C.原函数中的原变量换成反变量，反变量则保持不变D.不能改变原函数的运算顺序正确答案：B、D8、下列说法正确的有A.X ̅∙Y̅和XY不是互补的。
数电实验报告答案
实验名称：数字电路基础实验实验目的：1. 熟悉数字电路的基本原理和基本分析方法。
2. 掌握数字电路实验设备的使用方法。
3. 培养动手实践能力和分析问题、解决问题的能力。
实验时间：2023年X月X日实验地点：实验室XX室实验仪器：1. 数字电路实验箱2. 万用表3. 双踪示波器4. 数字信号发生器5. 短路线实验内容：一、实验一：基本逻辑门电路实验1. 实验目的- 熟悉与门、或门、非门的基本原理和特性。
- 学习逻辑门电路的测试方法。
2. 实验步骤- 连接实验箱，设置输入端。
- 使用万用表测量输出端电压。
- 记录不同输入组合下的输出结果。
- 分析实验结果，验证逻辑门电路的特性。
3. 实验结果与分析- 实验结果与理论预期一致，验证了与门、或门、非门的基本原理。
- 通过实验，加深了对逻辑门电路特性的理解。
二、实验二：组合逻辑电路实验1. 实验目的- 理解组合逻辑电路的设计方法。
- 学习使用逻辑门电路实现组合逻辑电路。
2. 实验步骤- 根据设计要求，绘制组合逻辑电路图。
- 连接实验箱，设置输入端。
- 测量输出端电压。
- 记录不同输入组合下的输出结果。
- 分析实验结果，验证组合逻辑电路的功能。
3. 实验结果与分析- 实验结果符合设计要求，验证了组合逻辑电路的功能。
- 通过实验，掌握了组合逻辑电路的设计方法。
三、实验三：时序逻辑电路实验1. 实验目的- 理解时序逻辑电路的基本原理和特性。
- 学习使用触发器实现时序逻辑电路。
2. 实验步骤- 根据设计要求，绘制时序逻辑电路图。
- 连接实验箱，设置输入端和时钟信号。
- 使用示波器观察输出波形。
- 记录不同输入组合和时钟信号下的输出结果。
- 分析实验结果，验证时序逻辑电路的功能。
3. 实验结果与分析- 实验结果符合设计要求，验证了时序逻辑电路的功能。
- 通过实验，加深了对时序逻辑电路特性的理解。
四、实验四：数字电路仿真实验1. 实验目的- 学习使用数字电路仿真软件进行电路设计。
数字电子技术课后习题答案(全部)
第一章数制与编码1.1自测练习1.1.1、模拟量数字量1.1.2、（b）1.1.3、（c）1.1.4、（a）是数字量，（b）（c）（d）是模拟量1.2 自测练习1.2.1. 21.2.2.比特bit1.2.3.101.2.4.二进制1.2.5.十进制1.2.6.（a）1.2.7.（b）1.2.8.（c）1.2.9.（b）1.2.10.（b）1.2.11.（b）1.2.12.（a）1.2.13.（c）1.2.14.（c）1.2.15.（c）1.2.16.11.2.17.111.2.18.1.2.19.11011.2.20.8进制1.2.21.（a）1.2.22.0，1，2，3，4，5，6，71.2.23.十六进制1.2.24.0，1，2，3，4，5，6，7，8，9，A，B，C，D，E，F 1.2.25.（b）1.3自测练习1.3.1.1221.3.2.675.521.3.3.011111110.011.3.4.521.3.5.1BD.A81.3.6.1111.11101.3.7.38551.3.8.28.3751.3.9.100010.111.3.10.135.6251.3.11.570.11.3.12.120.51.3.13.2659.A1.4自测练习1.4.1.BCD Binaryl二—十进制码1.4.2.（a）1.4.3.（b）1.4.4.8421BCD码，4221BCD码，5421BCD1.4.5.（a）1.4.6.011001111001.10001.4.7.111111101.4.8.101010001.4.9.111111011.4.10.61.051.4.11.01011001.011101011.4.12.余3码1.4.13.XS31.4.14.XS31.4.15.1000.10111.4.16.1001100000111.4.17.521.4.18.110101.4.19.0101111.4.20.（b）1.4.21.ASCII1.4.22.（a）1.4.23.ASCII h ange美准码EBCDICExtende d BinaryCoded Decimal Interch ange Code 扩展二-十进制 1.4.24.10010111.4.25.ASCII1.4.26.（b）1.4.27.(b)1.4.28.110111011.4.29.-1131.4.30.+231.4.31.-231.4.32.-861.5 自测练习 1.5.1 略 1.5.2 11011101 1.5.3 01000101 1.5.4 11100110 补码形式 1.5.5 01111101 1.5.6 10001000 补码形式 1.5.7 11100010 补码形式 习题1.1 （a ）（d ）是数字量，（b ）（c ）是模拟量，用数字表时（e ）是数字量，用模拟表时（e ）是模拟量1.2 （a ）7, （b ）31, （c ）127, （d ）511, （e ）40951.3 （a ）22104108⨯+⨯+， （b ）26108108⨯+⨯+，（c ）321102105100⨯+⨯+⨯+（d ）322104109105⨯+⨯+⨯+1.4 （a ）212121⨯+⨯+, （b ）4311212121⨯+⨯+⨯+, （c ）64212+12+12+12+1⨯⨯⨯⨯（d ）9843212+12+12+12+12⨯⨯⨯⨯⨯ 1.5 2201210327.15310210710110510--=⨯+⨯+⨯+⨯+⨯,3210-1-221011.0112+02+12+12+02+12=⨯⨯⨯⨯⨯⨯, 210-18437.448+38+78+48=⨯⨯⨯⨯, 10-1-2163A.1C 316+A 16+116+C 16=⨯⨯⨯⨯1.6 （a ）11110, （b ） ,（c ） , （d ）1011 1.7 （a ） 0, （b ） 1111 1.8 110102 = 2610, 1011.0112 = 11.37510， 57.6438 = 71.81835937510， 76.EB 16 = 118.7510 1.9 1101010010012 = 65118 = D4916，0.100112 = 0.468 = 0.9816，1011111.011012 =137.328 = 5F.68161.10 168 = 1410，1728 = 12210，61.538 = 49.671875， 126.748 = 86.937510 1.11 2A 16 = 4210 = 2 = 528， B2F 16 = 286310 = 2 = 54578，D3.E 16 = 211.87510 = 11.11102 = 323.78， 1C3.F916 = 451 2510 = 011.111110012 = 703.76281.12 （a ）E, （b ）2E, （c ）1B3, （d ）349 1.13 （a ）22, （b ）110, （c ）1053, （d ）2063 1.14 （a ）4094, （b ）1386, （c ）49282 1.15 （a ）23, （b ）440, （c ）2777 1.16 198610 = = 00011001100001108421BCD ， 67.31110 = 1.010012 = 01100111.0011000100018421BC D ，1.183410 = 1.0010112 = 0001.00011000001101008421BCD ， 0.904710 = 0.1110012 = 0000.10010000010001118421BCD1.17 1310 = 000100118421B CD = 01000110XS3 = 1011Gra y， 6.2510 = 0110.001001018421B CD = 1001.01011000XS3 = 0101.01Gray，0.12510= 0000.000100100101 = 0011.010001101000X S3 = 0.001 Gray8421BCD1.18 101102= 11101 Gray，0101102 = 011101 Gray1.19 110110112 = 0010000110018421BCD，45610 = 0100010101108421BCD，1748=0010011101008421BCD，2DA16 = 0111001100008421BCD，101100112421B CD = 010100118421B CD，11000011XS3 = 100100008421B CD1.20 0.0000原= 0.0000反= 0.0000补，0.1001原= 0.1001反= 0.1001补，11001原=10110反=10111补1.21 010100原= 010100补，101011原= 110101补，110010原= 101110补，100001原=111111补1.22 1310 = 00001101补，11010 = 01101110补，-2510 = 11100111补，-90 = 10100110补1.23 01110000补= 11210，00011111补= 3110，11011001补= -3910，11001000补= -56101.24 100001110000011010101101010010010011001111 1001110010000101000001001000 1101001 1100111 1101000 0100000 1010110 1101111 1101100 1110100 1100001 1100111 11001011.25 010001010110000100000011110101000000110010 01101010101111101100101000101.26 BEN SMITH1.27 00000110 100001101.28 01110110 10001110第二章逻辑门1.1 自测练习2.1.1. （b）2.1.2. 162.1.3. 32, 62.1.4. 与2.1.5. （b）2.1.6. 162.1.7. 32, 62.1.8. 或2.1.9. 非2.1.10. 12.2 自测练习2.2.1. F A B=⋅2.2.2. (b)2.2.3. 高2.2.4. 322.2.5. 16，52.2.6. 12.2.7. 串联2.2.8. (b)2.2.9. 不相同2.2.10. 高2.2.11. 相同2.2.12. (a)2.2.13. (c)2.2.14. 奇2.3 自测练习2.3.1. OC，上拉电阻2.3.2. 0，1，高阻2.3.3. （b）2.3.4. （c）2.3.5. F A B=⋅, 高阻2.3.6. 不能2.4 自测练习1.29 TTL，CMOS1.30 Transis itor Transis tor Logic1.31 Complem entary Metal Oxide Semicod uctor1.32 高级肖特基TT L， 高级 肖特基T TL1.33 高，强，小1.34 （c）1.35 （b）1.36 （c）1.37 大1.38 强1.39 （a）1.40 （a）1.41 （b）1.42 高级肖特基TT L1.43 （c）习题2.1 与，或，与2.2 与门，或门，与门2.3 （a）F=A+B, F=AB （b）F=A+B+C, F=ABC （c）F=A+B+C+D, F=ABCD2.4 （a ）0 （b ）1 （c ）0 （d ）0 2.5 （a ）0 （b ）0 （c ）1 （d ）0 2.6 （a ）1 （b ）1 （c ）1 （d ）1 2.7 （a ）4 （b ）8 （c ）16 （d ）32 2.8 （a ）3 （b ）4 （c ）5 （d ）6 2.9 （a ）（b ） A B C D F 0 0 0 0 1 0 0 0 1 0 0 0 1 0 0 0 0 1 1 1 0 1 0 0 0 0 1 0 1 1 0 1 1 0 1 0 1 1 1 0 1 0 0 0 0 1 0 0 1 1 1 0 1 0 1 1 0 1 1 0 1 1 0 0 1 1 1 0 1 0 1 1 1 0 0 1 11112.10 Y AB AC =+2.11A B C Y 0 0 0 0 0 0 1 0 011A B C F 0 0 0 0 0 0 1 1 0 1 0 1 0 1 1 0 1 0 0 1 1 0 1 0 1 1 0 0 11110 1 1 11 0 0 01 0 1 11 1 0 01 1 1 12.122.13F1 = A(B+C), F2=A+BCA B C F1F20 0 0 0 00 0 1 0 00 1 0 0 00 1 1 0 11 0 1 1 11 0 0 0 11 1 0 1 11 1 1 1 12.142.15 （a）0 （b）1 （c）1 （d）02.16 （a）1 （b）0 （c）0 （d）12.17 （a）0 （b）02.18=⋅⋅⋅2.19 Y AB BC DE F=⋅⋅2.20 Y AB CD EF2.21 102.22 402.23 当TTL反相器的输出为3V，输出是高电 ，红灯亮。
数电实验思考题答案
实验一 TTL 逻辑门电路 和组合逻辑电路1． Y 4具有何种逻辑功能？答：为异或门。
2． 在实际应用中若用74LS20来实现Y=AB 时，多余的输入端应接高电平还是低电平？答：多余的输入端应接高电平3． 在全加器电路中，当A i =0，S i *=1，C i =1时C i-1=？答：C i-1=1实验二 组合逻辑电路的设计1． 通过实验你觉得用小规模集成电路和中规模集成电路来设计组合逻辑电路哪个更方便些？答：中规模集成电路来设计组合逻辑电路更方便。
2． 能否以一片74LS151为核心来设计全加器？答：不能以一片74LS151为核心来设计全加器。
3． 以74LS138和门电路来设计全减器，选用TTL 或CMOS 门电路那种更合适？ 答：选用TTL 门电路。
实验三 触发器的逻辑功能测试及移位寄存器1．在图3-1中经过一个CP 脉冲后，JK 触发器为何种状态？ 答：JK 触发器为“1”态。
2．用74LS76的JK 触发器转换成的D 触发器与74LS74的D 触发器在工作中有什么不同之处？ 图3-1答：前者在时钟脉冲后沿触发翻转，后者在时钟脉冲前沿触发翻转。
3．移位寄存器如果采用串行输出方式应从哪里输出？需送几个脉冲才能把“1101”取出？ 答：移位寄存器如果采用串行输出方式应从Q 3输出。
需送八个脉冲才能把“1101” 取出。
实验四 计数器（1）1．将图4-1作什么样的改变，即可构成四位异步二进制减法计数器？答： 将低位触发器的输出端Q 接到高位触发器的时钟输入端即可。
2．图4-2中由JK 触发器构成的计数器是几进制计数器？答： 三进制计数器。
3．以74LS74为核心构成九进制计数器，至少要用几片74LS74？答：至少要用两片74LS74集成片。
1实验五计数器（2）1．异步置零和同步置零的区别在哪里？答：所谓异步置零即当置零信号一到计数器立即置零。
若置零信号到还需经一个时钟脉冲后计数器才能置零即为同步置零。
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数字电路习题答案(第一、二次实验)
2009-12-18 09:10
实验一：
1. 在示波器处于“内触发”、“常态”扫描方式时，若改变电压灵敏度（V/div）,特别是降低它，则可能会使信号波形消失。
问若是“外触发”，是否也会影响信号波形的显示呢？
解：这道题主要从以下几种情况来分析：
A．示波器是“内触发”，而误打到“外触发”的情况下，如果是“自动”扫描方式，示波器有波形显示，但是不会稳定；如果是“常态”扫描方式，示波器没有波形显示；
B．示波器确实是“外触发”，则要求外触发信号与被测信号的频率和相位都相关，这时波形才有可能稳定。
C．示波器在“外触发”工作时，若改变电压灵敏度，会影响波形的显示。
当扫描方式为“常态”时，如果降低它，可能会使波形消失，原因是降低了电压灵敏度的同时也降低了触发信号的电平，当触发电平降低到一定的程度，就不足以使触发器工作，触发器不工作，扫描发生器也就不能工作产生扫描电压，波形就消失了。
2. 实验内容3中，如何用示波器观察CH1+CH2的波形？
解：要观察CH1+CH2的波形，只要使示波器的显示方式处于“叠加”，同时保证CH1和CH2的电压灵敏度保持一致就可以了。
3. 简述用示波器测量TTL高、低电平的步骤。
解：将函数发生器输出TTL波形（f=1kHz）接到示波器一个通道上；示波器扫描方式打“AUTO”；电压灵敏度选择旋钮和时基因数选择旋钮处于适当的位置（比如1V/div和0.2ms/div）；微调旋钮都处于“校准”位置；把输入耦合方式打到“GND”，确定零电平线的位置，再打到“DC”，读出高低电平值。
4. 对于方波和三角波，交流毫伏表的指示值是否它们的有效值？如何根据交流毫伏表的指示值求得方波或三角波的有效值？
解：对于方波和三角波，交流毫伏表的指示值不是他们的有效值。
先由指示值除以1.11得到它们的平均值，然后根据平均值和有效值的关系求到有效值。
U方=U平，U三=1.15U平。
实验二
1. 由实验结果总结以上各门电路的逻辑关系，画出真值表、逻辑图，写出表达式。
解：74LS00 四2输入与非门
74LS86 四2输入异或门‘
2 . 简述与非门对脉冲的控制作用。
解：与非门一个输入端输入脉冲，另一个输入端为控制端，当控制端输入0时，输出为高电平；当控制端输入1时，脉冲反相输出。
3. 与非门的输出端能否接高电平？为什么？与非门、或非门的多余输入端应如何处理？
解：与非门的输出端不能接高电平。
原因：若与非门输出端输出为低电平，在高电平与输出端之间形成一低阻通路，从而产生很大的电流，有可能导致器件损毁。
与非门多余输入端的处理：a.悬空；b.接高电平；c. 与有用输入端并联使用；d.接高值电阻（几百欧以上）到地。
或非门多余输入端的处理：a.接地；b.接小值电阻（两百欧以下）到地。
4. 总结74LS86逻辑功能并分析结果。
解：74LS86逻辑功能是相同为0，相异为1。
当一个输入端为0时，输出与另一输入相同（原码输出）；当一个输入端为1时，输出与另一输入相反（反码输出）。
实验三
1. 用OC门时是否需要外接其它元件？如果需要，此元件应如何取值？
解：用OC门只有在外接负载电阻Rc和电源Ec后才能正常工作。
2. 几个OC门的输出端是否允许短接？
解：允许短接。
3. 几个三态门的输出端是否允许短接？有没有条件限制？应注意什么问题？
解：三态门的输出端允许短接，但是有条件限制，需要注意在单向总线方式下，要求只有需要传输信息的那个三态门的控制端处于使能状态，其余各门皆处于禁止状态。
实验四：
1. 简述组合逻辑电路分析方法。
解：（1）由逻辑图写出各输出端的逻辑表达式；
（2）化简和变换各逻辑表达式；
（3）列出真值表；
（4）根据真值表和逻辑表达式对逻辑电路进行分析，最后确定其功能。
2. 简述组合逻辑电路的设计方法。
解：（1）根据实际问题对电路逻辑功能的要求，定义输入输出变量，要求把变量取1值的含义表达清楚；
（2）列出真值表；
（3）由真值表写出逻辑表达式；
（4）简化和变换逻辑表达式（注意消除竞争冒险现象）；
（5）画出逻辑电路图。
3. 试设计一个4位的奇校验电路，当4位数中有奇数个时输出为1，反之为0，并选择元件。
（要有设计过程）
实验五
1. 普通四位二进制与一位8421BCD码的设计方案有什么不同？
解：普通四位二进制有0000~1111十六种状态；一位8421BCD码只有0000~1001十个状态有效，后六个状态是无关项，在圈卡诺图的时候，既可以圈为0，也可以圈为1。
2. 信号波形如图2-2-3所示，这些干扰信号是否属于冒险现象？
解：不属于，图中信号波形虽然受干扰了，但是一直保持是高电平。
而冒险现象会使逻辑电路产生错误的输出状态。
3. 在实验内容4中，如何选择两个自变量的组合与血型的对位关系，使得电路最简？解：将O型血和AB型血定义为00和11或者11和00，可以使电路最简。
实验六
1. 数据选择器是一种通用性很强的功能件，它的功能很容易得到扩展。
如何用4选1数据选择器实现8选1选择器功能？
解：
2．如何将两个3线-8线译码器组合成一个4线-16线的译码器？解：
实验七
1. 触发器实现正常逻辑功能状态时，S和R应处于什么状态？悬空行不行？
解：触发器实现正常逻辑功能状态时，S和R应处于高电平状态，不能悬空。
2. 设计广告流水灯，用一个3位二进制异步加计数器，后面再接一个三线—八线译码器，是否可行？
解：可行，课上讲的用三个JK触发器或三个D触发器设计的3位二进制异步加计数器，后面再接一个74138就可以。
实验八：
1. 如何用示波器观察实验内容中第⑤项及第⑥项中各个波形的相互关系？对⑤和⑥中的一组波形，分别应选哪个波形作为触发扫描同步信号？
解：用示波器双踪显示，先对照CP分别观察一下Q1、Q2、Q3、Q4，了解一下计数器四个输出端波形的大概形状，然后参照Q3或Q4,记录波形。
在选择触发扫描同步信号的时候，必须选择CH1或CH2，使得两波形双踪显示时能够稳定。
2. 用CD4518设计一个27进制计数器。
解：（27）10=（0010，0111）B
复位端。