PCB设计技巧疑难解析
2、如何避免高频干扰？
避免高频干扰的基本思路是尽量降低高频信号电磁场的干扰，也就是所谓的串扰(Crosstalk)。可用拉大高速信号和模拟信号之间的距离，或加ground guard/shunt traces 在模拟信号旁边。还要注意数字地对模拟地的噪声干扰。
3、在高速设计中，如何解决信号的完整性问题？
信号完整性基本上是阻抗匹配的问题。而影响阻抗匹配的因素有信号源的架构和输出阻抗(output impedance)，走线的特性阻抗，负载端的特性，走线的拓朴(topology)架构等。解决的方式是靠端接(termination)与调整走线的拓朴。
4、差分布线方式是如何实现的？
差分对的布线有两点要注意，一是两条线的长度要尽量一样长，另一是两线的间距(此间距由差分阻抗决定)要一直保持不变，也就是要保持平行。平行的方式有两种，一为两条线走在同一走线层
(side-by-side)，一为两条线走在上下相邻两层(over-under)。一般以前者side-by-side 实现的方式较多。
5、对于只有一个输出端的时钟信号线，如何实现差分布线？
要用差分布线一定是信号源和接收端也都是差分信号才有意义。所以对只有一个输出端的时钟信号是无法使用差分布线的。
6、接收端差分线对之间可否加一匹配电阻？
接收端差分线对间的匹配电阻通常会加, 其值应等于差分阻抗的值。这样信号品质会好些。
7、为何差分对的布线要靠近且平行？
对差分对的布线方式应该要适当的靠近且平行。所谓适当的靠近是因为这间距会影响到差分阻抗(differential impedance)的值, 此值是设计差分对的重要参数。需要平行也是因为要保持差分阻抗的一致性。若两线忽远忽近, 差分阻抗就会不一致, 就会影响信号完整性(signal integrity)及时间延迟(timingdelay)。
8、如何处理实际布线中的一些理论冲突的问题
1. 基本上, 将模/数地分割隔离是对的。要注意的是信号走线尽量不要跨过有分割的地方(moat), 还有不要让电源和信号的回流电流路径(returning current path)变太大。
2. 晶振是模拟的正反馈振荡电路, 要有稳定的振荡信号, 必须满足loop gain 与phase的规范,而这模拟信号的振荡规范很容易受到干扰, 即使加ground guard traces 可能也无法完全隔离干扰。而且离的太远, 地平面上的噪声也会影响正反馈振荡电路。所以, 一定要将晶振和芯片的距离进可能靠近。
3. 确实高速布线与EMI 的要求有很多冲突。但基本原则是因EMI 所加的电阻电容或ferritebead, 不能造成信号的一些电气特性不符
合规范。所以, 最好先用安排走线和PCB 叠层的技巧来解决或减少EMI 的问题, 如高速信号走内层。最后才用电阻电容或ferrite bead 的方式, 以降低对信号的伤害。
9、如何解决高速信号的手工布线和自动布线之间的矛盾？
现在较强的布线软件的自动布线器大部分都有设定约束条件来控制绕线方式及过孔数目。各家EDA 公司的绕线引擎能力和约束条件的设定项目有时相差甚远。例如, 是否有足够的约束条件控制蛇行线(serpentine)蜿蜒的方式, 能否控制差分对的走线间距等。这会影响到自动布线出来的走线方式是否能符合设计者的想法。另外, 手动调整布线的难易也与绕线引擎的能力有绝对的关系。例如, 走线的推挤能力, 过孔的推挤能力, 甚至走线对敷铜的推挤能力等等。所以, 选择一个绕线引擎能力强的布线器, 才是解决之道。
10、关于test coupon。
test coupon 是用来以TDR (Time Domain Reflectometer) 测量所生产的PCB 板的特性阻抗是否满足设计需求。一般要控制的阻抗有单根线和差分对两种情况。所以， test coupon 上的走线线宽和线距(有差分对时)要与所要控制的线一样。最重要的是测量时接地点的位置。为了减少接地引线(ground lead)的电感值， TDR 探棒(probe)
接地的地方通常非常接近量信号的地方(probe tip)，所以， test coupon 上量测信号的点跟接地点的距离和方式要符合所
用的探棒。
11、在高速PCB 设计中，信号层的空白区域可以敷铜，而多个信号层的敷铜在接地和接电源上应如何分配？
一般在空白区域的敷铜绝大部分情况是接地。只是在高速信号线旁敷铜时要注意敷铜与信号线的距离，因为所敷的铜会降低一点走线的特性阻抗。也要注意不要影响到它层的特性阻抗，例如在dual stripline 的结构时。
12、是否可以把电源平面上面的信号线使用微带线模型计算特性阻抗？电源和地平面之间的信号是否可以使用带状线模型计算？
是的，在计算特性阻抗时电源平面跟地平面都必须视为参考平面。例如四层板: 顶层-电源层-地层-底层，这时顶层走线特性阻抗的模型是以电源平面为参考平面的微带线模型。
13、在高密度印制板上通过软件自动产生测试点一般情况下能满足大批量生产的测试要求吗？
一般软件自动产生测试点是否满足测试需求必须看对加测试点的规范是否符合测试机具的要求。另外，如果走线太密且加测试点的规范
PCB板布线技巧
PCB板布线技巧 在PCB设计中，布线是完成产品设计的重要步骤，可以说前面的准备工作都是为它而做的，在整个PCB中，以布线的设计过程限定最高，技巧最细、工作量最大。PCB布线有单面布线、双面布线及多层布线。布线的方式也有两种：自动布线及交互式布线，在自动布线之前，可以用交互式预先对要求比较严格的线进行布线，输入端与输出端的边线应避免相邻平行，以免产生反射干扰。必要时应加地线隔离，两相邻层的布线要互相垂直，平行容易产生寄生耦合。 自动布线的布通率，依赖于良好的布局，布线规则可以预先设定，包括走线的弯曲次数、导通孔的数目、步进的数目等。一般先进行探索式布经线，快速地把短线连通，然后进行迷宫式布线，先把要布的连线进行全局的布线路径优化，它可以根据需要断开已布的线。并试着重新再布线，以改进总体效果。 对目前高密度的PCB设计已感觉到贯通孔不太适应了，它浪费了许多宝贵的布线通道，为解决这一矛盾，出现了盲孔和埋孔技术，它不仅完成了导通孔的作用，还省出许多布线通道使布线过程完成得更加方便，更加流畅，更为完善，PCB 板的设计过程是一个复杂而又简单的过程，要想很好地掌握它，还需广大电子工程设计人员去自已体会，才能得到其中的真谛。 1 电源、地线的处理 既使在整个PCB板中的布线完成得都很好，但由于电源、地线的考虑不周到而引起的干扰，会使产品的性能下降，有时甚至影响到产品的成功率。所以对电、地线的布线要认真对待，把电、地线所产生的噪音干扰降到最低限度，以保证产品的质量。 对每个从事电子产品设计的工程人员来说都明白地线与电源线之间噪音所产生的原因，现只对降低式抑制噪音作以表述： 众所周知的是在电源、地线之间加上去耦电容。 尽量加宽电源、地线宽度，最好是地线比电源线宽，它们的关系是：地线＞电源线＞信号线，通常信号线宽为：0.2～0.3mm,最经细宽度可达0.05～0.07mm,电源线为1.2～2.5 mm 对数字电路的PCB可用宽的地导线组成一个回路, 即构成一个地网来使用(模拟电路的地不能这样使用) 用大面积铜层作地线用,在印制板上把没被用上的地方都与地相连接作为地线用。或是做成多层板，电源，地线各占用一层。 2 数字电路与模拟电路的共地处理 现在有许多PCB不再是单一功能电路（数字或模拟电路），而是由数字电路和模拟电路混合构成的。因此在布线时就需要考虑它们之间互相干扰问题，特别是地线上的噪音干扰。 数字电路的频率高，模拟电路的敏感度强，对信号线来说，高频的信号线尽可能远离敏感的模拟电路器件，对地线来说，整人PCB对外界只有一个结点，所以必须在PCB内部进行处理数、模共地的问题，而在板内部数字地和模拟地实际上是分开的它们之间互不相连，只是在PCB与外界连接的接口处（如插头等）。数字地与模拟地有一点短接，请注意，只有一个连接点。也有在PCB上不共地的，这由系统设计来决定。 3 信号线布在电（地）层上 在多层印制板布线时，由于在信号线层没有布完的线剩下已经不多，再多加层数就会造成浪费也会给生产增加一定的工作量，成本也相应增加了，为解决这个矛盾，可以考虑在电（地）层上进行布线。首先应考虑用电源层，其次才是地层。因为最好是保留地层的完整性。 4 大面积导体中连接腿的处理
PCB设计技巧疑难解析
2、如何避免高频干扰？ 避免高频干扰的基本思路是尽量降低高频信号电磁场的干扰，也就是所谓的串扰(Crosstalk)。可用拉大高速信号和模拟信号之间的距离，或加ground guard/shunt traces 在模拟信号旁边。还要注意数字地对模拟地的噪声干扰。 3、在高速设计中，如何解决信号的完整性问题？ 信号完整性基本上是阻抗匹配的问题。而影响阻抗匹配的因素有信号源的架构和输出阻抗(output impedance)，走线的特性阻抗，负载端的特性，走线的拓朴(topology)架构等。解决的方式是靠端接(termination)与调整走线的拓朴。 4、差分布线方式是如何实现的？ 差分对的布线有两点要注意，一是两条线的长度要尽量一样长，另一是两线的间距(此间距由差分阻抗决定)要一直保持不变，也就是要保持平行。平行的方式有两种，一为两条线走在同一走线层 (side-by-side)，一为两条线走在上下相邻两层(over-under)。一般以前者side-by-side 实现的方式较多。 5、对于只有一个输出端的时钟信号线，如何实现差分布线？ 要用差分布线一定是信号源和接收端也都是差分信号才有意义。所以对只有一个输出端的时钟信号是无法使用差分布线的。
6、接收端差分线对之间可否加一匹配电阻？ 接收端差分线对间的匹配电阻通常会加, 其值应等于差分阻抗的值。这样信号品质会好些。 7、为何差分对的布线要靠近且平行？ 对差分对的布线方式应该要适当的靠近且平行。所谓适当的靠近是因为这间距会影响到差分阻抗(differential impedance)的值, 此值是设计差分对的重要参数。需要平行也是因为要保持差分阻抗的一致性。若两线忽远忽近, 差分阻抗就会不一致, 就会影响信号完整性(signal integrity)及时间延迟(timingdelay)。 8、如何处理实际布线中的一些理论冲突的问题 1. 基本上, 将模/数地分割隔离是对的。要注意的是信号走线尽量不要跨过有分割的地方(moat), 还有不要让电源和信号的回流电流路径(returning current path)变太大。 2. 晶振是模拟的正反馈振荡电路, 要有稳定的振荡信号, 必须满足loop gain 与phase的规范,而这模拟信号的振荡规范很容易受到干扰, 即使加ground guard traces 可能也无法完全隔离干扰。而且离的太远, 地平面上的噪声也会影响正反馈振荡电路。所以, 一定要将晶振和芯片的距离进可能靠近。
射频电路PCB的设计技巧
射频电路PCB的设计技巧 摘要：针对多层线路板中射频电路板的布局和布线，根据本人在射频电路PCB设计中的经验积累，总结了一些布局布线的设计技巧。并就这些技巧向行业里的同行和前辈咨询，同时查阅相关资料，得到认可，是该行业里的普遍做法。多次在射频电路的PCB设计中采用这些技巧，在后期PCB的硬件调试中得到证实，对减少射频电路中的干扰有很不错的效果，是较优的方案。 关键词：射频电路；PCB；布局；布线 由于射频(RF)电路为分布参数电路，在电路的实际工作中容易产生趋肤效应和耦合效应，所以在实际的PCB设计中，会发现电路中的干扰辐射难以控制，如：数字电路和模拟电路之间相互干扰、供电电源的噪声干扰、地线不合理带来的干扰等问题。正因为如此，如何在PCB的设计过程中，权衡利弊寻求一个合适的折中点，尽可能地减少这些干扰，甚至能够避免部分电路的干涉，是射频电路PCB设计成败的关键。文中从PCB的LAYOUT角度，提供了一些处理的技巧，对提高射频电路的抗干扰能力有较大的用处。 1 RF布局 这里讨论的主要是多层板的元器件位置布局。元器件位置布局的关键是固定位于RF路径上的元器件，通过调整其方向，使RF路径的长度最小，并使输入远离输出，尽可能远地分离高功率电路和低功率电路，敏感的模拟信号远离高速数字信号和RF信号。 在布局中常采用以下一些技巧。 1．1 一字形布局 RF主信号的元器件尽可能采用一字形布局，如图1所示。但是由于PCB板和腔体空间的限制，很多时候不能布成一字形，这时候可采用L形，最好不要采用U字形布局(如图2所示)，有时候实在避免不了的情况下，尽可能拉大输入和输出之间的距离，至少1．5 cm 以上。
PCB设计技巧问答题
PCB 设计技巧百问 分类: 科学和工程技术 | 标签：pｃb,电路,仪器 PCB 设计技巧百问 本人浅尝PCB时遇到的经典文章,特转载于此。 １、如何选择PＣＢ板材? 选择PCB 板材必须在满足设计需求和可量产性及成本中间取得平衡点。设计需求包含电气和机构这两部分。通常在设计非常高速的ＰCB 板子(大于GH ｚ的频率)时这材质问题会比较重要。例如，现在常用的FＲ-４材质，在几个GHz 的频率时的介质损（dielectric loｓs)会对信号衰减有很大的影响，可能就不合用。就电气而言，要注意介电常数（ｄｉelecｔｒic constａnt)和介质损在所设计的频率是否合用。 2、如何避免高频干扰？ 避免高频干扰的基本思路是尽量降低高频信号电磁场的干扰，也就是所谓的串扰(Crｏsstalｋ)。可用拉大高速信号和模拟信号之间的距离，或加groｕnd ｇuａrd／shuｎtｔraces 在模拟信号旁边。还要注意数字地对模拟地的噪声干扰。 ３、在高速设计中，如何解决信号的完整性问题? 信号完整性基本上是阻抗匹配的问题。而影响阻抗匹配的因素有信号源的架构和输出阻抗（oｕtput impedaｎce),走线的特性阻抗，负载端的特性，走线
的拓朴（ｔopolｏgy）架构等。解决的方式是靠端接（terminatiｏn)与调整走线的拓朴。 4、差分布线方式是如何实现的? 差分对的布线有两点要注意，一是两条线的长度要尽量一样长，另一是两线的间距(此间距由差分阻抗决定)要一直保持不变，也就是要保持平行。平行的方式有两种，一为两条线走在同一走线层(siｄｅ-by-siｄe),一为两条线走在上下相邻两层（over-uｎｄeｒ)。一般以前者ｓiｄe－bｙ-side 实现的方式较多。 5、对于只有一个输出端的时钟信号线，如何实现差分布线? 要用差分布线一定是信号源和接收端也都是差分信号才有意义。所以对只有一个输出端的时钟信号是无法使用差分布线的。 6、接收端差分线对之间可否加一匹配电阻？ 接收端差分线对间的匹配电阻通常会加，其值应等于差分阻抗的值。这样信号品质会好些。 7、为何差分对的布线要靠近且平行？ 对差分对的布线方式应该要适当的靠近且平行。所谓适当的靠近是因为这间距会影响到差分阻抗（dｉｆfereｎtｉal ｉｍｐedanｃe)的值, 此值是设计差分对的重要参数。需要平行也是因为要保持差分阻抗的一致性。若两线忽远忽近，差分阻抗就会不一致, 就会影响信号完整性(ｓｉgnal iｎtegrｉtｙ)及时间延迟(ｔimiｎg ｄelay)。 8、如何处理实际布线中的一些理论冲突的问题 基本上, 将模/数地分割隔离是对的。要注意的是信号走线尽量不要跨过有分割的地方(moat), 还有不要让电源和信号的回流电流路径(ｒetｕrning current path)变太大。 晶振是模拟的正反馈振荡电路, 要有稳定的振荡信号, 必须满足loｏp gain 与phａｓｅ的规范, 而这模拟信号的振荡规范很容易受到干扰，即使加ground guard traｃｅｓ可能也无法完全隔离干扰。而且离的太远，地平面上的噪声也会影响正反馈振荡电路。所以，一定要将晶振和芯片的距离进可能靠近。 确实高速布线与EMI 的要求有很多冲突。但基本原则是因EMI 所加的电阻电容或ferriｔe bｅａd，不能造成信号的一些电气特性不符合规范。所以, 最好先用安排走线和PCB 叠层的技巧来解决或减少EMＩ的问题,如高速信 号走内层。最后才用电阻电容或ferrite bｅａｄ的方式, 以降低对信号的伤害。
PCB设计工程师最基本的技巧
PCB设计工程师最基本的技巧 布线（Layout）是PCB设计工程师最基本的工作技能之一。走线的好坏将直接影响到整个系统的性能，大多数高速的设计理论也要最终经过Layout得以实现并验证，由此可见，布线在高速PCB设计中是至关重要的。下面将针对实际布线中可能遇到的一些情况，分析其合理性，并给出一些比较优化的走线策略。主要从直角走线，差分走线，蛇形线等三个方面来阐述。 1．直角走线 直角走线一般是PCB布线中要求尽量避免的情况，也几乎成为衡量布线好坏的标准之一，那么直角走线究竟会对信号传输产生多大的影响呢？从原理上说，直角走线会使传输线的线宽发生变化，造成阻抗的不连续。其实不光是直角走线，顿角，锐角走线都可能会造成阻抗变化的情况。 直角走线的对信号的影响就是主要体现在三个方面：一是拐角可以等效为传输线上的容性负载，减缓上升时间；二是阻抗不连续会造成信号的反射；三是直角尖端产生的EMI。 传输线的直角带来的寄生电容可以由下面这个经验公式来计算： C=61W(Er)1/2/Z0 在上式中，C就是指拐角的等效电容（单位：pF），W指走线的宽度（单位：inch），εr指介质的介电常数，Z0就是传输线的特征阻抗。举个例子，对于一个4Mils的50欧姆传输线（εr为4.3）来说，一个直角带来的电容量大概为0.0101pF，进而可以估算由此引起的上升时间变化量： T10-90%=2.2*C*Z0/2 = 2.2*0.0101*50/2 = 0.556ps 通过计算可以看出，直角走线带来的电容效应是极其微小的。 由于直角走线的线宽增加，该处的阻抗将减小，于是会产生一定的信号反射现象，我们可以根据传输线章节中提到的阻抗计算公式来算出线宽增加后的等效阻抗，然后根据经验公式计算反射系数：ρ=(Zs-Z0)/(Zs+Z0)，一般直角走线导致的阻抗变化在7%-20%之间，因而反射系数最大为0.1左右。而且，从下图可以看到，在W/2线长的时间内传输线阻抗变化到最小，再经过W/2时间又恢复到正常的阻抗，整个发生阻抗变化的时间极短，往往在10ps之内，这样快而且微小的变化对一般的信号传输来说几乎是可以忽略的。 很多人对直角走线都有这样的理解，认为尖端容易发射或接收电磁波，产生EMI，这也成为许多人认为不能直角走线的理由之一。然而很多实际测试的结果显示，直角走线并不会比直线产生很明显的EMI。也许目前的仪器性能，测试水平制约了测试的精确性，但至少说明了一个问题，直角走线的辐射已经小于仪器本身的测量误差。 总的说来，直角走线并不是想象中的那么可怕。至少在GHz以下的应用中，其产生的任何诸如电容，反射，EMI等效应在TDR测试中几乎体现不出来，高速PCB设计工程师的重点还是应该放在布局，电源/地设计，走线设计，过孔等其他方面。当然，尽管直角走线带来的影响不是很严重，但并不是说我们以后都可以走直角线，注意细节是每个优秀工程师必备的基本素质，而且，随着数字电路的飞速发展，PCB工
PCB设计基础教程
PCB设计基础教程 目录 1.高速PCB设计指南之一 2.高速PCB设计指南之二 3.PCB Layout指南(上) 4.PCB Layout指南(下) 5.PCB设计的一般原则 6.PCB设计基础知识 7.PCB设计基本概念 8.pcb设计注意事项 9.PCB设计几点体会 10.PCB LAYOUT技术大全 11.PCB和电子产品设计 12.PCB电路版图设计的常见问题 13.PCB设计中格点的设置 14.新手设计PCB注意事项 15.怎样做一块好的PCB板 16.射频电路PCB设计 17.设计技巧整理 18.用PROTEL99制作印刷电路版的基本流程 19.用PROTEL99SE 布线的基本流程 20.蛇形走线有什么作用 21.封装小知识 22.典型的焊盘直径和最大导线宽度的关系 23.新手上路认识PCB 24.新手上路认识PCB<二> 高速PCB设计指南之一 高速PCB设计指南之一 第一篇 PCB布线
在PCB设计中，布线是完成产品设计的重要步骤，可以说前面的准备工作都是为它而做的，在整个PCB中，以布线的设计过程限定最高，技巧最细、工作量最大。PCB布线有单面布线、双面布线及多层布线。布线的方式也有两种：自动布线及交互式布线，在自动布线之前，可以用交互式预先对要求比较严格的线进行布线，输入端与输出端的边线应避免相邻平行，以免产生反射干扰。必要时应加地线隔离，两相邻层的布线要互相垂直，平行容易产生寄生耦合。 自动布线的布通率，依赖于良好的布局，布线规则可以预先设定，包括走线的弯曲次数、导通孔的数目、步进的数目等。一般先进行探索式布经线，快速地把短线连通，然后进行迷宫式布线，先把要布的连线进行全局的布线路径优化，它可以根据需要断开已布的线。并试着重新再布线，以改进总体效果。 对目前高密度的PCB设计已感觉到贯通孔不太适应了，它浪费了许多宝贵的布线通道，为解决这一矛盾，出现了盲孔和埋孔技术，它不仅完成了导通孔的作用，还省出许多布线通道使布线过程完成得更加方便，更加流畅，更为完善，PCB 板的设计过程是一个复杂而又简单的过程，要想很好地掌握它，还需广大电子工程设计人员去自已体会，才能得到其中的真谛。 1 电源、地线的处理 既使在整个PCB板中的布线完成得都很好，但由于电源、地线的考虑不周到而引起的干扰，会使产品的性能下降，有时甚至影响到产品的成功率。所以对电、地线的布线要认真对待，把电、地线所产生的噪音干扰降到最低限度，以保证产品的质量。 对每个从事电子产品设计的工程人员来说都明白地线与电源线之间噪音所产生的原因，现只对降低式抑制噪音作以表述： （1）众所周知的是在电源、地线之间加上去耦电容。 （2）尽量加宽电源、地线宽度，最好是地线比电源线宽，它们的关系是：地线＞电源线＞信号线，（通常信号线宽为：0.2～0.3mm,最经细宽度可达0.05～0.07mm,电源线为1.2～2.5 mm）对数字电路的PCB可用宽的地导线组成一个回路, 即构成一个地网来使用(模拟电路的地不能这样使用) （3）用大面积铜层作地线用,在印制板上把没被用上的地方都与地相连接作为地线用。或是做成多层板，电源，地线各占用一层。 2 数字电路与模拟电路的共地处理 现在有许多PCB不再是单一功能电路（数字或模拟电路），而是由数字电路和模拟电路混合构成的。因此在布线时就需要考虑它们之间互相干扰问题，特别是地线上的噪音干扰。 数字电路的频率高，模拟电路的敏感度强，对信号线来说，高频的信号线尽可能远离敏感的模拟电路器件，对地线来说，整个PCB对外界只有一个结点，所以必须在PCB部进行处理数、模共地的问题，而在板部数字地和模拟地实际上是分开的它们之间互不相连，只是在PCB与外界连接的接口处（如插头等）。数字地与模拟地有一点短接，请注意，只有一个连接点。也有在PCB上不共地的，这由系统设计来决定。 3 信号线布在电（地）层上
PCB设计基础教程
ＰＣＢ设计基础教程 目录 １．高速ＰＣＢ设计指南之一 ２．高速ＰＣＢ设计指南之二 ３．ＰＣＢＬａｙｏｕｔ指南（上） ４．ＰＣＢＬａｙｏｕｔ指南（下） ５．ＰＣＢ设计的一般原则 ６．ＰＣＢ设计基础知识 ７．ＰＣＢ设计基本概念 ８．ｐｃｂ设计注意事项 ９．ＰＣＢ设计几点体会 １０．ＰＣＢＬＡＹＯＵＴ技术大全 １１．ＰＣＢ和电子产品设计 １２．ＰＣＢ电路版图设计的常见问题 １３．ＰＣＢ设计中格点的设置 １４．新手设计ＰＣＢ注意事项 １５．怎样做一块好的ＰＣＢ板 １６．射频电路ＰＣＢ设计 １７．设计技巧整理 １８．用ＰＲＯＴＥＬ９９制作印刷电路版的基本流程 １９．用ＰＲＯＴＥＬ９９ＳＥ布线的基本流程 ２０．蛇形走线有什么作用 ２１．封装小知识 ２２．典型的焊盘直径和最大导线宽度的关系 ２３．新手上路认识ＰＣＢ ２４．新手上路认识ＰＣＢ＜二＞ 高速ＰＣＢ设计指南之一 高速ＰＣＢ设计指南之一 第一篇 ＰＣＢ布线 在ＰＣＢ设计中，布线是完成产品设计的重要步骤，可以说前面的准备工作都是为它而做的，在整个ＰＣＢ中，以布线的设计过程限定最高，技巧最细、工作量最大。ＰＣＢ布线有单面布线、双面布线及多层布线。布线的方式也有两种：自动布线及交互式布线，在自动布线之前，可以用交互式预先对要求比较严格的线进行布线，输入端与输出端的边线应避免相邻平行，以免产生反射干扰。必要时应加地线隔离，两相邻层的布线要互相垂直，平行容易产生寄生耦合。 自动布线的布通率，依赖于良好的布局，布线规则可以预先设定，包括走线的弯曲次数、导通孔的数目、步进的数目等。一般先进行探索式布经线，快速地把短线连通，然后进行迷宫式布线，先把要布的连线进行全局的布线路径优化，它可以根据需要断开已布的线。并试着重新再布线，以改进总体效果。 对目前高密度的ＰＣＢ设计已感觉到贯通孔不太适应了，它浪费了许多宝贵的布线通道，为解决这一矛盾，出现了盲孔和埋孔技术，它不仅完成了导通孔的作用，还省出许多布线通道使布线过程完成得更加方便，更加流畅，更为完善，ＰＣＢ板的设计过程是一个复杂而又简单的过程，要想很好地掌握它，还需广大电子工程设计人员去自已体会，才能得到其中的真谛。 １电源、地线的处理 既使在整个ＰＣＢ板中的布线完成得都很好，但由于电源、地线的考虑不周到而引起的干扰，会使产品的性能下降，有时甚至影响到产品的成功率。所以对电、地线的布线要认真对待，把电、地线所产生的噪音干扰降到最低限度，以保证产品的质量。 对每个从事电子产品设计的工程人员来说都明白地线与电源线之间噪音所产生的原因，现只对降低式抑制噪音作以表述：
Pcb设计基础：pcb各层的含义以及自定义的方法
Pcb设计基础：pcb各层的含义以及自定义的方法 亲爱的朋友，你好！ 我是向工。 下面给你分享的是我的一些pcb设计的心得经验！ Altium Designer 09 中各层的含义！ 其实我觉得这是PCB设计中最基本的常识， 我在pcb设计的最初的时候也是 靠死记硬背的把每一层代表的含义给记下来，后来我发现自己 没能活学活用，其实方法很简单，下面让我慢慢道来： 一：不用记住都能知道含义的层 1. 线路层 我将用一个4层板来做一个案例分享， Altium Designer 09一般我们新建一个pcb都是双面板来的， 那如何看一个pcb的叠层结构呢？ 可以在pcb编辑图纸区域内右键=》Options =》Layer Stack Manager…如下图1
图1
你将会打开Layer Stack Manager对话框，如下图2所示: 我们可以看到这是一款双面板：只有Top Layer 和Bottom Layer 这两层线路层。 图2
因为我们要设计的是一款4层板，所以我们还要增加两层线路层才是一个4层板， 参考下图3，我们可以点击右边的Add Layer 来增加两层线路层。 （我不推荐点击Add Plane来增加两层负片的线路层，即使你是用来做电源和地， 两个大片的铜箔，因为不管你是初学还是已经有一定经验的pcb设计者，我觉得 使用正片是最容易让人理解的，看到什么就是什么，出错的几率会小很多…) 图3
我刚做pcb设计的最初几年，到这一步我就不理他了，其实到这里有一个很关键的 技巧，这些层的名字是可以自己设定的，没必要用软件默认的名字，那样看 起来太让人费劲了，你可以双击它，会弹出一个对话框，如下图4：你可以对他进行设定…… 图4我一般按自己所喜欢的命名方法（主要是自己好记，一看就明白）如下图5一样把 4层线路层按如下方法命名： 第1层：L1_TOP 第2层：L2_GND 第3层：L3_VCC 第4层：L4_BOT (6层板，8层板，10层板，12层板……也是如此类推……)
PCB课程设计
PCB课程设计报告 课题:8255并行口扩展设计 学院: 核工程与地球物理学院 班级: 学号:2 姓名: 何鹏宇 目录 一、设计题目 (2) 二、设计内容与要求 (2) 三、设计目得意义 (2) 四、系统硬件电路图 (2) 五、程序流程图与源程序......................................... 错误!未定义书签。 六、系统功能分析与说明 (3) 七、设计体会 ............................................................ 错误!未定义书签。
一、设计题目 8255并行口扩展控制系统设计。利用单片机AT89C52控制实现8255得PB口输出数据等于PA口输入数据。 二、设计内容与要求 (1)利用单片机AT89C52与8255A设计一个扩展控制系统设计。 (3)要求使用得元器件数目最少,电路尽可能简单。 (4)电源电压为＋5V。 三、设计目得意义 1、通过8255并行口扩展控制,进一步熟悉与掌握单片机得结构及工作原理,加深 对单片机理论知识得理解; 2、掌握单片机内部功能模块得应用; 3、掌握单片机得接口及相关外围芯片得特性、使用与控制方法; 4、掌握单片机应用系统得构建与使用,为以后设计与实现单片机应用系统打下 良好得基础。 四、系统硬件电路图 (1) 8255并行口扩展控制硬件电路原理图如下: 图1:电路原理图 三大元件:
各元件封装: (2) PCB图如下 : 图2:PCB图五、程序流程图与源程序 5、1 程序流程图 六、系统功能分析与说明 6、1 总体功能实现说明 本次设计单片机采用 8位CMOS微
PCB设计技巧总结经验谈
PCB设计技巧总结经验谈 趁着五一有空，这几天断断续续，结合工作中的一些经验，参考资料，总结，写了一下PCB设计方面的技巧和注意的地方，详细介绍给DIYer，希望能够从中提高DIYer的技能水平。 注意:不一定都对，仅仅供参考，只是个人的经验。 一. PCB板框设计 1. 物理板框的设计一定要注意尺寸精确，避免安装出现麻烦，确保能够将电路板顺利安装进机箱，外壳，插槽等。 2. 拐角的地方（例如矩形板的四个角）最好使用圆角。一方面避免直角，尖角刮伤人，另一方面圆角可以减轻应力作用，减少PCB板因各种原因出现断裂的情况。 3. 在布局前应确定好各种安装孔（例如螺丝孔）及各种开口，开槽。一般来说，孔与PCB板边缘的距离至少大于孔的直径。 4. 当电路板的面积大于200 x 150 mm时，应重视该板所受的机械强度。从美学角度来看，电路板的最佳形状为矩形。宽和长之比最好是黄金比值0.618（黄金比值的应 用也是很广的）。实际应用时可取宽和长为2：3或3：4等。 5. 结合产品设计要求（尤其是批量生产），综合考虑PCB板的尺寸大小。尺寸过大，印刷铜线过长，阻抗增加，抗噪声能力下降；尺寸过小，散热不好，线距不好控制，相邻导线容易干扰。 6. 一般来说，板框的规划是在KeepOutLayer层进行。 二．PCB板布局设计 元件布置是否合理对整板的寿命，稳定性，易用性及布线都有很大的影响，是设计出优秀PCB板的前提。不同的板的布局各有其要求和特点，但当中不乏一些通用的规则，技巧。现详细介绍给DIYer，希望能够从中提高DIYe的技能水平。 1. 元件的放置顺序 ①一般来说，首先放置与整板的结构紧密相关的且固定位置的元件。比如常见的电源插座，开关，指示灯，各种有特殊位置要求的接口（连接件之类），继电器等，并且不要与PCB板中的开孔，开槽相冲突，位置要正确。放置好后，最好用软件的锁定功能将其固定。 ②接着放置体积大的元件和核心元件以及一些特殊的元件。例如变压器等大元件，集成电路，处理器等核心IC元件，发热元件等。这些元件会随着布线的考虑有所移动，因此是大致的放置，更不用锁定。 ③最后放置小元件。例如阻容元件，辅助小IC等。
关于PCB设计的一些小技巧
关于PCB设计的一些小技巧 一、在进行高速多层PCB设计时，关于电阻电容等器件的封装的选择的，主要依据是什么？常用那些封装，能否举几个例子。 答：0402是手机常用；0603是一般高速信号的模块常用；依据是封装越小寄生参数越小，当然不同厂家的相同封装在高频性能上有很大差异。建议在关键的位置使用高频专用元件。 二、多层板布局时需要注意哪些事项？ 答：多层板布局时，因为电源和地层在内层，要注意不要有悬浮的地平面或电源平面，另外要确保打到地上的过孔确实连到了地平面上，最后是要为一些重要的信号加一些测试点，方便调试的时候进行测量。 三、通孔和盲孔对信号的差异影响有多大？应用的原则是什么？ 答：采用盲孔或埋孔是提高多层板密度、减少层数和板面尺寸的有效方法，并大大减少了镀覆通孔的数量。但相比较而言，通孔在工艺上好实现，成本较低，所以一般设计中都使用通孔。 四、在设计PCB 时，如何考虑电磁兼容性EMC/EMI，具体需要考虑哪些方面？采取哪些措施？ 答：好的EMI/EMC 设计必须一开始布局时就要考虑到器件的位置, PCB 叠层的安排，重要联机的走法，器件的选择等。例如时钟产生器的位置尽量不要靠近对外的连接器，高速信号尽量走内层并注意特性阻抗匹配与参考层的连续以减少反射，器件所推的信号之斜率(slew rate)尽量小以减低高频成分，选择去耦合(decoupling/bypass)电容时注意其频率响应是否符合需求以降低电源层噪声。另外，注意高频信号电流之回流路径使其回路面积尽量小(也就是回路阻抗loop impedance 尽量小)以减少辐射，还可以用分割地层的方式以控制高频噪声的范围，最后，适当的选择PCB 与外壳的接地点(chassis ground)。 五、高速PCB，布线过程中过孔的避让如何处理，有什么好的建议？
高速PCB设计新手 入门及进阶教程(上)
https://www.360docs.net/doc/1d3648267.html, 高速PCB设计新手入门及进阶教程（上） 高速PCB设计指南之一----PCB布局，布线，高速设计 第一篇PCB布线 在PCB设计中，布线是完成产品设计的重要步骤，可以说前面的准备工作都是为它而做的，在整个PCB中，以布线的设计过程限定最高，技巧最细、工作量最大。PCB布线有单面布线、双面布线及多层布线。布线的方式也有两种：自动布线及交互式布线，在自动布线之前，可以用交互式预先对要求比较严格的线进行布线，输入端与输出端的边线应避免相邻平行，以免产生反射干扰。必要时应加地线隔离，两相邻层的布线要互相垂直，平行容易产生寄生耦合。 自动布线的布通率，依赖于良好的布局，布线规则可以预先设定，包括走线的弯曲次数、导通孔的数目、步进的数目等。一般先进行探索式布经线，快速地把短线连通，然后进行迷宫式布线，先把要布的连线进行全局的布线路径优化，它可以根据需要断开已布的线。并试着重新再布线，以改进总体效果。 对目前高密度的PCB设计已感觉到贯通孔不太适应了，它浪费了许多宝贵的布线通道，为解决这一矛盾，出现了盲孔和埋孔技术，它不仅完成了导通孔的作用，还省出许多布线通道使布线过程完成得更加方便，更加流畅，更为完善，PCB 板的设计过程是一个复杂而又简单的过程，要想很好地掌握它，还需广大电子工程设计人员去自已体会，才能得到其中的真谛。 1 电源、地线的处理 既使在整个PCB板中的布线完成得都很好，但由于电源、地线的考虑不周到而引起的干扰，会使产品的性能下降，有时甚至影响到产品的成功率。所以对电、地线的布线要认真对待，把电、地线所产生的噪音干扰降到最低限度，以保证产品的质量。 对每个从事电子产品设计的工程人员来说都明白地线与电源线之间噪音所产生的原因，现只对降低式抑制噪音作以表述： （1）、众所周知的是在电源、地线之间加上去耦电容。 （2）、尽量加宽电源、地线宽度，最好是地线比电源线宽，它们的关系是：地线＞电源线＞信号线，通常信号线宽为：0.2～0.3mm,最经细宽度可达0.05～0.07mm,电源线为1.2～2.5 mm 对数字电路的PCB可用宽的地导线组成一个回路, 即构成一个地网来使用(模拟电路的地不能这样使用) （3）、用大面积铜层作地线用,在印制板上把没被用上的地方都与地相连接作为地线用。或是做成多层板，电源，地线各占用一层。 2 数字电路与模拟电路的共地处理 现在有许多PCB不再是单一功能电路（数字或模拟电路），而是由数字电路和模拟电路混合构成的。因此在布线时就需要考虑它们之间互相干扰问题，特别是地线上的噪音干扰。 数字电路的频率高，模拟电路的敏感度强，对信号线来说，高频的信号线尽可能远离敏感的模拟电路器件，对地线来说，整人PCB对外界只有一个结点，所以必须在PCB内部进行处理数、模共地的问题，而在板内部数字地和模拟地实际上是分开的它们之间互不相连，
双面板布线技巧PCB布线设计
PCB布线设计原则 1.多层布线选择 在当今激烈竞争的电池供电市场中，由于成本指标限制，设计人员常常使用双面板。尽管多层板(4层、6层及8层)方案在尺寸、噪声和性能方面具有明显优势，成本压力却促使工程师们重新考虑其布线策略，采用双面板。 2.自动布线的优缺点以及模拟电路布线的注意事项 设计PCB时，往往很想使用自动布线。通常，纯数字的电路板(尤其信号电平比较低，电路密度比较小时)采用自动布线是没有问题的。但是，在设计模拟、混合信号或高速电路板时，如果采用布线软件的自动布线工具，可能会出现一些问题，甚至很可能带来严重的电路性能问题。 3. 电路布线的注意事项 （1）在手工布线时，尽量采用地平面作为电流回路；将模拟地平面和数字地平面分开；如果地平面被信号走线隔断，为降低对地电流回路的干扰，应使信号走线与地平面垂直；模拟电路尽量靠近电路板边缘放臵，数字电路尽量靠近电源连接端放臵，这样做可以降低由数字开关引起的di/dt效应。厂商的演示板和评估板通常采用这种布线策略。但是，更为普遍的做法是将地平面布在电路板顶层，以降低电磁干扰。 （2）电路接地方式的考虑原则。
当电子线路中信号工作频率小于1MHz时。由于布线与元器件问的电感影响较小，而接地电路形成的环流可能形成较大的干扰，应该考虑单点接地。当工作频率大于10MHz时。地线阻抗变得很大。此时应考虑降低地线阻抗。可采用多点接地。当工作频率在1～10MHz 时。也应尽量考虑多点接地。在只有数字电路组成的PCB板接地时，要将接地电路做成闭式环路．可明显提高电路的抗干扰能力。 PCB上的接地连接如要考虑走线时，设计应将走线尽量加粗。这是一个好的经验法则，但要知道，接地线的最小宽度是从此点到末端的有效宽度，此处“末端”指距离电源连接端最远的点。应避免地环路。 （3）如果不能采用地平面，应 采用星形连接策略(见图1)。通过这 种方法，地电流独立返回电源连接 端。图1中，注意到并非所有器件都 有自己的回路，U1和U2是共用回路 的。如遵循以下第4条和第5条准则 是可以这样做的。 (4) 数字电流不应流经模拟器件。 数字器件开关时，回路中的数字 电流相当大，但只是瞬时的，这种现象是由地线的有效感抗和阻抗引起图1如果不能采用地平面，可以采用“星形”布线策略来处 理电流回路
PCB设计技巧百问
PCB设计技巧百问(合集) 1、如何选择PCB板材？ 选择PCB板材必须在满足设计需求和可量产性及成本中间取得平衡点。设计需求包含电气和机构这两部分。通常在设计非常高速的PCB板子(大于GHz的频率)时这材质问题会比较重要。例如，现在常用的FR-4材质，在几个GHz的频率时的介质损(dielectric loss)会对信号衰减有很大的影响，可能就不合用。就电气而言，要注意介电常数(dielectric constant)和介质损在所设计的频率是否合用。 2、如何避免高频干扰？ 避免高频干扰的基本思路是尽量降低高频信号电磁场的干扰，也就是所谓的串扰(Crosstalk)。可用拉大高速信号和模拟信号之间的距离，或加ground guard/shunt traces在模拟信号旁边。还要注意数字地对模拟地的噪声干扰。 3、在高速设计中，如何解决信号的完整性问题？ 信号完整性基本上是阻抗匹配的问题。而影响阻抗匹配的因素有信号源的架构和输出阻抗(output impeda nce)，走线的特性阻抗，负载端的特性，走线的拓朴(topology)架构等。解决的方式是靠端接(termination)与调整走线的拓朴。 4、差分布线方式是如何实现的？ 差分对的布线有两点要注意，一是两条线的长度要尽量一样长，另一是两线的间距(此间距由差分阻抗决定)要一直保持不变，也就是要保持平行。平行的方式有两种，一为两条线走在同一走线层(side-by-side)，一为两条线走在上下相邻两层(over-under)。一般以前者side-by-side实现的方式较多。 5、对于只有一个输出端的时钟信号线，如何实现差分布线？ 要用差分布线一定是信号源和接收端也都是差分信号才有意义。所以对只有一个输出端的时钟信号是无法使用差分布线的。 6、接收端差分线对之间可否加一匹配电阻？ 接收端差分线对间的匹配电阻通常会加, 其值应等于差分阻抗的值。这样信号品质会好些。 7、为何差分对的布线要靠近且平行？ 对差分对的布线方式应该要适当的靠近且平行。所谓适当的靠近是因为这间距会影响到差分阻抗(different ial impedance)的值, 此值是设计差分对的重要参数。需要平行也是因为要保持差分阻抗的一致性。若两线忽远忽近, 差分阻抗就会不一致, 就会影响信号完整性(signal integrity)及时间延迟(timing delay)。 8、如何处理实际布线中的一些理论冲突的问题 1. 基本上, 将模/数地分割隔离是对的。要注意的是信号走线尽量不要跨过有分割的地方(moat), 还有不要让电源和信号的回流电流路径(returning current path)变太大。 2. 晶振是模拟的正反馈振荡电路, 要有稳定的振荡信号, 必须满足loop gain与phase的规范, 而这模拟信号的振荡规范很容易受到干扰, 即使加ground guard traces可能也无法完全隔离干扰。而且离的太远, 地平面上的噪声也会影响正反馈振荡电路。所以, 一定要将晶振和芯片的距离进可能靠近。
PCB设计基础知识
PCB设计基础知识 印刷电路板（Printed circuit board，PCB）几乎会出现在每一种电子设备当中。如果在某样设备中有电子零件，那么它们也都是镶在大小各异的PCB上。除了固定各种小零件外，PCB的主要功能是提供上头各项零件的相互电气连接。随着电子设备越来越复杂，需要的零件越来越多，PCB上头的线路与零件也越来越密集了。标准的PCB长得就像这样。裸板（上头没有零件）也常被称为「印刷线路板Printed Wiring Board（PWB）」。 板子本身的基板是由绝缘隔热、并不易弯曲的材质所制作成。在表面可以看到的细小线路材料是铜箔，原本铜箔是覆盖在整个板子上的，而在制造过程中部份被蚀刻处理掉，留下来的部份就变成网状的细小线路了。这些线路被称作导线（conductor pattern）或称布线，并用来提供PCB上零件的电路连接。 为了将零件固定在PCB上面，我们将它们的接脚直接焊在布线上。在最基本的PCB（单面板）上，零件都集中在其中一面，导线则都集中在另一面。这么一来我们就需要在板子上打洞，这样接脚才能穿过板子到另一面，所以零件的接脚是焊在另一面上的。因为如此，PCB 的正反面分别被称为零件面（Component Side）与焊接面（Solder Side）。 如果PCB上头有某些零件，需要在制作完成后也可以拿掉或装回去，那么该零件安装时会用到插座（Socket）。由于插座是直接焊在板子上的，零件可以任意的拆装。下面看到的是ZIF（Zero Insertion Force，零拨插力式）插座，它可以让零件（这里指的是CPU）可以轻松插进插座，也可以拆下来。插座旁的固定杆，可以在您插进零件后将其固定。 如果要将两块PCB相互连结，一般我们都会用到俗称「金手指」的边接头（edge connector）。金手指上包含了许多裸露的铜垫，这些铜垫事实上也是PCB布线的一部份。通常连接时，我们将其中一片PCB上的金手指插进另一片PCB上合适的插槽上（一般叫做扩充槽Slot）。在计算机中，像是显示卡，声卡或是其它类似的界面卡，都是借着金手指来与主机板连接的。 PCB上的绿色或是棕色，是阻焊漆（solder mask）的颜色。这层是绝缘的防护层，可以保护铜线，也可以防止零件被焊到不正确的地方。在阻焊层上另外会印刷上一层丝网印刷面（silk screen）。通常在这上面会印上文字与符号（大多是白色的），以标示出各零件在板子上的位置。丝网印刷面也被称作图标面（legend）。 单面板（Single-Sided Boards） 我们刚刚提到过，在最基本的PCB上，零件集中在其中一面，导线则集中在另一面上。因为导线只出现在其中一面，所以我们就称这种PCB叫作单面板（Single-sided）。因为单面板在设计线路上有许多严格的限制（因为只有一面，布线间不能交叉而必须绕独自的路径），所以只有早期的电路才使用这类的板子。 双面板（Double-Sided Boards） 这种电路板的两面都有布线。不过要用上两面的导线，必须要在两面间有适当的电路连接才行。这种电路间的「桥梁」叫做导孔（via）。导孔是在PCB上，充满或涂上金属的小洞，它可以与两面的导线相连接。因为双面板的面积比单面板大了一倍，而且因为布线可以互相交错（可以绕到另一面），它更适合用在比单面板更复杂的电路上。 多层板（Multi-Layer Boards） 为了增加可以布线的面积，多层板用上了更多单或双面的布线板。多层板使用数片双面板，并在每层板间放进一层绝缘层后黏牢（压合）。板子的层数就代表了有几层独立的布线层，通常层数都是偶数，并且包含最外侧的两层。大部分的主机板都是4到8层的结构，不过技术上可以做到近100层的PCB板。大型的超级计算机大多使用相当多层的主机板，不过因为这类计算机已经可以用许多普通计算机的集群代替，超多层板已经渐渐不被使用了。因为PCB中的各层都紧密的结合，一般不太容易看出实际数目，不过如果您仔细观察主机板，
PCB设计技巧百问解答
PCB 设计技巧百问解答 1、如何选择PCB 板材？ 选择PCB 板材必须在满足设计需求和可量产 性及成本中间取得平衡点。设计需求包含电 气和机构这两部分。通常在设计非常高速的PCB 板子(大于GHz 的频率)时这材质问题会比较重要。例如，现在常用的FR-4材质，在几个GHz 的频率时的介质损(dielectric loss)会对信号衰减有很大的影响，可能就不合用。就电气而言，要注意介电常数(dielectric constant)和介质损在所设计的频率是否合用。 2、如何避免高频干扰？ 避免高频干扰的基本思路是尽量降低高频信号电磁场的干扰，也就是所谓的串扰(Crosstalk)。可用拉大高速信号和模拟信号之间的距离，或加ground guard/shunt traces 在模拟信号旁边。还要注意数字地对模拟地的噪声干扰。 3、在高速设计中，如何解决信号的完整性问题？ 信号完整性基本上是阻抗匹配的问题。而影响阻抗匹配的因素有信号源的架构和输出阻抗(output impedance)，走线的特性阻抗，负载端的特性，走线的拓朴(topology)架构等。解决的方式是靠端接(termination)与调整走线的拓朴。 4、差分布线方式是如何实现的？ 差分对的布线有两点要注意，一是两条线的长度要尽量一样长， 另一
是两线的间距(此间距由差分阻抗决定)要一直保持不变，也就是要保持平行。平行的方式有两种，一为两条线走在同一走线层 (side-by-side)，一为两条线走在上下相邻两层(over-under)。一般以前者side-by-side实现的方式较多。 5、对于只有一个输出端的时钟信号线，如何实现差分布线？ 要用差分布线一定是信号源和接收端也都是差分信号才有意义。所以对只有一个输出端的时钟信号是无法使用差分布线的。 6、接收端差分线对之间可否加一匹配电阻？ 接收端差分线对间的匹配电阻通常会加, 其值应等于差分阻抗的值。这样信号品质会好些。 7、为何差分对的布线要靠近且平行？ 对差分对的布线方式应该要适当的靠近且平行。所谓适当的靠近是因为这间距会影响到差分阻抗(differential impedance)的值, 此值是设计差分对的重要参数。需要平行也是因为要保持差分阻抗的一致性。若两线忽远忽近, 差分阻抗就会不一致, 就会影响信号完整性(signal integrity)及时间延迟(timing delay)。 8、如何处理实际布线中的一些理论冲突的问题 1. 基本上, 将模/数地分割隔离是对的。要注意的是信号走线尽量不要跨过有分割的地方(moat), 还有不要让电源和信号的回流电流路径(returning current path)变太大。 2. 晶振是模拟的正反馈振