教学课件：组合逻辑电路的设计
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组合逻辑电路的分析和设计PPT课件
(3) 列函数表达式
F2 m(1,2) d(3,5,6,7) F1 m(1,4) d(3,5,6,7)
第35页/共228页
F2 m(1,2) d(3,5,6,7) F1 m(1,4) d(3,5,6,7)
(4) 逻辑函数的化简
a. 化简F2
BC
A 00 01 11 10
0
1 1
种不同的编码器，如二进制编码器、优先编码器和 8421BCD编码器等。 1. 二进制编码器
用n位二进制代码对N=2n个一般信号进行编码 的电路，叫做二进制编码器。 二进制编码器也称之为2n –n线二进制编码器。
第42页/共228页
(1) 二进制编码器的主要特点
任何时刻只允许输入一个有效信号，不允许同时出现 两个或两个以上的有效信号，因而其输入是一组有约束(互 相排斥)的变量。
第22页/共228页
⑵ 写出逻辑函数表达式
由真值表写出逻辑函数表达式。
⑶ 对逻辑函数式进行化简和变换 根据选用的逻辑门的类型，将函数式化简或变换
为最简式。选用的逻辑门不同，化简的形式也不同。 ⑷ 画出逻辑电路图
根据化简后的逻辑函数式，画出门级逻辑电路图。 在实际数字电路设计中，还须选择器件型号。
第23页/共228页
& B
& B
L CA CB
L CA CB
若用集成门实现与或式，至少需要两种类型的门电路。
若用集成门实现与非式，则仅需要一种类型的门电路。
第29页/共228页
[例7] 试用与或非门设计一个操作码形成器，如图所 示。当按下*、+、-各个操作键时，要求分别产生乘 法、加法和减法的操作码01、10和11。
2. 组合逻辑电路的主要特点 a. 电路中就不包含记忆性元器件; b. 而且输出与输入之间没有反馈连线; c. 门电路是组合电路的基本单元。 d. 输出与电路原来状态无关。
第四章-组合逻辑电路PPT课件
输入 G3 G2 G1 G0
0000 0001 0011 0010 0110 0111 0101 0100
2021/3/12
逻辑电路真值表
输出 B3 B2 B1 B0
0000 0001 0010 0011 0100 0101 0110 0111
输入 G3 G2 G1 G0 1100 1101 1111 1110 1010 1011 1001 1000
因此当B＝D =1，A＝0时(此时F =C+C )，电路 可能由于C 的变化而产生竞争冒险。
ABCD 00 01 11 10
00
1
01 1 1 1
11 1 1
2021/3/12
10 1 1
27
BC 00 01 11 10 A 00110 10011
D＝AB＋AC
有相切的卡诺图
2021/3/12
BC 00 01 11 10 A 00110 10011
01 0 1 1 1
11 1 1 0 0
FABAC＋ BC 10 1 1 0 0
F A C A B D B C D A C D A B C
2021/3/12
32
3. 输出端并联电容器
如果逻辑电路在较慢速度下工作，为了消去竞争冒险，可 以在输出端并联一电容器，致使输出波形上升沿和下降沿 变化比较缓慢，可对于很窄的负跳变脉冲起到平波的作用。
A Y
t t 2021/3/121 2
t3 t4
它不符合静态下Y= AA恒为 0 的
逻辑关系
20
C
C
AC
BC
L
竞争: 当一个逻辑门的两个输入端的信号同时向相反方向变化， 而变化的时间有差异的现象。
《组合逻辑电路》课件
常见的逻辑门
与门
与门只有当所有输入 信号均为高电平时或门只要有一个输入 信号为高电平，输出 信号就为高电平。
非门
非门将输入信号取反， 输出信号与输入信号 相反。
异或门
异或门只有当输入信 号中有且仅有一个信 号为高电平时，输出 信号才为高电平。
组合逻辑电路的设计示例
4位全加器
4位全加器能够对两个4位二进制数进行相加， 并输出相应的和与进位。
8位选择器
8位选择器根据控制信号选择对应的输入信号输 出。
4位比较器
4位比较器用于比较两个4位二进制数的大小， 并输出相应的比较结果。
7段数码管译码器
7段数码管译码器将二进制输入信号转换为7段 数码管上的显示。
总结
组合逻辑电路是电路设计中的重要组成部分，它通过逻辑门等实现输入输出 的转换和处理。分析问题、求最简式、选择逻辑门是组合逻辑电路设计的核 心方法。
组合逻辑电路的基本元件
逻辑门
逻辑门是组合逻辑电路中的基本构建块，如与门、 或门、非门、异或门等。
多路选择器
多路选择器可以根据输入信号的值，选择特定的 输出信号。
解码器
解码器将输入信号转换为对应的输出线路。
编码器
编码器将多个输入信号编码为较少的输出信号。
组合逻辑电路的设计方法
1. 理解问题并确定输入输出要求。 2. 将输入输出转化为逻辑函数。 3. 求出逻辑函数的最简式。 4. 根据最简式选择逻辑门和组成电路。
《组合逻辑电路》PPT课 件
欢迎来到《组合逻辑电路》的PPT课件。想要深入了解什么是组合逻辑电路 以及它的基本元件和设计方法吗？让我们一起开始探索吧！
什么是组合逻辑电路？
组合逻辑电路是由输入端口和输出端口组成的电路，它们用于将输入端口上的信号转换为输出端口的状态。与 存储器不同，组合逻辑电路只考虑当前输入产生的输出。
第三章组合逻辑电路ppt课件
图3.3.1 3位二进制普通编码器框图 《数字电子技术》
3.3 若干常用中规模组合逻辑电路 表3-3-1 3位二进制普通编码器真值表
《数字电子技术》
3.3 若干常用中规模组合逻辑电路
由于普通编码器在任何时刻 I0 ~ I7 当中仅有一个 取值为1，即只有真值表中所列的8种状态，而且它
的（ 28 8 ）种状态均为约束项。因此，由真值表
A
&
1
F2
C
B
&
C
图3.2.1 【例1】逻辑电路图
《数字电子技术》
3.2 组合逻辑电路的分析和设计方法
§3.2.2 组合逻辑电路的设计方法
所谓“设计”：即根据给出的实际逻辑问题，求出实 现这个逻辑功能的最简逻辑电路。
所谓“最简”：是指所用器件最少，器件种类最少， 而且器件之间的连线也最少。
一、设计步骤 （1）进行逻辑抽象
【例1】试用两片74LS148接成16线-4线优先编码器，
将－的优11先11权’最1低6个。146位个二低进A电0A制平1~5代输A码1入5 ，信其号中
编为‘0000
的A优0 先权最高，
接成的电路图如图3.3.4所示：
《数字电子技术》
3.3 若干常用中规模组合逻辑电路
图3.3.4 用两片74LS148接成的16线－4线优先编码器逻辑图
I7
)
S
Y0 (I1I2 I4 I6 I3 I4 I6 I5 I6 I7 ) S
（由功能表第一行体现）。
《数字电子技术》
3.3 若干常用中规模组合逻辑电路
（2）YS 为选通输出端，其表达式为：
YS I0 I1 I2 I3 I4 I5 I6 I7 S
此式表明：只有当所有的编码输入端均为高 电平（即没有编码输入），且S=1（ S 0 ）
3.3 若干常用中规模组合逻辑电路 表3-3-1 3位二进制普通编码器真值表
《数字电子技术》
3.3 若干常用中规模组合逻辑电路
由于普通编码器在任何时刻 I0 ~ I7 当中仅有一个 取值为1，即只有真值表中所列的8种状态，而且它
的（ 28 8 ）种状态均为约束项。因此，由真值表
A
&
1
F2
C
B
&
C
图3.2.1 【例1】逻辑电路图
《数字电子技术》
3.2 组合逻辑电路的分析和设计方法
§3.2.2 组合逻辑电路的设计方法
所谓“设计”：即根据给出的实际逻辑问题，求出实 现这个逻辑功能的最简逻辑电路。
所谓“最简”：是指所用器件最少，器件种类最少， 而且器件之间的连线也最少。
一、设计步骤 （1）进行逻辑抽象
【例1】试用两片74LS148接成16线-4线优先编码器，
将－的优11先11权’最1低6个。146位个二低进A电0A制平1~5代输A码1入5 ，信其号中
编为‘0000
的A优0 先权最高，
接成的电路图如图3.3.4所示：
《数字电子技术》
3.3 若干常用中规模组合逻辑电路
图3.3.4 用两片74LS148接成的16线－4线优先编码器逻辑图
I7
)
S
Y0 (I1I2 I4 I6 I3 I4 I6 I5 I6 I7 ) S
（由功能表第一行体现）。
《数字电子技术》
3.3 若干常用中规模组合逻辑电路
（2）YS 为选通输出端，其表达式为：
YS I0 I1 I2 I3 I4 I5 I6 I7 S
此式表明：只有当所有的编码输入端均为高 电平（即没有编码输入），且S=1（ S 0 ）
《组合逻辑电路的设计》公开课PPT课件
P ABC
A B C
0 0 0 0 1 1 1 1 0 0 0 1 1 0 1 1 0 0 0 ≥1 1 1 0 1 1
L
0 1 1 1 1 1 L 1 0
L AP BP CP
A ABC B ABC C ABC
& & &
2、化简表达式
A P & L ABC( A B C ) BC AB AC B C 3、由表达式列出真值表
1
1 1
1
1 1
0
1 1
1
0 1
0
0 1
ABCD
由真值表写出逻辑表达式
Z ABCD ABCD ABCD ABCD ABCD ABCD
ABCD ABCD ABCD
化简或转换逻辑函数表达式
● 化简
Z AB CD BC AD
化简或转换逻辑函数表达式
画逻辑 电路图
1、认真读题， 把握逻辑关系
把取值为1的项写成与或式
2、设输入输出变量， 定义状态的含义
3、列真值表 目的：减少器件的数量、种类和器 件之间的连接线。减少成本，提高 效率和稳定性
1列表 2得式 3变形 4画图
形成性练习
星空卫视“中国达人秀”海选，有三名评 委。以少数服从多数的原则判定选手能否 通过海选。假设我们是电子设计师，帮他 们设计一个电路能够体现评委判定和选手 是否过关之间的逻辑关系。
C 0 0 1 1
D 0 1 0 1
血型 O型 B型 A型 AB型
以变量Z表示配型结果
Z=1表示血型相配，可以输血
Z=0表示血型不配，不可以输血
以变量Z表示配型结果
Z=1表示血型相配，可以输血 根据题意确定输入和输出变量 Z=0表示血型不配，不可以输血
A B C
0 0 0 0 1 1 1 1 0 0 0 1 1 0 1 1 0 0 0 ≥1 1 1 0 1 1
L
0 1 1 1 1 1 L 1 0
L AP BP CP
A ABC B ABC C ABC
& & &
2、化简表达式
A P & L ABC( A B C ) BC AB AC B C 3、由表达式列出真值表
1
1 1
1
1 1
0
1 1
1
0 1
0
0 1
ABCD
由真值表写出逻辑表达式
Z ABCD ABCD ABCD ABCD ABCD ABCD
ABCD ABCD ABCD
化简或转换逻辑函数表达式
● 化简
Z AB CD BC AD
化简或转换逻辑函数表达式
画逻辑 电路图
1、认真读题， 把握逻辑关系
把取值为1的项写成与或式
2、设输入输出变量， 定义状态的含义
3、列真值表 目的：减少器件的数量、种类和器 件之间的连接线。减少成本，提高 效率和稳定性
1列表 2得式 3变形 4画图
形成性练习
星空卫视“中国达人秀”海选，有三名评 委。以少数服从多数的原则判定选手能否 通过海选。假设我们是电子设计师，帮他 们设计一个电路能够体现评委判定和选手 是否过关之间的逻辑关系。
C 0 0 1 1
D 0 1 0 1
血型 O型 B型 A型 AB型
以变量Z表示配型结果
Z=1表示血型相配，可以输血
Z=0表示血型不配，不可以输血
以变量Z表示配型结果
Z=1表示血型相配，可以输血 根据题意确定输入和输出变量 Z=0表示血型不配，不可以输血
组合逻辑电路的设计PPT课件
定义逻辑状态的含义；
根据给定的逻辑因果关系列出逻辑真值表。
计算机系
数字电子技. 术基础
3
组合逻辑电路的设计方法
(2)写出逻辑函数式； (3)将逻辑函数化简或变换成适当地形式； (4)根据化简或变换后的逻辑函数式，画出逻 辑电路图。
逻辑
逻辑
逻辑
将函数
逻辑
问题
真值表
函数式
式化简
电路图
组合逻辑电路设计步骤
组合逻辑电路的设计
计算机系
数字电子技. 术基础
1
引入
组合逻辑电路在智能控制系统中的应用。
交通信号灯
电子密码锁
计算机系
数字电子技. 术基础
ATM取款机
2
组合逻辑电路的设计方法
组合逻辑电路的设计就是根据给出的实际逻 辑问题，求出实现这一逻辑功能的最简单逻辑电 路。步骤为:
(1)进行逻辑抽象；
分析事件的逻辑因果关系，确定输入变量 和输出变量；
故障状态计算ຫໍສະໝຸດ 系数字电子技. 术基础5
实例
解：（1）进行逻辑抽象
表1
输入：红、黄、绿三盏
灯，分别用R、A、G表示， R A G Y
规定灯亮时为“1”，不
0001
亮时为“0”； 输出：故障信号，用Z表
001 0
示，规定正常工作状态
0 100
下 Z=0，发生故障时Z=1。 0 1 1 1
列出真值表如表1所示
7
课堂练习
设计一个三人表决电路，结果按“少数服从多数” 的原则决定。
计算机系
数字电子技. 术基础
8
计算机系
数字电子技. 术基础
4
实例
例1. 设计一个监视交通信号灯工作状态的逻辑电 路。每一组信号灯由红、黄、绿三盏灯组成。正常工作 情况下，任何时刻总有一盏灯点亮，而只允许有一盏灯 点亮。而当出现其他五种点亮状态时，电路发生故障， 这时要求发出故障信号，以提醒维护人员前去维修。
根据给定的逻辑因果关系列出逻辑真值表。
计算机系
数字电子技. 术基础
3
组合逻辑电路的设计方法
(2)写出逻辑函数式； (3)将逻辑函数化简或变换成适当地形式； (4)根据化简或变换后的逻辑函数式，画出逻 辑电路图。
逻辑
逻辑
逻辑
将函数
逻辑
问题
真值表
函数式
式化简
电路图
组合逻辑电路设计步骤
组合逻辑电路的设计
计算机系
数字电子技. 术基础
1
引入
组合逻辑电路在智能控制系统中的应用。
交通信号灯
电子密码锁
计算机系
数字电子技. 术基础
ATM取款机
2
组合逻辑电路的设计方法
组合逻辑电路的设计就是根据给出的实际逻 辑问题，求出实现这一逻辑功能的最简单逻辑电 路。步骤为:
(1)进行逻辑抽象；
分析事件的逻辑因果关系，确定输入变量 和输出变量；
故障状态计算ຫໍສະໝຸດ 系数字电子技. 术基础5
实例
解：（1）进行逻辑抽象
表1
输入：红、黄、绿三盏
灯，分别用R、A、G表示， R A G Y
规定灯亮时为“1”，不
0001
亮时为“0”； 输出：故障信号，用Z表
001 0
示，规定正常工作状态
0 100
下 Z=0，发生故障时Z=1。 0 1 1 1
列出真值表如表1所示
7
课堂练习
设计一个三人表决电路，结果按“少数服从多数” 的原则决定。
计算机系
数字电子技. 术基础
8
计算机系
数字电子技. 术基础
4
实例
例1. 设计一个监视交通信号灯工作状态的逻辑电 路。每一组信号灯由红、黄、绿三盏灯组成。正常工作 情况下，任何时刻总有一盏灯点亮，而只允许有一盏灯 点亮。而当出现其他五种点亮状态时，电路发生故障， 这时要求发出故障信号，以提醒维护人员前去维修。
《组合逻辑电路》PPT课件
输入
输出
DCBA
0000 0001 0010 0011 0100 0101 0110 0111 1000 1001 1010 1011 1100 1101 1110 201211/31 /21 6
Y 2Y 1Y 0
001 001 001 001 001 001 010 010 010 010 010 100 100 100 100 100
2021/3/26
（第4章-13）
例1：设计一个监视交通信号灯状态的逻辑电路
R
A 如果信号灯 Z
出现故障，
G
Z为1
2021/3/26
（第4章-14）
输入变量 输
出
1. 抽象
R AGZ
• 输入变量: 红（R）、黄（A）、绿（G）
• 输出变量： 故障信号（Z）
2. 写出逻辑表达式
0 001 0 010 0 100 0 111
例3：试分析图示电路的逻辑功能，指出该电路的用途。
解： 1.根据逻辑图写出逻辑式
Y2 DC DBA DC DBA
D
1
C
1
B
Y1 DCBDCBDCA A
1
DCBDCBDCA 1
&& & && &&
Y0 DC DB DC DB
&
&
&
Y2
Y1
Y0
2021/3/26
（第4章-11）
2.列出真值表
1 000
Z R 'A 'G ' R 'A R G 'G A R' A RG AG
1 011Biblioteka 1 1012021/3/26
三章组合逻辑电路设计ppt课件
能对两个一位二进制数相加，求得其和 值及进位的逻辑电路称为半加器。半加 器的特点是：只考虑两个一位二进制数 的相加，而不考虑来自低位进位的运算 电路，称为半加器。任务7中设计的一位 加法器级为半加器。
3.2 全加器
一位二进制数相加不仅要考虑本位的加 数与被加数，还要考虑低位的进位信号， 而输出包括本位和以及向高位的进位信 号，这就是通常所说的全加器。
f~0f~reBiblioteka 0aPRED
Q
f
b
ENA
clk CLR
3.1 组合逻辑电路定义
组合逻辑含义：
电路任一时刻的输出状态只决定于 该时刻各输入状态的组合，而与电路的 原状态无关。组合电路就是由门电路组 合而成，电路中没有记忆单元，没有反 馈通路。
3.1 组合逻辑建模方法
建模思路：
用语言表述出来：针对输入，总有确定的输出，输入一变化，输出就随之 变化
设计思路：
1.打开scan0的时候， 在abcdefg线上赋值 “9”
2.打开scan1的时候， 在abcdefg线上赋值 “5”
需要轮流打开4个数码管，每 个数码管显示1/4的时间，由 于视觉暂留效应，就好像显示
4个不同的数字
3.打开scan2的时候， 在abcdefg线上赋值 “2”
4.打开scan3的时候， 在abcdefg线上赋值 “7”
count <= count + 1; disable COUNT; end end endmodule
3.3过程中的阻塞赋值与非阻塞赋值
阻塞式 （blocking） 的操作符为 “=”
非阻塞式 （non-blocking）的操作符为 “ <= ”
阻塞赋值和非阻塞赋值的基本区别是： 阻塞赋值是顺序执行语句，而非阻塞赋 值是并行执行语句。两种语句的含义不 同，建模的应用也就不同。
3.2 全加器
一位二进制数相加不仅要考虑本位的加 数与被加数，还要考虑低位的进位信号， 而输出包括本位和以及向高位的进位信 号，这就是通常所说的全加器。
f~0f~reBiblioteka 0aPRED
Q
f
b
ENA
clk CLR
3.1 组合逻辑电路定义
组合逻辑含义：
电路任一时刻的输出状态只决定于 该时刻各输入状态的组合，而与电路的 原状态无关。组合电路就是由门电路组 合而成，电路中没有记忆单元，没有反 馈通路。
3.1 组合逻辑建模方法
建模思路：
用语言表述出来：针对输入，总有确定的输出，输入一变化，输出就随之 变化
设计思路：
1.打开scan0的时候， 在abcdefg线上赋值 “9”
2.打开scan1的时候， 在abcdefg线上赋值 “5”
需要轮流打开4个数码管，每 个数码管显示1/4的时间，由 于视觉暂留效应，就好像显示
4个不同的数字
3.打开scan2的时候， 在abcdefg线上赋值 “2”
4.打开scan3的时候， 在abcdefg线上赋值 “7”
count <= count + 1; disable COUNT; end end endmodule
3.3过程中的阻塞赋值与非阻塞赋值
阻塞式 （blocking） 的操作符为 “=”
非阻塞式 （non-blocking）的操作符为 “ <= ”
阻塞赋值和非阻塞赋值的基本区别是： 阻塞赋值是顺序执行语句，而非阻塞赋 值是并行执行语句。两种语句的含义不 同，建模的应用也就不同。
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警信号。要求用与非门组成电路。
黄灯 X X X X √ √ √ √
绿灯 X X √ √ X X √ √
红灯 X √ X √ X √ X √
输出结果 √ X X √ X √ X √
逻辑门与组合逻辑电路
电子技术基础 1 确定逻辑函数与变量关系
设黄、绿、红三灯分别用输
黄灯
绿灯
红灯
输出结果
入变量A、B、C表示， 灯
电子技术基础
实验一：组合逻辑电路的设计
逻辑门与组合逻辑电路
电子技术基础
逻辑门与组合逻辑电路
电子技术基础
5.3 组合逻辑电路的设计 根据给定的逻辑功能，画出实现该功能的逻辑电路的过程 称为组合逻辑电路的设计。
用与非门设计一个交通报警控制电路。交通信号灯有 黄、绿、红3种，3种灯分别单独工作或黄、绿灯同时 工作时属正常情况，其他情况均属故障，出现故障时输出报
5 画出逻辑电路图
A
1
&
B
1
C
1
&
&
F
&
显然，组合逻辑电路的设计步骤为：①据题意确定输入、 输出变量的逻辑形式；②列出相关真值表；③写出相应逻 辑表达式；④化简逻辑式；⑤根据最简逻辑式画出逻辑电 路图。
逻辑门与组合逻辑电路
电子技术基础
湖南卫视超级女声海选，有三名评委。 只有当两名以上评委(其中要求必有主评委) 表示同意时，表明该名选手可以晋级，否则 予以淘汰。
逻辑门与组合逻辑电路
电子技术基础
请各位同仁批评指正！
逻辑门与组合逻辑电路
F
2 列
0
出
1
相 应
0
真
1
值
表
F ABC ABC ABC ABC
3 列出逻辑函数式
用卡诺图对上式进行化简：Biblioteka 4 得出最简式BC
A 00 01 11 10
01
1
F ABC AC BC
1
11
逻辑门与组合逻辑电路
电子技术基础 应用非非定律对逻辑式变换，找出输出对输入的与非关系：
F ABC AC BC ABC • AC• BC
亮时为工作，其值为“1”，灯
X
X
X
√
灭时为不工作，其值为“0”；
X
X
√
X
出报警信号用F表示，正常工
作时F值为“0”，出现故障时
X
√
X
X
F值为“1”。
X
√
√
√
√
X
X
X
√
X
√
√
√
√
X
X
√
√
√
√
逻辑门与组合逻辑电路
电子技术基础
ABC
F
000
1
001
0
010
0
011
1
ABC 100 101 110 111
黄灯 X X X X √ √ √ √
绿灯 X X √ √ X X √ √
红灯 X √ X √ X √ X √
输出结果 √ X X √ X √ X √
逻辑门与组合逻辑电路
电子技术基础 1 确定逻辑函数与变量关系
设黄、绿、红三灯分别用输
黄灯
绿灯
红灯
输出结果
入变量A、B、C表示， 灯
电子技术基础
实验一：组合逻辑电路的设计
逻辑门与组合逻辑电路
电子技术基础
逻辑门与组合逻辑电路
电子技术基础
5.3 组合逻辑电路的设计 根据给定的逻辑功能，画出实现该功能的逻辑电路的过程 称为组合逻辑电路的设计。
用与非门设计一个交通报警控制电路。交通信号灯有 黄、绿、红3种，3种灯分别单独工作或黄、绿灯同时 工作时属正常情况，其他情况均属故障，出现故障时输出报
5 画出逻辑电路图
A
1
&
B
1
C
1
&
&
F
&
显然，组合逻辑电路的设计步骤为：①据题意确定输入、 输出变量的逻辑形式；②列出相关真值表；③写出相应逻 辑表达式；④化简逻辑式；⑤根据最简逻辑式画出逻辑电 路图。
逻辑门与组合逻辑电路
电子技术基础
湖南卫视超级女声海选，有三名评委。 只有当两名以上评委(其中要求必有主评委) 表示同意时，表明该名选手可以晋级，否则 予以淘汰。
逻辑门与组合逻辑电路
电子技术基础
请各位同仁批评指正！
逻辑门与组合逻辑电路
F
2 列
0
出
1
相 应
0
真
1
值
表
F ABC ABC ABC ABC
3 列出逻辑函数式
用卡诺图对上式进行化简：Biblioteka 4 得出最简式BC
A 00 01 11 10
01
1
F ABC AC BC
1
11
逻辑门与组合逻辑电路
电子技术基础 应用非非定律对逻辑式变换，找出输出对输入的与非关系：
F ABC AC BC ABC • AC• BC
亮时为工作，其值为“1”，灯
X
X
X
√
灭时为不工作，其值为“0”；
X
X
√
X
出报警信号用F表示，正常工
作时F值为“0”，出现故障时
X
√
X
X
F值为“1”。
X
√
√
√
√
X
X
X
√
X
√
√
√
√
X
X
√
√
√
√
逻辑门与组合逻辑电路
电子技术基础
ABC
F
000
1
001
0
010
0
011
1
ABC 100 101 110 111