数字集成电路基本单元与版图
精选数字电路版图设计及标准单元技术补充

网格式布线系统要求的库设计规则
二、高度固定,宽度可变如果库中的每一个门高度不同,就会导致版图中的电源线布线混乱。最小单元高度的确定:通过模拟得到的晶体管尺寸,以及库的网格来决定。一般来说,所选择的高度要略大于这个最小高度。这种技术在模拟版图设计中也经常使用。
网格式布线系统要求的库设计规则
网格式布线系统要求的库设计规则
9、静夜四无邻,荒居旧业贫。。10、雨中黄叶树,灯下白头人。。11、以我独沈久,愧君相见频。。12、故人江海别,几度隔山川。。13、乍见翻疑梦,相悲各问年。。14、他乡生白发,旧国见青山。。15、比不了得就不比,得不到的就不要。。。16、行动出成果,工作出财富。。17、做前,能够环视四周;做时,你只能或者最好沿着以脚为起点的射线向前。。9、没有失败,只有暂时停止成功!。10、很多事情努力了未必有结果,但是不努力却什么改变也没有。。11、成功就是日复一日那一点点小小努力的积累。。12、世间成事,不求其绝对圆满,留一份不足,可得无限完美。。13、不知香积寺,数里入云峰。。14、意志坚强的人能把世界放在手中像泥块一样任意揉捏。15、楚塞三湘接,荆门九派通。。。16、少年十五二十时,步行夺得胡马骑。。17、空山新雨后,天气晚来秋。。9、杨柳散和风,青山澹吾虑。。10、阅读一切好书如同和过去最杰出的人谈话。11、越是没有本领的就越加自命不凡。12、越是无能的人,越喜欢挑剔别人的错儿。13、知人者智,自知者明。胜人者有力,自胜者强。14、意志坚强的人能把世界放在手中像泥块一样任意揉捏。15、最具挑战性的挑战莫过于提升自我。。16、业余生活要有意义,不要越轨。17、一个人即使已登上顶峰,也仍要自强不息。
标准单元技术
一般用于数字版图设计。单元库中的标准单元按照一定的规则进行设计,以便可以堆积在一起(像积木一样)形成逻辑电路。
集成电路版图设计(适合微电子专业)

①了解工艺现状,确定工艺路线
确定选用标准pn结隔离或对通隔离工艺或等平面 隔离工艺。由此确定工艺路线及光刻掩膜版的块数。 由制版和光刻工艺水平确定最小接触孔的尺寸和 光刻套刻精度。光刻工艺的分辨率,即能刻蚀图形的 最小宽度,受到掩膜分辨率、光刻胶分辨率、胶膜厚 度、横向腐蚀等多因素的限制。套刻精度与光刻机的 精度和操作人员的熟练程度关系密切。
功能设计 设 计 逻辑设计 电路设计 功能图 逻辑图 电路图 符号式版图 , 版图
图
版图设计
12
举例:
功能描述 x=a’b+ab’ 的逻辑图
13
CMOS与非门的电路图
14
场SiO2
栅SiO2 栅SiO2
CMOS反相器的掩膜版图
15
版图设计就是按照线路的要求和一定 的工艺参数,设计出元件的图形并进行排 列互连,以设计出一套供IC制造工艺中使 用的光刻掩膜版的图形,称为版图或工艺 复合图。 版图设计是制造IC的基本条件,版图 设计是否合理对成品率、电路性能、可靠 性影响很大,版图设计错了,就一个电路 也做不出来。若设计不合理,则电路性能 和成品率将受到很大影响。版图设计必须 与线路设计、工艺设计、工艺水平适应。 版图设计者必须熟悉工艺条件、器件物理、 电路原理以及测试方法。 16
23
要了解采用的管壳和压焊工艺。封 装形式可分为金属圆筒塑(TO-5型)、扁 平封装型和双列直插型(DIP)等多种,管 芯压点分布必须和管壳外引脚排列相吻 合。当采用热压焊时,压焊点的面积只 需70μm×70μm,超声压焊需 100μm×100μm ~125μm×25μm,金丝 球焊需125μm ×125μm,金丝球焊牢固 程度高,金丝在靠近硅片压点处是垂直 的,可压到芯片纵深处(但必须使用温度 SiO2纯化层),使用起来很灵活。
制造工艺-CMOS集成电路原理图及版图

硅芯片上的电子世界—晶体管
• 三级管:pnp,npn • 硅芯片上的三极管:
2012年春季
P+ …N…+. P+
N阱
P型衬底
28中北大学
三极管的设计
CMOS工艺下可以做双极晶体管。 以N阱工艺为例说明PNP, NPN如何形成。
PNP
注:
薄氧
由于P衬底接最低电位vss/gnd
因此,VPNP集电极也必须接
C
N+
N–-epi
钝化层
SiO2
P+
P-Sub
2012年春季
N+埋层
P P(G- ND)
N+
Sub
EB C
N+ P
N+
P+
N–-epi
60
60中北大学
版图设计
• 电子设计 + 绘图艺术 • 仔细设计,确保质量
2012年春季
61中北大学
MOS管的版图设计
沟道宽
沟道长
当多晶硅穿过有源区时,就形成了一个管子。在图中当 多晶硅穿过N型有源区时,形成NMOS,当多晶硅穿过P型有 源区时,形成PMOS。
MIM 上电级
第n-1层金属
电容区的下方不要走线;
2012年春季
20中北大学
多层金属制作的平板电容和侧壁电容
多层平板电容(MIM) •增加单位面积电容; •精度高,匹配性好;
2012年春季
侧壁电容: •单位面积电容值可比左边的大; •精度较高,匹配性较好;
21中北大学
MOS电容
CGS
累积区
强反型
vss/gnd 。
C
B
9-数字集成电路基本单元与版图

NMOS传输门(续)
假定: = 0 —— V = 0
= 1 —— V = Vdd I = 0 —— Vi = 0 I = 1 —— Vi = Vdd
则传输门的输出电压Vo特性为,
=0 —— VO= VO =1 —— VO= min(Vi, V -Vtn)
NMOS传输门(续)
7
CMOS反相器的转移特性
NMOS:
Vi < Vtn Vi > Vtn
截止 导通
PMOS:VVii
> <
Vdd Vdd
-
|Vtp| |Vtp|
截止 导通
PMOS视为NMOS的负载,可以像作负载线一样,把PMOS的 特性作在NMOS的特性曲线上
整个工作区 分为五个区域
ABCDE
8
CMOS反相器的转移特性(续1)
R1B
A
T1A
T2A T2B
T1B
B
Re2
R4
T4
D L
T3
A
B
GND
(a)
GND
≥1
L AB
(b)
5
第九章 数字集成电路基本单元与版图
9.1 TTL基本电路 9.2 CMOS基本门电路及版图实现 9.3 数字电路标准单元库设计 9.4 焊盘输入输出单元 9.5 了解CMOS存储器
6
9.2.1 CMOS反相器
处于饱和区,等效一个电流源:
Idsp =
p
2
(Vi
Vdd
Vtp )2
NMOS强导通,等效于非线性电阻
Idsn
n
Vi
Vtn
Vdsn
数字集成电路设计 pdf

数字集成电路设计一、引言数字集成电路设计是一个广泛且深入的领域,它涉及到多种基本元素和复杂系统的设计。
本文将深入探讨数字集成电路设计的主要方面,包括逻辑门设计、触发器设计、寄存器设计、计数器设计、移位器设计、比较器设计、译码器设计、编码器设计、存储器设计和数字系统集成。
二、逻辑门设计逻辑门是数字电路的基本组成单元,用于实现逻辑运算。
常见的逻辑门包括与门、或门、非门、与非门和或非门等。
在设计逻辑门时,需要考虑门的输入和输出电压阈值,以确保其正常工作和避免误操作。
三、触发器设计触发器是数字电路中用于存储二进制数的元件。
它有两个稳定状态,可以存储一位二进制数。
常见的触发器包括RS触发器、D触发器和JK触发器等。
在设计触发器时,需要考虑其工作原理和特性,以确保其正常工作和实现预期的功能。
四、寄存器设计寄存器是数字电路中用于存储多位二进制数的元件。
它由多个触发器组成,可以存储一组二进制数。
常见的寄存器包括移位寄存器和同步寄存器等。
在设计寄存器时,需要考虑其结构和时序特性,以确保其正常工作和实现预期的功能。
五、计数器设计计数器是数字电路中用于对事件进行计数的元件。
它可以对输入信号的脉冲个数进行计数,并输出计数值。
常见的计数器包括二进制计数器和十进制计数器等。
在设计计数器时,需要考虑其工作原理和特性,以确保其正常工作和实现预期的功能。
六、移位器设计移位器是数字电路中用于对二进制数进行移位的元件。
它可以对输入信号进行位移操作,并输出移位后的结果。
常见的移位器包括循环移位器和算术移位器等。
在设计移位器时,需要考虑其工作原理和特性,以确保其正常工作和实现预期的功能。
七、比较器设计比较器是数字电路中用于比较两个二进制数的元件。
它可以比较两个数的值,并输出比较结果。
常见的比较器包括并行比较器和串行比较器等。
在设计比较器时,需要考虑其工作原理和特性,以确保其正常工作和实现预期的功能。
八、译码器设计译码器是数字电路中用于将二进制数转换为另一种形式的元件。
数字集成电路设计入门(从HDL到版图)6-9

第六章Verilog的数据类型及逻辑系统学习内容:•学习Verilog逻辑值系统•学习Verilog中不同类的数据类型•理解每种数据类型的用途及用法•数据类型说明的语法Verilog采用的四值逻辑系统’0’, Low, False, Logic Low, Ground,VSS,Negative Assertion‘1’, High, True, Logic High, Power,VDD, VCC, Positive Assertion’X’ Unknown: Occurs at Logical Which Cannotbe Resolved ConflictHiZ, High Impedance, Tri-Stated,Disabled Driver (Unknown)主要数据类型Verilog主要有三类(class)数据类型:•net (线网): 表示器件之间的物理连接•register (寄存器):表示抽象存储元件•parameters(参数) : 运行时的常数(run-time constants)net(线网)net需要被持续的驱动,驱动它的可以是门和模块。
当net驱动器的值发生变化时,Verilog自动的将新值传送到net上。
在例子中,线网out由or门驱动。
当or门的输入信号置位时将传输到线网net上。
•有多种net 类型用于设计(design-specific)建模和工艺(technology-specific)建模•没有声明的net 的缺省类型为1 位(标量)wire 类型。
但这个缺省类型可由下面的编译指导改变:`default_nettype <nettype>net 类型功能wire, trisupply1, supply0wor, triorwand, triandtriregtri1, tri0标准内部连接线(缺省)电源和地多驱动源线或多驱动源线与能保存电荷的net 无驱动时上拉/下拉综合编译器不支持的net 类型•wire类型是最常用的类型,只有连接功能。
《集成电路版图设计》课件
了解各种元器件的工作原理是进行版图设计的基础,如晶 体管的工作原理涉及到载流子的运动和电荷的积累等。
元器件版图设计规则
在进行元器件版图设计时,需要遵循一定的设计规则,如 电阻的阻值计算、电容的容量计算等,以确保设计的准确 性和可靠性。
集成电路工艺
01 02
集成电路工艺流程
集成电路的制造需要经过多个工艺步骤,包括薄膜制备、光刻、刻蚀、 掺杂等,这些工艺步骤的参数和条件对集成电路的性能和可靠性有着重 要影响。
学生需要按照指导要求,完成集成电路版图设计实践任务,并
提交实践报告。
集成电路版图设计实践图设计
案例四
某混合信号集成电 路版图设计
案例一
某数字集成电路版 图设计
案例三
某射频集成电路版 图设计
案例五
某可编程逻辑集成 电路版图设计
集成电路版图设计实践经验总结
实践经验总结的重要性
特点
集成电路版图设计具有高精度、 高复杂度、高一致性的特点,需 要综合考虑电路功能、性能、可 靠性以及制造工艺等多个方面。
集成电路版图设计的重要性
01
02
03
实现电路功能
集成电路版图设计是将电 路设计转化为实际产品的 关键环节,是实现电路功 能的重要保障。
提高性能和可靠性
合理的版图设计可以提高 集成电路的性能和可靠性 ,确保产品在长期使用中 保持稳定。
DRC/LVS检查
进行设计规则检查和版图验证 ,确保版图设计的正确性和可 制造性。
布图输出
将版图数据输出到制造环节, 进行硅片的制作。
02
集成电路版图设计基础知识
半导体材料
半导体材料分类
半导体材料分为元素半导体和化合物半导体两大类,元素半导体包括硅和锗,化合物半导 体包括三五族化合物(如砷化镓、磷化镓等)和二六族化合物(如硫化镉、硒化镉等)。
第八章 数字集成电路基本单元及版图
§7.数字电路标准单元库设计简介
基本设计思想 用人工设计好的各种成熟的、优化的、 版图等高的单元电路,存储在一个单元数据 库中。根据用户的要求,把电路分成各个单 元的连接组合。通过调用单元库的这些单元, 以适当方式把它们排成几行,使芯片成长方 形,行间留出足够的空隙作为单元行间的连 线通道。利用EDA工具,根据已有的布局、 布线算法,可以自动布出用户所要求的IC。
TTL基本电路及版图实现
IC的版图设计已把电路与工艺融为一体,所以一般 较复杂的电路都是先设计实验电路(或单元电路), 根据实验电路的测试结果获得有关电路功能和电路 参数的第一手资料。 掌握了这些资料,就可以根据元件的不同要求,在 设计中采取相应措施,保证电路达到设计目标。必 要时还要调整个别工艺或工艺参数。 当然设计出的版图要经过实践不断加以改进,一个 成熟的产品一般都要经过几次改版才行。
υ1
T3 Re2
负 载
v0 -
-
GND
TTL基本电路
(1)电路组成 该电路由三部分组成: 1)由双极型晶体管T1和电阻Rb1组成电路输入级。 2)由T2、Re2和Rc2组成中间驱动电路,将单端信号 υB2转换为双端信号υB3和υB4。 3)由T3、T4、Rc4和二级管D组成输出级。 (2)工作原理 输入为高电平时,输出为低电平。 输入为低电平时,输出为高电平。
CMOS反相器
瞬态特性
我们希望反相器的上升时间和下降时间近似相等,则 需要使PMOS管的沟道宽度必须加宽到NMOS管沟道 宽度的 n / p倍左右。 V (t)
i
+VDD 0 t Vo(t) +VDD 0.9VDD 0.1VDD 0
td tf tr
数字集成电路基本单元
4
三态门版图
2020/3/1
4
驱动电路
驱动电路的结构示意图
2020/3/1
4
驱动电路版图
2020/3/1
4
9.3 数字电路标准单元库设计
基本原理
设计者或高级 综合设计系统
功能定义与说明 用户设计逻辑图
标准单元设计流程图
逻辑图输入
单元逻辑符号库
逻辑模拟、时序模拟
单元电路功能库
标准单元 设计系统
2020/3/1
2
3. CMOS反相器的瞬态特性
研究瞬态特性与研究静态 特性不同的地方在于必须考虑 负载电容(下一级门的输入电 容)的影响。
脉冲电路上升,下降和延迟 时间的定义,即如图所示。
tr : (Vo=10%VomaxVo=90%Vomax) tf : (Vo=90%VomaxVo=10%Vomax) td : (Vi=50%VimaxVo=50%Vomax)
布局、布线 提取布线寄生参数
单元拓扑库 工艺、电学参数
生成测试向量
逻辑模拟、时序模拟
转换拓扑图为掩模版版图
2020/3/1
9
转移特性(续)
整个工作区可以分为五个区域来讨论:
1. A区:0 Vi Vtn
NMOS截止 Idsn = 0
PMOS导通 Vdsn = Vdd Vdsp = 0
等效电路如右图所示。
2020/3/1
1
转移特性(续)
2. B区: Vtn Vi ½ Vdd NMOS导通,处于饱和区,等效于一个电流源:
on
C On+ on+
D On on++
E off on+++
《集成电路版图设计》课件
布局原则
在布局时,应遵循一些基本原则,如模块化、层次化、信号流向清晰等,以提高 布局的可读性和可维护性。
优化方法
可以采用一些优化方法来提高布局的效率和可读性,如使用自动布局算法、手动 调整布局、考虑布线约束等。
布线优化
布线原则
在布线时,应遵循一些基本原则,如 避免交叉、减少绕线、保持线宽一致 等,以提高布线的可靠性和效率。
04
集成电路版图设计技巧与优化
布图策略与技巧
布图策略
根据电路功能和性能要求,选择合适的布图策略,如层次化、模块化、对称性 等,以提高布图的效率和可维护性。
技巧
在布图过程中,可以采用一些技巧来提高布图的效率和可读性,如使用标准单 元、宏单元等模块化设计,以及合理利用布局空间、避免布线拥堵等。
布局优化
用于实现电路中的电阻功能,调节电流和电 压。
电感器
用于实现电路中的电感功能,用于产生磁场 和感应电流。
版图设计规则
几何规则
规定了各种几何元素的使用方法和尺寸 ,以确保版图的准确性和一致性。
器件规则
规定了各种器件的尺寸、形状和排列 方式,以确保器件的性能和可靠性。
连线规则
规定了各种连线元素的宽度、间距和 连接方式,以确保电路的可靠性和稳 定性。
直线
用于连接集成电路中的不同部 分,实现电路的导通。
弧线
用于表示不同层之间的过渡, 以平滑电路。
折线
用于表示复杂电路中的分支或 连接点。
点
用于表示电路中的节点或连接 点。
ቤተ መጻሕፍቲ ባይዱ 器件元素
晶体管
用于实现电路中的逻辑功能,是集成电路中 的基本元件。
电容器
用于实现电路中的电容功能,用于存储电荷 和过滤信号。
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Vdsn = 0 |Vdsp| = Vdd Idsp = 0
等效电路如图所示。
转移特性(续)
综合上述讨论,CMOS反相器的转移特性和稳态支路电流如图
所示。
Vo
Id s n
AB Vd d
Vo
D
Eபைடு நூலகம்
C
0
Vtn
Vdd Vdd+Vtp Vdd
-
Vtn )2
n
n t ox
Wn Ln
称之为NMOS平方率跨导因子。
PMOS等效于非线性电阻:
Isdp
=
p[(Vi
-
Vdd
-
Vtn
)
( Vo
-
Vdd
)
-
1 2
(Vo
-
Vdd
)]
p
p Wp tox Lp
称之为PMOS平方率跨导因子。
在Idsn的驱动下,Vdsn自Vdd下降, |Vdsp|自0V开始上升。等效电路如图所 示。
Is-s= 0
Vi = Vdd (I = 1) Vo = 0
(O=0)
Pdc= 0
从一种状态转换到另一种状态时,有:
(I = 0) (I = 1) (I =1) (I = 0)
Is-s 0 Ptr 0
转移特性(续)
对于模拟信号,CMOS反相器必须工作在B区和D 区之间,反相器支路始终有电流流通, 所以
Is-s> 0, Pdc> 0 。
[3]. CMOS反相器的瞬态特性
研究瞬态特性与研究静态 特性不同的地方在于必须考虑 负载电容(下一级门的输入电 容)的影响。
脉冲电路上升,下降和延迟 时间的定义,即如图所示。
tr : (Vo=10%VomaxVo=90%Vomax) tf : (Vo=90%VomaxVo=10%Vomax) td : (Vi=50%VimaxVo=50%Vomax)
[2]. 转移特性(续)
在直流电路上,PMOS和NMOS串联连接在Vdd 和 地之间,因而有
Vdsn - Vdsp = Vdd
Idsn从NMOS的d流向s,是正值, Idsp从PMOS的d流 向s,是负值。
[2]. 转移特性(续)
把PMOS视为NMOS的负载,可以像作负载线一样, 把PMOS的特性作在NMOS的特性曲线上。如图所示
7.1 TTL基本电路
VCC(5V)
Rb1 Rc2
Rc4
+
T1
υ1
-
T2 Re2
T4
D +
T3 负 v0 载 -
GND
图7.1 TTL反相器的基本电路
VCC
Rb1 Rc2
Rc4
A
B
T1
C
T4
T2
D
A
L
B T3
C Re2
& L ABC
(a)
GND
(b)
图7.3 具有多发射极晶体管的3输入端与非门电路: (a)电路图,(b)符号
Vi
Vdd
Vtp 1
Vtn n n / p
/p
如果n=p,且有 Vtn= -Vtp,则有 Vi = Vdd/2 但是,n (2-3) p,所以应有 Wp/Lp 2.5 Wn/Ln 由n=p,Vtn= -Vtp和Vi = Vdd/2,应有 VO = Vdd/2
转移特性(续)
比(n/p)对转移特性的影响,如下图所示。
在电路中,PMOS和NMOS地位对等,功能互补
它们都是驱动管,都是有源开关,部分的互为负载:
它们都是增强型 MOSFET
对于NMOS有 对于PMOS有
Vi < Vtn Vi > Vtn
截止 导通
Vi > Vdd - |Vtp| 截止 Vi < Vdd - |Vtp| 导通 对输入和输出信号而言,PMOS和NMOS是并联的
转移特性(续)
整个工作区可以分为五个区域来讨论:
1. A区:0 Vi Vtn
NMOS截止 Idsn = 0
PMOS导通 Vdsn = Vdd Vdsp = 0
等效电路如右图所示。
转移特性(续)
2. B区: Vtn Vi ½ Vdd NMOS导通,处于饱和区,等效于一个电流源:
Idsn
=
n 2
(Vi
转移特性(续)
3. C区: Vi ½ Vdd
NMOS导通,处于饱和区,
PMOS也导通, 处于饱和区,
均等效于一个电流源,等效电路如 右图所示。此时有,
Idsn
=
n 2
(Vi
- Vtn )2
Idsp
=
p 2
(Vi
-
Vdd
Vtp )2
转移特性(续)
两个电流必须相等,即 Idsn = Isdp,所以
n (Vi -Vtn )2 = p (Vi -Vdd Vtp )2
另外一种符号表示
注意2:
NMOS的源极接地, 漏极接高电位; PMOS的源极接Vdd, 漏极接低电位。
注意3:
输入信号Vi对两管来说, 都是加在g和s之间, 但
是由于NMOS的s接地, PMOS的s接 Vi对两管来说参考电位是不同的。
Vdd,所以
[2]. 转移特性
在分析CMOS反相器的特性时,注意如下事实:
CMOS反相器的瞬态特性
i) Vi从1到0, CL充电。
在此过程中,NMOS和PMOS源、漏极间电压的变化过程为: Vdsn:0Vdd |Vdsp|:Vdd0 ,即 123原点
CMOS反相器的瞬态特性
考虑到上拉管导通时先为饱和状态而后为非饱和 状态,故输出脉冲上升时间可分为两段来计算。
﹤
CMOS反相器的瞬态特性
转移特性(续)
4. D区: Vdd/2 Vi Vdd/2 +Vtp 与B区情况相反:
PMOS导通,处于饱和区,
等效一个电流源:
I dsp
=
p 2
(Vi
- Vdd
Vtp )2
NMOS强导通,等效于非线性电阻:
Idsn
n Vi
Vtn
Vdsn
V2 dsn 2
等效电路如图所示。
转移特性(续)
VCC
R1A
R2
R1B
A
T1A
T2A T2B
T1B
B
Re2
R4
T4
D L
T3
A
B
≥1
L AB
GND
(a)
GND
(b)
图7.4 TTL或非门 (a) 电路图 (b) 符号
7.2 CMOS反相器
[1]. 电路图
标准的CMOS反相器 电路如图所示。
注意1: NMOS和PMOS的衬底是分开的, NMOS的衬底接最低电位地, PMOS的衬底接最高电位Vdd。
Vi
2
转移特性(续)
PMOS和NMOS在5个区域中的定性导电特性。
A
B
C
D
E
PMOS on+++
on++
On+
On
off
NMOS off
on
on+
on++
on+++
转移特性(续)
对于数字信号,CMOS反相器静态时,或工作在 A区, 或工作在E区。 此时有:
Vi = 0 (I = 0) Vo = Vdd ( O = 1 )
a、饱和状态时 假定VC(0)=0, 恒流充电时间段有