数电课设报告
数电课设报告
数电计数报警器课设报告摘要：利用数字电子技术基础知识设计一个计数报警器，该计数报警器的设计采用的元件主要有译码器74LS247、十进制计数器74LS192、555组成的单稳态触发器。
该计数报警器计数最大值是99，当计数溢出时放出声光报警，报警时间为10秒,计数脉冲由按钮和555组成的单稳态触发器产生。
关键词:555定时器; 计数器; 触发器; 译码器；数码管1、课题设计背景1.1 了解数字电路系统的定义及组成数字电路系统一般包括输入电路、控制电路、输出电路、时钟电路和电源等.输入电路主要作用是将被控信号转换成数字信号，其形式包括各种输入接口电路。
比如数字频率计中，通过输入电路对微弱信号进行放大、整形，得到数字电路可以处理的数字信号。
模拟信号则需要通过模数转换电路转换成数字信号再进行处理。
在设计输入电路时,必须首先了解输入信号的性质，接口的条件，以设计合适的输入接口电路。
1.2 掌握时钟电路的作用及基本构成时钟电路是数字电路系统中的灵魂,它属于一种控制电路，整个系统都在它的控制下按一定的规律工作。
时钟电路包括主时钟振荡电路及经分频后形成各种时钟脉冲的电路。
比如多路可编程控制器中的555 多谐振荡电路，数字频率计中的基准时间形成电路等都属于时钟电路.设计时钟电路，应根据系统的要求首先确定主时钟的频率，并注意与其他控制信号结合产生系统所需的各种时钟脉冲。
2、设计任务目的和要求2.1 设计任务：设计一个到计数达99时报警的计数报警器2。
2 设计要求:A、设计一个计数报警器;B、计数最大值为99；C、计数达到最大时发出声光报警信号，报警时间长度为10秒，报警信号用红色LED表示；D、计数脉冲用按钮产生。
3、设计方案选取经过任务分析可得，本设计用到两片74LS192组成100进制计数，用两片74LS47来驱动两个七段共阳极数码管，需要一个电平开关作为手动脉冲控制，计数的次数由数码管显示.需要一片555定时器若干电阻、电容,构成多谐振荡器，然后用555定时器组成多谐振荡器电路产生10秒脉冲驱动扬声器和LED,以此来产生报警信号。
数电课程设计(血型遗传规律分析电路)报告精选全文完整版
可编辑修改精选全文完整版课程设计课程名称：数字电子技术设计题目：血型遗传分析电路院系：指导教师：专业：学号：姓名：年月日目录No table of contents entries found.第一章设计目的1.本实验设计的研究目的主要是帮助学生掌握组合逻辑电路的分析和计算方法，培养学习专业知识能力。
2.通过血型遗传规律分析电路的设计，使学生在查阅资料、设计方案、参数选择、电路制作、系统调试等方面得到训练，并使学生在电路设计方面具有进一步发挥的余地。
3.根据遗传学中血型遗传规律，设计一种血型遗传规律分析电路。
使用时，只要按钮输入一组父母的血型，仪器能立即显示出子女可能的血型第二章设计要求1、根据电路设计指标的要求，本次设计血型遗传规律分析电路考虑由常用的TTL集成电路设计，由译码电路、按钮控制输入电路、译码显示电路等组成，用探针作为显示指示灯，显示子女的可能的血型。
图1 血型遗传规律分析电路设计方框图方案：血型遗传规律分析电路由两片74LS138译码器，若干与非门完成；方案材料表序号元器件名称规格型号数量备注1 3,8线译码器74LS138D 22、方案要经济实惠，还要更加直观方便的实现电路的功能，元件尽量少，连线布置更简单，维修方便。
第三章总体方案本设计用两片74LS138 线译码器以及逻辑门设计了一种血型遗传分析电路，电路中用单刀双掷开关控制输入端的高低电平来表示父母的血型情况，用灯泡的亮灭代表子女的可能的血型。
实现了输入父母血型就可以实现子女可能血型的设计。
通过用multisim的逻辑电路的仿真成功完成了电路测试。
血型遗传规律分析电路总原理图如图所示：图2 血型遗传电路原理图其主要功能为实现血型遗传规律的电路设计，电路主要由单刀双掷开关、3,8线译码器、与非门、探针组成.其工作原理如下：AB 代表父亲血型，CD代表母亲血型，则一共有16种血型配对的可能，所以本实验采用两片74LS138（译码器）级联，可完成4输入16输出功能血型配对真值表如下：在电路设计上，我们从子女的血型可能性入手，设计输出六组信号，每一组代表在父母的血型影响下孩子可能出现的血型根据设计指标中提供的血型配对表格,可多得到以下结果：实验电路图中对应的 ProdeX1 代表——B型和O型。
数电课程设计报告
数电课程设计报告 The following text is amended on 12 November 2020.《基于FPGA的洗衣机电机正反转控制器》学院：信息与控制工程学院专业：电子信息工程班级：姓名：学号：2014年7月目录1.设计任务与要求........................................................ . (1)2.设计思路........................................................ (1)3.设计原理及方案....................................................................... (2)4.总结与讨论........................................................................... (14)一、设计任务及要求：1．控制洗衣机的电机作如下周期性运转，正转4S――暂停2S――反转4S――暂停2S，用8位七段数码管显示自己学号的后四位（显示在从左边数第一个到第四个数码管上）、定时时间（两位，单位：分钟，显示在第五个和第六个数码管上）,剩余时间（两位，单位：分钟，显示在第七个和第八个数码管上2．洗衣机控制器的工作过程为：(1)上电后显示自己学号的后四位，在运行中不变；初始洗涤时间为10分钟，在开始前可用S1和S2按键设置总的工作时间，确定洗衣机控制器定时工作时间。
(按下并松开S1定时时间增加一分钟，按下并松开S2定时时间减少一分钟，时间范围为：00~30分钟)(2)设定好定时时间后，按下并松开S3(按下时S3=0，松开时S3=1)，启动控制器，整个系统开始运行；再次按下并松开S3，停止运行；再次按下并松开S3继续运行；按下并松开S4则回到上电初始状态。
其他两个按键不起作用。
数电课程设计报告数字钟的设计
数电课程设计报告第一章设计背景与要求设计要求第二章系统概述设计思想与方案选择各功能块的组成工作原理第三章单元电路设计与分析各单元电路的选择设计及工作原理分析第四章电路的组构与调试遇到的主要问题现象记录及原因分析解决措施及效果功能的测试方法,步骤,记录的数据第五章结束语对设计题目的结论性意见及进一步改进的意向说明总结设计的收获与体会附图电路总图及各个模块详图参考文献第一章设计背景与要求一．设计背景与要求在公共场所,例如车站、码头,准确的时间显得特别重要,否则很有可能给外出办事即旅行袋来麻烦;数字钟是一种用数字电路技术实现时、分、秒计时的装置,与机械式时钟相比具有更高的准确度和直观性,且无机械装置,具有更长的使用寿命,因此得到了广泛的使用;数字钟是一种典型的数字电路,包括了组合逻辑电路和时序电路;设计一个简易数字钟,具有整点报时和校时功能;1以四位LED数码管显示时、分,时为二十四进制;2时、分显示数字之间以小数点间隔,小数点以1Hz频率、50%占空比的亮、灭规律表示秒计时;3整点报时采用蜂鸣器实现;每当整点前控制蜂鸣器以低频鸣响4次,响1s、停1s,直到整点前一秒以高频响1s,整点时结束;4才用两个按键分别控制“校时”或“校分”;按下校时键时,是显示值以0~23循环变化；按下“校分”键时,分显示值以0~59循环变化,但时显示值不能变化;二．设计要求电子技术是一门实践性很强的课程,加强工程训练,特别是技能的培养,对于培养学生的素质和能力具有十分重要的作用;在电子信息类本科教学中,课程设计是一个重要的实践环节,它包括选择课题、电子电路设计、组装、调试和编写总结报告等实践内容;通过本次简易数字钟的设计,初步掌握电子线路的设计、组装及调试方法;即根据设计要求,查阅文献资料,收集、分析类似电路的性能,并通过组装调试等实践活动,使电路达到性能要求;第二章系统概述设计思想与方案选择方案一 ,利用数字电路中学习的六十进制和二十四进制计数器和三八译码器来实现数字中的时间显示;方案二,利用AT89S51单片机和74HC573八位锁存器以及利用C语言对AT89S51进行编程来实现数字钟的时间显示;由于方案一通过数电的学习我们都比较熟悉,而方案二比较复杂,涉及到比较多我们没学过的内容,所以选择方案一来实施;简易数字钟电路主体部分是三个计数器,秒、分计数器采用六十进制计数器,而时计数器采用二十四进制计数器,其中分、时计数器的计数脉冲由校正按键控制选择秒、分计数器的溢出信号或校正10Hz计数信号;计数器的输出通过七段译码后显示,同时通过数值判断电路控制蜂鸣器报时;各功能块的组成分频模块,60进制计数器模块,24进制计数器模块,4位显示译码模块,正点报时电路模块,脉冲按键消抖动处理模块工作原理一．简易数字钟的基本工作原理是对1Hz标准频率秒脉冲进行计数;当秒脉冲个数累计满60后产生一个分计数脉冲,而分计数脉冲累计满60后产生一个时计数脉冲,电路主要由3个计数器构成,秒计数和分计数为六十进制,时计数为二十四进制;将FPGA开发装置上的基准时钟OSC作为输入信号通过设计好的分频器分成1Hz~10MHz8个10倍频脉冲信号;1Hz的脉冲作为秒计数器的输入,这样实现了一个基本的计时装置;通过4位显示译码模块,可以显示出时间;时间的显示范围为00时00分~23时59分;二．当需要调整时间时,可使用数字钟的时校正和分校正进行调整,数字钟中时、分计数器都有两个计数脉冲信号源,正常工作状态时分别为时脉冲和分脉冲；校正状态时都为5~10Hz的校正脉冲;这两种状态的切换由脉冲按键控制选择器的S 端来实现;为了更准确的设定时间,需要对脉冲按键进消抖动处理;三．电路在整点前10 秒钟内开始控制蜂鸣器报时,可采用数字比较器或逻辑门判断分、秒计数器的状态码值,以不同频率的脉冲控制蜂鸣器的鸣响;第三章单元电路设计与分析各单元电路的选择1分频模块,设计一个8级倍率为10 的分频电路,输出频率分别为1Hz 、10Hz、100 Hz、1k Hz、10k Hz、100k Hz、1 MHz、10MHz8组占空比为50%的脉冲信号;260进制计数器模块,采用两片74161级联;324进制计数器模块,采用两片74161级联;44位显示译码模块,由分频器,计数器,数据选择器,七段显示译码,3-8线译码器构成一个4位LED数码显示动态扫描控制电路;其中4位计数器用74161,数据选择器用74153,七段显示译码器部分采用AHDL硬件描述语言设计;5正点报时电路模块,该模块采用与门和数据选择器74153构成6脉冲按键消抖动处理模块,采用D触发器实现消抖动,从而能够比较精确地设定时间;设计及工作原理分析1分频模块要输出8级频率差为10倍的分频电路,可采用十进制计数器级联实现;集成十进制计数器的类型很多,比较常用的有74160、74162、74190、74192和7490等;这里采用7490来实现分频,7490是二-五-十进制加计数器,片上有一个二进制计数器和一个异步五进制计数器;QA是二进制加计数器的输出,QB、QC、QD是五进制加计数器的输出,位序从告到低依次为D,C,B;该分频器一共用到7片7490,初始信号输入到第一片7490的CLKB 端口,QD输出端连接到CLKA端,作为输入,从QA引出1MHz的output端口,并引线到第二片7490的CLKB端口,依此类推,直到第七片7490连接完成如附图所示;每片7490相当于一个五进制计数器和一个二进制计数器级联实现了十进制加计数,从而实现分频;分频模块图如图所示分频模块内部结构图如下图所示260进制计数器模块采用两片74161级联,如图,下面一片74161做成十进制的,初始脉冲从CLK输入,ENT和ＥＮＰ都接高电平,而QD与QA用作为与非门的两个输入,与非门输出分别连接到自身的LDN端与上面一片74161的CLK端；上面一片74161的QC和QA端作为与非门的两个输入通过输出连接到自身的LDN,ENT 和ENP接高电平;下面一片实现从0000到1001即0~9十个状态码的计数,当下面一片为1001状态时,自身的LDN为低电平,此时QD,QC,QB,QA的状态恢复到0000,即从0开始从新计数,而上面一片74161的CLK电平改变,上面一片74161开始计数为0001,实现从0000~到0101即0到5六个状态码的计数,当上面一片状态为0101时,LDN为低电平,此时计数器为0000;这样子通过两片74161就实现了一个六十进制计数器;下图为六十进制计数器模块的示意图由六十进制计数模块构成的秒分计数如下图,下面那块六十进制技术模块表示为妙,上面那块六十进制计数模块表示为分;当妙计数模块的状态为0101 1001时,向分计数模块进位, 即通过74153M的输入C1,此时74153M输出接到分计数模块的输入端 ,通过74153M作为选择器,实现进位控制;324进制计数器模块采用两片74161级联,如图,下面一片74161做成十进制的,初始脉冲从CLK输入,ENT和ＥＮＰ都接高电平,而QD与QA用作为与非门的两个输入分别连接到自身的LDN端与上面一片74161的CLK端；上面一片74161的QB非门的一个输入通过输出连接到自身的LDN,ENT 和ENP接高电平,并且上面74161的QB端和下面一块74161的QC端通过与非门输出接到两片74161的清零端CLRN;下面一片实现从0000到1001即0~9十个状态码的计数,当下面一片为1001状态时,自身的LDN为低电平,此时QD,QC,QB,QA的状态恢复到0000,即从0开始从新计数,而上面一片74161的CLK电平改变,上面一片74161开始计数为0001,实现从0000~到0010即0到2三个状态码的计数,当上面一片状态为0010即2时,下面一片状态为0100即4时,两块74161的CLRN为低电平,此时两块74161的状态都为0000,即实现了23时过后显示00时;这样子通过两片74161就实现了一个24进制计数器;下图为24进制计数器模块示意图由二十四进制计数模块构成的时计数模块如图,下面那块六十进制技术模块表示为分,上面那块24进制计数模块表示为时;当分计数模块的状态为0101 1001时,向时计数模块进位, 即通过74153M的输入C1,此时74153M输出接到时计数模块的输入端 ,通过74153M作为选择器,实现进位控制;二十四进制计数模块构成的时计数模块44位显示译码模块由分频器,计数器,数据选择器,七段显示译码,3-8线译码器构成一个4位LED数码显示动态扫描控制电路;4位计数器由74161构成;如下图所示74161构成的4位计数器数据选择器采用两片74153 和一片74153M两片74153实现连在一起实现对四个数字的选择,而一片74153M实现对小数点的选择;如下图所示74153M构成的数据选择器两片74153构成的数据选择器七段显示译码器部分采用AHDL硬件描述语言设计,语句如下：subdesign ymqdata_in3..0 :input;a,b,c,d,e,f,g :output;begintabledata_in3..0 =>a,b,c,d,e,f,g;b"0000" =>1,1,1,1,1,1,0;b"0001" =>0,1,1,0,0,0,0;b"0010" =>1,1,0,1,1,0,1;b"0011" =>1,1,1,1,0,0,1;b"0100" =>0,1,1,0,0,1,1;b"0101" =>1,0,1,1,0,1,1;b"0110" =>0,0,1,1,1,1,1;b"0111" =>1,1,1,0,0,0,0;b"1000" =>1,1,1,1,1,1,1;b"1001" =>1,1,1,0,0,1,1;b"1010" =>1,1,1,0,1,1,1;b"1011" =>0,0,1,1,1,1,1;b"1100" =>1,0,0,0,1,1,0;b"1101" =>0,1,1,1,1,0,1;b"1110" =>1,0,0,1,1,1,1;b"1111" =>1,0,0,0,1,1,1;end table;end;整个四位显示译码模块如图所示5正点报时电路模块该模块采用与门和数据选择器74153构成,如下图所示;7个输入端口的与门控制A,当时间在59分51s,53s,55s,57s,59s的时候,A为高电平1,当秒的个位数为9时,B为高电平1,A为1,B为0时,输出C1低频率信号,A为1,B为1时输出C3高频率信号,实现整点的不同频率的报时电路;整点报时电路模块6脉冲按键消抖动处理模块采用D触发器实现消抖动,从而能够精确地设定时间;校正状态为5HZ的校正脉冲,分频器输出的10HZ通过T触发器得到5HZ的校正脉冲;如图脉冲按键消抖动处理模块通过T触发器得到的5HZ校正脉冲第四章电路的组构与调试遇到的主要问题1在用74161做二十四进制计数器时,没有深入考虑,打算采用第一片六进制,第二片四进制级联而成,结果出现问题;2时、分调整按键没有安装消抖动装置;3在设置简易数字钟的分时,时计数器也会进;现象记录及原因分析1虽然也能够计数实现二十四进制,但是不能与七段显示译码器配合使用,不能显示直观的数值,这样给用户带来不便;2在下载调试的时候,我要进行时分调整,但是有时按一下子脉冲键会进两个数值,这样子给时分的设置带来了麻烦,原因是按键没有采用消抖动装置;3在调试的时候,打算通过按键调整分,但是发现时计数器也会进位,这就不符合要求了,原因是调整分时,各计数器都按正常状况在计数,所以会按正常情况产生进位;解决措施及效果1仍然采用两片74161,第一片可以从0~9,第二片只能从0~2,而且当第二片为2的时候,第一片到4的话就都清零复位,这样不仅实现了二十四进制计数器,而且能与七段显示译码器配合使用,直观的显示数字;2在脉冲控制按键上加上了D触发器,这样子可以达到消抖动的效果;3加上选择器,把两路信号分开,当调整分的时候,不对时计数器产生进位,这样子就不会产生十进位了,解决了这个问题;功能的测试方法、步骤,记录的数据1简易数字钟的测试,将电路图连好后,分析与综合,仿真,编译,下载到仪器上,表示秒的小数点按1Hz,占空比50%跳动,分从0~59计数,分过了59后,向时计数器进1;2整点点报时功能的测试,到了整点,即59分51s,53s,55s,57s时蜂鸣器低频率间断性鸣响,59分59秒时,蜂鸣器高频率鸣响一次;3时、分调整功能的测试,按分调整键,分按一定的频率逐次加一,但是时显示不变；按时调整键,时按一定的频率逐次加一,但是分显示不变;第五章结束语对设计题目的结论性意见及进一步改进的意向说明简易数字钟的设计中,主要运用了分频器,六十进制计数器,二十四进制计数器,动态扫描显示电路,选择器,按键消抖以及门电路等数字电路方面的知识;可以在简易数字钟的基础上加上24小时和12小时转换功能,秒表功能,闹钟功能,这样更能满足人们的使用需求;总结设计的收获与体会简易数字钟的设计及实验当中,我坚持了下来,上学期的数电我学的并不好,而且对软件应用的接受能力不强,刚开始的时候做的很慢,看到别人都做好了,心里比较着急,于是,我找出了数电课本,复习所涉及的知识点,并练习所学软件,终于有了进步,可以更上同学们的进度,但数字钟的设计一直困扰我,看到别人拓展功能都做好了,自己基本的都还没做好,心里很急;在设计的过程中,碰到了很多的困难,遇到了很多问题,不断地思考与尝试,以及向同学和老师请教,但还是没能完全设计好,以后有时间还得多去实验室尝试,争取做好一些拓展功能;通过这次设计,对上学期学习的数字电路的相关知识得到了复习和巩固,也查阅了一些相关的资料,也加深了我对数字电路应用的理解,总之这次的电子技术课程设计受益匪浅;参考文献：基于FPGA的数字电路系统设计西安电子科技大学出版社数字电子技术基础电子工业出版社数字电路与逻辑设计实验及应用人民邮电出版社附图1.分频模块分频器仿真波形下图为分频器线路图2.60进制计数器模块60进制计数器仿真波形3.24进制计数器模块24进制计数器仿真波形4. 4位显示译码模块七段显示译码器模块七段显示译码器部分采用AHDL硬件描述语言设计,语句如下：subdesign ymqdata_in3..0 :input;a,b,c,d,e,f,g :output;begintabledata_in3..0 =>a,b,c,d,e,f,g;b"0000" =>1,1,1,1,1,1,0;b"0001" =>0,1,1,0,0,0,0;b"0010" =>1,1,0,1,1,0,1;b"0011" =>1,1,1,1,0,0,1;b"0100" =>0,1,1,0,0,1,1;b"0101" =>1,0,1,1,0,1,1;b"0110" =>0,0,1,1,1,1,1;b"0111" =>1,1,1,0,0,0,0;b"1000" =>1,1,1,1,1,1,1;b"1001" =>1,1,1,0,0,1,1;b"1010" =>1,1,1,0,1,1,1;b"1011" =>0,0,1,1,1,1,1;b"1100" =>1,0,0,0,1,1,0;b"1101" =>0,1,1,1,1,0,1;b"1110" =>1,0,0,1,1,1,1;b"1111" =>1,0,0,0,1,1,1;end table;end;整个4位显示译码模块四位显示译码模块。
数电课程设计报告 DT-830数字万用表组装
数字电子技术课程设计报告设计课题: DT-830数字万用表组装姓名:学院: 信息工程学院专业:班级:学号:日期指导教师:山东大学威海分校信息工程学院DT-830的焊接与装配摘要：电压表按其工作原理和读数方式分为模拟式电压表和数字式电压表两大类。
与普通的模拟式多用表相比，数字多用表的测量功能较多，它不但能测量直流电压、交流电压、交流电流、直流电流和电阻等参数，而且能测量信号频率、电容器容量及电路的通断等。
本次实验主要是焊接DT-830数字万用表及其组装，学会数字万用表的工作原理。
关键词：数字万用表、工作原理、焊接组装1 工作原理1.1数字万用表的特点数字电压表可缩写为DVM。
较之模拟式多用表，数字多用表除具有一般的所具有的DVM准确度高、数字显示、读数迅速准确、分辨力高、输入阻抗高、能自动调零、自动转换量程、自动转换及显示极性等优点外，还由于采用大规模集成电路，因而体积小，可靠性好，测量功能齐全，操作简便，有些数字多用表可以精确地测量电容、电感量、温度等，大大地扩展了功能；同时数字多用表内部有较完善的保护电路，过载能力强等等。
由于数字多用表具有上述这些优点，使得它获得越来越广泛的应用。
但它也有不足之处，它不能反映被测量的连续变化过程以及变化的趋势，如用来观察电容器的充、放电过程，就不如模拟电压表方便直观，也不适于作电桥调平衡用的零位指示器；同时，其价格也偏高，所以尽管数字多用表具有许多优点，但它不可能完全取代模拟式多用表对于DT-830数字万用表来说，它的主要特点有，（1）技术成熟，主电路采用典型数字集成电路ICL7106,性能稳定可靠；（2）性价比高，由于技术成熟，应用广泛，具有精度高、输入电阻大、读数直观、功能齐全、体积小等优点；（3）结构合理，安装简单，集成电路ICL7106采用COB封装。
1.2 数字多用表的基本原理和模拟直流电压表前端配接检波器即可构成模拟交流电压表一样，在数字直流电压表前端接相应的交流-直流转换器(AC/DC)、电流-电压转换电路（I/V）、电阻-电压转换电路（Ω/V）等，就构成了数字多用表，如图一所示。
数电课程实验报告——数字钟的设计
.《数字电子技术》课程设计报告设计题目: 数字钟班级学号：1407080701221 1407080701216 1407080701218学生：志强企海清指导教师：周玲时间：2016.6.15-2016.6.16《数字电子技术》课程设计一、设计题目：数字钟的设计一、设计任务与要求：1.时钟显示功能，能够以十进制显示“时”、“分”、“秒”。
其中时为24进制，分秒为60进制。
2. 其他功能扩展：（1）设计一个电路实现时分秒校准功能。
（2）闹钟功能，可按设定的时间闹时。
（3）设计一个电路实现整点报时功能等。
在59分51秒、53秒、55秒、57秒输出750Hz 音频信号，在59分59秒时输出1000Hz信号，音频持续1s，在1000Hz荧屏结束时刻为整点。
二、设计方案：数字电子钟由石英晶体振荡器、分频器、计数器、译码器显示器和校时电路组成。
振荡器产生稳定的高频脉冲信号,作为数字钟的时间基准,然后经过分频器输出标准秒脉冲。
秒计数器满60后向分计数器进位,分计数器满60后向小时计数器进位,小时计数器按照“24翻1”规律计数。
计数器的输出分别经译码器送显示器显示。
计时出现误差时,可以用校时电路校时、校分。
三、芯片选定及各单元功能电路说明：实验器材及主要器件（1）CC4511 6片（2）74LS90 5片（3）74LS92 2片（4）74LS191 1片（5）74LS00 5片（6）74LS04 3片（7）74LS74 1片（8）74LS2O 2片（9）555集成芯片1片（10）共阴七段显示器6片（11）电阻、电容、导线等若干①振荡器石英晶体振荡器的特点是振荡频率准确、电路结构简单、频率易调整。
它还具有压电效应，在晶体某一方向加一电场，则在与此垂直的方向产生机械振动，有了机械振动，就会在相应的垂直面上产生电场，从而机械振动和电场互为因果，这种循环过程一直持续到晶体的机械强度限止时，才达到最后稳定。
这用压电谐振的频率即为晶体振荡器的固有频率。
数字电子技术课程设计报告
数字电子技术课程设计报告题目：数字显示计时报警器班级：姓名：指导老师：组号：第六组目录一、课程设计的目的————————————————————1 二、设计要求———————————————————————1 三、方案设计与论证-------------------------------------------------------- 1四、设计原理与原理框图4.1设计原理————————————————————---24.2原理框图—————————————————————-2 五、数字显示计时报警器结构5.1外部10s脉冲CP电路----------------------------- 25.2D触发器构成的10秒显示灯------------------------ 35.3计时电路数码管显示——————————————-——45.4改变报警时间电路———————————————-——5 六、电路板焊接————————————————————-—-5 七、实验遇到的问题及解决方案————————————-——-5 八、设计结果——————————————————————--6 九、最后总结——————————————————————--6 十、主要参考资料——————————————————-——-6 十一、附录11.1电路仿真图——————————————————--- 611.2电路 AD—SCHDoc 画图----------------------------- 711.3电路PCBDoc画图---------------------------------- 811.4实物图—————————————————— ------ 9十二、操作步骤------------------------------------------ 10十三、元件清单------------------------------------------ 11一、课程设计的目的（1）掌握数字计时显示的原理。
数电课程设计数字电子钟报告
数字电子技术课程设计报告题目：数字钟的设计与制作时间：09-10学年第二学期18-19周院校：武汉纺织大学班级：测控081组员：夏亦冰李艳飞田传雪吴哲伦数字电子技术课程设计报告一．设计目的数字钟是一种用数字电路技术实现时、分、秒计时的装置，与机械式时钟相比具有更高的准确性和直观性，且无机械装置，具有更更长的使用寿命，因此得到了广泛的使用。
数字钟从原理上讲是一种典型的数字电路，其中包括了组合逻辑电路和时序电路。
因此，我们此次设计与制做数字钟就是为了了解数字钟的原理，从而学会制作数字钟.而且通过数字钟的制作进一步的了解各种在制作中用到的中小规模集成电路的作用及实用方法.且由于数字钟包括组合逻辑电路和时叙电路.通过它可以进一步学习与掌握各种组合逻辑电路与时序电路的原理与使用方法.二．实现功能1．要求内容1）时以24为周期2）分和秒以60为周期3）能显示时、分、秒4）具有校时功能，可以分别对时及分进行单独校时，使其校正到标准时间2. 发挥内容1）星期的显示2）计时过程具有报时功能三．元器件1．洞洞板2块2．0.47uF电容1个3．100nF电容1个4．共阴八段数码管7个5．网络线10米6．CD4511集成块7块7．CD4060集成块1块8．74HC390集成块4块9．74HC51集成块1块10．74HC00集成块4块11．74HC30集成块1块12．10MΩ电阻5个13．74HC00集成块4块14．L7805三端稳压管1个15．30pF瓷片电容2个16．9V电池1块17．单刀双掷开关2个18．单刀单置开关1个19．74HC10集成块1块各个芯片引脚图1．CD74HC3902．L7805稳压管3．CD4060 4．CD4511 5．74HC10 6．74HC307．74HC518．74HC00四、原理框图1．数字钟的构成数字钟实际上是一个对标准频率（1HZ）进行计数的计数电路。
由于计数的起始时间不可能与标准时间（如北京时间）一致，故需要在电路上加一个校时电路，同时标准的1HZ 时间信号必须做到准确稳定。
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数电课设报告
、
西安电子科技大学
电子技术应用设计课程实验报告实验名称改通用示波器为简易的逻辑分析仪
网络与信息安全学院 1518021 班
姓名 ** 学号 **
同作者无
实验日期 2017 年 12 月21 25 日
实验地点 E-II-310
一、方案设计报告
1、任务要求
通过扩展示波器的功能，完成简易逻辑分析仪的设计。
2、方案的原理及可行性
A、组成
通用示波器通常由显示器件（阴极射线管）、垂直放大器、触发器
或同步电路、时基、水平放大器、门控放大器、电源等组成，其
框图如下所示。
B、工作原理
被测信号经垂直放大器后加到示波器的垂直（Y轴）的偏转系统，
使电子射线的垂直偏转距离正比于输入信号的瞬时值。
在示波管
的水平（X轴）偏转系统上加以随时间线性变化的信号；使电子射
线在水平偏转正比于时间，那么再示波管的屏幕上就得到输入信
号的时间波形。
由于水平偏转系统所加线性变化的信号不可能无
限增长，荧光屏的尺寸也有限，故实际线性变化的信号（扫描信
号）是一锯齿波，这样就能使输入信号的时间波形在荧光屏上反
复出现。
当锯齿波的重复周期等于输入信号周期（或输入信号周
期的整数倍）时，每次重复出现的波形正好完全重合（同步）就
可看到稳定的波形。
C、双踪示波器
对于双踪示波器，则是由一个电子开关来控制Y轴偏移电压，使
其在第一个扫描周用内接通第一路信号，在第二个扫描周期接通第二路信号（在两个扫描周期可以加入不同的偏移电压），交替进行。
这样在屏幕上就可同时看到两个波形。
如图所示。
实际上示波器是分时工作。
D、示波器功能扩展
根据上述原理，若要示波器能够同时观察多个波形。
只需在每个波形加入Y轴放大器（垂直放大器）的同时加一偏移电压，然后调节扫描周明便能得到稳定的多个波形。
示波器观察多个波形功能扩展框图如下。
3、单元电路与器件选择
3.1、脉冲波形的产生与整形
采用555定时器产生方波。
555 集成定时器是一种模拟电路和数字电路结合的中规模集成电路。
而多谐振荡器也称无稳态触
发器，它没有稳定状态，同时不需要外加脉冲信号，就能输出一
定频率的矩形脉冲。
通过使用 555定时器组成多谐振荡器，可以
十分容易的获得符合要求的方波信号。
3.2、正弦波振荡电路（采用741实现）
电路图：
3.3、分频电路
在方波的基础上实现4阶16阶波的输出
3.4移相器
根据显示李沙育图形的原理，将两个频率相同，并有一定相位差（60°～90°）的正弦波，分别加到Y轴和X轴输入端，示波器就可显示字符“ 0”；若只有Y轴加信号，X 轴不加信号，就可显示字符“ 1”。
若在Y 轴和X 轴加（或不加）信号的同时加上一定的偏移电压，就可把“ 0”、“1”字符显示
在荧光屏的不同位置上。
因此正弦波产生后，需要选取一路进行恰当的移相。
通过调整此部分电路的电容大小便能实现。
具体电路见总图
二、方案实验预习报告
1、方波产生电路图
2、正弦波产生电路图
3、总电路设计图
三、课程设计总结报告
总结：这次实验难度比较大。
在实验中遇到了非常多的问题。
有时候一个小小的电路图自己都连不对，然后就要各种查错，排除错误。
而且在连接电路的过程中一定要让电路图尽量简单简洁，排线要压好，不然对后来查错误非常的不方便。
对于排除错误一定要有方法，不能一味的去看电路，一定要动手，去测电路，测电阻，然后逐一排除错误。
还有很重要的一点就是一定要做好预习工作，不然这个实验是真的做不出来的，在连接电路之前要将电路图设计好。
通过这次实验，我学习了74LS93、 7404、 74LS153 等芯片的使用，并且对电子电路的设计有了更深的理解。