上拉电阻与下拉电阻的概念与用法
485上拉电阻和下拉电阻
485上拉电阻和下拉电阻
485总线是一种串行通信协议，常用于工业自动化领域的数据传输。
在485总线中，传输线一般采用双线制，分为A线和B线。
而上拉电阻和下拉电阻则是在485总线通信中常见的电路元件。
上拉电阻和下拉电阻都是一种电阻，它们的作用是控制总线上信号的电平。
在485总线中，上拉电阻和下拉电阻分别连接在A线和B线上，起到调整总线电平的作用。
上拉电阻是将总线电平拉高的电阻，它连接在总线A线上，并向上拉高总线电平。
上拉电阻的阻值一般较大，通常为1kΩ至10kΩ。
当总线无信号时，上拉电阻会将总线电平拉高至逻辑1的电平，以保证总线处于高电平状态。
下拉电阻则是将总线电平拉低的电阻，它连接在总线B线上，并向下拉低总线电平。
下拉电阻的阻值一般较小，通常为150Ω至300Ω。
当总线有数据传输时，总线会出现电平变化，下拉电阻则会将总线电平拉低至逻辑0的电平，以保证数据传输的准确性。
总的来说，上拉电阻和下拉电阻在485总线通信中起到非常重要的作用，它们可以保证总线电平的稳定性和数据传输的可靠性。
上拉电阻和下拉电阻的原理以及部分应用总结
上拉电阻和下拉电阻的原理以及部分应用总结推荐图中上下两个电阻分别为下拉电阻和上拉电阻,上拉就是将A点的电位拉高,下拉就是将A点的电位拉低,图中的12k有些是没有画出来的,或者是没有的.他们的作用就是在电路驱动器关闭时,给该节点一个固定的电平.上拉电阻：1、当TTL电路驱动COMS电路时，如果TTL电路输出的高电平低于COMS 电路的最低高电平（一般为3.5V），这时就需要在TTL的输出端接上拉电阻，以提高输出高电平的值。
2、OC门电路必须加上拉电阻，才能使用。
3、为加大输出引脚的驱动能力，有的单片机管脚上也常使用上拉电阻。
4、在COMS芯片上，为了防止静电造成损坏，不用的管脚不能悬空，一般接上拉电阻产生降低输入阻抗，提供泄荷通路。
5、芯片的管脚加上拉电阻来提高输出电平，从而提高芯片输入信号的噪声容限增强抗干扰能力。
6、提高总线的抗电磁干扰能力。
管脚悬空就比较容易接受外界的电磁干扰。
7、长线传输中电阻不匹配容易引起反射波干扰，加上下拉电阻是电阻匹配，有效的抑制反射波干扰。
上拉电阻阻值的选择原则包括:1、从节约功耗及芯片的灌电流能力考虑应当足够大；电阻大，电流小。
2、从确保足够的驱动电流考虑应当足够小；电阻小，电流大。
3、对于高速电路，过大的上拉电阻可能边沿变平缓。
综合考虑以上三点,通常在1k到10k之间选取。
对下拉电阻也有类似道理对上拉电阻和下拉电阻的选择应结合开关管特性和下级电路的输入特性进行设定，主要需要考虑以下几个因素：1．驱动能力与功耗的平衡。
以上拉电阻为例，一般地说，上拉电阻越小，驱动能力越强，但功耗越大，设计是应注意两者之间的均衡。
2．下级电路的驱动需求。
同样以上拉电阻为例，当输出高电平时，开关管断开，上拉电阻应适当选择以能够向下级电路提供足够的电流。
3．高低电平的设定。
不同电路的高低电平的门槛电平会有不同，电阻应适当设定以确保能输出正确的电平。
以上拉电阻为例，当输出低电平时，开关管导通，上拉电阻和开关管导通电阻分压值应确保在零电平门槛之下。
上拉电阻下拉电阻的原理和作用
上拉电阻下拉电阻的原理和作用上拉电阻和下拉电阻是电子电路设计中常用的元件，其原理和作用如下：1.上拉电阻：上拉电阻是一种电阻器，它的作用是将一个信号线拉高到高电平状态。
在数字电路中，上拉电阻通常用来确保信号线在断开连接时保持逻辑高电平，防止其浮动。
当信号线未连接到任何驱动器或信号源时，上拉电阻会向信号线提供一个连接到电源高电平的路径，从而确保信号线保持在逻辑高电平。
上拉电阻的原理是利用电阻的阻值将信号线连接到电源引脚，与电源之间形成一个电阻分压电路。
当信号线未被外部驱动时，上拉电阻会通过电流流向信号线，将其拉高到电源电压，使其保持逻辑高电平。
上拉电阻常用于开关电路、输入/输出电路、微控制器引脚等地方。
例如，在微控制器的输入引脚上加上上拉电阻，当外部信号未连接时，输入引脚会受到上拉电阻的影响，保持在逻辑高电平状态。
当外部信号连接并给出低电平信号时，外部信号能够更容易地拉低输入引脚电压，使微控制器能够检测到这个低电平信号。
2.下拉电阻：下拉电阻与上拉电阻相反，它的作用是将一个信号线拉低到低电平状态。
在数字电路中，下拉电阻通常用来确保信号线在断开连接时保持逻辑低电平，防止其浮动。
它通过提供一个连接到地的路径，将信号线拉低到地电位。
下拉电阻的原理也是利用电阻的阻值将信号线连接到地引脚，与地之间形成一个电阻分压电路。
当信号线未被外部驱动时，下拉电阻会通过电流流向地，将其拉低到地电位，使其保持逻辑低电平。
下拉电阻同样常用于开关电路、输入/输出电路、微控制器引脚等地方。
例如，在微控制器的输入引脚上加上下拉电阻，当外部信号未连接时，输入引脚会受到下拉电阻的影响，保持在逻辑低电平状态。
当外部信号连接并给出高电平信号时，外部信号能够更容易地拉高输入引脚电压，使微控制器能够检测到这个高电平信号。
总之，上拉电阻和下拉电阻在电子电路设计中起着重要的作用。
它们能够确保信号线的稳定性，防止浮动和干扰，从而提高电路的可靠性和抗干扰能力。
上拉电阻 下拉电阻
上、下拉电阻一、定义1、上拉就是将不确定的信号通过一个电阻嵌位在高电平！“电阻同时起限流作用”！下拉同理！2、上拉是对器件注入电流，下拉是输出电流3、弱强只是上拉电阻的阻值不同，没有什么严格区分4、对于非集电极（或漏极）开路输出型电路（如普通门电路）提升电流和电压的能力是有限的，上拉电阻的功能主要是为集电极开路输出型电路输出电流通道。
二、拉电阻作用1、一般作单键触发使用时，如果IC本身没有内接电阻，为了使单键维持在不被触发的状态或是触发后回到原状态，必须在IC外部另接一电阻。
2、数字电路有三种状态：高电平、低电平、和高阻状态，有些应用场合不希望出现高阻状态，可以通过上拉电阻或下拉电阻的方式使处于稳定状态，具体视设计要求而定！3、一般说的是I/O端口，有的可以设置，有的不可以设置，有的是内置，有的是需要外接，I/O端口的输出类似与一个三极管的C，当C接通过一个电阻和电源连接在一起的时候，该电阻成为上C拉电阻，也就是说，如果该端口正常时为高电平；C通过一个电阻和地连接在一起的时候，该电阻称为下拉电阻，使该端口平时为低电平，作用吗：比如：“当一个接有上拉电阻的端口设为输入状态时，他的常态就为高电平，用于检测低电平的输入”。
4、上拉电阻是用来解决总线驱动能力不足时提供电流的。
一般说法是拉电流，下拉电阻是用来吸收电流的，也就是我们通常所说的灌电流5、接电阻就是为了防止输入端悬空6、减弱外部电流对芯片产生的干扰7、保护cmos内的保护二极管，一般电流不大于10mA8、通过上拉或下拉来增加或减小驱动电流9、改变电平的电位，常用在TTL-CMOS匹配10、在引脚悬空时有确定的状态11、增加高电平输出时的驱动能力。
12、为OC门提供电流三、上拉电阻应用原则1、当TTL电路驱动COMS电路时，如果TTL电路输出的高电平低于COMS电路的最低高电平（一般为3。
5V），这时就需要在TTL的输出端接上拉电阻，以提高输出高电平的值。
【硬件设计】上拉电阻和下拉电阻用法
【硬件设计】上拉电阻和下拉电阻的用法一、什么是上拉电阻？什么是下拉电阻？上拉就是将不确定的信号通过一个电阻嵌位在高电平！电阻同时起限流作用！下拉同理！上拉是对器件注入电流，下拉是输出电流；弱强只是上拉电阻的阻值不同，没有什么严格区分；对于非集电极（或漏极）开路输出型电路（如普通门电路）提升电流和电压的能力是有限的，上拉电阻的功能主要是为集电极开路输出型电路输出电流通道。
二、上拉电阻及下拉电阻作用：1、提高電壓准位：a.当TTL电路驱动COMS电路时，如果TTL电路输出的高电平低于COMS电路的最低高电平（一般为3.5V），这时就需要在TTL的输出端接上拉电阻，以提高输出高电平的值。
b.OC门电路必须加上拉电阻，以提高输出的搞电平值。
2、加大输出引脚的驱动能力，有的单片机管脚上也常使用上拉电阻。
3、N/A pin防靜電、防干擾：在COMS芯片上，为了防止静电造成损坏，不用的管脚不能悬空，一般接上拉电阻产生降低输入阻抗，提供泄荷通路。
同時管脚悬空就比较容易接受外界的电磁干扰。
4、电阻匹配，抑制反射波干扰：长线传输中电阻不匹配容易引起反射波干扰，加上下拉电阻是电阻匹配，有效的抑制反射波干扰。
5、預設空閒狀態/缺省電位：在一些 CMOS 输入端接上或下拉电阻是为了预设缺省电位. 当你不用这些引脚的时候, 这些输入端下拉接 0 或上拉接 1。
在I2C 总线等总线上，空闲时的状态是由上下拉电阻获得。
6. 提高芯片输入信号的噪声容限：输入端如果是高阻状态，或者高阻抗输入端处于悬空状态，此时需要加上拉或下拉，以免收到随机电平而影响电路工作。
同样如果输出端处于被动状态，需要加上拉或下拉，如输出端仅仅是一个三极管的集电极。
从而提高芯片输入信号的噪声容限增强抗干扰能力。
三、上拉电阻阻值的选择原则包括:1、从节约功耗及芯片的灌电流能力考虑应当足够大；电阻大，电流小。
2、从确保足够的驱动电流考虑应当足够小；电阻小，电流大。
上拉电阻和下拉电阻
上拉电阻和下拉电阻什么是上拉电阻和下拉电阻？在电子电路中，上拉电阻和下拉电阻是常用于控制和稳定电路的元件。
它们主要用于输入引脚的电平的控制，帮助确保信号稳定和可靠。
上拉电阻是指连接在信号引脚和正电源之间的电阻，用于将信号引脚的电平拉高。
当信号引脚未接外部信号时，上拉电阻会将引脚的电平拉高到正电源电平。
通常，上拉电阻的阻值比较大，一般在10kΩ到100kΩ之间。
下拉电阻则是连接在信号引脚和地之间的电阻，用于将信号引脚的电平拉低。
当信号引脚未接外部信号时，下拉电阻会将引脚的电平拉低到地电平。
下拉电阻的阻值与上拉电阻类似，通常也在10kΩ到100kΩ之间。
上拉电阻和下拉电阻的应用上拉电阻的应用上拉电阻常用于数字电路中的输入引脚。
在数字电路中，当输入引脚未连接外部信号时，它往往处于一个悬空状态，容易受到干扰而产生误判。
通过连接上拉电阻，可以确保输入引脚的电平稳定地被拉高到正电源电平，从而避免误判。
下拉电阻的应用下拉电阻同样常用于数字电路中的输入引脚。
当输入引脚未连接外部信号时，下拉电阻可以确保引脚电平稳定地被拉低到地电平，避免产生误判。
下拉电阻也常用于与上拉电阻配合使用，实现部分输入引脚上升沿和下降沿触发功能。
上拉电阻和下拉电阻的实现方式上拉电阻和下拉电阻可以通过不同的实现方式来实现。
软件实现在一些特定的矽晶管结构中，当将输入引脚设置为输入模式时，可以通过软件配置使其内部电路自带上拉电阻或下拉电阻。
这种方式可以减少外部电路元件的使用，但在某些情况下可能受到芯片设计限制。
外部电路实现在一些情况下，需要通过外部电路连接上拉电阻或下拉电阻。
上拉电阻和下拉电阻可以通过将电阻连接到信号引脚和正电源或地之间来实现。
这种方式更灵活，可以根据需要选择不同阻值的电阻，以满足特定的应用要求。
小结上拉电阻和下拉电阻是在电子电路中常用的元件，用于控制和稳定电路的输入引脚电平。
通过连接上拉电阻和下拉电阻，可以确保信号引脚的电平稳定地被拉高或拉低。
三极管上拉电阻和下拉电阻
三极管上拉电阻和下拉电阻
【原创版】
目录
1.三极管的概念和基本结构
2.上拉电阻和下拉电阻的定义及作用
3.上拉电阻和下拉电阻的连接方式及应用场景
4.上拉电阻和下拉电阻的优缺点比较
5.结论
正文
三极管，又称双极型晶体管，是一种常用的半导体器件。
它具有放大和开关等功能，被广泛应用于放大电路、振荡电路、脉冲电路等领域。
三极管的基本结构包括三个区域：发射区、基区和集电区，其中发射区和集电区由 n 型半导体制成，而基区由 p 型半导体制成。
在电子电路中，上拉电阻和下拉电阻是两种常见的电阻类型，它们在三极管电路中起着重要的作用。
上拉电阻是指在三极管的基区与电源正极之间串联一个电阻，使得当基区电流为零时，三极管处于截止状态。
而下拉电阻则是指在三极管的基区与电源负极之间串联一个电阻，使得当基区电流为零时，三极管处于导通状态。
上拉电阻和下拉电阻的连接方式通常是在三极管的基区，它们可以单独使用，也可以同时使用。
在实际应用中，上拉电阻常用于开关电路和振荡电路，而下拉电阻常用于放大电路和稳压电路。
上拉电阻和下拉电阻各有优缺点。
上拉电阻的优点是结构简单，稳定性好，能够实现三极管的快速开关；缺点是功耗较大，对电源电压有一定的要求。
而下拉电阻的优点是功耗小，对电源电压要求不高；缺点是结构相对复杂，稳定性较差。
总的来说，上拉电阻和下拉电阻都是三极管电路中不可或缺的元件，它们在不同的应用场景中发挥着重要的作用。
上拉电阻和下拉电阻的作用以及使用原则
上拉电阻,下拉电阻的含义,作用及选用原则在数字电路中不用的输入脚都要接固定电平，通过1k电阻接高电平或接地。
1、定义：上拉就是将不确定的信号通过一个电阻嵌位在高电平！电阻同时起限流作用！下拉同理！上拉是对器件注入电流，下拉是输出电流弱强只是上拉电阻的阻值不同，没有什么严格区分对于非集电极（或漏极）开路输出型电路（如普通门电路）提升电流和电压的能力是有限的，上拉电阻的功能主要是为集电极开路输出型电路输出电流通道。
2、为什么要使用拉电阻：一般作单键触发使用时，如果IC本身没有内接电阻，为了使单键维持在不被触发的状态或是触发后回到原状态，必须在IC外部另接一电阻。
数字电路有三种状态：高电平、低电平、和高阻状态，有些应用场合不希望出现高阻状态，可以通过上拉电阻或下拉电阻的方式使处于稳定状态，具体视设计要求而定！一般说的是I/O端口，有的可以设置，有的不可以设置，有的是内置，有的是需要外接，I/O端口的输出类似于一个三极管的C，当C接通过一个电阻和电源连接在一起的时候，该电阻成为上C拉电阻，也就是说，如果该端口正常时为高电平，C通过一个电阻和地连接在一起的时候，该电阻称为下拉电阻，使该端口平时为低电平，作用吗：比如：当一个接有上拉电阻的端口设为输如状态时，他的常态就为高电平，用于检测低电平的输入。
上拉电阻是用来解决总线驱动能力不足时提供电流的。
一般说法是拉电流，下拉电阻是用来吸收电流的，也就是灌电流。
3.上拉电阻的作用：1.当TTL电路驱动COMS电路时，如果TTL电路输出的高电平低于COMS电路的最低高电平（一般为3.5V），这时就需要在TTL的输出端接上拉电阻，以提高输出高电平的值。
2.OC门电路必须加上拉电阻，才能使用。
3.为加大输出引脚的驱动能力，有的单片机管脚上也常使用上拉电阻。
4.在COMS芯片上，为了防止静电造成损坏，不用的管脚不能悬空，一般接上拉电阻产生降低输入阻抗，提供泄荷通路。
同时管脚悬空就比较容易接受外界的电磁干扰（MOS器件为高输入阻抗，极容易引入外界干扰）。
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上拉电阻定义：上拉就是将不确定的信号通过一个电阻嵌位在高电平！电阻同时起限流作用！下拉同理！上拉是对器件注入电流，下拉是输出电流；弱强只是上拉电阻的阻值不同，没有什么严格区分；对于非集电极（或漏极）开路输出型电路（如普通门电路）提升电流和电压的能力是有限的，上拉电阻的功能主要是为集电极开路输出型电路输出电流通道。
上拉:1TTL驱动CMOS时,如果TTL输出最低高电平低于CMOS最低高电平时,提高输出高电平值2 OC门必须加上拉,提高电平值3 加大输出的驱动能力(单片机较常用)4 CMOS芯片中(特别是门的芯片),为防静电干扰,不用的引脚也不悬空,一般上拉,降低阻抗,提供泄荷通路5 提高输出电平,提高芯片输入信号的噪声容限,增强抗干扰6 提高总线抗电磁能力,空脚易受电磁干扰7 长线传输中加上拉,是阻抗匹配抑制反射干扰原则:1 从节约功耗和芯片的电流、能力应是电阻尽量大,R大,I小啊2 从确保驱动能力,应当电阻足够小,R小,I大啊3 对高速电路,加上拉可能边沿平缓(上升时间延长)建议可以在1K---10K之间选(可根据实际情况)信号输入端上拉电阻的工作原理（从电路原理的角度分析输入端口电压为何会被提高）悬赏分：20 - 提问时间2008-11-7 02:57假如信号输入端是外界电路送来的低电平，那么输入端的电压不是应该被锁定在低电平吗，为什么加了个上拉电阻和电源，输入端的电压就被提高了呢？这个问题一直很困惑，希望能耐心解答。
问题补充：我想问的是上拉电阻如何实现电压上拉的，而不是问的上拉电阻的使用目的和必要性，我很清楚上拉电阻的作用和目的。
提问者：michael6810 - 二级其实你不清楚上拉电阻的作用和目的。
否则你不会困惑。
你的困惑，yao311yan805 已经说出来了。
只是你没有细心看，或者没有想到你该专著的重点。
yao311yan805 ：最后一句话--“一般大家都习惯默认无信号为低电平，所以下拉电阻一般的应用较为普遍”，好像应该改一下吧。
回答者：562738047 - 九级2008-11-7 22:24上拉电阻的目的是为了保证在无信号输入时输入端的电平为高电平。
在信号输入为低电平是输入端的电平应该也为低电平，并不是像你说的那样为高电平。
如果没有上拉电阻，在没有外界输入的情况下输入端是悬空的，他的电平是未知的无法保证的，上拉电阻就是为了保证无信号输入时输入端的电平为高电平，同样还有下拉电阻它是为了保证无信号输入时输入端的电平为低电平。
首先，你问的问题就有问题。
上拉电阻是为了在无信号输入的使ic脚为高电平，而在输入为低电平的时候ic脚会是低电平，而不是你所说的变为高电平。
我认为你跟本就不明白上拉电阻的作用和必要性，另外你的基础是在是太差了，有一些模拟电路基础的人看过上拉电阻的原理图之后都可以明白上拉电阻的工作原理，而你居然连这么简单的东西都看不明白，足可见你要么是基础不扎实，要么对电路的东西不敏感。
同时你又如此的不谦虚，如果你是我的下属，我会狠狠的骂你一顿的。
一个对上拉电阻的功能从根本上理解就错误的人还敢号称自己“很清楚上拉电阻的作用和目的”，哼哼…………不过我还是告诉你吧，ic的输入口属于高阻抗的输入，在无信号输入的情况下，一个正电源串一个电阻（就是你所说的上拉电阻）接到ic口上，因为阻抗高，电阻上是没有电流的，自然电阻上也没有压降，此ic口当然是高电平了。
当有输入为低电平的时候，信号的输入自然会使此ic口变为低电平（记住此时不是高电平，除非你接了一个反向电路，说多了你也不懂）。
另外谢谢562738047的提醒，由于我能力有限有说错的地方，已经改正，以免误导大家回答者：yao311yan805 - 六级2008-11-21 14:26已解决单片机中P0口作为输出为什么要上拉电阻？悬赏分：20 - 解决时间：2008-5-29 12:51简单明了，谢谢！上拉电阻：就是从电源高电平引出的电阻接到输出1，如果电平用OC(集电极开路，TTL)或OD(漏极开路，COMS)输出，那么不用上拉电阻是不能工作的，这个很容易理解，管子没有电源就不能输出高电平了。
2，如果输出电流比较大，输出的电平就会降低（电路中已经有了一个上拉电阻，但是电阻太大，压降太高），就可以用上拉电阻提供电流分量，把电平“拉高”。
（就是并一个电阻在IC内部的上拉电阻上，让它的压降小一点）。
当然管子按需要该工作在线性范围的上拉电阻不能太小。
当然也会用这个方式来实现门电路电平的匹配。
需要注意的是，上拉电阻太大会引起输出电平的延迟。
（RC延时）一般CMOS门电路输出不能给它悬空，都是接上拉电阻设定成高电平。
下拉电阻：和上拉电阻的原理差不多，只是拉到GND去而已。
那样电平就会被拉低。
下拉电阻一般用于设定低电平或者是阻抗匹配(抗回波干扰)。
回答者：血染的战役- 一级2008-5-26 13:31其他回答共 1 条P0口：是一组8位漏极开路双向I/O口，也即地址/数据总线复用口。
作为输出口用时，每位驱动8个TTL逻辑门电路，对端口写“I”可作为高阻抗输入端用。
在访问外部数据存储器或程序存储器时，这组口线分时转换地址（低8位）和数据总线复用，在访问期间激活内部上拉电阻。
0在Flash编程时，P0口接受指令字节，而在程序校验时，输出指令字节，校验时，要求外接上拉电阻。
已解决数据传输端口一定要上拉电阻吗？什么情况下可以不用加悬赏分：0 - 解决时间：2010-9-5 17:18最佳答案端口输出电阻是指实际从输出端口表现的电阻，常常指含源电路或放大电路的输出端等效电阻指的是所有的电阻作用可以用一个电阻等效代替，这个电阻就称是那些电阻的等效电阻两者并无直接关系回答者：993027163 - 二级2010-5-8 12:10 上拉电阻和下拉电阻[From Net]标签：电阻电流驱动电路电平上拉电阻：1、当TTL电路驱动COMS电路时，如果TTL电路输出的高电平低于COMS电路的最低高电平（一般为3.5V），这时就需要在TTL的输出端接上拉电阻，以提高输出高电平的值。
2、OC门电路必须加上拉电阻，才能使用。
3、为加大输出引脚的驱动能力，有的单片机管脚上也常使用上拉电阻。
4、在COMS芯片上，为了防止静电造成损坏，不用的管脚不能悬空，一般接上拉电阻产生降低输入阻抗，提供泄荷通路。
5、芯片的管脚加上拉电阻来提高输出电平，从而提高芯片输入信号的噪声容限增强抗干扰能力。
6、提高总线的抗电磁干扰能力。
管脚悬空就比较容易接受外界的电磁干扰。
7、长线传输中电阻不匹配容易引起反射波干扰，加上下拉电阻是电阻匹配，有效的抑制反射波干扰。
上拉电阻阻值的选择原则包括:1、从节约功耗及芯片的灌电流能力考虑应当足够大；电阻大，电流小。
2、从确保足够的驱动电流考虑应当足够小；电阻小，电流大。
3、对于高速电路，过大的上拉电阻可能边沿变平缓。
综合考虑以上三点,通常在1k到10k之间选取。
对下拉电阻也有类似道理对上拉电阻和下拉电阻的选择应结合开关管特性和下级电路的输入特性进行设定，主要需要考虑以下几个因素：1．驱动能力与功耗的平衡。
以上拉电阻为例，一般地说，上拉电阻越小，驱动能力越强，但功耗越大，设计是应注意两者之间的均衡。
2．下级电路的驱动需求。
同样以上拉电阻为例，当输出高电平时，开关管断开，上拉电阻应适当选择以能够向下级电路提供足够的电流。
3．高低电平的设定。
不同电路的高低电平的门槛电平会有不同，电阻应适当设定以确保能输出正确的电平。
以上拉电阻为例，当输出低电平时，开关管导通，上拉电阻和开关管导通电阻分压值应确保在零电平门槛之下。
4．频率特性。
以上拉电阻为例，上拉电阻和开关管漏源级之间的电容和下级电路之间的输入电容会形成RC延迟，电阻越大，延迟越大。
上拉电阻的设定应考虑电路在这方面的需求。
下拉电阻的设定的原则和上拉电阻是一样的。
OC门输出高电平时是一个高阻态，其上拉电流要由上拉电阻来提供，设输入端每端口不大于100uA,设输出口驱动电流约500uA，标准工作电压是5V，输入口的高低电平门限为0.8V(低于此值为低电平)；2V(高电平门限值)。
选上拉电阻时：500uA x 8.4K= 4.2即选大于8.4K时输出端能下拉至0.8V以下，此为最小阻值，再小就拉不下来了。
如果输出口驱动电流较大，则阻值可减小，保证下拉时能低于0.8V即可。
当输出高电平时，忽略管子的漏电流，两输入口需200uA200uA x15K=3V即上拉电阻压降为3V，输出口可达到2V，此阻值为最大阻值，再大就拉不到2V了。
选10K可用。
COMS门的可参考74HC系列设计时管子的漏电流不可忽略，IO口实际电流在不同电平下也是不同的，上述仅仅是原理，一句话概括为：输出高电平时要喂饱后面的输入口，输出低电平不要把输出口喂撑了（否则多余的电流喂给了级联的输入口，高于低电平门限值就不可靠网友评论：1,一般来说，上拉就是接到高电平，下来就是接到低电平.2,主要是为了提高芯片引脚的驱动能力或者是为了防止临界电平会引起错误的操作!例如,有的芯片引脚驱动能力较差,不能将电平拉高,就必须接上拉电阻;对于中断引脚也必须接上拉(对于低电平有效)或下拉(对于高电平有效)防止误中断3,上拉就是通过一个电阻接到高电平；下拉就是通过一个电阻接到参考地（低电平）。
在数字电路中不用的输入脚都要接固定电平，通过1k电阻接高电平或接地。
1. 电阻作用：l 接电组就是为了防止输入端悬空l 减弱外部电流对芯片产生的干扰l 保护cmos内的保护二极管,一般电流不大于10mAl 上拉和下拉、限流l 1. 改变电平的电位，常用在TTL-CMOS匹配2. 在引脚悬空时有确定的状态3.增加高电平输出时的驱动能力。
4、为OC门提供电流l 那要看输出口驱动的是什么器件，如果该器件需要高电压的话，而输出口的输出电压又不够，就需要加上拉电阻。
l 如果有上拉电阻那它的端口在默认值为高电平你要控制它必须用低电平才能控制如三态门电路三极管的集电极，或二极管正极去控制把上拉电阻的电流拉下来成为低电平。
反之，l 尤其用在接口电路中,为了得到确定的电平,一般采用这种方法,以保证正确的电路状态,以免发生意外,比如,在电机控制中,逆变桥上下桥臂不能直通,如果它们都用同一个单片机来驱动,必须设置初始状态.防止直通!2、定义：l 上拉就是将不确定的信号通过一个电阻嵌位在高电平！电阻同时起限流作用！下拉同理！l 上拉是对器件注入电流，下拉是输出电流l 弱强只是上拉电阻的阻值不同，没有什么严格区分l 对于非集电极（或漏极）开路输出型电路（如普通门电路）提升电流和电压的能力是有限的，上拉电阻的功能主要是为集电极开路输出型电路输出电流通道。
3、为什么要使用拉电阻：l 一般作单键触发使用时，如果IC本身没有内接电阻，为了使单键维持在不被触发的状态或是触发后回到原状态，必须在IC外部另接一电阻。