基于FPGA的数字电源调节器研究与设计
用fpga简易数字钟电路设计实验报告 概述及解释说明
用fpga简易数字钟电路设计实验报告概述及解释说明1. 引言1.1 概述本实验报告旨在介绍使用FPGA（可编程门阵列）设计的简易数字钟电路。
数字钟是一种可以显示时间的时钟装置，广泛应用于日常生活和工业领域。
本文将详细讲解数字钟的设计原理、硬件要求、设计步骤以及实验的实现过程。
1.2 文章结构本文共分为五个部分，即引言、FPGA简易数字钟电路设计、实验实现过程、实验结果分析和结论与总结。
下面将对每个部分进行具体说明。
1.3 目的该实验旨在通过学习和操作FPGA，深入理解数字电路设计的基本原理和方法，并通过设计一个简易的数字钟电路来巩固所学知识。
通过本实验，我们还将探索数字钟电路的性能评估和可能的改进方向，并对未来发展方向进行展望。
同时，通过参与这个项目，我们也将获得一定的实践经验和技能提升。
2. FPGA简易数字钟电路设计：2.1 设计原理：在本次实验中，我们使用FPGA（现场可编程逻辑门阵列）来设计一个简易的数字钟电路。
FPGA是一种集成电路芯片，可依据用户需要重新配置其内部互连，从而实现不同的逻辑功能。
我们将利用FPGA的可编程性和强大的计算能力来实现数字钟的功能。
该数字钟电路主要由时钟模块、倒计时模块和显示模块组成。
时钟模块负责产生稳定而精确的脉冲信号作为系统的时基；倒计时模块通过对输入时间进行倒计时操作，并发出相应信号提示时间变化；显示模块用于将倒计时结果以数码管显示出来。
2.2 硬件要求：为了完成该设计，我们需要准备以下硬件设备：- FPGA开发板：提供了外部接口和资源，用于连接其他硬件设备并加载程序。
- 数码管：用于显示时间信息。
- 时钟源：提供稳定而精确的脉冲信号作为系统的时基。
2.3 设计步骤：以下是设计步骤的详细说明：1. 确定所需功能：首先明确数字钟需要具备哪些功能，例如12小时制还是24小时制、倒计时功能等。
2. 确定FPGA型号：根据设计需求和资源限制，选择适合的FPGA型号。
基于FPGA的电子钟设计报告
基于FPGA的电子钟设计报告一、FPGA的基本知识1、可编程逻辑器件的概况可编程逻辑器件主要分为FPGA和CPLD 两种,两者的功能基本相同。
FPGA--现场可编程门阵列的简称CPLD--复杂可编程逻辑器件的简称2、FPGA芯片及其最小系统(1)FPGA芯片它的外形与普通嵌入式处理器芯片相同采用PGA(Organic pin grid Array，有机管脚阵列)的封装形式，但可以通过烧写特殊程序改变其内部结构，实现专门的电路功能。
基于FPGA的数字时钟2019-11-23 21:36·电力源动一、FPGA的基本知识1、可编程逻辑器件的概况可编程逻辑器件主要分为FPGA和CPLD 两种,两者的功能基本相同。
FPGA--现场可编程门阵列的简称CPLD--复杂可编程逻辑器件的简称它的外形与普通嵌入式处理器芯片相同采用PGA(Organic pin grid Array，有机管脚阵列)的封装形式，但可以通过烧写特殊程序改变其内部结构，实现专门的电路功能。
二、FPGA的设计方法1、编程语言FPGA的主流程序设计语言主要有VHDL语言与Verilog语言两种。
本课题采用VHDL语言进行编写。
VHDL--用简洁明确的源代码来描述复杂的逻辑控制。
它具有多层次的设计描述功能，层层细化，最后可直接生成电路级描述。
Verilog--一种基本语法与C语言相近，相比较于C语言更容易理解，2、图形化程序设计(设计效率低)三、软件开发环境QuartusII是Altera提供的FPGA开发集成环境，它提供了一种与结构无关的设计环境，使设计者能方便地进行设计输入、快速处理和器件编程。
它完全支持VHDL设计流程，其内部嵌有VHDL逻辑综合器。
四、数字钟功能模块认识数字时钟的设计采用了自顶向下分模块的设计。
底层是实现各功能的模块，各模块由VHDL语言编程实现顶层采用原理图形式调用。
具体的设计框图：各模块原理剖析：（1）在七段数码管上具有时--分--秒的依次显示；（2）时、分、秒的个位记满十向高位进一，分、秒的十位记满五向高位进一，小时按24进制计数，分、秒按60进制计数；（3）整点报时，当计数到整点时扬声器发出响声；（4）时间设置：可以通过按键手动调节秒和分的数值。
基于FPGA的数字选频器设计
基于FPGA的数字选频器设计作者：张曜等来源：《现代电子技术》2012年第01期摘要：提出了一种基于FPGA的数字选频器设计方案，该数字选频器应用于八通道的GSM系统直放站，采用低成本的FPGA芯片Xilink Spartan-3A DSP XC3SD3400A进行数字信号处理。
给出了较详细的硬件设计方案，并通过Agilent Technologies N5230A网络分析仪对数字选频器进行了测量，被选出的有效相邻信道之间的最小间隔能达到1 MHz，能够实现较好的选频功能，可满足实际应用的要求。
关键词：FPGA；数字选频器； GSM；直放站中图分类号：TN710-34文献标识码：A文章编号：1004-373X(2012)01-0088-04Design of digital frequency choice device based on FPGAZHANG Yao1, YANG Hong1, ZHANG Hao2,(1.College of Electrical Engineering, Chongqing University of Posts and Telecommunications, Chongqing 400065, China；2.Institute of Microelectronics, Chinese Academy of Sciences, Beijing 100029, China)Abstract：A design scheme of FPGA-based digital frequency choice device is introduced. The frequency choice device was used in GSM repeater with eight channels, which used low-cost FPGA chip Xilinx Spartan- 3A DSP XC3SD3400A for digital signal processing. A hardware design is proposed. The frequency choice device was measured by Agilent Technologies N5230A network analyzer, and the minimum spacing between adjacent effective channels could reach 1 MHz. A better frequency choice function can be realized, which can meet the requirements of practical application.Keywords： FPGA; digital frequency choice device; GSM; repeater收稿日期：2011-08-基金项目：国家863项目：面向软件无线电的宽带数据变换和可重构射频集成电路(2009AA011606);重庆市教委科学技术研究项目(KJ100512)；重庆市自然科学基金项目(CSTC2010BB2412)0 引言随着移动通信的迅速发展，无论何种无线通信的覆盖区域都将产生弱信号区和盲区，要架设模拟或数字基站成本太高，基础设施也比较复杂，为此提供一种成本低、架设简单，却具有小型基站功能的直放站是很有必要的。
一种基于fpga的cx9261芯片配置方法
一种基于fpga的cx9261芯片配置方法下载温馨提示：该文档是我店铺精心编制而成，希望大家下载以后，能够帮助大家解决实际的问题。
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基于fpga的智能温度控制系统的设计
基于fpga的智能温度控制系统的设计随着科技的发展，智能控制系统被广泛应用于工业领域和智能家居中，其中智能温度控制系统是其中的一种。
智能温度控制系统能够根据环境温度变化自动控制加热或制冷设备，从而保证环境温度始终在设定值范围内，提高生产效率和舒适度。
本文将介绍一种基于FPGA的智能温度控制系统设计方案。
1. 系统设计该系统由传感器、FPGA、驱动器以及显示器组成。
传感器用于检测环境温度变化，FPGA用于对传感器信号进行处理，驱动器用于控制加热或制冷设备，显示器用于显示系统状态。
系统设计流程如下：1.1 传感器传感器可以选择温度传感器、热敏电阻传感器或热电偶传感器等。
本系统选用温度传感器，将传感器输出的模拟信号转化为FPGA可读的数字信号，从而实现数字信号化。
1.2 数字信号化将模拟信号数字化是实现控制系统的关键所在。
数字信号化是通过模数转换器（ADC）将模拟信号转化为数字信号的过程。
本系统将模拟信号转化为12位数字信号。
1.3 FPGA处理FPGA芯片（Field-Programmable Gate Array）是一种可编程逻辑器件，它能够快速地对数字信号进行处理。
FPGA芯片是本系统的核心处理器，它被用来对传感器信号进行处理，根据环境温度的变化决定加热还是制冷，从而保持环境温度在设定范围内。
具体的处理流程如下：（1）读取温度传感器数据。
（2）将传感器输出的模拟信号转变为数字信号。
（3）将数字信号与设定的环境温度范围进行比较，以决定是否需要进行加热或制冷。
（4）对加热或制冷设备进行控制。
1.4 驱动器设计由于加热或制冷设备的控制电源电平和FPGA的电平不一致，需要通过驱动器进行转换。
本系统使用驱动器将FPGA输出的信号转化成能够控制加热或制冷设备的继电器信号。
1.5 显示器设计本系统使用7段LED数码管作为显示器，用于显示当前环境温度以及系统状态。
系统状态包括温度过高、温度过低、正常等状态，以告知用户系统运行情况。
基于FPGA的数字钟设计
基于FPGA的数字钟设计摘要:现实生活中经常会出现需要用时间测定参数数值的情况，服务日常生活和生产。
基于FPGA设计数字电路产品已经成为当前的重要设计方法。
本文设计选用了Quartus软件环境，运用描述逻辑Verilog HDL，由上至下的模式，基于FPGA完成了数字时钟的设计方案。
本次设计成果采用按键对闹钟的起止点进行控制，能够显示时，分，秒等并且能够实现整点报时。
其中的FPGA技术就是本次试验的亮点之一，其设计易于学习，各个模块分工清晰，在模拟软件上很容易运行，还能够适配于许多种环境，因此总体的系统性能指标还是相当有保证的。
关键词:数字钟；FPGA；Verilog HDL；Quartus1.1 课题研究背景在现代社会，数据集成电路已广泛运用于日常日常生活的各行各业。
数据集成电路也在不停拆换。
从起初的整流管、电子管、大中小型集成电路发展趋势为具备特大型集成电路和独特作用的各类专用型集成电路。
可是，因为微电子技术科技进步的迅猛发展，集成电路设计方案和生产制造工作中再也不会由半导体生产商独立担负。
系统软件室内设计师更喜欢立即设计方案专用型集成电路(ASIC)处理芯片，并马上资金投入具体运用，因而发生了当场可编程逻辑机器设备(FPLD)，在其中应用最普遍的是当场可编门阵列(FPGA)。
数字钟是一种选用数字电路设计技术性完成时、分、秒计时的装置，在完成数据与此同时表明时、分、秒的准确时间和精确校正时，体积小、重量轻、抗干扰能力强、对自然环境需要高、高精密、易于开发设计等与在办公系统系统软件等众多行业运用非常普遍的传统式表壳式机械手表对比，数字表更精确、形象化，因为沒有机械设备装置，使用期限长。
1.2 国内外研究现状近些年来已经有许多技术人员针对电子器件以及时钟等技术进行了研究，但真正意义上的数字钟表起源于50年代或60年代。
伴随着在我国数字钟表电源电路销售市场的迅速发展趋势，尤其是十二五阶段经济发展方法这一领土主权主旋律早已明确，与之有关的关键生产制造技术运用和产品研发将变成领域公司关心的焦点。
FPGA开发平台硬件系统设计及实现
研发设计 I RESEARCH DESIGN樓块图1系统总体设计框图近几年，随着FPGA (可编程逻辑器件）规模的日益增大， 我国数字电路设计取得了迅猛发展，硬件设计环境不断向实 用化、可靠化方向发展，为功能电路设计工作的有序开展提 供了硬件支持。
为此，如何科学设计和实现FPGA 开发平台 硬件系统、不断完善相关功能电路是相关软件开发人员必须思考和解决的问题。
1.系统总体设计FPGA 开发平台硬件系统主要由网 络模块、PS 2接口模 块和U S B 模块等模 块组成，系统总体 设计框图如图1所 示。
为了保证该系 统的运行性能，相关软件开发人员要重视对这些模块的设计与实现，为用户带 来良好的体验感。
1.1网络（D M 900A )模块电路设计网络（DM 900A )作为一种先进的接口芯片，充分利用 了以太网的应用优势，具有以下几种特征：①能够实现物理 层接口的全面集成；②内部含有FIFO 缓存，主要用于对大 量字节的接收和发送：③能够很好地兼容和支持不同类型的 主机工作模式；④在HP 证背景下，能够很好地实现自动翻 转功能和直接互联功能；⑤能够充分利用tcp /tp 加速器的应 用优势，避免CPU 承担过高的存储负担，从而实现对整机 运行性能的全面提高：⑥极大地缩短了读写时间。
总之，在 以太网控制器的应用背景下，相关软件开发人员要严格遵循 相关网络传输标准和要求，从而实现网速的提高和网络环境 的优化。
同时，在对网络模块电路进行科学设计的过程中， 确保该电路能够实现对相关接口的集成和应用，并采用接口 输入的方式将各种接口与芯片进行深度融合，以促进FPGA 开发平台硬件系统向智能化、自动化、信息化方向不断发展。
1.2USB 模块电路设计对于U S B 模块电路而言，为了保证其设计水平，相关软件开发人员要重 视对 CY 7C 68013A 芯片的使用，将 传输速度设置为摘要：随着社会经济水平的不断提高和信息时代的不断发展，FPGA (可编程逻辑器件）在集成电路领域中取得了良好的应用 效果，不仅有效扩大了编程器件电路的数量，还避免了定制电路的局限性，为更好地改进多种逻辑应用功能和结构发挥了 重要作用。
一种基于FPGA的数字逻辑分析仪的设计和实现
摘
要 ：设 计 和 实现 了一种 基 于 ＭＣＵ＋ Ｐ Ａ 的逻 辑 分析仪 。该逻 辑 分析仪 的 逻辑 信 号 门限 电压 可在 ｏ ＦＧ ￣
５ 范 围 内按 ２ ６级 变 化 ，精 度 达 到 ０Ｏ Ｖ。 数 字 信 号 发 生 器 能 重 复 输 出 ８路 频 率 为 １ ０ ０５ Ｖ ５ ．１ ０＋ ． ＿ Ｈｚ
电流 仅 为 ２ ｎ ５ Ａ。输入 阻抗 完全 可 以满 足 逻 辑分 析仪
的需要 ，不 需要 再用 跟 随器 ，简 化 了电路 。
及 波形 显 示 等模 块 Ｆ Ｇ Ｐ Ａ选 用 Ｅ １ ６ ２０ ８ Ｐ Ｃ Ｑ ４ Ｃ ，利 用 其
内部支 持 的 双端 Ｒ Ｍ 实 时 回放 实现 数 据存 储 ，同时 利 Ａ
ቤተ መጻሕፍቲ ባይዱ
且 可预 置 的循环 移位 逻 辑信 号序 列。 测试 结果 表 明该 系统 稳定 精确 ，操 作 简单 、成本 低 等特 点 ．
具 有 广 阔的应 用前景 。
关 键 词 ：Ｆ ＧＡ；信 号 发 生 ；信 号 处 理 ； 触 发 控 制 Ｐ
中图分 类 号 ：’ ２ ４ ． 文 献标 识码 ：Ａ 文章编 号 ：１ ２ ６ ７ （０ ７ ６ ０ ６ ０ Ｔ ７ ＋２ Ｐ ０ — ６ ３ ２ ０ ）０ — ９ — ３
理 单 元 组 成 。 门 限 控 制 单 元 采 用 串 行 数 模 转 换 器 ＭＡ １ Ｘ５ ７作 为 程 控 衰 减 器 。ＭＡ ５ ７是 ８位 电 压 输 出 型 Ｘ １
Ｄ ＡＣ 【 １ 一，采 用单 ５ Ｖ电源 工 作 ，使 用简 单 的 双线 串行接
口 ，可直 接 实 现 ０ ５ ～ Ｖ范 围内 的 ５ ／５ １ ．２ 的 ２ ６级 Ｖ ２ ６ ００ Ｖ ５ 变 化 ，仅 占用 ＭＣ 的 ２根 总线 ，电路 简 单 ，控 制 方便 ， Ｕ 可 实现 多级 门限 电压控 制 。
基于FPGA的ADC采集系统的设计_毕业设计论文
基于FPGA的ADC采集系统的设计摘要基于FPGA在高速数据采集方面有单片机和DSP无法比拟的优势，FPGA具有时钟频率高，内部延时小，全部控制逻辑由硬件完成，速度快，效率高，组成形式灵活等特点。
因此，本文研究并开发了一个基于FPGA的数据采集系统。
FPGA的IO口可以自由定义，没有固定总线限制更加灵活变通。
本文中所提出的数据采集系统设计方案，就是利用FPGA作为整个数据采集系统的核心来对系统时序和各逻辑模块进行控制。
依靠FPGA强大的功能基础，以FPGA作为桥梁合理的连接了ADC、显示器件以及其他外围电路，最终实现了课题的要求，达到了数据采集的目的。
关键词FPGA A/D转换AbstractFPGA is better than microcontroller and DSP in high speed data acquisition, FPGA has higher internal clock frequency, smaller delay than DSP,and all the control logic of FPGA is completed by hardware, FPGA has fast speed, high efficiency, and so on. Therefore, this paper introduces and develops a data acquisition system which is based on FPGA.The I/O pin of FPGA can be defined yourself without fixed limit,it’s very flexible. This design of data acquisition system use FPGA as the data acquisition system core to control the timing and the logic control module. Relying on the powerful function of FPGA, FPGA can connect ADC, display devices and other peripheral circuits, finally we can achieve the requirements of the subject, and the purpose of the data collection。
基于FPGA数字示波器设计
摘要高速数字化采样技术和FPGA技术的发展，已经开始对传统测试仪器，包括现有的数字化仪器发展产生着深刻的影响，对传统仪器体系结构，传统测量方法，传统仪器的定义和分类等都将产生深刻的变革。
近几年来，数字仪器通常采用DSP或FPGA结构，从信息处理技术的发展上看，以FPGA为基础的软件硬件化是其重要的发展方向，本文设计的基于FPGA的数字示波器，是由单片机和FPGA相结合的方式组成，即用单片机完成人机界面，系统调控，用FPGA完成数据采集，数据处理等功能。
由通道输入调整，数据采集，数据处理，波形显示和操作界面等功能模块组成，系统中的数据采集及数据处理模块，采用了FPGA 内制的RAM IP核，使系统的工作频率基本不受外围器件影响。
设计中采用了自顶向下的方法，将系统按逻辑功能划分模块，各模块使用VHDL语言进行设计，在ISE中完成软件的设计和仿真关键词：FPGA 数字示波器数字采样AbstractHigh-speed digital sampling and FPGA technology has begun to influnence the development of traditional test equipment, including existing digital instruments , the architecture of traditional instruments, traditional measurement methods, definition and classification of traditional instruments and so will produce profound changes.In recent years, independent instrument is made up of DSP or FPGA structure, from the point of information processing technology development, to FPGA based hardware of software is an important direction of development, the paper design FPGA-based digital oscilloscope, which combines a single chip and FPGA , namely, with a microcontroller for interface and system control, with the FPGA for data acquisition, data processing and other functions. It is made up of adjustable channel input, data acquisition, data processing,waveform display and user interface features such as modules, the system of data collection and data processing module, using the FPGA within the system RAM IP core, which make a great significance on the data processing speed and real-time entry requirements. Using top-down approach, the system is logical and functional modules, each module is designed using the VHDL language, completed in the ISE software .Keywords: FPGA，Digital Oscilloscope，Digital Sampling目录摘要 (1)第一章绪论 (5)1.1研究概况与意义 (5)1.2 主要工作 (6)第二章数字示波器的工作原理 (8)2.1 工作原理框图 (8)2.1.1 数字示波器系统框图 (8)2.2 采样定理 (9)2.3 频率测量 (10)2.3.1高频双计数器测量方法 (10)2.3.2大范围双计数器测量法 (11)2.3.3 等精度测量法 (11)2.4扫描速度 (12)第三章硬件电路 (13)3.1 系统组成结构 (13)3.2放大电路 (14)3.2.1程控衰减放大器电路 (15)3.2.2 ADS830的应用 (16)3.2.3 放大器AD603介绍 (17)3.3整形电路 (20)3.3.1信号整形电路设计 (20)3.4采样与保持电路 (21)3.4.1 随机采样 (21)3.4.2 采样与保持电路设计 (22)3.5 数据采集电路 (22)3.5.1 FIFO的选择 (23)3.5.2 随机采样展宽电路 (23)3.6 电路的保护及滤波处理 (24)第四章 FPGA软件设计及仿真 (25)4.1分频电路及产生A/D转换器的控制信号 (25)4.2 FIFO功能单元设计 (26)4.3双口RAM (27)4.4液晶显示及键盘模块 (27)4.5系统软件住程序设计 (28)第五章实验结果 (29)5. 1 垂直灵敏度测试 (29)5. 2 水平扫描速度的测试 (29)总结 (30)参考文献 (31)第一章绪论与传统模拟示波器相比,数字示波器不仅具有可存储波形、体积小、功耗低,使用方便等优点,而且还具有强大的信号实时处理分析功能。
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制码 ） 。连 续 地 将 Ａ Ｃ输 出结 果 保 存 在 文 件 Ｄ 中， 以衡 量 Ａ Ｃ精 度 指 标 ， ４为 １３Ｖ 电压 Ｄ 图 ． 信号 时 Ａ Ｃ精度 测 试结 果 。 Ｄ
； ２ ６ Ｏ ６ Ｏ ４ ８ ２ ４ｌ ｌ ｝ 一 ｌ
的实现方法 ； 最后 ， 以一台 １ ／ ５Ｖ校正磁铁电源为样机 ， ５Ａ １ 进行了闭环调节实验 ， 出了测试结果 。 给
将 数 字 控 制 技 术 应 用 于 加 速 器 电源 调 节 器 ， 现 电源 的数 字 化 … ， 以消 除 温度 漂 移 、 实 可
制。
易老化等常规模拟调节器难 以克服的缺点 。数 字调节器有很强的灵活性 ， 可以方便实现参数
以实现运行数据的 自动存储 和故障 自动诊断，
有助于实现智能化控制 。将数字控制技术应用 于电源调节器的设计 ， 已成为现代加速器 电源 发展 的趋 势 ， 并在 加速 器领域 迅速 普及 。 本文选择 Ｆ Ｇ Ｐ Ａ作为控制核心器件 ， Ｆ ． 在 Ｐ
Ｇ Ａ中实现数 字 电源 调 节器 的控 制 算 法 。通 过 高速高精度 Ａ Ｃ实 现对 电源 输 出 电流 和 电压 Ｄ
整定 和 变参数 调 节 ， 通过 改 变程 序 甚 至 可 以调 整控制 方案 和实 现 多 种新 型 控 制 策 略 。此外 ， 数字调 节器具 有高速 强大 的远程 通讯 能力 和方 便建 立快 捷 友善 的本 地 人机 交 互 界 面 的能 力 ，
１ 数字 电源调节器硬 件设计
Ｒ ２２ ｓ ３ 故 障保护 大容量 非易失 性大容 高速８ 道 高速高精 度 通 通 讯设备 信 号输 入 Ｓ Ａ Ｒ Ｍ 量数据存 储器 Ａ Ｃ Ｄ 模块 Ｄ ０ 块 ｌ Ａ
０
｛
Ｃ Ｎ总线 高分辨率 Ａ 通讯设备 ｎ 号
、Ｉ ｉ 土 ／ ｆ 、
信号采集 ， Ｆ Ｇ 经 Ｐ Ａ处理后转换为高精度 Ｐ ＷＭ
信 号输 出 ， 过 驱 动 电路 直接 控 制 电力 电子器 通 件 的开 通 和关 断 以实 现 电源 的输 出调 节 和控
速度跟不上数字调节 器 的 Ｐ ＷＭ调节需求 ， 会
影 响数 字调 节器 的正常 运行 ， 如果 Ａ Ｃ的 采样 Ｄ
一
个电压信号的工作波形 ； 其次介绍 了数字 调节器的 软件设计 ， 包括 调节器算法 、 能 以及 在 Ｆ Ｇ 内 功 ＰＡ
关键词 ： 数字调节器 ； 硬件模块 ； Ｄ ６４ Ａ ７３
中 图分 类 号 ： Ｔ ０ ． Ｌ５３ ５ 文献标识码 ： Ａ 文 章 编 号 ： ０５ －９ ４ ２ １ ） ０１３ ￣３ ２ ８０３ （ ０ ０ １ －３４ －
采用高速数字隔离器件或高速光耦隔离 ， 自 各
独立 的辅助电源系统供 电， 具有 良好的抗干扰 能力 。 图 １为 Ｅ ２ ３ 案 的数字 电源 调 节器 Ｐ Ｃ ５方
各功 能模块 连接 框 图。 由于 Ａ Ｃ 位 于 数 字 控 制 流程 图 的反 馈 Ｄ 位置上 ，Ｄ Ａ Ｃ的采样 速 度 和精 度 直接决 定 了反 馈 网络 传递 函数 的本质 特性 ， 如果 Ａ Ｃ的采样 Ｄ
收稿 日期 ：０００ —０ ２ １ － ３ ４
精度不够 则数字调节器 的调节效果会 大打折 扣， 严重影响整台电源的精度和稳定度等指标。
作者简介 ： 黄玉珍 （９３） 女 ， １８一， 河南唐 河人 ， 博士研
究生 ， 核技术及应用专业 。
ｌ３ ３４因此 ，Fra bibliotek模数转换器 Ａ Ｃ成为影响数字调节器性 Ｄ 能的关键硬件设计。
，、
大 容量Ｆ Ｇ Ｐ Ｃ ５ Ｐ Ａ Ｅ ２ ３
Ｉ Ｉ
大容 量Ｄ ） 光纤 同步脉冲 高速 ｉ精 度 高速高精度 Ｉ Ｒ Ｉ ５ Ｓ 受 Ｍ Ｄ Ａ 运行信号 Ａ 模－ ｌ Ａ Ｃ ＤＣ 块 Ｄ￣ ２
图 １ Ｅ２３ Ｐ Ｃ ５方案 的数 字电源调节器各功能模块 连接框 图
本 文提 出 的数字 调 节器 高速 高精 度数 据采 集解 决 方 案 以 ＡＤ 公 司 的 Ｓ Ｒ（ｕｃｓｉ Ｉ Ａ ｓｃｅｓ ｅ印－ ｖ ｐｏｉａｏ ｒｈｔ ｔ ｅ ｒｘｍ ｔ ｎ ａｃｉｃ ｒ ）型 １ 位 高 速 Ａ Ｃ ｉ ｅｕ ８ Ｄ Ａ ７３ Ｄ ６４为核 心 。如 图 ２所 示 ， Ｄ ６４的 数 据 Ａ ７３
第３ Ｏ卷 第 １ 期 Ｏ
２１ ０ ０年 ｌ ０月
核 电子 学与探测 技术
Ｎｕ ｌａ ｅ ｔｏ ｃ ｃｅ ｒ Ｅｌｃ ｒｎｉｓ＆ Ｄｅｅ ｔ ｎ Ｔ ｃ ｎ ｌｇ ｔ ｃｉ ｅ ｈ ｏ ｏ ｙ ｏ
Ｖｏ ． Ｏ ＮＯ Ｏ １３ ．１
０ｃ ． ２０１ ｔ ０
基 于 Ｆ Ｇ 的 数 字 电源 调 节 器 研 究 与 设 计 Ｐ Ａ
黄玉珍 ， 陈又新 闫怀海 王荣坤 ， ， ， 吴凤军 王进 军 ， ， 周 忠祖 上 官靖斌 高大庆 原振栋 高亚林 ， ， ， ，
（． １ 中国科学院近代物理研究所 ， 甘肃兰州 ７ ００ ２ 中国科学院研 究生 院 ， ３００；． 北京 １０ ４ ） ００ ９
摘要 ： 详细描述 了基于 Ｆ Ｇ Ｐ Ａ方案 的数字 电源调节器 。首先 介绍 了数字调 节器的硬 件功能模块设 计， 重点对用于采样 电源输 出电流 的高速高精度 Ａ ７ ３ Ｄ ６４的工 作原理做 了描述 ， 并给 出 了 Ａ ７ ３ Ｄ ６４采集
以 Ａ Ｔ Ｒ ＿ 的 Ｃ ｃ ｎ 系列低成本大 Ｌ Ｅ Ａ２ ｙｌ ｅＩ ｏ Ｉ 容量 Ｆ Ｇ Ｐ Ａ中的 Ｅ ２ ３ Ｐ Ｃ ５为核 心， 扩展 了高速 高精 度 ＡＤ Ｃ模 块 、 高速 高精 度 Ｄ Ｃ模块 ， 出 Ａ 输 高精度 Ｐ ＷＭ调节信号 通道 ， 通用 电源故 障保 护信号输人通道、 数字电源通讯 口， 大容量数据 存储器等。数字调节器的各功能模块设计上均