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68问电子版

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(1)因人手比较紧张,M从正在从事编程工作的高手中选择了小张作为负责软件子项目的项目经理,小张同时兼任模块的编程工作●项目管理岗位是管理岗位,对技术的要求不高,小张仅仅从事过编程工作,对项目管理工作不熟悉,没有及时得到相关岗位工作培训。

●小张同时兼任模块编程,导致其工作精力分散,不能集中于某一项工作。

(2)该开发人员就直接对系统软件进行了修改●软件测试计划编制不合理。

在软件测试过程中,应该避免自己测试自己的产品,这样更有利于保证质量和测试的准确性。

●没有遵循变更控制流程。

开发人员修改模块,应该通过变更控制流程,得到 CCB的批准后,才能修改。

(3)在验收过程中,老刘提出了一些小问题。

项目经理张斌带领团队很快妥善解决了这些问题。

但是随着时间的推移,客户的问题似乎不断。

时间已超过系统试用期,但是客户仍然提出一些小问题,而有些问题都是客户方曾经提出过,并实际上已经解决了的问题。

●没有确定清晰地变更控制流程,项目有了新的需求,发生变更后没有及时的告知项目干系人,导致需求重复的出现。

●变更发生后应对结果进行评审,保证项目实施与计划一致协调。

●沟通管理不到位。

没有重视和及时的处理和记录客户提出问题。

●配置管理没有做好,走配置管理流程●没有一个验收标准(4)项目经理小丁做过5年的系统分析和设计工作,但这是他第一次担任项目经理。

小丁兼任系统分析工作●人员调配不合理。

项目经理岗位是管理岗位,对技术的要求不高,小丁仅仅从事过编程工作,缺乏项目管理经验。

●小丁同时兼任系统分析工作,导致其工作精力分散,不能集中于某一项工作。

●应该对小丁有足够的项目管理知识的培训,以提高项目管理知识,以利于更好的开展工作。

●没有项目管理经验(5)因此他要求项目组成员无论如何每周都必须按时参加例会并发言,但对例会具体应如何进行,老张却不知如何规定。

很快项目组成员就开始抱怨例会目的不明,时间太长,效率太低,缺乏效果等等,而且由于在例会上意见相左,很多组员开始相互争吵,甚至影响到了人际关系的融洽●团队沟通管理未做好,会议目的不明确。

FPGA工程师面试试题

FPGA工程师面试试题

FPGA工程师面试试题FPGA工程师面试试题001、同步电路和异步电路的区别是什么?(仕兰微电子)2、什么是同步逻辑和异步逻辑?(汉王笔试)同步逻辑是时钟之间有固定的因果关系.异步逻辑是各时钟之间没有固定的因果关系.3、什么是线与逻辑是两个输出信号相连可以实现与的功能.在硬件上,要用oc门来实现,由于不用 oc门可能使灌电流过大,而烧坏逻辑门. 同时在输出端口应加一个上拉电阻.4、什么是Setup 和Holdup时间?(汉王笔试)5、setup和holdup时间,区别.(南山之桥)6、解释setup time和hold time的定义和在时钟信号延迟时的变化.(未知)7、解释setup和hold time violation,画图说明,并说明解决办法.(威盛VIA2003.11.06 上海笔试试题)Setup/hold time 是测试芯片对输入信号和时钟信号之间的时间要求.建立时间是指触发器的时钟信号上升沿到来以前,数据稳定不变的时间.输入信号应提前时钟上升沿(如上升沿有效)T 时间到达芯片,这个T就是建立时间-Setup time.如不满足setup time,这个数据就不能被这一时钟打入触发器,只有在下一个时钟上升沿,数据才能被打入触发器. 保持时间是指触发器的时钟信号上升沿到来以后,数据稳定不变的时间.如果hold time 不够,数据同样不能被打入触发器.建立时间 (Setup Time)和保持时间(Hold time).建立时间是指在时钟边沿前,数据信号需要保持不变的时间.保持时间是指时钟跳变边沿后数据信号需要保持不变的时间.如果不满足建立和保持时间的话,那么DFF将不能正确地采样到数据,将会出现 metastability的情况.如果数据信号在时钟沿触发前后持续的时间均超过建立和保持时间,那么超过量就分别被称为建立时间裕量和保持时间裕量.8、说说对数字逻辑中的竞争和冒险的理解,并举例说明竞争和冒险怎样消除.(仕兰微电子)9、什么是竞争与冒险现象?怎样判断?如何消除?(汉王笔试)在组合逻辑中,由于门的输入信号通路中经过了不同的延时,导致到达该门的时间不一致叫竞争.产生毛刺叫冒险.如果布尔式中有相反的信号则可能产生竞争和冒险现象.解决方法:一是添加布尔式的消去项,二是在芯片外部加电容.10、你知道那些常用逻辑电平?TTL与COMS电平可以直接互连吗?(汉王笔试)常用逻辑电平:12V,5V,3.3V;TTL和CMOS不可以直接互连,由于TTL是在0.3-3.6V之间,而CMOS则是有在12V的有在5V 的.CMOS输出接到TTL是可以直接互连.TTL接到CMOS需要在输出端口加一上拉电阻接到5V或者12V.11、如何解决亚稳态.(飞利浦-大唐笔试)亚稳态是指触发器无法在某个规定时间段内达到一个可确认的状态.当一个触发器进入亚稳态时,既无法预测该单元的输出电平,也无法预测何时输出才能稳定在某个正确的电平上.在这个稳定期间,触发器输出一些中间级电平,或者可能处于振荡状态,并且这种无用的输出电平可以沿信号通道上的各个触发器级联式传播下去.12、IC设计中同步复位与异步复位的区别.(南山之桥)13、MOORE 与 MEELEY状态机的特征.(南山之桥)14、多时域设计中,如何处理信号跨时域.(南山之桥)15、给了reg的setup,hold时间,求中间组合逻辑的delay范围.(飞利浦-大唐笔试)Delay16、时钟周期为T,触发器D1的建立时间最大为T1max,最小为T1min.组合逻辑电路最大延迟为T2max,最小为T2min.问,触发器D2的建立时间T3和保持时间应满足什么条件.(华为)17、给出某个一般时序电路的图,有Tsetup,Tdelay,Tck->q,还有 clock的delay,写出决定最大时钟的因素,同时给出表达式.(威盛VIA 2003.11.06 上海笔试试题)18、说说静态、动态时序模拟的优缺点.(威盛VIA2003.11.06 上海笔试试题)19、一个四级的Mux,其中第二级信号为关键信号如何改善timing.(威盛VIA2003.11.06 上海笔试试题)20、给出一个门级的图,又给了各个门的传输延时,问关键路径是什么,还问给出输入, 使得输出依赖于关键路径.(未知)21、逻辑方面数字电路的卡诺图化简,时序(同步异步差异),触发器有几种(区别,优点),全加器等等.(未知)22、卡诺图写出逻辑表达使.(威盛VIA 2003.11.06 上海笔试试题)23、化简F(A,B,C,D)= m(1,3,4,5,10,11,12,13,14,15)的和.(威盛)24、please show the CMOS inverter schmatic,layout and its cross sectionwith P-well process.Plot its transfer curve (Vout-Vin) And also explain theoperation region of PMOS and NMOS for each segment of the transfer curve? (威盛笔试题circuit design-beijing-03.11.09)25、To design a CMOS invertor with balance rise and fall time,please definethe ration of channel width of PMOS and NMOS and explain?26、为什么一个标准的倒相器中P管的宽长比要比N管的宽长比大?(仕兰微电子)27、用mos管搭出一个二输入与非门.(扬智电子笔试)28、please draw the transistor level schematic of a cmos 2 input AND gate andexplain which input has faster response for output rising edge.(less delaytime).(威盛笔试题circuit design-beijing-03.11.09)29、画出NOT,NAND,NOR的符号,真值表,还有transistor level的电路.(Infineon笔试)30、画出CMOS的图,画出tow-to-one mux gate.(威盛VIA 2003.11.06 上海笔试试题)31、用一个二选一mux和一个inv实现异或.(飞利浦-大唐笔试)32、画出Y=A*B+C的cmos电路图.(科广试题)33、用逻辑们和cmos电路实现ab+cd.(飞利浦-大唐笔试)34、画出CMOS电路的晶体管级电路图,实现Y=A*B+C(D+E).(仕兰微电子)35、利用4选1实现F(x,y,z)=xz+yz’.(未知)36、给一个表达式f=xxxx+xxxx+xxxxx+xxxx用最少数量的与非门实现(实际上就是化简).37、给出一个简单的由多个NOT,NAND,NOR组成的原理图,根据输入波形画出各点波形. (Infineon笔试)38、为了实现逻辑(A XOR B)OR (C AND D),请选用以下逻辑中的一种,并说明为什么?1)INV 2)AND 3)OR 4)NAND 5)NOR 6)XOR 答案:NAND(未知)39、用与非门等设计全加法器.(华为)40、给出两个门电路让你分析异同.(华为)41、用简单电路实现,当A为输入时,输出B波形为…(仕兰微电子)42、A,B,C,D,E进行投票,多数服从少数,输出是F(也就是如果A,B,C,D,E中1的个数比0 多,那么F输出为1,否则F为0),用与非门实现,输入数目没有限制.(未知)43、用波形表示D触发器的功能.(扬智电子笔试)44、用传输门和倒向器搭一个边沿触发器.(扬智电子笔试)45、用逻辑们画出D触发器.(威盛VIA 2003.11.06 上海笔试试题)46、画出DFF的结构图,用verilog实现之.(威盛)47、画出一种CMOS的D锁存器的电路图和版图.(未知)48、D触发器和D锁存器的区别.(新太硬件面试)49、简述latch和filp-flop的异同.(未知)50、LATCH和DFF的概念和区别.(未知)51、latch与register的区别,为什么现在多用register.行为级描述中latch如何产生的. (南山之桥)52、用D触发器做个二分颦的电路.又问什么是状态图.(华为)53、请画出用D触发器实现2倍分频的逻辑电路?(汉王笔试)54、怎样用D触发器、与或非门组成二分频电路?(东信笔试)55、How many flip-flop circuits are needed to divide by 16? (Intel) 16分频?56、用filp-flop和logic-gate设计一个1位加法器,输入carryin和current-stage,输出 carryout和next-stage. (未知)57、用D触发器做个4进制的计数.(华为)58、实现N位Johnson Counter,N=5.(南山之桥)59、用你熟悉的设计方式设计一个可预置初值的7进制循环计数器,15进制的呢?(仕兰微电子)60、数字电路设计当然必问Verilog/VHDL,如设计计数器.(未知)61、BLOCKING NONBLOCKING 赋值的区别.(南山之桥)62、写异步D触发器的verilog module.(扬智电子笔试)module dff8(clk , reset, d, q);input clk;input reset;input [7:0] d;output [7:0] q;reg [7:0] q;always @ (posedge clk or posedge reset)if(reset)qelseqendmodule63、用D触发器实现2倍分频的Verilog描述? (汉王笔试) module divide2( clk , clk_o, reset);input clk , reset;output clk_o;wire in;reg out ;always @ ( posedge clk or posedge reset)if ( reset)outelseoutassign in = ~out;assign clk_o = out;endmodule64、可编程逻辑器件在现代电子设计中越来越重要,请问:a) 你所知道的可编程逻辑器件有哪些? b) 试用VHDL或VERILOG、ABLE描述8位D触发器逻辑.(汉王笔试)PAL,PLD,CPLD,FPGA.module dff8(clk , reset, d, q);input clk;input reset;input d;output q;reg q;always @ (posedge clk or posedge reset)if(reset)qelseqendmodule65、请用HDL描述四位的全加法器、5分频电路.(仕兰微电子)66、用VERILOG或VHDL写一段代码,实现10进制计数器.(未知)67、用VERILOG或VHDL写一段代码,实现消除一个glitch.(未知)68、一个状态机的题目用verilog实现(不过这个状态机画的实在比较差,很容易误解的).(威盛VIA 2003.11.06 上海笔试试题)69、描述一个交通信号灯的设计.(仕兰微电子)70、画状态机,接受1,2,5分钱的卖报机,每份报纸5分钱.(扬智电子笔试)71、设计一个自动售货机系统,卖soda水的,只能投进三种硬币,要正确的找回钱数. (1)画出fsm(有限状态机);(2)用verilog编程,语法要符合fpga设计的要求.(未知)72、设计一个自动饮料售卖机,饮料10分钱,硬币有5分和10分两种,并考虑找零:(1) 画出fsm(有限状态机);(2)用verilog编程,语法要符合fpga设计的要求;(3)设计工程中可使用的工具及设计大致过程.(未知)73、画出可以检测10010串的状态图,并verilog实现之.(威盛)74、用FSM实现101101的序列检测模块.(南山之桥)a为输入端,b为输出端,如果a连续输入为1101则b输出为1,否则为0.例如a: [***********]0110b: [***********]0000请画出state machine;请用RTL描述其state machine.(未知)75、用verilog/vddl检测stream中的特定字符串(分状态用状态机写).(飞利浦-大唐笔试)76、用verilog/vhdl写一个fifo控制器(包括空,满,半满信号).(飞利浦-大唐笔试)77、现有一用户需要一种集成电路产品,要求该产品能够实现如下功能:y=lnx,其中,x为4位二进制整数输入信号.y为二进制小数输出,要求保留两位小数.电源电压为3~5v假设公司接到该项目后,交由你来负责该产品的设计,试讨论该产品的设计全程.(仕兰微电子)78、sram,falsh memory,及dram的区别?(新太硬件面试)79、给出单管DRAM的原理图(西电版《数字电子技术基础》杨颂华、冯毛官205页图9-14b),问你有什么办法提高refresh time,总共有5个问题,记不起来了.(降低温度,增大电容存储容量)(Infineon笔试)80、Please draw schematic of a mon SRAM cell with 6 transistors,point outwhich nodes can store data and which node is word line control? (威盛笔试题circuit design-beijing-03.11.09)81、名词:sram,ssram,sdram名词IRQ,BIOS,USB,VHDL,SDRIRQ: Interrupt ReQuestBIOS: Basic Input Output SystemUSB: Universal Serial BusVHDL: VHIC Hardware Description LanguageSDR: Single Data Rate压控振荡器的英文缩写(VCO).动态随机存储器的英文缩写(DRAM).名词解释,无聊的外文缩写罢了,比如PCI、ECC、DDR、interrupt、pipeline、IRQ,BIOS,USB,VHDL,VLSI VCO(压控振荡器) RAM (动态随机存储器),FIR IIR DFT(离散傅立叶变换)或者是中文的,比如:a.量化误差 b.直方图 c.白平FPGA工程师面试试题011 什么是Setup 和Holdup时间?2 什么是竞争与冒险现象?怎样判断?如何消除?3 用D触发器实现2倍分频的逻辑电路? .......4 什么是5 什么是同步逻辑和异步逻辑?6 请画出微机接口电路中,典型的输入设备与微机接口逻辑示意图(数据接口、控制接口、所存器/缓冲器)。

IC设计面试笔试题目

IC设计面试笔试题目

IC设计面试笔试题目集合分类笔试/面试题目集合分类--IC设计基础1、我们公司的产品是集成电路,请描述一下你对集成电路的认识,列举一些与集成电路相关的内容(如讲清楚模拟、数字、双极型、CMOS、MCU、RISC、CISC、DSP、ASIC、FPGA等的概念)。

(仕兰微面试题目)2、FPGA和ASIC的概念,他们的区别。

(未知)答案:FPGA是可编程ASIC。

ASIC:专用集成电路,它是面向专门用途的电路,专门为一个用户设计和制造的。

根据一个用户的特定要求,能以低研制成本,短、交货周期供货的全定制,半定制集成电路。

与门阵列等其它ASIC(Application Specific IC)相比,它们又具有设计开发周期短、设计制造成本低、开发工具先进、标准产品无需测试、质量稳定以及可实时在线检验等优点模拟电路1、基尔霍夫定理的内容是什么?(仕兰微电子)2、平板电容公式(C=εS/4πkd)。

(未知)3、最基本的如三极管曲线特性。

(未知)4、描述反馈电路的概念,列举他们的应用。

(仕兰微电子)5、负反馈种类(电压并联反馈,电流串联反馈,电压串联反馈和电流并联反馈);负反馈馈的优点(降低放大器的增益灵敏度,改变输入电阻和输出电阻,改善放大器的线性和非线性失真,有效地扩展放大器的通频带,自动调节作用)(未知)6、放大电路的频率补偿的目的是什么,有哪些方法?(仕兰微电子)7、频率响应,如:怎么才算是稳定的,如何改变频响曲线的几个方法。

(未知)8、给出一个查分运放,如何相位补偿,并画补偿后的波特图。

(凹凸)9、基本放大电路种类(电压放大器,电流放大器,互导放大器和互阻放大器),优缺点,特别是广泛采用差分结构的原因。

(未知)10、给出一差分电路,告诉其输出电压Y+和Y-,求共模分量和差模分量。

(未知)11、画差放的两个输入管。

(凹凸)12、画出由运放构成加法、减法、微分、积分运算的电路原理图。

并画出一个晶体管级的运放电路。

电子信息工程专业面试题

电子信息工程专业面试题

电子信息、通信、电类专业将会遇到的面试题大全!精!!!看了让人大吃一惊.模拟电路1、基尔霍夫定理的内容是什么?(仕兰微电子)基尔霍夫电流定律是一个电荷守恒定律,即在一个电路中流入一个节点的电荷与流出同一个节点的电荷相等.基尔霍夫电压定律是一个能量守恒定律,即在一个回路中回路电压之和为零.2、平板电容公式(C=εS/4πkd)。

(未知)3、最基本的如三极管曲线特性。

(未知)4、描述反馈电路的概念,列举他们的应用。

(仕兰微电子)5、负反馈种类(电压并联反馈,电流串联反馈,电压串联反馈和电流并联反馈);负反馈的优点(降低放大器的增益灵敏度,改变输入电阻和输出电阻,改善放大器的线性和非线性失真,有效地扩展放大器的通频带,自动调节作用)(未知)6、放大电路的频率补偿的目的是什么,有哪些方法?(仕兰微电子)7、频率响应,如:怎么才算是稳定的,如何改变频响曲线的几个方法。

(未知)8、给出一个差分运放,如何相位补偿,并画补偿后的波特图。

(凹凸)9、基本放大电路种类(电压放大器,电流放大器,互导放大器和互阻放大器),优缺点,特别是广泛采用差分结构的原因。

(未知)10、给出一差分电路,告诉其输出电压Y+和Y-,求共模分量和差模分量。

(未知)11、画差放的两个输入管。

(凹凸)12、画出由运放构成加法、减法、微分、积分运算的电路原理图。

并画出一个晶体管级的运放电路。

(仕兰微电子)13、用运算放大器组成一个10倍的放大器。

(未知)14、给出一个简单电路,让你分析输出电压的特性(就是个积分电路),并求输出端某点的rise/fall时间。

(Infineon笔试试题)15、电阻R和电容C串联,输入电压为R和C之间的电压,输出电压分别为C上电压和R上电压,要求制这两种电路输入电压的频谱,判断这两种电路何为高通滤波器,何为低通滤波器。

当RC<< period - setup ? hold16、时钟周期为T,触发器D1的建立时间最大为T1max,最小为T1min。

硬件工程师面试题集(含答案,很全).

硬件工程师面试题集(含答案,很全).

硬件工程师面试题集(DSP,嵌入式系统,电子线路,通讯,微电子,半导体)1、下面是一些基本的数字电路知识问题,请简要回答之。

(1) 什么是Setup和Hold 时间?答:Setup/Hold Time 用于测试芯片对输入信号和时钟信号之间的时间要求。

建立时间(Setup Time)是指触发器的时钟信号上升沿到来以前,数据能够保持稳定不变的时间。

输入数据信号应提前时钟上升沿(如上升沿有效)T 时间到达芯片,这个T就是建立时间通常所说的SetupTime。

如不满足Setup Time,这个数据就不能被这一时钟打入触发器,只有在下一个时钟上升沿到来时,数据才能被打入触发器。

保持时间(Hold Time)是指触发器的时钟信号上升沿到来以后,数据保持稳定不变的时间。

如果Hold Time 不够,数据同样不能被打入触发器。

(2) 什么是竞争与冒险现象?怎样判断?如何消除?答:在组合逻辑电路中,由于门电路的输入信号经过的通路不尽相同,所产生的延时也就会不同,从而导致到达该门的时间不一致,我们把这种现象叫做竞争。

由于竞争而在电路输出端可能产生尖峰脉冲或毛刺的现象叫冒险。

如果布尔式中有相反的信号则可能产生竞争和冒险现象。

解决方法:一是添加布尔式的消去项,二是在芯片外部加电容。

(3) 请画出用D 触发器实现2 倍分频的逻辑电路答:把D 触发器的输出端加非门接到D 端即可,如下图所示:(4) 什么是"线与"逻辑,要实现它,在硬件特性上有什么具体要求?答:线与逻辑是两个或多个输出信号相连可以实现与的功能。

在硬件上,要用OC 门来实现(漏极或者集电极开路),为了防止因灌电流过大而烧坏OC 门,应在OC 门输出端接一上拉电阻(线或则是下拉电阻)。

(5) 什么是同步逻辑和异步逻辑?同步电路与异步电路有何区别?答:同步逻辑是时钟之间有固定的因果关系。

异步逻辑是各时钟之间没有固定的因果关系.电路设计可分类为同步电路设计和异步电路设计。

芯片设计基础知识题库单选题100道及答案解析

芯片设计基础知识题库单选题100道及答案解析

芯片设计基础知识题库单选题100道及答案解析1. 芯片制造过程中,用于光刻的光源通常是()A. 紫外线B. 红外线C. 可见光D. X 射线答案:A解析:芯片制造光刻过程中通常使用紫外线作为光源,因为其波长较短,能够实现更高的分辨率。

2. 以下哪种材料常用于芯片的绝缘层?()A. 硅B. 二氧化硅C. 铝D. 铜答案:B解析:二氧化硅具有良好的绝缘性能,常用于芯片的绝缘层。

3. 在芯片设计中,CMOS 技术的主要优点是()A. 低功耗B. 高速度C. 高集成度D. 低成本答案:A解析:CMOS 技术的主要优点是低功耗。

4. 芯片中的晶体管主要工作在()A. 截止区和饱和区B. 截止区和放大区C. 饱和区和放大区D. 饱和区和线性区答案:A解析:芯片中的晶体管主要工作在截止区和饱和区。

5. 以下哪个是衡量芯片性能的重要指标?()A. 功耗B. 面积C. 时钟频率D. 封装形式答案:C解析:时钟频率是衡量芯片性能的重要指标之一。

6. 芯片布线过程中,为了减少信号延迟,通常采用()A. 长导线B. 短而宽的导线C. 细而长的导线D. 弯曲的导线答案:B解析:短而宽的导线电阻小,能减少信号延迟。

7. 下列哪种工艺可以提高芯片的集成度?()A. 减小晶体管尺寸B. 增加芯片面积C. 降低工作电压D. 减少引脚数量答案:A解析:减小晶体管尺寸可以在相同面积上集成更多的晶体管,从而提高集成度。

8. 芯片设计中,逻辑综合的主要目的是()A. 优化电路性能B. 生成门级网表C. 验证功能正确性D. 确定芯片布局答案:B解析:逻辑综合的主要目的是将高级描述转化为门级网表。

9. 以下哪种存储单元在芯片中速度最快?()A. SRAMB. DRAMC. FlashD. EEPROM答案:A解析:SRAM 的速度通常比DRAM、Flash 和EEPROM 快。

10. 芯片测试中,功能测试的目的是()A. 检测芯片的制造缺陷B. 验证芯片的功能是否符合设计要求C. 评估芯片的性能D. 确定芯片的可靠性答案:B解析:功能测试主要是验证芯片的功能是否符合设计要求。

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电气自动化面试最常见的问题

电气自动化专业面试最常见的16个问题电气自动化1. 硅材料与锗材料的二极管导通后的压降各为多少?在温度升高后,二极管的正向压降,反向电流各会起什么变化?试说出二极管用途(举3个例子即可)硅材料二极管:导通电压约0。

5~0。

7V,温度升高后正向压降降低,反向电流增加。

锗材料二极管:导通电压约0。

1~0.3V,温度升高后正向压降降低,反向电流增加.二极管主要功能是其单向导通。

有高低频之分,还有快恢复与慢恢复之分,特殊的:娈容二极管,稳压二极管,隧道二极管,发光二极管,激光二极管,光电接收二极管,金属二极管(肖特基),,,用途:检波,整流,限幅,吸收(继电器驱动电路),逆程二极管(电视行输出中).2. 如何用万用表测试二极管的好坏?在选用整流二极管型号时,应满足主要参数有哪些?如何确定?3. 在发光二极管LED电路中,已知LED正向压降UF=1.4V,正向电流IF=10mA,电源电压5V,试问如何确定限流电阻.4。

三极管运用于放大工作状态时,对NPN管型的,各极电位要求是:c极b极,b 极e极,而对PNP管型,是c极b极,b极e极。

5。

场效应管是型控制器件,是由极电压,控制极电流,对P沟道及N沟道场效应管,漏极电压的极性如何?6. 集成运算放大器作为线性放大时,信号从同相端输入,试画出其电路图,并说明相应电阻如何取?7。

说出一个你熟悉的运算放大器的型号,指出输入失调电压的意义.8. 试画出用运算放大器组成比例积分电路的电路图,说明各元件参数的选择。

9。

某电子线路需要一组5V,1A的直流稳压电源,请设计一个电源线路,并说明所需元件的大致选择。

10. 在一台电子设备中需要±15V两组电源,负载电流200mA,主用三端集成稳压器,1、画出电路图,2、试确定变压器二次侧电压有效值及容量.11. TTL电路和CMOS电路是数字电子电路中最常用的,试说出TTL电路和CMOS 电路主要特点及常用系列型号。

电子信息类面试题

数字电路1、同步电路和异步电路的区别是什么?(仕兰微电子)同步:存储电路中所有触发器时钟输入接同一个时钟源,所有触发器的状态的变化与所加的时钟脉冲信号同步。

异步:电路无统一时钟,触发器的时钟输入与时钟脉冲源相连,状态变化与时钟同步,其他触发器状态变化不同步2、什么是同步逻辑和异步逻辑?(汉王笔试)同步逻辑是时钟之间有固定的因果关系。

异步逻辑是各时钟之间没有固定的因果关系。

3、什么是"线与"逻辑,要实现它,在硬件特性上有什么具体要求?(汉王笔试)线与逻辑是两个输出信号相连可以实现与的功能。

在硬件上,要用oc门来实现,由于不用oc门可能使灌电流过大,而烧坏逻辑门。

同时在输出端口应加一个上拉电阻。

4、什么是Setup 和Holdup时间?(汉王笔试)Setup/hold time 是测试芯片对输入信号和时钟信号之间的时间要求。

建立时间是指触发器的时钟信号上升沿到来以前,数据稳定不变的时间。

输入信号应提前时钟上升沿(如上升沿有效)T时间到达芯片,这个T就是建立时间-Setup time.如不满足setup time,这个数据就不能被这一时钟打入触发器,只有在下一个时钟上升沿,数据才能被打入触发器。

保持时间是指触发器的时钟信号上升沿到来以后,数据稳定不变的时间。

如果holdtime不够,数据同样不能被打入触发器。

5、setup和holdup时间,区别.(南山之桥)6、解释setup time和hold time的定义和在时钟信号延迟时的变化。

(未知)7、解释setup和hold time violation,画图说明,并说明解决办法。

(威盛VIA 2003.11.06 上海笔试试题)Setup/hold time 是测试芯片对输入信号和时钟信号之间的时间要求。

建立时间是指触发器的时钟信号上升沿到来以前,数据稳定不变的时间。

输入信号应提前时钟上升沿(如上升沿有效)T时间到达芯片,这个T就是建立时间-Setup time.如不满足setup time,这个数据就不能被这一时钟打入触发器,只有在下一个时钟上升沿,数据才能被打入触发器。

2011年Sigrity研讨会资料


SystemSI Parallel Bus Analysis for new product innovation
Power Planner
Target impedance BGA Pre & post layout SiP Decap optimization EMI resonance removal Leadframe WB or FC eDriven design Package assessment
Sigrity Confidential
gr
9 Sigrity Confidential 11
ity
General Analysis Physical tools
Sigrity Confidential 7
Customized SI / PI / EMC
Chip Analysis
Sigrity Confidential
Headquartered in the US, Sigrity has sales, support and R&D offices throughout the world with a total of over 110 employees and more than 250 customers.
XtractIM – Comprehensive capabilities for the assessment of IC package electrical performance including per-pin electrical assessment to evaluate the properties of power and ground nets. Released PowerDC-Thermal – Industry’s first, and so far the only electrical and thermal co-simulation tool.
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EMI/EMC设计经典85问 1、为什么要对产品做电磁兼容设计? 答:满足产品功能要求、减少调试时间,使产品满足电磁兼容标准的要求,使产品不会对系统中的 其它设备产生电磁干扰。 2、对产品做电磁兼容设计可以从哪几个方面进行? 答:电路设计(包括器件选择)、软件设计、线路板设计、屏蔽结构、信号线/电源线滤波、电路的 接地方式设计。 3、在电磁兼容领域,为什么总是用分贝(dB)的单位描述? 答:因为要描述的幅度和频率范围都很宽,在图形上用对数坐标更容易表示,而dB 就是用对数表示时的单位。 4、 关于EMC,我了解的不多,但是现在电路设计中数据传输的速率越来越快,我在制做PCB板的时候,也遇到了一些PCB的EMC问题,但是觉得太潜。我想好好在这方面学习学习,并不是随大流,大家学什么我就学什么,是自己真的觉得EMC在今后的电路设计中的重要性越来越大,就像我在前面说的,自己了解不深,不知道怎么入手,想问问,要在EMC方面做的比较出色,需要有哪些基础知识,应该学习哪些基础课程。如何学习才是一条比较好的道路,我知道任何一门学问学好都不容易,也不曾想过短期内把他搞通,只是希望给点建议,尽量少走一些弯路。 答:关于EMC需要首先了解一下EMC方面的标准,如EN55022(GB9254),EN55024,以及简单测试原理,另外需要了解EMI元器件的使用,如电容,磁珠,差模电感,共模电感等,在PCB层面需要了解PCB的布局、层叠结构、高速布线对EMC的影响以及一些规则。还有一点就是对出现EMC问题需要掌握一些分析与解决思路。这些今后是作为一个硬件人员必须掌握的基本知识! 5、我是一个刚涉足PCB设计的新手,我想向您请教一下,要想做好PCB设计我应该多多掌握哪方面的知识?另外,在PCB设计中遇到的关于安规方面的知识一般在哪里能找到?盼望您的指点,不胜感激! 答:对于PCB设计应该掌握:

1、熟悉与掌握相关PCB设计软件,如POWERPCB/CANDENCE等; 2、了解熟悉所设计产品的具体架构,同时熟悉原理图电路知识,包含数字与模拟知识; 3、掌握PCB加工流程、工艺、可维护加工要求; 4、掌握PCB板高速信号完整性、电磁兼容(emi与ems)、SI、PI仿真设计等相关的知识; 5、 如果相关工作涉及射频,还需掌握射频知识; 6、对于PCB设计地的按规知识主要看GB4943或UL60950,一般的绝缘间距要求通过查表可以得到! 6、电磁兼容设计基本原则 答:电子线路设计准则电子线路设计者往往只考虑产品的功能,而没有将功能和电磁兼容性综合考虑,因此产品在完成其功能的同时,也产生了大量的功能性骚扰及其它骚扰。而且,不能满足敏感度要求。电子线路的电磁兼容性设计应从以下几方面考虑: 元件选择在大多数情况下,电路的基本元件满足电磁特性的程度将决定着功能单元和最后的设备满足电磁兼容性的程度。选择合适的电磁元件的主要准则包括带外特性和电路装配技术。因为是否能实现电磁兼容性往往是由远离基频的元件响应特性来决定的。而在许多情况下,电路装配又决定着带外响应(例如引线长度)和不同电路元件之间互相耦合的程度。具体规则是: ⑴在高频时,和引线型电容器相比,应优先进用引线电感小的穿心电容器或支座电容器来滤波。 ⑵在必须使用引线式电容时,应考虑引线电感对滤波效率的影响。 ⑶铝电解电容器可能发生几微秒的暂时性介质击穿,因而在纹波很大或有瞬变电压的电路里,应该使用固体电容器。 ⑷使用寄生电感和电容量小的电阻器。片状电阻器可用于超高频段。 ⑸大电感寄生电容大,为了提高低频部分的插损,不要使用单节滤波器,而应该使用若干小电感组成的多节滤波器。 ⑹使用磁芯电感要注意饱和特性,特别要注意高电平脉冲会降低磁芯电感的电感量和在滤波器电路中的插损。 ⑺尽量使用屏蔽的继电器并使屏蔽壳体接地。 ⑻选用有效地屏蔽、隔离的输入变压器。 ⑼用于敏感电路的电源变压器应该有静电屏蔽,屏蔽壳体和变压器壳体都应接地。 ⑽设备内部的互连信号线必须使用屏蔽线,以防它们之间的骚扰耦合。 ⑾为使每个屏蔽体都与各自的插针相连,应选用插针足够多的插头座。 7、方波脉冲驱动电感传感器的问题 答:1、信号测试过程中,尽量在屏蔽环境下进行,如果不便的话,至少要屏蔽传感器和前级。 2、测试过程中尽量使用差分探头,或至少要尽可能减短探头的接地线长度。这样能减少测试误差。 3、你的电路实际工作频率并不太高,可以通过布线减少振铃。为了噪声特性更好,应当考虑共模信号的抑制问题,必要时插入共扼电抗器,同时注意整个工作环境中的开关电源噪声,以及避免电源耦合。 4、如果传感器允许,可以使用电流放大模式,这有利于提高速度,降低噪声。模拟开关尽量放到前置放大器之后,尽管多了一路前放,但性能提高不少,而且降低调试难度。 5、如果十分介意波形,考虑额外的频率补偿。如果仅仅是数字检测,则应当降低工作频率。总而言之,能低频则低频,能隔直则隔直。 6、注意AD转换前的抗混叠滤波,以及软件滤波,提高数据稳定性。 8、GPS电磁干扰现象表现:尤其是GPS应用在PMP这种产品,功能是MP4、MP3、FM调频+GPS导航功能的手持车载两用的GPS终端产品,一定得有一个内置GPS Antenna,这样GPS Antenna与GPS终端产品上的MCU、SDROM、晶振等元器件很容易产生EMI/EMC电磁干扰,致使GPS Antenna的收星能力下降很多,几乎没办法正常定位。采取什么样的办法可以解决这样的EMI/EMC电磁干扰? 答:可以在上面加上ESD Filter,既有防静电又能抗电磁干扰。我们的手机客户带GPS功能的就用的这个方法。做这些的厂家有泰克(瑞侃),佳邦,韩国ICT等等很多。 9、板子上几乎所有的重要信号线都设计成差分线对,目的在增强信号抗干扰能力.那俺一直有很多困惑的地方: 1.是否差分信号只定义在仿真信号或数字信号或都有定义? 2.在实际的线路图中差分线对上的网罗如滤波器,应如何分析其频率响应,是否还是与分析一般的二端口网罗的方法一样? 3.差分线对上承载的差分信号如何转换成一般的信号? 差分线对上的信号波形是怎样的,相互之间的关系如何? 答:1,差分信号只是使用两根信号线传输一路信号,依靠信号间电压差进行判决的电路,既可以是模拟信号,也可以是数字信号。实际的信号都是模拟信号,数字信号只是模拟信号用门限电平量化后的取样结果。因此差分信号对于数字和模拟信号都可以定义。 2,差分信号的频率响应,这个问题好。实际差分端口是一个四端口网络,它存在差模和共模两种分析方式。如下图所示。在分析频率相应的时候,要分别添加同极性的共模扫频源和互为反极性的差模扫频源。而相应端需要相应设置共模电压测试点Vcm=(V1+V2)/2, 和差模电压测试点Vdm=V1-V2。网络上有很多关于差分信号阻抗计算和原理的文章,可以详细了解一下。 3,差分信号通常进入差分驱动电路,放大后得到差分信号。最简单的就是差分共射镜像放大器电路了,这个在一般的模拟电路教材都有介绍。下图是某差分放大器件的spice电路图和输出信号波形,一般需要他们完全反相,有足够的电压差大于差模电压门限。当然信号不可避免有共模成分,所以差分放大器一个很重要的指标就是共模抑制比Kcmr=Adm/Acm。 10、我为单位的直流磁钢电机设计了一块调速电路,电源端以用0.33uf+夏普电视机电感+0.33uf后不理想,后用4只电感串在PCB板电源端,但在30~50MHz之间超了12db,该如何处理? 答:通常来讲,LC或PI型滤波电路比单一的电容滤波或电感滤波效果要好。您所谓的电源端以用0.33uf+夏普电视机电感+0.33uf后不理想不知道是什么意思?是辐射超标吗?在什么频段?我猜测直流磁钢电机供电回路中,反馈噪声幅度大,频率较低,需要感值大一点的电感滤波,同时采用多级电容滤波,效果会好一些。 11、最近正想搞个0--150M,增益不小于80 DB的宽带放大器,!请问在EMC方面应该注意什么问题呢? 答1:宽带放大器设计时特别要注意低噪声问题,比如要电源供给必须足够稳定等。 答2:1. 注意输入和数出的阻抗匹配问题,比如共基输入射随输出等 2. 各级的退偶问题,包括高频和低频纹波等 3. 深度负反馈,以及防止自激振荡和环回自激等 4. 带通滤波气的设计问题 答3:实在不好回答,看不到实际的设计,一切建议还是老生常谈:注意EMC的三要素,注意传导和辐射路径,注意电源分配和地弹噪声。150MHz是模拟信号带宽,数字信号的上升沿多快呢?如果转折频率也在150MHz以下,个人认为,传导耦合,电源平面辐射将是主要考虑的因素,先做好电源的分配,分割和去耦电路吧。80dB,增益够高的,做好前极小信号及其参考电源和地的隔离保护,尽量降低这个部分的电源阻抗。 12、求教小功率直流永磁电机设计中EMC的方法和事项。生产了一款90W的直流永磁电机(110~120V,转速2000/分钟)EMC一直超标,生产后先把16槽改24槽,有做了轴绝缘,未能达标!现在又要设计生产125W的电机,如何处理? 答:直流永磁电机设计中EMC问题,主要由于电机转动中产生反电动势和换相时引起的打火。具体分析,可以使用RMxpert来设计优化电机参数,Maxwell2D来仿真EMI实际辐射。 13、是否可用阻抗边界(Impedance)方式设定?或者用类似的分层阻抗 RLC阻抗?又或者使用designer设计电路和hfss协同作业? 答:集中电阻可以用RLC边界实现;如果是薄膜电阻,可以用面阻抗或阻抗编辑实现。 14、我现在在对外壳有一圈金属装饰件的机器做静电测试,测试中遇到:接触放电4k时32k晶振没问题,空气放电8k停振的问题,如何处理? 答:有金属的话,空气放电和接触放电效果差不多,建议你在金属支架上喷绝缘漆试试。 15、我们现在测量PCB电磁辐射很麻烦,采用的是频谱仪加自制的近场探头,先不说精度的问题,光是遇到大电压的点都很头疼,生怕频谱仪受损。不知能否通过仿真的方法解决。 答:首先,EMI的测试包括近场探头和远场的辐射测试,任何仿真工具都不可能替代实际的测试;其次,Ansoft的PCB单板噪声和辐射仿真工具SIwave和任意三维结构的高频结构仿真器HFSS分别可以仿真单板和系统的近场和远场辐射,以及在有限屏蔽环境下的EMI辐射。 仿真的有效性,取决于你对自己设计的EMI问题的考虑以及相应的软件设置。例如:单板上差模还是共模辐射,电流源还是电压源辐射等等。就我们的一些实践和经验,绝大多数的EMI问题都可以通过仿真分析解决,而且与实际测试比较,效果非常好。 16、听说Ansoft的EMC工具一般仿真1GHz以上频率的,我们板上频率最高的时钟线是主芯片到SDRAM的只有133MHz,其余大部分的频率都是KHz级别的。我们主要用Hyperlynx做的SI/PI设计,操作比较简单,但是现在整板的EMC依旧超标,影响画面质量。另外,你们的工具和Mentor PADS有接口吗? 答:Ansoft的工具可以仿真从直流到几十GHz以上频率的信号,只是相对其它工具而言,1GHz以上的有损传输线模型更加精确。据我所知,HyperLynx主要是做SI和crosstalk的仿真,以及一点单根信号线的EMI辐射分析,目前还没有PI分析的功能。影响单板的EMC的原因很多,解决信号完整性和串扰只是解决EMC的其中一方面,电源平面的噪声,去耦策略,屏蔽方式,电流分布路径等都会影响到EMC指标。这些都可以再ansoft的SIwave工具中,通过仿真进行考察。补充说明,ansoft的工具与Mentor PADS有接口。 17、请说明一下什么时候用分割底层来减少干扰,什么时候用地层分区来减少干扰。 答:分割底层,我还没听说过,什么意思?是否能举个例子。 地层分割,主要是为了提高干扰源和被干扰体之间的隔离度,如数模之间的隔离。当然分割也会带来诸如跨分割等信号完整性问题,利用ansoft的SIwave可以方便的检查任意点之间的隔离度。当然提高隔离度,还有其它办法,分层、去耦、单点连接、都是办法,具体应用的效果可以用软件仿真。 18、电容跨接两个不同的电源铜箔分区用作高频信号的回流路径,众所周知电容隔直流通交流,频率越高电流越流畅,我的疑惑是现今接入PCB中的电平大都是经过虑除交流的,那么如前所述电容通过的是什么呢?"交流的信号"吗? 答1:这个问题很有点玄妙,没见过很服人的解释。对于交流,理想的是,电源和地“短路”,然而实际上其间的阻抗不可能真的是 0 欧。你说的电容,容量不能太大,以体现出“低频一点接地,搞频多点接地”这一原则。这大概就是该电容的存在价值。经常遇到这样的情况:2个各自带有电源的部件连接后,产生了莫名其妙的干扰,用个瓷片电容跨在2个电源间,

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