毕业设计论文：PLL锁相环电路
锁相环PLL（PhaseLockedLoop）
锁相环PLL（PhaseLockedLoop）锁相环PLL目前我见到的所有芯片中都含有PLL模块，而且一直不知道如何利用PLL对晶振进行倍频的，这次利用维基百科好好的学习了下PLL 的原理。
1. 时钟与振荡电路在芯片中，最重要的就是时钟，时钟就像是心脏的脉冲，如果心脏停止了跳动，那人也就死亡了，对于芯片也一样。
了解了时钟的重要性，那时钟是怎么来的呢？时钟可以看成周期性的0与1信号变化，而这种周期性的变化可以看成振荡。
因此，振荡电路成为了时钟的来源。
振荡电路的形成可以分两类：1. 石英晶体的压电效应：电导致晶片的机械变形，而晶片两侧施加机械压力又会产生电，形成振荡。
它的谐振频率与晶片的切割方式、几何形状、尺寸有关，可以做得精确，因此其振荡电路可以获得很高的频率稳定度。
2. 电容Capacity的充电放电：能够存储电能，而充放电的电流方向是反的，形成振荡。
可通过电压等控制振荡电路的频率。
2. PLL与倍频由上面可以知道，晶振由于其频率的稳定性，一般作为系统的外部时钟源。
但是晶振的频率虽然稳定，但是频率无法做到很高（成本与工艺限制），因此芯片中高频时钟就需要一种叫做压控振荡器（Voltage Controlled Oscillator）的东西生成了（顾名思义，VCO 就是根据电压来调整输出频率的不同）。
可压控振荡器也有问题，其频率不够稳定，而且变化时很难快速稳定频率。
哇偶，看到这种现象是不是很熟悉？嘿嘿，这就是标准开环系统所出现的问题，解决办法就是接入反馈，使开环系统变成闭环系统，并且加入稳定的基准信号，与反馈比较，以便生成正确的控制。
PLL倍频电路因此，为了将频率锁定在一个固定的期望值，锁相环PLL出现了！一个锁相环PLL电路通常由以下模块组成：·鉴相鉴频器PFD（Phase Frequency Detector）：对输入的基准信号（来自频率稳定的晶振）和反馈回路的信号进行频率的比较，输出一个代表两者差异的信号·低通滤波器LPF（Low-Pass Filter）：将PFD中生成的差异信号的高频成分滤除，保留直流部分·压控振荡器VCO（Voltage Controlled Oscillator）：根据输入电压，输出对应频率的周期信号。
毕业设计论文：PLL锁相环电路
1摘 要随着通信及电子系统的飞速发展，促使集成锁相环和数字锁相环突飞猛进。
本次毕业设计的主要任务是，采用0.180.18μμm CMOS 工艺，设计实现一个基于改进的鉴频鉴相器，压控振荡器，环路滤波器的全集成的CMOS PLL 锁相环电路，设计重点为PLL 锁相环电路的版图设计，设计工具为Laker 。
本论文介绍了PLL 锁相环电路的基本原理以及其完整的版图设计结果。
本次设计表明，采用该方案实现的锁相环电路主要功能工作正常，初步达到设计要求。
求。
关键词：PLL 锁相环电路，鉴频鉴相器，压控振荡器，环路滤波器，版图设计，0.180.18μμm CMOS 工艺工艺AbstractWith the development of the communications and electronic systems, the technology of the integrated PLL and digital PLL develops rapidly.The main task of graduation is to design and realize a fully integrated CMOS PLL circuit which is based on an improved phase detector, VCO, loop filter using the 0.18μm CMOS technology 0.18μm CMOS technology. The design focus on the layout of the PLL circuit, and the . The design focus on the layout of the PLL circuit, and the design tools is the Laker.This paper introduces the basic principles of PLL phase locked loop circuit and its comprehensive layout results. This design shows that the program implemented by the main function of PLL circuit is working well, and it meets the design requirements.Key words:PLL phase locked loop circuits, popularly used phase detectors, discrimination, VCO loop filter, layout design, 0.18 μm CMOS process目 录 (11)摘 要.............................................................................................................................. (22)Abstract .......................................................................................................................... (44)第1章 绪论................................................................................................................ (44)1.1 锁相技术的发展.............................................................................................. (44)1.2 锁相环路的主要特性......................................................................................1.3 PLL锁相环的应用领域 (5)第2章 基于CMOS锁相环的电路设计 (7)2.1 锁相环的基本组成.......................................................................................... (77) (77)2.2 锁相环工作原理.............................................................................................. (88)2.3 鉴相器..............................................................................................................2.3.1 鉴频鉴相器（PFD） (9) (110)2.3.2 鉴频鉴相器设计.................................................................................. (110)2.4 环路滤波器....................................................................................................11 (11)2.5 压控振荡器....................................................................................................第3章 关于COMS锁相环的版图设计 (12) (112)3.1 电路设计........................................................................................................3.2 版图设计........................................................................................................ (112) (113)3.2.1 版图设计规则检查.............................................................................. (113)3.2.2 注意事项..............................................................................................3.3 锁相环的版图设计........................................................................................ (115) (117)第4章 结束语............................................................................................................ (118)参考文献...................................................................................................................... (119)致谢..............................................................................................................................第1章 绪论1.1锁相技术的发展 锁相技术起源于20世纪30年代，提出无线电调幅信号的锁相同步检波技术。
CMOS4046集成电路研究锁相环(PLL)的工作原理 毕业论文外文翻译
本实验要使用CMOS4046集成电路研究锁相环（PLL ）的工作原理。
电路包括两个不同的鉴相器和一个VCO 。
另外还有一个齐纳二极管参考电压源用在供电调节中，在解调器输出中有一个缓冲电路。
用户必须提供环路滤波器。
4046具有高输入阻抗和低输出阻抗，容易选择外围元件。
注意事项1. 本实验较为复杂，进入实验室之前，确认你已经弄懂了电路预计应该怎样工作。
对 某样东西还没有充分分析之前，不要去尝试制作它。
在开始实验之前要通读本文。
2. 在实验第一部分得到的数据要用来完成实验的其它任务。
所以要仔细对待这部分内容。
3. 小心操作4046芯片，CMOS 集成电路很容易损坏。
避免静电释放，使用10k Ω电阻 把信号发生器的输出耦合到PLL 。
在关掉4046供电电源之前先关闭信号发生器，或者从信号输入端给整个电路供电。
要避免将输出端对电源或对地短路，TTL 门电 路可以容忍这种误操作但CMOS 不能（要注意松散的导线）。
CMOS 输出也没有能力驱动电容负载。
VSS 应该接地，VDD 应该接5V ，引脚5应该接地（否则VCO 被禁止）。
1 VCO 工作原理阅读数据手册中的电路描述。
VCO 常数（0K 单位为弧度/秒-伏）是工作频率变化与输入电压（引脚9上）变化之比值。
测量出0K ，即，画出输出频率关于输入电压的曲线。
确认数据范围要覆盖5kHz 到50kHz 。
对于R1, R2 和C 的各种参数取值进行测量，确定0K 对于R1 ,R2 和C 是怎样的近似关系。
测量VCO 输出的上升和下降时间，研究电容性负载的影响。
2 无源环路滤波器无源环路滤波器位于鉴相器输出与VCO 输入之间。
此滤波器对鉴相器输出中的高次谐波进行衰减，并控制环路的强度。
通常用一个简单RC 滤波器就可以满足要求，这种设计能避免有源滤波器设计中固有的电平移动和输出限制的恼人问题。
但另外一方面，有源滤波器可以提供更优越的性能。
2.1 相位比较器首先来看一下4046的相位比较器II 的输出。
锁相环论文1
第1章绪论1.1 课题研究的目的意义本次进行研究的课题是全数字锁相环。
锁相环路是一种反馈电路，锁相环的英文全称是Phase-Locked Loop，简称PLL。
其作用是使得电路上的时钟和某一外部时钟的相位同步。
因锁相环可以实现输出信号频率对输入信号频率的自动跟踪，所以锁相环通常用于闭环跟踪电路。
锁相环在工作的过程中，当输出信号的频率与输入信号的频率相等时，输出电压与输入电压保持固定的相位差值，即输出电压与输入电压的相位被锁住，这就是锁相环名称的由来。
锁相环在通信、雷达、测量和自动化控制等领域应用极为广泛，随着电子技术向数字化方向发展，需要采用数字方式实现信号的锁相处理。
因此，对全数字锁相环的研究和应用得到了越来越多的关注。
传统的数字锁相环系统是希望通过采用具有低通特性的环路滤波器，获得稳定的振荡控制数据。
对于高阶全数字锁相环，其数字滤波器常常采用基于DSP 的运算电路。
这种结构的锁相环，当环路带宽很窄时，环路滤波器的实现将需要很大的电路量，这给专用集成电路的应用和片上系统SOC（system on chip）的设计带来一定困难。
另一种类型的全数字锁相环是采用脉冲序列低通滤波计数电路作为环路滤波器，如随机徘徊序列滤波器、先N 后M 序列滤波器等。
这些电路通过对鉴相模块产生的相位误差脉冲进行计数运算，获得可控振荡器模块的振荡控制参数。
1.2 国内外研究现状1.2.1 锁相环技术的产生背景锁相环路诞生于20世纪30年代。
在40年代开始在电视接收技术中得到广泛应用。
此后空间技术的发展又极大的促进了锁相技术的发展，现已广泛应用于电子技术的各个领域。
随着数字电路技术的发展，数字锁相环在调制解调、频率合成、FM 立体声解码、彩色副载波同步、图象处理等各个方面得到了广泛的应用。
数字锁相环不仅吸收了数字电路可靠性高、体积小、价格低等优点，还解决了模拟锁相环的直流零点漂移、器件饱和及易受电源和环境温度变化等缺点，此外还具有对离散样值的实时处理能力，已成为锁相技术发展的方向。
锁相环论文2
目录第1章绪论 (1)1.1锁相环（PLL）－全数字锁相环（ADPLL）的发展过程 (1)1.2锁相环（PLL） (1)1.2.1锁相环的发展及应用 (1)1.2.2锁相环的分类与特点 (2)1.2.3锁相环的优点 (3)1.3全数字锁相环的现状及发展 (3)1.4本论文的研究内容 (4)第2章全数字锁相环的开发系统 (5)2.1EDA技术简介 (5)2.1.1EDA的发展 (5)2.1.2EDA技术的主要内容 (5)2.1.3EDA技术的基本特征及特点 (5)2.1.4EDA设计工具 (6)2.2现场可编程门阵列（FPGA） (6)2.3硬件设计语言－VHDL (6)2.3.1VHDL语言简介 (6)2.3.2VHDL语言的特点 (7)2.4软件开发工具－MAX＋plus II (8)2.4.1MAX+PLUSⅡ概述 (8)2.4.2Max+plusⅡ功能简介 (9)2.4.3Max+plusⅡ设计流程 (12)2.5实验开发系统 (12)第3章设计总体规划 (14)3.1整体方案 (14)3.2关于全数字锁相环设计的几种方案 (14)3.3设计分工 (17)3.3.1模块划分 (17)第4章基于VHDL的全数字锁相环的设计 (19)4.1全数字锁相环的介绍 (19)4.2ADPLL结构及工作原理 (19)4.3全数字锁相环模块介绍 (20)4.4全数字锁相环的VHDL设计 (20)4.4.1全数字锁相环的基本结构框图 (20)4.4.2全数字锁相环各模块原理及子程序设计 (21)4.4.3总体模块、仿真及体统性能分析 (25)第5章结论与进一步研究的问题 (30)5.1主要结论-ADLL同步范围 (30)5.2进一步研究的问题 (31)5.2.1ADPLL的减小波纹技术 (31)5.2.2ADPLL的实际应用 (32)参考文献 (34)致谢 (35)附录A英文资料翻译 (36)附录B源程序代码 (52)第１章绪论1.1 锁相环（PLL）－全数字锁相环（ADPLL）的发展过程锁相环从30年代开始发展，1932年，De Bellescize实现了第一个PLL，这个法国工程师称该发明为“相关通信”（coherent conmmunication）。
带有PLL的频率锁定电路的设计
带有PLL的频率锁定电路的设计电子与电气工程是一门涵盖了广泛领域的学科，其中包含了许多重要的电路设计和应用。
在这篇文章中，我们将讨论一种常见的电路设计——带有PLL（Phase-Locked Loop，锁相环）的频率锁定电路。
频率锁定电路是一种电路设计，可用于将输入信号的频率与参考信号的频率同步。
它在许多应用中都起到了关键作用，比如无线通信、音频处理和数字信号处理等领域。
PLL是频率锁定电路中的核心部分，它由相位比较器、低通滤波器、电压控制振荡器（VCO）和分频器组成。
相位比较器用于比较输入信号和参考信号的相位差，并输出一个误差信号。
低通滤波器用于滤除误差信号中的高频噪声，以得到一个平滑的控制信号。
VCO根据控制信号的大小来调整输出信号的频率，以使其与参考信号同步。
分频器将VCO的输出信号分频，以获得一个反馈信号，用于与输入信号进行相位比较。
在设计带有PLL的频率锁定电路时，首先需要确定所需的锁定范围和精度。
锁定范围是指VCO能够调整的频率范围，而精度则是指VCO能够实现的频率调整的精确度。
根据应用的要求，选择合适的VCO和分频器以及设计适当的相位比较器和低通滤波器。
在实际设计中，还需要考虑电路的稳定性和抗干扰能力。
稳定性是指电路在长时间运行中能够保持锁定状态的能力，而抗干扰能力是指电路在面对外部干扰时能够保持稳定的能力。
为了提高稳定性和抗干扰能力，可以采用合适的滤波器和噪声抑制技术，并进行合理的电路布局和接地设计。
此外，还需要考虑电路的功耗和尺寸。
在一些应用中，功耗和尺寸是非常重要的因素。
为了降低功耗，可以采用低功耗的电路设计和优化的算法。
为了减小尺寸，可以采用集成电路和微小封装。
最后，还需要进行电路的仿真和调试。
通过使用电路仿真软件，可以对电路进行性能分析和优化。
在实际调试中，可以通过逐步调整电路参数和观察输出信号的变化来实现电路的最佳性能。
总之，带有PLL的频率锁定电路是电子与电气工程中一种重要的电路设计。
毕业设计(论文)-锁相环电路仿真模型的研究论文
摘要：锁相环（简称PLL）是一种反馈控制系统,也是闭环跟踪系统，其输出信号的频率跟踪输入信号的频率。
本课题主要研究的是有关锁相环电路仿真模型的研究方法，深入探讨了锁相环的组成和工作原理及在各种电路中的应用，通过研究仿真模型及对锁相环的特性的分析，使我进一步掌握了锁相环的原理及在实际工作中的应用。
对锁相环仿真，使用MATLAB来实现是方便快捷的。
本课题介绍了锁相环电路的分类、工作原理、应用现状；建立了仿真锁相环电路捕捉过程的MATLAB模型，并进行了仿真，比较了不同种类锁相环电路的捕捉时间；对锁相环电路各种性能指标如同步带、捕捉带进行了分析，比较了两种锁相环电路的性能；最后提出了锁相环电路的改进方法，并对改进后的环路进行了仿真分析。
关键词：锁相环；鉴相器；滤波器；振荡器；MATLAB仿真Research of phase-locked loop circuit simulation model AbstractThe phase-locked loop (i.e. PLL) is one kind of feedback control system, is also the closed loop tracking system, its output signal frequency track input signal frequency. What this topic main research is the related phase-locked loop circuit simulation model research technique, discussed the phase-locked loop each aspect and the phase-locked loop the composition and the principle of work in depth, By studying the simulation model and analysis of the characteristics of the PLL，I further understand that the principle of phase-locked loop and the application in practical work. For phase-locked loop simulation's realization, use MATLAB to realize is the convenience quickly. Analyzed various performance indicators such as timing belt and capturing belt of the PLL circuit, comparing the performance of two phase-locked loop circuit and proposed the improvement of phase-locked loop circuit, and simulation to the Improved loop circuit.Key words: PLL; phase; filters; oscillators; MATLAB simulation目录1引言............................................ 错误！未定义书签。
PLL(锁相环)电路原理及设计 [收藏]
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PLL(锁相环)电路原理及设计[收藏]PLL(锁相环)电路原理及设计在通信机等所使用的振荡电路，其所要求的频率范围要广，且频率的稳定度要高。
无论多好的LC振荡电路，其频率的稳定度，都无法与晶体振荡电路比较。
但是，晶体振荡器除了可以使用数字电路分频以外，其频率几乎无法改变。
如果采用PLL(锁相环)(相位锁栓回路，PhaseLockedLoop)技术，除了可以得到较广的振荡频率范围以外，其频率的稳定度也很高。
此一技术常使用于收音机，电视机的调谐电路上，以及CD唱盘上的电路。
一PLL(锁相环)电路的基本构成PLL(锁相环)电路的概要图1所示的为PLL(锁相环)电路的基本方块图。
此所使用的基准信号为稳定度很高的晶体振荡电路信号。
此一电路的中心为相位此较器。
相位比较器可以将基准信号与VCO (Voltage Controlled Oscillator……电压控制振荡器)的相位比较。
如果此两个信号之间有相位差存在时，便会产生相位误差信号输出。
(将VCO的振荡频率与基准频率比较，利用反馈电路的控制，使两者的频率为一致。
)利用此一误差信号，可以控制VCO的振荡频率，使VCO的相位与基准信号的相位(也即是频率)成为一致。
PLL(锁相环)可以使高频率振荡器的频率与基准频率的整数倍的频率相一致。
由于，基准振荡器大多为使用晶体振荡器，因此，高频率振荡器的频率稳定度可以与晶体振荡器相比美。
只要是基准频率的整数倍，便可以得到各种频率的输出。
从图1的PLL(锁相环)基本构成中，可以知道其是由VCO，相位比较器，基准频率振荡器，回路滤波器所构成。
在此，假设基准振荡器的频率为fr，VCO的频率为fo。
在此一电路中，假设frgt;fo时，也即是VC0的振荡频率fo比fr低时。
此时的相位比较器的输出PD 会如图2所示，产生正脉波信号，使VCO的振荡器频率提高。
相反地，如果frlt;fo时，会产生负脉波信号。
(此为利用脉波的边缘做二个信号的比较。
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摘要随着通信及电子系统的飞速发展，促使集成锁相环和数字锁相环突飞猛进。
本次毕业设计的主要任务是，采用0.18μm CMOS 工艺，设计实现一个基于改进的鉴频鉴相器，压控振荡器，环路滤波器的全集成的CMOS PLL 锁相环电路，设计重点为PLL 锁相环电路的版图设计，设计工具为Laker。
本论文介绍了PLL 锁相环电路的基本原理以及其完整的版图设计结果。
本次设计表明，采用该方案实现的锁相环电路主要功能工作正常，初步达到设计要求。
关键词：PLL 锁相环电路，鉴频鉴相器，压控振荡器，环路滤波器，版图设计，0.18μm CMOS 工艺AbstractWith the development of the communications and electronic systems, the technology of the integrated PLL and digital PLL develops rapidly.The main task of graduation is to design and realize a fully integrated CMOS PLL circuit which is based on an improved phase detector, VCO, loop filter using the 0.18 μ m CMOS technolog. yThe design focus on the layout of the PLL circuit, and the design tools is the Laker.This paper introduces the basic principles of PLL phase locked loop circuit and its comprehensive layout results. This design shows that the program implemented by the main function of PLL circuit is working well, and it meets the design requirements.Key words: PLL phase locked loop circuits, popularly used phase detectors, discrimination, VCO loop filter, layout design, 0.18μm CMOS process目录摘要 (1)Abstract (2)第1 章绪论 ................................................................ 4.. .1.1锁相技术的发展4...1.2锁相环路的主要特性...................................... 4..1.3PLL 锁相环的应用领域 .................................... 5..第2 章基于CMOS 锁相环的电路设计.............................. 7..2.1锁相环的基本组成........................................ 7..2.2锁相环工作原理7...2.3鉴相器8...2.3.1 .......................................................................................... 鉴频鉴相器（PFD）......................................... 9..2.3.2 ......................................................................................... 鉴频鉴相器设计1..02.4环路滤波器1..0.2.5压控振荡器1..1.第 3 章关于COMS 锁相环的版图设计 ............................................................... 1.. 23.1电路设计1..2.3.2版图设计1..2.3.2.1 ......................................................................................... 版图设计规则检查1..33.2.2 ......................................................................................... 注意事项1..3.3.3 锁相环的版图设计 ............................................................... 1.. 5第 4 章结束语 ............................................................... 1..7.参考文献 ............................................................... 1..8..致谢 ....................................................... 1..9..第 1 章绪论1.1 锁相技术的发展锁相技术起源于20 世纪30年代，提出无线电调幅信号的锁相同步检波技术。
锁相同步检波器要求锁相环路以输入的标准调幅波中，能输出准确的跟踪载波分量的等幅波而它们相位保持很小常数或零。
40 年代，电视技术得到迅速发展，电视接收机从行扫描振荡器输出中取出部分作反馈信号，和从同步分离器来的同步信号经鉴相器进行相位比较，得到相位误差信号经积分器得到控制信号，控制行扫描振荡器，实现同步扫描。
50~60 年代，随着空间技术的发展，前半期，由于锁相技术中的个别部件的制作费用仍然十分昂贵，所以在使用范围上仍然受到较大限制。
由维特毕研究了无噪声锁相环路非线性理论问题，并发表了相干通信原理。
后期开始相继研发出集成锁相环部件和单片集成锁相环路。
70 年代，由于半导体技术和集成电路技术的飞速发展，使锁相技术越来越广泛的应用于电子技术领域。
现今，锁相环路理论与研究日趋完善，应用范围遍及整个电子技术领域，随着通信及电子系统的飞速发展，促使集成锁相环和数字锁相环突飞猛进，现在品种齐全繁多，提高系统的工作稳定性、可靠性和小型化，目前仍朝着集成化、数字化、多用化的方向迅速发展。
1.2 锁相环路的主要特性锁相环路具有一些相当优良的功能，且成本低、使用方便，因而它已成为电子技术领域中一种相当有用的技术手段，获得了越来越广泛的应用，并且随着PLL 锁相技术的不断发展，其性能也在不断地提高，归结起来，锁相环路引人注目的优良特性有如下四个：(1)锁定特性环路对输入的固定频率锁定后，两信号的频差为零，只有一个很小的稳态剩余相差。
这是一般自动频率微调做不到的，正是由于锁相环路具有可以实现理想的频率锁定这一特性，使它在自动频率控制与频率合成技术等方面获得广泛的应用。
(2)载波跟踪特性无论输入锁相环路的信号是已调制或未调制的，只要信号中包含有载波频率成分，就可将环路设计成一个窄带跟踪滤波器，跟踪输入信号载波成分的频率与相位变化，环路输出信号就是需要提取(或复制)的载波信号。
这就是环路的载波跟踪特性。
(3)调制跟踪特性只要让环路有适当宽度的低频通带，压控振荡器输出信号的频率与相位就能跟踪输入调频或调相信号的变化，即得到输入角度调制信号的复制品，这就是调制跟踪特性。
利用环路的调制跟踪特性，可以制成角调制信号的调制器与解调器。
(4)低门限特性锁相环路不像一般非线性器件那样，门限取决于输入信噪比，而是由环路信噪比决定的。
一般环路的通频带总比环路输入端的前置通频带窄得多，因而环路信噪比明显高于输入信噪比，环路能在低输入信噪比条件下工作，即具有低门限的优良特性。
这样，只要将环路设计成窄带，就可把淹没在噪声中的微弱信号提取出来。
这样的环路用于解调调频、调相信号时，可取得门限的扩展的效果；用于解调数字调制信号时，可使误码率降低。
1.3 PLL 锁相环的应用领域由于锁相环路有上述种种优良的特性，再加上集成锁相环的出现，使锁相环路在电子技术等各个领域获得了广泛的应用，下面对锁相环在不同领域中的应用情况作一简单的概述。
(1)在通信中的应用主要用于短波，超短波发、收信机中的主振与本振源，有线通信中的载波供给，微波卫星通信中的微波固态源与微波功率放大器，数字通信中的载波同步、码元同步和网同步，以及上述各种通信中的调制与解调，自动频率微调等。
(2)在导航设备中的应用主要用于飞机、轮船和舰艇的导航定位监视系统中。
(3)在空间技术中的应用主要用于卫星、导弹、火箭和飞船的测速定轨、测距与遥控数据获取。
(4)在电视及高保真设备中的应用主要用于电视机同步、门限扩展解调、色差副载波提取与色差信号的同步检波，全国电视台的锁相连播同步毕业设计，高保真设备中的立体声多路解码( MPX )、频率合成式调谐器、四声道解调器( CD-4)及走带电机速度控制。
(5)在计算机中的应用主要用于各种钟频信号的供给、磁盘转速同步与控制等。
(6)在测量仪表中的应用主要用于频率合成器、自锁信号发生器、相位振幅仪(矢量电压表、微波网络分析仪)、相位噪声测试仪、频谱分析仪、锁相计数器、阻抗测试仪、电平振荡器、频偏仪、微波固态源、微波功率放大器以及微波相位调整器等仪表中。
第 2 章基于CMOS 锁相环的电路设计2.1 锁相环的基本组成锁相环路是一种反馈控制电路，简称锁相环（PLL ）。
锁相环的特点是：利用外部输入的参考信号控制环路内部振荡信号的频率和相位。
因锁相环可以实现输出信号频率对输入信号频率的自动跟踪，所以锁相环通常用于闭环跟踪电路。
锁相环在工作的过程中，当输出信号的频率与输入信号的频率相等时，输出电压与输入电压保持固定的相位差值，即输出电压与输入电压的相位被锁住，这就是锁相环名称的由来。
锁相环通常由鉴相器（PD）、环路滤波器（LF）和压控振荡器（VCO ）三部分组成，锁相环组成的原理框图如图2.1 所示。
图 2.1 锁相环组成的原理框图2.2 锁相环工作原理锁相环其作用是使得电路上的时钟和某一外部时钟的相位同步。
因锁相环可以实现输出信号频率对输入信号频率的自动跟踪，所以锁相环通常用于闭环跟踪电路。