DDS直接数字合成信号源
dds模块合成信号原理
dds模块合成信号原理DDS模块合成信号原理什么是DDS模块？DDS（Direct Digital Synthesis，直接数字合成）模块是一种常用于生成高精度、稳定的信号的电路。
它可以根据特定的算法和输入参数生成一个数字信号，然后将该数字信号转换为模拟信号输出。
DDS模块的基本原理1. 相位累加器DDS模块的核心是相位累加器，它可以根据输入的频率控制字（frequency tuning word）逐步累加一个相位值。
相位累加器可以看作一个简单的计数器，每次累加一个固定的量。
2. 周期寄存器周期寄存器用于存储一个固定的值，也就是相位累加器的最大值。
当相位累加器累加到周期寄存器的值时，相位累加器会重新从0开始累加。
3. 数字频率控制字数字频率控制字是DDS模块的输入参数之一，它指定了每个累加周期的相位增量的大小，也就是控制了输出信号的频率。
较大的数字频率控制字会使得相位累加器更快地累加，从而产生更高频率的信号。
4. 数字幅度控制字数字幅度控制字用于控制输出信号的幅度。
通过改变该参数的值，可以改变输出信号的振幅大小。
较大的数字幅度控制字会使得输出信号的振幅增大。
DDS模块的工作流程1.初始化DDS模块，设置初始参数，如数字频率控制字和数字幅度控制字的值。
2.DDS模块将数字频率控制字送入相位累加器。
3.相位累加器根据数字频率控制字的值每次累加一个固定的量，直到累加到周期寄存器的值。
4.当相位累加器累加到周期寄存器的值时，它会重新从0开始累加，重新开始一个新的累加周期。
5.根据相位累加器的当前值，生成一个数字信号。
6.数字信号经过数模转换器，被转换为模拟信号输出。
DDS模块的优势•高精度：DDS模块可以通过调整数字频率控制字的值，实现高精度的频率控制。
•稳定性：DDS模块的输出信号非常稳定，可以避免传统信号源频率漂移的问题。
•灵活性：DDS模块可以根据需要动态调整输出信号的频率和幅度，非常适用于频率可变的应用场景。
DDS信号源实验(通信基础实验)
实验报告单实验名称：DDS信号源实验实验项目：实验目的：1．了解DDS信号源的组成及工作原理；2．掌握DDS信号源使用方法；3．掌握DDS信号源各种输出信号的测试；4．配合示波器完成系统测试。
实验器材：1．DDS信号源2. 100M双踪示波器1台实验原理：1.DDS信号产生原理直接数字频率合成(DDS—Digital Direct Frequency Synthesis)，是一种全数字化的频率合成器，由相位累加器、波形ROM、D/A转换器和低通滤波器构成。
时钟频率给定后，输出信号的频率取决于频率控制字，频率分辨率取决于累加器位数，相位分辨率取决于ROM 的地址线位数，幅度量化噪声取决于ROM的数据位字长和D/A转换器位数。
图1-1 DDS信号产生原理DDS信号源模块硬件上由cortex-m3内核的ARM芯片(STM32)和外围电路构成。
在该模块中，我们用到STM32芯片的一路AD采集（对应插孔调制输入）和两路DAC输出（分别对应插孔P03.P04）。
抽样脉冲形成电路（P09）信号由STM32时钟配置PWM模式输出，调幅、调频信号通过向STM32写入相应的采样点数组，由时钟触发两路DAC同步循环分别输出其已调信号与载波信号。
对于外加信号的AM调制，由STM32的AD对外加音频信号进行采样，在时钟触发下当前采样值与载波信号数组的相应值进行相应算法处理，并将该值保存输出到DAC，然后循环进行这个过程，就实现了对外部音频信号的AM调制。
实验箱的DDS信号源能够输出抽样脉冲（PWM）、正弦波、三角波、方波、扫频信号、调幅波（AM）、双边带（DSB）、调频波（FM）及对外部输入信号进行AM调制输出。
2.DDS信号源使用及信号生成表DDS信号源主要包含以下几个部分：LCD：显示输出信号的频率。
调制输入：外部调制信号输入铆孔（注意铆孔下面标注的箭头方向。
若箭头背离铆孔，说明此铆孔点为信号输出孔；若箭头指向铆孔，说明此铆孔点为信号输入孔）。
dds信号源课程设计
dds信号源课程设计一、课程目标知识目标：1. 学生能理解DDS（直接数字频率合成器）信号源的基本原理，掌握其工作流程。
2. 学生能掌握DDS信号源的关键参数，如频率、相位、幅度等，并了解它们之间的关系。
3. 学生能解释DDS信号源在电子技术中的应用，如信号发生、通信系统等。
技能目标：1. 学生能够操作DDS信号源硬件，进行基本的信号生成与调制。
2. 学生能够利用相关软件对DDS信号源进行编程控制，实现特定信号的输出。
3. 学生能够通过实验，分析DDS信号源的性能，提出优化方案。
情感态度价值观目标：1. 学生对电子技术产生兴趣，培养探索精神和创新意识。
2. 学生在实验和讨论过程中，培养团队合作精神和沟通能力。
3. 学生认识到DDS信号源在科技发展中的重要作用，增强社会责任感和使命感。
课程性质：本课程为电子技术实践课程，结合理论讲解和实验操作，提高学生对DDS信号源的理解和应用。
学生特点：学生为高中年级，具备一定的电子技术基础，对实验操作感兴趣，但需引导深入理解理论知识。
教学要求：注重理论与实践相结合，鼓励学生动手实践，培养解决实际问题的能力。
在教学过程中，关注学生个体差异，提供针对性的指导。
通过课程学习，使学生能够将所学知识应用于实际电子技术领域。
二、教学内容1. DDS信号源原理介绍：- 数字频率合成技术背景- DDS信号源基本工作原理- 频率、相位、幅度控制原理2. DDS信号源硬件结构：- 主要组成部分及其功能- 常见DDS芯片介绍- 硬件连接与操作方法3. DDS信号源编程控制：- 编程接口与协议- 常用编程语言及工具- 实例演示：信号生成与调制4. DDS信号源应用案例分析：- 信号发生器- 通信系统- 频率合成器5. 实验教学：- 实验一：DDS信号源基本操作- 实验二：信号生成与调制- 实验三：性能分析与优化6. 教学进度安排：- 第一周：原理介绍与硬件结构学习- 第二周：编程控制与实例演示- 第三周：应用案例分析- 第四周：实验教学与实践教学内容关联教材章节：- 第一章：电子技术基础- 第二章：数字频率合成技术- 第三章：DDS信号源硬件与编程- 第四章：实验与实践三、教学方法本课程采用以下多样化的教学方法，以激发学生的学习兴趣和主动性，提高教学效果：1. 讲授法：- 对于DDS信号源的基本原理、硬件结构、编程控制等理论知识，采用讲授法进行系统讲解，使学生掌握必要的基础知识。
直接数字频率合成器(DDS PLL).
频率为
f out
fc M N 2
0 M 2N 1
频率控制字与输出信号频率和参考时钟频率之间的关系为：
M ( f out 2 N ) f c
其中N是相位累加器的字长。频率控制字与输出信号频率成正比。由取样定理，所产生 的信号频率不能超过时钟频率的一半，在实际运用中，为了保证信号的输出质量，输出 频率不要高于时钟频率的33%,以避免混叠或谐波落入有用输出频带内。 在图中，相位累加器输出位并不全部加到查询表，而要截断。相位截断减小了查询表长 度，但并不影响频率分辨率，对最终输出仅增加一个很小的相位噪声。DAC分辨率一器的分辨率，DDS的最小分辨率为
f min
fc 2N
这个增量也就是最低的合成频率。最高的合成频率受奈奎斯特抽样定理的限制，所 以有
f 0 max
fc 2
与PLL不同,DDS的输出频率可以瞬时地改变,即可以实现跳频，这是DDS的一个突 出优点，用于扫频测量和数字通讯中，十分方便。
续混频 分频,获得很小的频率步进,电路复杂,不易集成
– 直接数字合成法------DDS
VCO--用电压(流)控制振荡频率
改变C
改变R
改变L
改变电流
频率综合技术概述
• 开环VCO的频率稳定度和频率精度较低 • PLL使输出频率的稳定度和精度,接近参考 振荡源(通常用晶振)
PLL框图如下:
PLL的构成
DDS
这种技术的实现依赖于高速数字电路的产生，目前， 其工作速度主要受D/A变换器的限制。利用正弦信号的 相位与时间呈线性关系的特性，通过查表的方式得到信 号的瞬时幅值，从而实现频率合成。 DDS具有超宽的相对宽带，超高的捷变速率，超细 的分辨率以及相位的连续性，可编程全数字化，以及可 方便实现各种调制等优越性能。 但存在杂散大的缺点，限于数字电路的工作速度, DDS的频率上限目前还只能达到数百兆,限制了在某些 领域的应用。
DDS信号源设计原理
DDS信号源设计原理DDS（Direct Digital Synthesis，直接数字合成）是一种通过数字方式生成频率可调的信号的技术。
它主要由数字频率合成器（NCO）、数字控制的相位发生器和数字滤波器组成。
DDS信号源的设计原理涉及到数字信号处理、频率合成、相位发生和滤波等方面。
首先，DDS信号源的核心是数字频率合成器（NCO），它可以生成具有可调频率和可编程幅度的周期性信号。
NCO通过将一个参考时钟的频率分频得到一个相对稳定的时钟信号，并使用累加器来计算相位增量，然后通过查表的方式生成所需频率的正弦（或余弦）波形。
由于NCO的频率可以通过改变相位增量来实现，因此可以非常方便地实现频率的可编程性。
其次，DDS信号源在频率合成的过程中，利用相位发生器来实现频率可调。
相位发生器的作用是将相位增量乘以一个系数（在一定精度下实现乘法可以采用简化的移位和累加操作），得到每个时刻的相位值，并利用相位值查询三角函数表得到对应的幅度值。
通过改变相位增量和系数，可以实现对频率的精确控制。
此外，DDS信号源还采用数字滤波器来去除合成信号中的高频成分和噪声。
由于NCO合成的信号是采样间隔上是离散的，因此会引入非线性失真和混频等问题，这些问题都会导致合成信号中存在高频成分。
数字滤波器可以通过差分方程或频域滤波器的方式实现，将合成信号的频谱进行滤波，剔除不需要的高频成分和噪声。
总的来说，DDS信号源的设计原理可以归结为以下几个步骤：1）使用NCO生成参考时钟的分频时钟和相位增量；2）采用相位发生器将相位增量和系数相乘得到相位值；3）查表得到对应的幅度值；4）利用数字滤波器对合成信号进行滤波，去除高频成分和噪声；5）输出滤波后的合成信号。
DDS信号源具有以下优点：1）频率可调范围广；2）分辨率高，频率精度高；3）相位连续性好，相位精度高；4）幅度可编程；5）输出信号稳定性好；6）具有快速切换、变频和调制的能力等。
因此，在许多领域，例如无线通信、雷达测距、音频信号处理等方面都广泛应用了DDS信号源技术。
射频dds直接数字频率合成芯片
射频dds直接数字频率合成芯片
射频DDS（直接数字频率合成）芯片是一种集成电路芯片，它
可以通过数字信号直接合成射频信号。
这种芯片通常由数字控制器、相位累加器、数字-模拟转换器（DAC）、滤波器和射频输出级组成。
射频DDS芯片的工作原理是利用数字信号直接控制相位累加器，从
而实现射频信号的合成。
相位累加器会根据输入的数字控制信号累
加相位，然后经过数字-模拟转换器转换成模拟信号，再经过滤波器
进行滤波，最终输出到射频端口。
射频DDS芯片具有很高的频率分辨率和频率调制速度，能够实
现快速、精确的频率合成。
它还具有灵活的调制方式，可以通过改
变输入的数字控制信号来实现频率、相位和幅度的调制。
这种灵活
性使得射频DDS芯片在通信、雷达、无线电等领域有着广泛的应用。
在通信系统中，射频DDS芯片可以用于频率合成、调制解调、
信号发生和信号处理等方面。
在雷达系统中，它可以用于频率多普
勒处理、脉冲压缩和信号发生等方面。
在无线电设备中，射频DDS
芯片可以用于频率合成、频率调制、频谱分析和信号发生等方面。
总的来说，射频DDS芯片作为一种先进的集成电路芯片，具有
高性能、灵活性和广泛的应用前景，对于现代通信、雷达和无线电系统的发展具有重要意义。
直接数字频率合成技术DDS
幅
位
度
码
码
数模变换器 DAC
时 钟
低通滤波器 LPF 输出
图3-11 相位/幅度变换装置
假设DAC的输入幅度码是四位，则它的输出幅度与输 入幅度码之间的关系是按线性变化的，如表3-1所示。
二进制幅度码 0000 0001 0010 0011 0100 0101 0110 0111
表 3-1
十进制幅度 二进制幅度码
0.1875
0 +1.1875
续表 3 - 4
8 1000 17π/16 -0.1951 0011 0.1875 1 9 1001 19π/16 - 0.5556 1001 0.5625 1 10 1010 21π/16 - 0.8316 1101 0.8125 1 11 1011 23π/16 -0.9808 1111 0.9375 1 12 1100 25π/16 -0.9808 1111 0.9375 1 13 1101 27π/16 -0.8316 1101 0.8125 1 14 1110 29π/16 -0.5556 1001 0.5625 1 15 1111 31π/16 -0.1951 0011 0.8175 1
② 将模2π的累加相位变换成相应的正弦函数值的幅度， 这里幅度可先用代码表示，这可以用一只读存储器ROM来 存储一个正弦函数表的幅值代码；
③ 用幅度代码变换成模拟电压，这可由数模变换器 DAC来完成；
④ 相位累加器输出的累加相位在两次采样的间隔时间 内是保持的，最终从DAC输出的电压是经保持的阶梯波。
2. 相位与幅度的变换
累加器输出的相位码，需先经过一个相位码/幅度码变换 装置之后，再经数/模变换生成阶梯波，最后通过低通滤波 器才能得到所需的模拟电压。
DDS信号源设计
DDS信号源设计DDS（Direct Digital Synthesis，直接数字合成）是一种基于数字技术实现信号合成的方法，广泛应用于通信、雷达、测量和控制系统中。
DDS信号源设计的目标是生成高品质、稳定且具有可编程功能的信号。
本文将详细介绍DDS信号源的设计原理、主要组成部分以及相关技术要点。
一、DDS信号源设计原理1.相位累积器：DDS信号源的核心是相位累积器，用于实现信号的频率合成。
相位累积器接收一个时钟信号作为输入，并根据输入的控制字生成相位累积值，然后将相位累积值转换为数字信号输出。
2.频率控制字：频率控制字是用来控制相位累积器累积的速度，进而控制输出信号的频率。
频率控制字由用户通过编程设置，可以实现任意精度和任意频率的信号输出。
3.数字到模拟转换：DDS信号源的输出为数字信号，需要通过数字到模拟转换器（DAC）将其转换为模拟信号。
DAC将数字信号转换为相应的模拟电压或电流输出，用于驱动后续的放大器等模拟电路。
4.控制接口：DDS信号源通常需要提供用户友好的控制接口，以便用户可以方便地设置信号的频率、幅度、相位和波形等参数。
控制接口可以通过面板按键、旋钮，或者串行通信接口（例如SPI、I2C）等方式实现。
二、DDS信号源主要组成部分1.时钟源：时钟源为DDS信号源提供稳定的时钟信号，它的稳定性直接影响到DDS信号源的频率稳定性和相位噪声。
常用的时钟源包括晶振、稳压振荡器等，需要保证时钟源具有高稳定性和低噪声特性。
2.相位累积器：相位累积器根据时钟信号和频率控制字生成相位累积值，并将其转换为数字信号输出。
相位累积器的设计要点包括相位累积器的精度（通常由位数决定）、相位累积速率（由相位累积器的时钟频率和频率控制字决定）等。
3.频率控制字存储器：频率控制字存储器用于存储用户设置的频率控制字，可以是单个存储器芯片，也可以是集成在控制接口芯片中。
频率控制字存储器的设计要点包括存储器位宽、存储容量以及读写速度等。
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数码显示单元
采用了五个共阴极数码管作为显示单元。 因为当ＲＡＭ和Ｄ／Ａ被使用时，所有ＬＥＤ灯均被 禁用。由于实验底板上已用三片 GAL22V10D完成了所有数码管的译码功能， 所以设计中不需要对数码管另行做译码的 工作。而当RAM被使用时，显示方式为4位 2进制数控制显示数据、3位2进制数控制显 示位数的扫描显示。采用高速时钟进行扫 描显示
其他信号处理
port1引脚始终置为高阻态，确保单片机p1口上 的键盘电路不受影响。 port0引脚在改变DA的B通道的值，即输入引脚 mcu_sel_da='1'时，输出m7，即经过换算的幅度值 数据；其他时候始终置为高阻态。 ram_rd信号在总线控制权由FPGA掌握而且DA 的通道为A，即bus_ctrl='0'和mcu_sel_da='0'时，输 出'0'，即ram保持在读状态；其他时候始终与单片 机的rd信号相连，即输出mcu_rd的值。
系统总线
在实验箱上是单片机的P0口和P2口 与FPGA、D/A及RAM均连接在一起，必须 采取措施防止在系统运行时出现的总线冲 突。。可采用P3.0口对总线进行控制，P3.1 口选择D/A的通道。
相位累加器参数设定
相位累加器的位数定为２１位。输入频率采 用实验板上标准晶振，频率为１１．０５９２ＭＨｚ，根 据任务书上最小频率分辨率为１Ｈｚ的要求，则 １１．０５９２ＭＨｚ／（ｄｉｖ＊２Ｎ）＝１Ｈｚ 其中ｄｉｖ为将１１．０５９２ＭＨｚ的时钟分频的数值， Ｎ为相位累加器的位数。当ｄｉｖ＝２１，Ｎ＝１９时 １１．０５９２ＭＨｚ／（ｄｉｖ＊２Ｎ）＝１．００４５Ｈｚ 用相位累加器的高１５位作为ＲＡＭ的地址线
结论
l DDS输出信号的频率主要取决于频率控制字M l 相位累加器字长N决定DDS的频率分辨率 l 当M增大时， fout可以不断地提高，但根据采样
定理，最高输出频率不得大于fc/2 l 工作输出频率达40％ fc时，输出波形的相位抖 动就很大 l 实际工作时输出频率小于fc/3较为合适。
设计方案一
单片机写FPGA内寄存器模块
８０５１系列单片机的寻址范围是２ １６，因此 根据系统方案中地址的分配，把波形参数 以及显示数据写入FPGA内各个寄存器。 mcu_wr触发该进程，当mcu_wr为下降沿 时，如果port2_7和bus_ctrl都为'1'，根据 low_address的低３位地址进行写入操作，也 就是地址为'８００0h'时，port0引脚上的数据 给m0寄存器，m０存储显示数据的高位，以 此类推'８００７h'时port0引脚上的数据给m7。
分频模块
将输入的时钟频率进行分频，根据系 统方案中的计算，实验板上的clk1设定 为１１．06MHz，将其进行２１分频得到相位 累 加 器 的 时 钟 phaseclk， 频 率 为 ５２６.7KHz；将１MHz的时钟５０分频得到 数码管扫描时钟segclk。
锁存单片机低位地址模块
将单片机写操作时的低位地址进行锁存。 在单片机中的p0口是地址数据复用口，在 读写操作时需要有一个８位的地址锁存器根 据ALE信号进行锁存操作，当mcu_ale为 的下降沿时将port0引脚的数据送到寄存器 low_address
系统原理框图
显示单元 ＦＰＧＡ ＦＬＥＸ１０Ｋ１０ 单片机 ８９Ｃ５１ 键盘输入
波形存储 ＲＡＭ６２２５６
７５２８ Ａ通道波形输出 Ｂ通道幅度控制
输出 低通滤波
键盘控制单元
由于系统要求功能较多，若不加处理的利 用单片机Ｐ１口扩展键盘，则很有可能出现键 盘满足不了显示要求的情况，因此必须有效 的利用键盘。而且实验板本身在其设计中， 当ＲＡＭ及Ｄ／Ａ被使用时，Ｋ０～ＫＦ键盘均被禁用， 所以设计中，我们采用了实验底板上一个已 经与单片机的Ｐ１口相连的４×４的小键盘，通 过输入的数字长度、范围和确认键来区别发 送的信息。同时利用延时来解决键盘消抖动 问题。
FPGA部分原理框图
系统时钟
相位分频器
累加值
显示分频器
RAM地址
单 片 机
单 片 机 接 口
相位累加器
显示值
动态显示
总 线 仲 裁 器
RAM数据
控制电路
RAM，D/A控制信号
控制寄存器定义
名称 ｍ０ ｍ１ ｍ２ ｍ３ ｍ４ ｍ５ ｍ６ ｍ７ 地址 ８０００ ８００１ ８００２ ８００３ ８００４ ８００５ ８００６ ８００７ 功能 数码管第５位 数码管第４位 数码管第３位 数码管第２位 数码管第１位 相位累加值的低８位 相位累加值的高８位 输出波形的幅度值
DDS工作原理
奈奎斯特抽样定理： 任意一个频率带宽为F的连续信号f(t),d都 可以用一系列离散取样值f(t), f(t+T), f(t+2T)… .. f(t+nT)来表示。 只要取样点的时间间隔Ｔ小于１／２Ｆ，表示 就是完整的，包含了连续信号ｆ（ｔ）的全部信息
ＤＤＳ工作原理
相位取样地址 离散相位的幅度序列 c b a d
设计方案四
用ＦＰＧＡ实现的ＤＤＦＳ直接数字频率合成 利用可编程逻辑器件ＦＰＧＡ实现复杂的逻辑 控制，用存储器存储波形的量化数据，ＦＰＧＡ 按照不同频率要求以频率控制字的步进对相 位增量进行累加，以累加值作为地址码去读 取存储器相应地址单元里的量化数据，经Ｄ／Ａ 转换和幅值控制，再通过低通滤波器可得所 需波形。
l 软件部分
FPGA要求用原理图或VHDL设计实现 MCU要求用C51实现。 l 设计时要充分考虑系统的可兼容性及可扩展 性。
ＤＤＳ系统概述
DDS技术一般都是以数字控制振荡器 NCO（Numerically Controlled Oscillator） 为核心，来产生频率可调的sin正弦波的波 形的数字量表示的幅值。这些数字量表示 的波形幅值再通过一个DAC（DigitalAnalog Converter），得到正弦波的模拟量 波形。它是在时域中进行频率合成，从而 能够对输出频率进行快速而且精确的控制， 并且这种控制全部都是数字控制，因此可 以提供非常高的频率精度。
N位相位寄存器
输出序列
参数选择原理
DDS技术在本质上，是实现了一个数字分频器 的功能，它的频率精度是由相位累加器或者是频率 控制字M的比特数决定的，即输入的参考频率除以 2M就决定了DDS所能够实现的频率精度。输出信 号波形的频率及频率分辨率可以表示如下： fout=Mfc/2N fmin=fc/2N fout为输出信号频率； fmin为输出信号分辨率；M 为频率控制字；Ｎ为相位累加器字长；fc为标准参考 频率位分辨率的数字-模拟转换 器。该D/A转换器工作频率较高，在5V电源下工 作时其建立时间只有100nS，传输延时时间是80nS， 完全可以满足本次设计的要求，其控制信号主要 包 括 ： 片 选 CS， 低 电 平 有 效 ； D/A 选 择 端 DACA/DACB，低电平位DACA，高电平位DACB； 数据写入使能WR，低电平有效。通道A作为整个 波形的输出，通道B的输出作为A通道的基准电平， 这样可以实现输出波形幅度的数字控制。在实际 电路连接时，将7528的20脚OUTB与4脚VREF A 相连，VREFB接＋5V，这样就可以实现所需要的 功能了。
设计方案二
采用传统的直接频率合成技术 这种方案能实现快速频率变换，具有低 相位噪声以及所有方案中最高的工作频率。 但由于采用大量的倍分频、混频和滤波环 节，导致其结构复杂、体积庞大、成本高， 且容易产生过多的杂散分量。故此方案也 不适于在本次设计中采用。
设计方案三
用单片机实现的ＤＤＦＳ直接数字频率合成 利用单片机实现逻辑控制和累加器， 用存储器存储波形的量化数据，单片机 按照不同频率要求以频率控制字的步进 对相位增量进行累加，以累加值作为地 址码去读取存储器相应地址单元里的量 化数据，经Ｄ／Ａ转换和幅值控制，再通过 低通滤波器可得所需波形。此方案系统 简单，但受单片机运算速度的影响，频 率无法做高，同时易受干扰
相位累加器模块
这是整个dds系统的核心，由phaseclk或者 bus_ctrl触发。触发后，如果bus_ctrl为'1'， phase_add赋值'0'，否则在phaseclk的上升沿， 进行phase_add=phase_add+dphase的加法操 作
数码管扫描显示模块
由segclk触发，在segclk的上升沿，信号 ssegport进行累加操作，当达到'100'时就赋值 '000'。segport的输出值就是ssegport，这样 在segclk的上升沿segport轮流扫描5个数码管。 同时根据ssegport的值将m0到m4中的值分别 送到segnum引脚上。
综合课程设计课题
— — DDS直接数字合成信号源
技术指标要求
l 产生信号类型：
正弦波、方波、三角波。 l 输出信号频率范围： 1Hz～20KHz 步进1Hz 频率偏移小于5％ l 输出信号幅度范围： 0.1V～5V， 步进0.1V， 幅度误差小于10％。
工作要求
l 硬件部分
要求用MCU和FPGA来实现