74ls192中文资料
SN74LS192中文资料
Copyright © 1988, Texas Instruments Incorporated PRODUCTION DATA information is current as of publication date.Products conform to specifications per the terms of Texas Instrumentsstandard warranty. Production processing does not necessarily includetesting of all parameters.PACKAGING INFORMATIONOrderable Device Status(1)PackageType PackageDrawingPins PackageQtyEco Plan(2)Lead/Ball Finish MSL Peak Temp(3)5962-9558401QEA ACTIVE CDIP J161TBD Call TI Level-NC-NC-NC 5962-9558401QFA ACTIVE CFP W161TBD Call TI Level-NC-NC-NC 5962-9558401QFA ACTIVE CFP W161TBD Call TI Level-NC-NC-NC 76006012A ACTIVE LCCC FK201TBD Call TI Level-NC-NC-NC 76006012A ACTIVE LCCC FK201TBD Call TI Level-NC-NC-NC 7600601EA ACTIVE CDIP J161TBD Call TI Level-NC-NC-NC 7600601EA ACTIVE CDIP J161TBD Call TI Level-NC-NC-NC 7600601FA ACTIVE CFP W161TBD Call TI Level-NC-NC-NC 7600601FA ACTIVE CFP W161TBD Call TI Level-NC-NC-NCJM38510/01309BEA OBSOLETE CDIP J16TBD Call TI Call TIJM38510/01309BEA OBSOLETE CDIP J16TBD Call TI Call TIJM38510/31508B2A ACTIVE LCCC FK201TBD Call TI Level-NC-NC-NCJM38510/31508B2A ACTIVE LCCC FK201TBD Call TI Level-NC-NC-NCJM38510/31508BEA ACTIVE CDIP J161TBD Call TI Level-NC-NC-NCJM38510/31508BEA ACTIVE CDIP J161TBD Call TI Level-NC-NC-NCJM38510/31508BFA ACTIVE CFP W161TBD Call TI Level-NC-NC-NCJM38510/31508BFA ACTIVE CFP W161TBD Call TI Level-NC-NC-NCJM38510/31508SEA ACTIVE CDIP J161TBD Call TI Level-NC-NC-NCJM38510/31508SEA ACTIVE CDIP J161TBD Call TI Level-NC-NC-NCJM38510/31508SFA ACTIVE CFP W161TBD Call TI Level-NC-NC-NCJM38510/31508SFA ACTIVE CFP W161TBD Call TI Level-NC-NC-NC SN54192J ACTIVE CDIP J161TBD Call TI Level-NC-NC-NC SN54192J ACTIVE CDIP J161TBD Call TI Level-NC-NC-NC SN54193J OBSOLETE CDIP J16TBD Call TI Call TISN54193J OBSOLETE CDIP J16TBD Call TI Call TISN54LS193J ACTIVE CDIP J161TBD Call TI Level-NC-NC-NC SN54LS193J ACTIVE CDIP J161TBD Call TI Level-NC-NC-NC SN74192N OBSOLETE PDIP N16TBD Call TI Call TISN74192N OBSOLETE PDIP N16TBD Call TI Call TISN74193N OBSOLETE PDIP N16TBD Call TI Call TISN74193N OBSOLETE PDIP N16TBD Call TI Call TISN74193N3OBSOLETE PDIP N16TBD Call TI Call TISN74193N3OBSOLETE PDIP N16TBD Call TI Call TISN74LS192D OBSOLETE SOIC D16TBD Call TI Call TISN74LS192D OBSOLETE SOIC D16TBD Call TI Call TISN74LS192N OBSOLETE PDIP N16TBD Call TI Call TISN74LS192N OBSOLETE PDIP N16TBD Call TI Call TISN74LS193D ACTIVE SOIC D1640Green(RoHS&no Sb/Br)CU NIPDAU Level-2-260C-1YEARSN74LS193D ACTIVE SOIC D1640Green(RoHS&no Sb/Br)CU NIPDAU Level-2-260C-1YEARSN74LS193DE4ACTIVE SOIC D1640Green(RoHS&no Sb/Br)CU NIPDAU Level-2-260C-1YEAROrderable Device Status(1)PackageType PackageDrawingPins PackageQtyEco Plan(2)Lead/Ball Finish MSL Peak Temp(3)SN74LS193DE4ACTIVE SOIC D1640Green(RoHS&no Sb/Br)CU NIPDAU Level-2-260C-1YEARSN74LS193DR ACTIVE SOIC D162500Green(RoHS&no Sb/Br)CU NIPDAU Level-2-260C-1YEARSN74LS193DR ACTIVE SOIC D162500Green(RoHS&no Sb/Br)CU NIPDAU Level-2-260C-1YEARSN74LS193DRE4ACTIVE SOIC D162500Green(RoHS&no Sb/Br)CU NIPDAU Level-2-260C-1YEARSN74LS193DRE4ACTIVE SOIC D162500Green(RoHS&no Sb/Br)CU NIPDAU Level-2-260C-1YEAR SN74LS193J OBSOLETE CDIP J16TBD Call TI Call TISN74LS193J OBSOLETE CDIP J16TBD Call TI Call TISN74LS193N ACTIVE PDIP N1625Pb-Free(RoHS)CU NIPDAU Level-NC-NC-NCSN74LS193N ACTIVE PDIP N1625Pb-Free(RoHS)CU NIPDAU Level-NC-NC-NC SN74LS193N3OBSOLETE PDIP N16TBD Call TI Call TISN74LS193N3OBSOLETE PDIP N16TBD Call TI Call TISN74LS193NE4ACTIVE PDIP N1625Pb-Free(RoHS)CU NIPDAU Level-NC-NC-NCSN74LS193NE4ACTIVE PDIP N1625Pb-Free(RoHS)CU NIPDAU Level-NC-NC-NCSN74LS193NSR ACTIVE SO NS162000Green(RoHS&no Sb/Br)CU NIPDAU Level-1-260C-UNLIMSN74LS193NSR ACTIVE SO NS162000Green(RoHS&no Sb/Br)CU NIPDAU Level-1-260C-UNLIMSN74LS193NSRE4ACTIVE SO NS162000Green(RoHS&no Sb/Br)CU NIPDAU Level-1-260C-UNLIMSN74LS193NSRE4ACTIVE SO NS162000Green(RoHS&no Sb/Br)CU NIPDAU Level-1-260C-UNLIM SNJ54192J ACTIVE CDIP J161TBD Call TI Level-NC-NC-NCSNJ54192J ACTIVE CDIP J161TBD Call TI Level-NC-NC-NCSNJ54192W ACTIVE CFP W161TBD Call TI Level-NC-NC-NCSNJ54192W ACTIVE CFP W161TBD Call TI Level-NC-NC-NCSNJ54193J OBSOLETE CDIP J16TBD Call TI Call TISNJ54193J OBSOLETE CDIP J16TBD Call TI Call TISNJ54193W OBSOLETE CFP W16TBD Call TI Call TISNJ54193W OBSOLETE CFP W16TBD Call TI Call TISNJ54LS193FK ACTIVE LCCC FK201TBD Call TI Level-NC-NC-NC SNJ54LS193FK ACTIVE LCCC FK201TBD Call TI Level-NC-NC-NC SNJ54LS193J ACTIVE CDIP J161TBD Call TI Level-NC-NC-NC SNJ54LS193J ACTIVE CDIP J161TBD Call TI Level-NC-NC-NC SNJ54LS193W ACTIVE CFP W161TBD Call TI Level-NC-NC-NC SNJ54LS193W ACTIVE CFP W161TBD Call TI Level-NC-NC-NC (1)The marketing status values are defined as follows:ACTIVE:Product device recommended for new designs.LIFEBUY:TI has announced that the device will be discontinued,and a lifetime-buy period is in effect.NRND:Not recommended for new designs.Device is in production to support existing customers,but TI does not recommend using this part ina new design.PREVIEW:Device has been announced but is not in production.Samples may or may not be available.OBSOLETE:TI has discontinued the production of the device.(2)Eco Plan-The planned eco-friendly classification:Pb-Free(RoHS)or Green(RoHS&no Sb/Br)-please check /productcontent for the latest availability information and additional product content details.TBD:The Pb-Free/Green conversion plan has not been defined.Pb-Free(RoHS):TI's terms"Lead-Free"or"Pb-Free"mean semiconductor products that are compatible with the current RoHS requirements for all6substances,including the requirement that lead not exceed0.1%by weight in homogeneous materials.Where designed to be soldered at high temperatures,TI Pb-Free products are suitable for use in specified lead-free processes.Green(RoHS&no Sb/Br):TI defines"Green"to mean Pb-Free(RoHS compatible),and free of Bromine(Br)and Antimony(Sb)based flame retardants(Br or Sb do not exceed0.1%by weight in homogeneous material)(3)MSL,Peak Temp.--The Moisture Sensitivity Level rating according to the JEDEC industry standard classifications,and peak solder temperature.Important Information and Disclaimer:The information provided on this page represents TI's knowledge and belief as of the date that it is provided.TI bases its knowledge and belief on information provided by third parties,and makes no representation or warranty as to the accuracy of such information.Efforts are underway to better integrate information from third parties.TI has taken and continues to take reasonable steps to provide representative and accurate information but may not have conducted destructive testing or chemical analysis on incoming materials and chemicals.TI and TI suppliers consider certain information to be proprietary,and thus CAS numbers and other limited information may not be available for release.In no event shall TI's liability arising out of such information exceed the total purchase price of the TI part(s)at issue in this document sold by TI to Customer on an annual basis.IMPORTANT NOTICETexas Instruments Incorporated and its subsidiaries (TI) reserve the right to make corrections, modifications, enhancements, improvements, and other changes to its products and services at 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T o minimize the risks associated with customer products and applications, customers should provide adequate design and operating safeguards.TI does not warrant or represent that any license, either express or implied, is granted under any TI patent right, copyright, mask work right, or other TI intellectual property right relating to any combination, machine, or process in which TI products or services are used. Information published by TI regarding third-party products or services does not constitute a license from TI to use such products or services or a warranty or endorsement thereof. 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路达到最大计数状态(LS192为9,LS193为15)时，74LS192计数时钟的下一个高到低 转换将导致TCU降低。TCU将保持低直到CPU再次升高，从而有效地重复计数时 钟，但是由于两个门延迟而延迟。类似地，当电路处于零状态时，TCD输出将会 降低，而倒计时时钟则会降低。由于TC输出重复时钟波形，它们可以作为时钟输 入信号到多级计数器的更高阶电路中。每个电路都有一个异步并行负载能力，允 许计数器被预先设置。当并行负载(PL)和主重74LS192置(MR)输入值较低时，并 行数据输入 (P0、P3)上的信息被加载到库中，并在输出中显示，而不考虑时钟输入的影响。 主复位输入上的高信号将禁用预置门，覆盖两个clockinput，并将每个Q输出锁在 低状态。如果在复位或负载操作过程中，其中一个输入值较低，则该时钟的下一 个低到高转换将被解释为一个合法信号，并将被计算。
可预置的BCD/颓废/下降可预置的4位二进制对位SN54/74LS192是一个上升/下降的 BCD十年(8421)计数器，而n54 / 74ls193是一个上升/下降的moduo -16二进制计数 器。使用分装和计数钟，两种计数方式同时进行。输出变化状态与时钟输入的低 到高转换同步。提供了独立的终端计数和终端计数输出，这些输出被用作后续阶 段的时钟，而没有额74LS192外的逻辑，从而简化了多阶段计数74LS192器的设 计。单独的预置输入允许电路用作可编程计数器。并行加载(PL)和主重置(MR)输 入都异步覆盖锁。低功率…95mw典型耗散·高速…40 MHz典型计数频率·同步计 数·异步主复74LS192位和并行负载·独立预置输74LS192入·内部级联电路·输 入箝位二极管限制高速终止效果连接图底(前视图)14131211109123456716158 vccp1p0mr TCD TCUP2PLP3Q1Q0 CPD CPU Q2Q3 GNDPIN NAMESLOADING(注 一)HIGHLOWCPUCPDMRPLPnQnTCDTCUCount时钟脉冲InputCount下来时钟脉 冲InputAsynchronous主复位(清晰)InputAsynchronous并行负载(活性低)InputParallel 数据InputsFlip-Flop输出(注意b)终端倒计时(借)输出(注意b)终端数(携带)输出(注意 b)0.5 U.L.0.5 U.L.0.5 U.L.0.5 U.L.0.5 U.L.10 U.L.10 U.L.10 U.L.0.25 U.L.0.25 U.L.0.25 U.L.0.25 U.L.0.25 U.L.5(2.5)U.L.5(2.5)U.L.5(2.5)U.L.NOTES:一个。1 TTL单位荷载 (U.L.)= 40 / 1.6 mA LOW.b a高。输出低驱动因子为2.5 u . l用于军事(54)和5 u.l for Commercial (74)函数描述:LS192和LS193是异步预置十年和4位二进制同步上下(可反 转)计数器。LS192十进位计数器和LS193二进制计数器的工作模式是相同的，唯一 的区别是状态图中所示的计数序列。74LS192每个电路包含4个主/从属触发器，具 有内部的门控和转向逻辑来提供数据重置、单独的预置、计数和计数下行操作。 每个触发器都包含从从从从JK到母j的反馈，因此其T输入上的低到高的转换会导 致这个转换，因此Q输出会改变状态。74LS192与纹波计数相反，同步切换是通过 从公共计数线和公共计数下行线驱动所有阶段的转向闸来实现的，74LS192从而导 致同时启动所有74LS192状态的更改。计数输入的低到高转换将使计数增加1;计数 下降输入的类似转换将使计数减少1。当使用一个时钟输入计数时，另一个时钟应 该保持高。否则，电路将要么计数字节或根本不计数，这取决于第一个触发器的 状态，它不能切换，只要74LS192任何一个时钟输入是低的。终端计数(TCU)和终 端计数(TCD)输出通常是高的。当电
两片74ls192组成两位十进制减法计数器真值表
两片74ls192组成两位十进制减法计数器真值表两片74ls192组成两位十进制减法计数器,可以用于计算机编程和电子电路设计中。
74ls192是一款2x24位的动态存储器,可以在192位时钟周期内读写,具有高吞吐量和低延迟的特点。
在两位十进制减法计数器中,需要将输入的两位二进制数减去所需的减法值,并将结果存储在计数器的二进制位中。
为了实现这一功能,可以使用两片74ls192来实现一个简单的两位十进制减法计数器。
下面是两片74ls192组成的两位十进制减法计数器真值表的扩展:| 计数器 | 输入 | 减法值 | 真值表 || ---- | ---- | ---- | ---- || 1 | 10 | 0 | 00000000 || 2 | 11 | 1000 | 00000011 || 3 | 12 | 001000 | 00000010 || 4 | 13 | 101000 | 00000011 || 5 | 14 | 010010 | 00000010 || 6 | 15 | 001101 | 00000010 || 7 | 16 | 101100 | 00000011 || 8 | 17 | 011100 | 00000010 || 9 | 18 | 110101 | 00000011 || 10 | 19 | 101110 | 00000010 || 11 | 20 | 011011 | 00000010 || 12 | 21 | 101011 | 00000011 || 13 | 22 | 010010 | 00000010 || 14 | 23 | 001101 | 00000010 || 15 | 24 | 101101 | 00000011 || 16 | 25 | 011001 | 00000010 || 17 | 26 | 101100 | 00000011 || 18 | 27 | 011011 | 00000010 || 19 | 28 | 101111 | 00000011 || 20 | 29 | 011100 | 00000010 || 21 | 30 | 101011 | 00000011 || 22 | 31 | 011101 | 00000010 || 23 | 32 | 110101 | 00000011 || 24 | 33 | 011100 | 00000010 || 25 | 34 | 101100 | 00000011 || 26 | 35 | 011011 | 00000010 || 27 | 36 | 101101 | 00000011 || 28 | 37 | 011001 | 00000010 || 29 | 38 | 101100 | 00000011 || 30 | 39 | 011011 | 00000010 || 31 | 40 | 110101 | 00000011 |通过使用两片74ls192,我们可以实现一个复杂的两位十进制减法计数器,从而在计算机编程和电子电路设计中发挥重要的作用。
74ls192构成六进制计数器连接方法
74ls192构成六进制计数器连接方法
我们要使用74LS192芯片来制作一个六进制计数器。
首先，我们需要了解74LS192芯片的特性以及如何使用它来构建六进制计数器。
74LS192是一个双BCD（二进制编码的十进制）计数器，这意味着它可以同时计数到9（0000到1001）并保持其状态。
为了将其转换为六进制计数器，我们需要将74LS192的输出连接到适当的逻辑门或芯片，以便在计数到5时产生进位信号。
以下是一个简单的步骤，说明如何将74LS192连接为六进制计数器：
1. 将74LS192的Q0、Q1和Q2连接到适当的显示设备，如LEDs，以显示当前的计数值。
2. 将74LS192的进位输出（CO）连接到下一级的74LS192的时钟输入（CP）。
3. 将74LS192的清零输入（CLR）连接到适当的信号，以便在需要时重置计数器。
4. 将74LS192的异步置数输入（LD）连接到适当的信号，以便在需要时将计数器设置为特定的值。
5. 将74LS192的时钟输入（CP）连接到适当的时钟源，以便在每个时钟周期内递增计数器的值。
现在我们已经了解了如何连接74LS192以构建六进制计数器，我们可以开始进行实际的连接。
根据上述步骤和连接关系，我们可以开始构建六进制计数器的电路。
请注意，这只是一个概念性的连接方案，实际连接可能因具体的硬件和需求而有所不同。
cd40192简洁中文资料
cd40192中文资料
CD40192是同步十进制可逆计数器，具有双时钟输入，并具有清除和置数等功能，其引脚排列及逻辑符号，如图所示。
CD40192（同CC40192 74LS192）的功能见表，说明如下：
当清除端CR为高电平“1”时，计数器直接清零；CR置低电平则执行其他功能。
当CR为低电平，置数端也为低电平时，数据直接从置数端J1、J2、J3、J4 置入计数器。
引脚功能：图中：LD （11脚）—置数端CU(5脚) —加计数端CD(4脚) —减计数端C0 （12脚）－非同步进位输出端B0 （13脚）非同步借位输出端。
J1、J2、J3、J4 —计数器输入端. Q1、Q2、Q3、Q4 —数据输出端CR（14脚）—清除端
当CR为低电平，LD 为高电平时，执行计数功能。
执行加计数时，减计数端CD 接高电
平，计数脉冲由CU输入；在计数脉冲上升沿进行8421码十进制加法计数。
执行减计数时，加计数端CU接高电平，计数脉冲由减计数端CPD 输入。
表CD40192功能表
输ab126计算公式大全入输出
CR LD CPU CPD J4 J3 J2 J1 Q4 Q3 Q2 Q1
1 ×××××××0 0 0 0
0 0 ×× d c b A d c b a
0 1 ↑ 1 ××××加法计数
0 1 1 ↑××××减法计数。
芯片74LS192中文资料
十进制同步加/减计数器（双时钟）54192/7419254LS192/74LS192 逻辑符号简要说明：192为可预置的十进制同步加/减计数器，共有54192/74192，54LS192/74LS192两种线路结构形式。
其主要电特性的典型值如下：型号 fc P D54192/74192 32MHz 325mW 54LS192/74LS192 32MHz 95mW 192的清除端是异步的。
当清除端（MR ）为高电平时，不管时钟端（CP D 、CP U ）状态如何，即可完成清除功能。
192的预置是异步的。
当置入控制端（P ＿＿L ＿）为低电平时，不管时钟CP 的状态如何，输出端（Q0～Q3）即可预置成与数据输入端（P0～P3）相一致的状态。
192的计数是同步的，靠CP D 、CP U 同时加在4个触发器上而实现。
在CP D 、CP U 上升沿作用下Q0～Q3同时变化，从而消除了异步计数器中出现的计数尖峰。
当进行加计数或减计数时可分别利用CP D 或CP U ，此时另一个时钟应为高电平。
当计数上溢出时，进位输出端（T ＿＿C ＿U ）输出一个低电平脉冲，其宽度为CP U 低电平部分的低电平脉冲；当计数下溢出时，错位输出端（T ＿＿C ＿D ）输出一个低电平脉冲，其宽度为CP D 低电平部分的低电平脉冲。
当把T ＿＿C ＿D 和T ＿＿C ＿U 分别连接后一级的CP D 、CP U ，即可进行级联。
双列直插封装引出端符号T ＿＿C ＿D 错位输出端（低电平有效）T ＿＿C ＿U 进位输出端（低电平有效）CP D 减计数时钟输入端（上升沿有效） CP U 加计数时钟输入端（上升沿有效） MR 异步清除端P0～P3 并行数据输入端P ＿＿L ＿异步并行置入控制端（低电平有效）Q0～Q3 输出端 极限值电源电压 7V 输入电压54/74192 5.5V 54/74LS192 7V 工作环境温度54××× -55～125℃ 74××× 0～70℃储存温度 -65℃～150℃功能表状态图推荐工作条件:54/74192 54/74LS192单位最小额定最大最小额定最大54 4.5 5 5.5 4.5 5 5.5V 电源电压V CC5.2555.2574 4.7554.75输入高电平电压V iH 2 2 V54 0.8 0.7V 输入低电平电压V iL74 0.8 0.8uA 输出高电平电流I OH-400 -400mA54 16 4输出低电平电流I OL74 16 8MHz 时钟频率fcp 0 25 0 20脉冲宽度T W CP 20 20 nsnsP 20 20 建立时间 tsetMR无效40 保持时间t H0 5 ns逻辑图静态特性（T A 为工作环境温度范围）‘192 LS192 单位参 数测 试 条 件【1】最小最大最小最大I ik =-12mA -1.5 V IK 输入嵌位电压 Vcc=最小，I ik =-18mA-1.5V 54 2.4 2.5 V OH 输出高电平电压 Vcc ＝最小V IH ＝2V V IL ＝最大, I OH ＝-400µA 74 2.4 2.7 V540.4 0.4V OL 输出低电平电压 Vcc=最小，V IH =2V , V IL ＝最大，I OL =最大 74 0.4 0.5V I I 最大输入电压时输入电流Vcc ＝最大V I =5.5V （LS192为7V ）1 0.1 mA I IH 输入高电平电流Vcc ＝最大V IH =2.4V （LS192为2.7V ）40 20 µA I IL 输入低电平电流 Vcc ＝最大,V IL =0.4V -1.6 -0.4 mA54 -20 -65 -20 -100 I OS 输出短路电流 Vcc ＝最大74 -18 -65 -20 -100mA 54 89 34 I CC 电源电流Vcc ＝最大，MR 和P ＿＿L ＿接地，其余接4.5V74 102 34mA [1]: 测试条件中的“最小”和“最大”用推荐工作条件中的相应值。
74Ls192
实验四触发器及其功能转换一、实验目的1、掌握基本RS、JK、D和T触发器的逻辑功能2、掌握集成触发器的逻辑功能及使用方法3、熟悉触发器之间相互转换的方法二、实验原理触发器具有两个稳定状态，用以表示逻辑状态“1”和“0”，在一定的外界信号作用下，可以从一个稳定状态翻转到另一个稳定状态，它是一个具有记忆功能的二进制信息存贮器件，是构成各种时序电路的最基本逻辑单元。
1、基本RS触发器图4－1为由两个与非门交叉耦合构成的基本RS触发器，它是无时钟控制低电平直接触发的触发器。
基本RS触发器具有置“0”、置“1”和“保持”三种功能。
通常称S为置“1”端，因为S＝0（R＝1）时触发器被置“1”；R为置“0”端，因为R＝0（S＝1）时触发器被置“0”，当S＝R＝1时状态保持；S＝R＝0时，触发器状态不定，应避免此种情况发生，表9－1为基本RS触发器的功能表。
基本RS触发器。
也可以用两个“或非门”组成，此时为高电平触发有效。
2、JK触发器在输入信号为双端的情况下，JK触发器是功能完善、使用灵活和通用性较强的一种触发器。
本实验采用74LS112双JK触发器，是下降边沿触发的边沿触发器。
引脚功能及逻辑符号如图4－2所示。
JK触发器的状态方程为Q n+1＝J Q n＋K Q nJ和K是数据输入端，是触发器状态更新的依据，若J、K有两个或两个以上输入端时，组成“与”的关系。
Q与Q为两个互补输出端。
通常把 Q＝0、Q＝1的状态定为触发器“0”状态；而把Q＝1，Q＝0定为“1”状态。
图4－2 74LS112双JK触发器引脚排列及逻辑符号下降沿触发JK触发器的功能如表4－2表4－2注：×— 任意态 ↓— 高到低电平跳变 ↑— 低到高电平跳变Q n （Q n ）— 现态 Q n+1（Q n+1 ）— 次态 φ— 不定态 JK 触发器常被用作缓冲存储器，移位寄存器和计数器。
3、D 触发器在输入信号为单端的情况下，D 触发器用起来最为方便，其状态方程为 Q n+1＝D n，其输出状态的更新发生在CP 脉冲的上升沿，故又称为上升沿触发的边沿触发器，触发器的状态只取决于时钟到来前D 端的状态，D 触发器的应用很广，可用作数字信号的寄存，移位寄存，分频和波形发生等。
74LS192参数
同步十进制可逆计数器注：74LS192参数74192引脚图真值表：H=高电平 L=低电平 X=不定（高或低电平）↑=由“低”→“高”电平的跃变引脚功能表：NOTES:a. 1 TTL UNIT 单位 Load (U.L.) = 40 mA HIGH/1.6 mA LOW.b. The Output LOW drive factor is 2.5 U.L.for Military(54)and 5 U.L.for Commercial(74)Temperature Ra EQUATIONSOperating Conditions 建议操作条件：DC SPECIFICATIONS直流电气规格：AC CHARACTERISTICS (TA = 25℃) 交流特性(TA = 25℃)：交流安装要求(TA =25℃)原理：本电路复杂程度为55 个等效门。
本电路通过同时触发所有触发器而提供同步操作，以便在使用控制逻辑结构时，输出端的变化可相互重合。
本工作方式避免了一般用异步(行波时钟)计数器所带来的计数输出的尖峰脉冲。
四个主从触发器的输出端，由两计数(时钟)输入之一的“低”到“高”电平的过渡而被触发。
计数方向在其它计数输入端为“高”时，由脉冲的计数输入端所定。
本电路为全可编程的，当置数输入为“低”时，把所希望的数据送入数据输入端上，来把每个输出端预置到两电平之一。
输出将符合独立于计数脉冲的数据输入的改变。
该特点可使电路以预置输入而简单地更改计数长度，用作N 模数分频器(除法器)。
清零输入在加高电平时，迫使所有输出端为低电平。
清零功能独立于计数输入和置数输入。
清零、计数和置数等输入端都是缓冲过的，它降低了驱动的要求,这就可减少为长字所要求的时钟驱动器数等等。
本电路都设计成可被直接级联而勿需外接电路。
借位和进位两输出端可级联递增计数和递减计数两功能。
借位输出在计数器下谥时，产生宽度等于递减计数输入的脉冲；同样，进位输出在计数器上谥时, 产生宽度等于递加计数输入的脉冲。