锁相环PLL电路原理及笔记本主板PLL芯片汇总
锁相环PLL（PhaseLockedLoop）
锁相环PLL（PhaseLockedLoop）锁相环PLL目前我见到的所有芯片中都含有PLL模块，而且一直不知道如何利用PLL对晶振进行倍频的，这次利用维基百科好好的学习了下PLL 的原理。
1. 时钟与振荡电路在芯片中，最重要的就是时钟，时钟就像是心脏的脉冲，如果心脏停止了跳动，那人也就死亡了，对于芯片也一样。
了解了时钟的重要性，那时钟是怎么来的呢？时钟可以看成周期性的0与1信号变化，而这种周期性的变化可以看成振荡。
因此，振荡电路成为了时钟的来源。
振荡电路的形成可以分两类：1. 石英晶体的压电效应：电导致晶片的机械变形，而晶片两侧施加机械压力又会产生电，形成振荡。
它的谐振频率与晶片的切割方式、几何形状、尺寸有关，可以做得精确，因此其振荡电路可以获得很高的频率稳定度。
2. 电容Capacity的充电放电：能够存储电能，而充放电的电流方向是反的，形成振荡。
可通过电压等控制振荡电路的频率。
2. PLL与倍频由上面可以知道，晶振由于其频率的稳定性，一般作为系统的外部时钟源。
但是晶振的频率虽然稳定，但是频率无法做到很高（成本与工艺限制），因此芯片中高频时钟就需要一种叫做压控振荡器（Voltage Controlled Oscillator）的东西生成了（顾名思义，VCO 就是根据电压来调整输出频率的不同）。
可压控振荡器也有问题，其频率不够稳定，而且变化时很难快速稳定频率。
哇偶，看到这种现象是不是很熟悉？嘿嘿，这就是标准开环系统所出现的问题，解决办法就是接入反馈，使开环系统变成闭环系统，并且加入稳定的基准信号，与反馈比较，以便生成正确的控制。
PLL倍频电路因此，为了将频率锁定在一个固定的期望值，锁相环PLL出现了！一个锁相环PLL电路通常由以下模块组成：·鉴相鉴频器PFD（Phase Frequency Detector）：对输入的基准信号（来自频率稳定的晶振）和反馈回路的信号进行频率的比较，输出一个代表两者差异的信号·低通滤波器LPF（Low-Pass Filter）：将PFD中生成的差异信号的高频成分滤除，保留直流部分·压控振荡器VCO（Voltage Controlled Oscillator）：根据输入电压，输出对应频率的周期信号。
芯片pll
芯片pll
PLL（Phase-Locked Loop，锁相环）芯片是一种电路组件，用
于生成稳定的时钟信号或频率合成信号。
它包含一个比较器、一个VCO（Voltage Controlled Oscillator，电压控制振荡器）
和一个反馈回路。
PLL芯片的工作原理如下：首先，输入一个参考信号和PLL
芯片的参考频率。
比较器将比较参考信号与VCO输出信号的
相位差，并产生一个错误信号。
错误信号经过滤波器进行滤波，然后通过一个控制电压转化器转换成控制VCO频率的电压。
VCO根据控制电压的变化来调整输出频率，使得与参考信号
的相位差最小化。
当相位差达到最小时，就称为锁定状态，此时VCO输出的频率与参考信号频率一致。
通过不断调整控制
电压，PLL芯片可以追踪参考信号的频率变化，使得输出信号始终与参考信号保持同步。
PLL芯片具有以下优点：首先，它可以在输入和输出频率之间进行频率合成，从而扩大信号的频率范围。
其次，PLL芯片具有较高的频率稳定性和抗噪声能力。
此外，由于使用了反馈回路进行频率比对，PLL芯片可以实现对输入信号的准确跟踪。
综上所述，PLL芯片是一种用于生成稳定的时钟信号或频率合成信号的电路组件，通过反馈机制实现与输入信号的频率跟踪与同步。
它广泛应用于通信、数据传输、音视频设备等领域。
锁相环PLL的电路原理以及基本构成
锁相环PLL的电路原理以及基本构成锁相环（phase locked loop），顾名思义，就是锁定相位的环路。
学过自动控制原理的人都知道，这是一种典型的反馈控制电路，利用外部输入的参考信号控制环路内部振荡信号的频率和相位，实现输出信号频率对输入信号频率的自动跟踪，一般用于闭环跟踪电路。
是无线电发射中使频率较为稳定的一种方法，主要有VCO（压控振荡器）和PLL IC （锁相环集成电路），压控振荡器给出一个信号，一部分作为输出，另一部分通过分频与PLL IC所产生的本振信号作相位比较，为了保持频率不变，就要求相位差不发生改变，如果有相位差的变化，则PLL IC的电压输出端的电压发生变化，去控制VCO，直到相位差恢复，达到锁相的目的。
能使受控振荡器的频率和相位均与输入信号保持确定关系的闭环电子电路。
PLL（锁相环）电路原理在通信机等所使用的振荡电路，其所要求的频率范围要广，且频率的稳定度要高。
无论多好的LC振荡电路，其频率的稳定度，都无法与晶体振荡电路比较。
但是，晶体振荡器除了可以使用数字电路分频以外，其频率几乎无法改变。
如果采用PLL（锁相环）（相位锁栓回路，PhaseLockedLoop）技术，除了可以得到较广的振荡频率范围以外，其频率的稳定度也很高。
此一技术常使用于收音机，电视机的调谐电路上，以及CD唱盘上的电路。
PLL（锁相环）电路的基本构成PLL（锁相环）电路的概要图1所示的为PLL（锁相环）电路的基本方块图。
此所使用的基准信号为稳定度很高的晶体振荡电路信号。
此一电路的中心为相位此较器。
相位比较器可以将基准信号与VCO （V oltage Controlled Oscillator电压控制振荡器）的相位比较。
如果此两个信号之间有相位差存在时，便会产生相位误差信号输出。
（将VCO的振荡频率与基准频率比较，利用反馈电路的控制，使两者的频率为一致。
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pll电路原理
pll电路原理PLL电路原理一、引言PLL（Phase-Locked Loop）电路是一种广泛应用于通信领域的电路，它具有频率和相位锁定的特性，可以用于信号调制解调、频率合成、时钟恢复等应用。
本文将详细介绍PLL电路的原理和工作过程。
二、PLL电路的基本组成PLL电路由相位比较器、低通滤波器、VCO（Voltage-Controlled Oscillator）和分频器组成。
1. 相位比较器相位比较器是PLL电路的核心部件，它用来比较输入信号和反馈信号的相位差，并产生一个控制电压用于调节VCO的频率。
常见的相位比较器有边沿比较器、相位频率比较器等。
2. 低通滤波器低通滤波器用于对相位比较器输出的脉冲信号进行平滑处理，去除高频噪声，得到平稳的控制电压。
3. VCOVCO是一个电压控制的振荡器，其输出频率与输入的控制电压成正比。
通过调节VCO的频率，可以实现对输入信号的频率和相位的锁定。
4. 分频器分频器用于将VCO的输出信号进行频率分频，以提供反馈信号给相位比较器进行比较。
通过控制分频器的分频比例，可以实现对锁定频率的精确调节。
三、PLL电路的工作原理PLL电路的工作过程可以分为两个阶段：捕获阶段和跟踪阶段。
1. 捕获阶段在捕获阶段，PLL电路首先将输入信号和VCO的输出信号送入相位比较器进行比较。
相位比较器输出的脉冲信号经过低通滤波器平滑处理后，得到一个控制电压。
这个控制电压通过反馈回VCO，调节VCO的频率，使其与输入信号的频率和相位锁定。
在捕获阶段，PLL 电路通过不断调节VCO的频率来逐渐减小输入信号与VCO输出信号之间的相位差，直到两者相位一致。
2. 跟踪阶段当PLL电路经过捕获阶段成功锁定输入信号的频率和相位后，进入跟踪阶段。
在跟踪阶段，PLL电路继续通过比较VCO输出信号和反馈信号的相位差，并根据相位比较器的输出调节VCO的频率，使其保持与输入信号的相位一致。
这样，PLL电路就能够跟踪输入信号的频率和相位的变化，保持锁定状态。
锁相环pll原理与应用
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目 录
• 锁相环PLL的基本原理 • 锁相环PLL的种类与特性 • 锁相环PLL的应用 • 锁相环PLL的发展趋势与挑战 • 锁相环PLL的设计与实现
01
锁相环PLL的基本原理
PLL的基本结构
鉴相器（PD）
用于比较输入信号和反馈信号的相位 差。
压控振荡器（VCO）
相位同步
锁相环PLL用于电力系统的相位同步，确保不同电源之间的相位一 致，提高电力系统的稳定性。
频率跟踪
锁相环PLL用于电力系统的频率跟踪，实时监测电网频率变化，确 保电力系统的正常运行。
故障定位
通过分析电网信号的相位和频率变化，结合锁相环PLL实现电力故 障的快速定位和排查。
其他领域的应用
电子测量
PLL的发展趋势
高速化
随着通信技术的发展， 对信号的传输速率要求 越来越高，锁相环PLL 的频率合成速度和跟踪
速度也在不断加快。
数字化
随着数字信号处理技术 的进步，越来越多的锁 相环PLL开始采用数字 控制方式，提高了系统 的稳定性和灵活性。
集成化
为了减小电路体积和降 低成本，锁相环PLL的 集成化程度越来越高， 越来越多的功能被集成
软件PLL具有灵活性高、可重 构性好等优点，但同时也存在 计算量大、实时性差等缺点。
各种PLL的优缺点比较
1 2
3
模拟PLL
优点是响应速度快、跟踪性能好；缺点是元件参数漂移、温 度稳定性差。
数字PLL
优点是精度高、稳定性好、易于集成；缺点是响应速度慢、 跟踪性能较差。
软件PLL
优点是灵活性高、可重构性好；缺点是计算量大、实时性差 。
锁相环工作原理
锁相环工作原理锁相环（Phase-Locked Loop，PLL）是一种常用的电子电路，用于同步和稳定地追踪输入信号的相位。
它在许多领域中被广泛应用，如通信系统、数据传输、音频处理等。
本文将详细介绍锁相环的工作原理及其组成部分。
一、锁相环的组成部分1. 相位比较器（Phase Detector）：相位比较器是锁相环的核心组成部分，用于比较输入信号和反馈信号的相位差。
常见的相位比较器有边沿比较器、恒幅比较器等。
2. 低通滤波器（Low-Pass Filter）：相位比较器的输出信号经过低通滤波器进行滤波，去除高频噪声，得到稳定的控制电压。
3. 电压控制振荡器（Voltage-Controlled Oscillator，VCO）：VCO是一种根据输入电压的大小来调节输出频率的振荡器。
锁相环中的VCO的频率可以通过控制电压进行调节。
4. 分频器（Divider）：分频器用于将VCO的输出频率进行分频，得到反馈信号，使其与输入信号保持同步。
5. 锁相环滤波器（Loop Filter）：锁相环滤波器用于对VCO的控制电压进行滤波和调整，使其能够更好地追踪输入信号的相位。
二、锁相环的工作原理锁相环的工作原理可以简单概括为：通过相位比较器比较输入信号和反馈信号的相位差，根据相位差的大小产生控制电压，通过滤波和调整后的控制电压来调节VCO的频率，使其与输入信号保持同步。
具体工作流程如下：1. 初始状态下，输入信号和反馈信号的相位差较大，相位比较器的输出信号较大。
2. 相位比较器的输出信号经过低通滤波器滤波后，得到稳定的控制电压。
3. 控制电压作用于VCO，调节VCO的频率。
4. 经过分频器的分频，得到反馈信号。
5. 反馈信号与输入信号经过相位比较器比较，进一步调节控制电压。
6. 重复上述步骤，直到输入信号和反馈信号的相位差趋近于零。
通过不断调节VCO的频率，锁相环能够实现对输入信号的相位进行追踪和同步，使得输出信号与输入信号保持一致。
PLL锁相环相关基础知识
PLL锁相环相关基础知识由于近期找工作，所以把射频的一些基础知识复习了一遍。
趁着自己还有点时间和精力，把锁相环的一些知识记录一下，基础功不扎实，有误之处还请大佬拍错。
1. PLL的工作原理锁相环一般由PD(鉴相器）,LPF（环路滤波器），VCO组成。
有的同学可能要问了：“既然VCO在给定电压之后已经能输出频率了，为什么不直接拿来用呢？”实际上可以这么用，现在有的晶振会针对某个固定的频点把频率优化的非常好，比如一些122.88MHz的VCXO（外置的VCO），这些晶振有个特点，在这个频点相噪性能优化的特别好。
但是晶振一般很难把频率做高。
而我们PLL中经常使用的VCO，频率变化中频都是GHz为单位，变化范围几百兆MHz，若使用开环VCO（不加PLL的结构），那么出来的频率信号相噪特别糟糕，而且随着电压变化（例如噪声，温度带来的影响）导致VCO的输出频率发生漂移。
于是有人提出了使用PLL这样的结构，能够输出比较稳定的（LOCKED）频率。
其主要思想是利用一个相位比较干净的参考频率，建立一个闭环结构来获取到相位比较干净的高频频率。
如上图所示，输入信号经过鉴相器，当反馈信号和fref的相位一致的时候，PD输出一个恒定电压值（实际上由CP输出电流），从而使得这个系统稳定。
如果我们把PD简单看做一个乘法器，那么有参考输入信号反馈输入的角频率为：N一般表示为反馈DIV的分频比。
反馈输入信号为：两者相乘根据积化和差可以得到高频和低频两个分量。
其中高频的部分会被LPF滤掉。
所以只剩低频部分。
对于低频部分，将相位记为：要使得系统稳定，即相位恒定，可以关于相位对时间t求导数，当等于0时可以认为两个相位一致。
一般把看做两个时钟的随机起振相位，上电后保持不变。
所以有当导数为0的时候：此时有假如此时参考频率10MHz，N为350，可以得到3.5GHz的频率输出。
当然前提是PLL的VCO支持这个频段。
当然对于现在的芯片，鉴频器的参考频率输入前也有一个分频器或者倍频器，一般记为R。
锁相环PLL的组成和工作原理
锁相环的组成和工作原理#11．锁相环的基本组成许多电子设备要正常工作，通常需要外部的输入信号与内部的振荡信号同步，利用锁相环路就可以实现这个目的。
锁相环路是一种反馈控制电路，简称锁相环（PLL）。
锁相环的特点是：利用外部输入的参考信号控制环路内部振荡信号的频率和相位。
因锁相环可以实现输出信号频率对输入信号频率的自动跟踪，所以锁相环通常用于闭环跟踪电路。
锁相环在工作的过程中，当输出信号的频率与输入信号的频率相等时，输出电压与输入电压保持固定的相位差值，即输出电压与输入电压的相位被锁住，这就是锁相环名称的由来。
锁相环通常由鉴相器（PD）、环路滤波器（LF）和压控振荡器（VCO）三部分组成，锁相环组成的原理框图如图8-4-1所示。
锁相环中的鉴相器又称为相位比较器，它的作用是检测输入信号和输出信号的相位差，并将检测出的相位差信号转换成uD（t）电压信号输出，该信号经低通滤波器滤波后形成压控振荡器的控制电压uC（t），对振荡器输出信号的频率实施控制。
2．锁相环的工作原理锁相环中的鉴相器通常由模拟乘法器组成，利用模拟乘法器组成的鉴相器电路如图8-4-2所示。
鉴相器的工作原理是：设外界输入的信号电压和压控振荡器输出的信号电压分别为：（8-4-1）（8-4-2）式中的ω0为压控振荡器在输入控制电压为零或为直流电压时的振荡角频率，称为电路的固有振荡角频率。
则模拟乘法器的输出电压uD为：用低通滤波器LF将上式中的和频分量滤掉，剩下的差频分量作为压控振荡器的输入控制电压uC（t）。
即uC（t）为：（8-4-3）式中的ωi为输入信号的瞬时振荡角频率，θi（t）和θO（t）分别为输入信号和输出信号的瞬时位相，根据相量的关系可得瞬时频率和瞬时位相的关系为：即（8-4-4）则，瞬时相位差θd为（8-4-5）对两边求微分，可得频差的关系式为（8-4-6）上式等于零，说明锁相环进入相位锁定的状态，此时输出和输入信号的频率和相位保持恒定不变的状态，uc（t）为恒定值。
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锁相环PLL电路原理及笔记本主板PLL芯片汇总
锁相环（phase locked loop），顾名思义，就是锁定相位的环路。
学过自动控制原理的人都知道，这是一种典型的反馈控制电路，利用外部输入
的参考信号控制环路内部振荡信号的频率和相位，实现输出信号频率对输入
信号频率的自动跟踪，一般用于闭环跟踪电路。
是无线电发射中使频率较为
稳定的一种方法，主要有VCO（压控振荡器）和PLL IC （锁相环集成电路），压控振荡器给出一个信号，一部分作为输出，另一部分通过分频与PLL IC 所产生的本振信号作相位比较，为了保持频率不变，就要求相位差不发生改变，如果有相位差的变化，则PLL IC的电压输出端的电压发生变化，去控制VCO，直到相位差恢复，达到锁相的目的。
能使受控振荡器的频率和相位均与输入信号保持确定关系的闭环电子电路。
PLL（锁相环）电路原理
在通信机等所使用的振荡电路，其所要求的频率范围要广，且频率的稳定度要高。
无论多好的LC振荡电路，其频率的稳定度，都无法与晶体振
荡电路比较。
但是，晶体振荡器除了可以使用数字电路分频以外，其频率几
乎无法改变。
如果采用PLL（锁相环）（相位锁栓回路，PhaseLockedLoop）
技术，除了可以得到较广的振荡频率范围以外，其频率的稳定度也很高。
此
一技术常使用于收音机，电视机的调谐电路上，以及CD唱盘上的电路。