嵌入式系统的低功耗问题分析研究

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嵌入式系统低功耗设计研究

嵌入式系统低功耗设计研究

嵌入式系统低功耗设计研究作者:文桦张亚军来源:《现代电子技术》2009年第22期摘要:在嵌入式系统设计中低功耗设计是许多设计人员必须面对的问题,其原因在于嵌入式系统产品不是一直都有充足的电源供应,往往是靠电池来供电的,而且大多数嵌入式设备都有体积和质量的约束。

另外,系统部件产生的热量和功耗成比例,为解决散热问题而采取的冷却措施进一步增加了整个系统的功耗。

为了得到最好的结果,在系统设计时就必须考虑低功耗问题。

系统的功耗设计涉及到软件、硬件、集成电路工艺等多个方面,这里分析了功耗产生的原因,从原理和实践上探讨系统的低功耗设计问题,综述硬件低功耗和软件低功耗的设计方法,给出实现低功耗设计的一种可行方法。

关键词:嵌入式系统;硬件低功耗;软件低功耗;集成电路工艺中图分类号:TP274;TP3680引言经过近几年的快速发展,嵌入式系统(Embedded System)已经成为电子信息产业中最具增长力的一个分支。

随着手机、PDA,GPS、机顶盒等新兴产品的大量应用,嵌入式系统的市场正在以每年30%的速度递增(IDC预测),嵌入式系统的设计也成为软硬件工程师越来越关心的话题。

在嵌入式系统设计中,低功耗设计(Low Power Design)是许多设计人员必须面对的问题。

其原因在于嵌入式系统被广泛应用于便携式和移动性较强的产品中,而这些产品不是一直都有充足的电源供应,往往是靠电池来供电的;而且大多数嵌入式设备都有体积和质量的约束。

另外,系统部件产生的热量和功耗成比例,为解决散热问题而采取的冷却措施进一步增加了系统的功耗。

为了得到最好的结果,降低系统的功耗具有下面的优点(1) 电池驱动的需要。

在强调绿色环保时期,许多电子产品都采用电池供电。

对于电池供电系统,延长电池寿命,降低用户更换电池的周期,提高系统性能与降低系统开销,甚至能起到保护环境的作用。

(2) 安全的需要。

在现场总线领域,本安问题是一个重要话题。

例如FF的本安设备,理论上每个网段可以容纳32个设备,而实际应用中考虑到目前的功耗水平,每个网段安装10个比较合适。

嵌入式系统低功耗软件技术研究

嵌入式系统低功耗软件技术研究
ue, eigU iesyo eh ooy B in 0 14 C ia D p.f mpt B in nvrt f cnlg , e i 102 ,hn ) C r j i T jg
Ab t a t Th r s a r s a c i l o o p we e h o o y t a a e me t n d o l y t e h r wa e d sg s h n u i g l w- s r c : e e i e e r h fed f rl w o rt c n l g h tc n tb n i e n y b h a d r e in, o t e sn o o p we o t r c n l g al e u e s s m we o s mp i n.Fr m e s f r e s e tv o rs f wa e t h o o y c l r d c y t p e e o rc n u to o t o t e p r p ci e,a c r i g t h n e n p o e s rl a h wa c o d n c a g si r c so d o o
( 京工业 大 学 计 算机学 院 , 北 北京 10 2 ) 0 14
摘 要 : 入式 系统低 功耗设计 中有硬 件技术 无法 涉足 的空 间 , 嵌 可通 过低 功耗 软 件技 术实 现 降低 系统 功 耗 的 目的 。针 对
液晶显示 器 ( C ) L D 电气 特性 , 软件角 度 , 运用动 态 电源管理 技术和动 态 电压 管 理技 术 , 据处 理 器负 载变 化趋 势 和 从 综合 根
对 空闲模 式计 时的思想 , 出了降低液 晶显示 器功耗 的算 法和策 略 ; 给 利用 优化编译 技术 中的操 作替 换 和指 令排序 方 法 , 分 析和研究 图形 图像处 理 中常见 的矩 阵变 换算法 , 出了低 功耗策 略和验证 节能 7.% 。并就 低功耗 软 件技术 算 法 和策 略 给 39 给 出了结 论 和提 出了下一步 研究 的方向 。

嵌入式系统中的低功耗设计策略

嵌入式系统中的低功耗设计策略

嵌入式系统中的低功耗设计策略在嵌入式系统中,低功耗设计一直是一个重要的课题。

随着移动互联网的迅速发展和智能设备的普及,对于嵌入式系统的功耗要求也越来越高。

低功耗设计不仅可以延长嵌入式系统的使用时间,还可以降低系统的发热量,提高系统的稳定性和可靠性。

因此,如何在设计阶段合理降低系统的功耗,成为了设计工程师们必须面对的一个挑战。

首先,在嵌入式系统中实施低功耗设计策略时,可以从硬件设计和软件设计两个方面进行考虑。

在硬件设计方面,采用低功耗的微处理器和低功耗芯片是提高整体系统功耗效率的关键。

选择适合的电源管理芯片并在设计中合理布局供电线路,可以有效减少功耗的消耗。

此外,通过合理设计系统的时钟频率和使用低功耗组件也是低功耗设计的重要手段。

其次,对于软件设计而言,优化软件算法和程序结构是减少系统功耗的有效途径。

在编写程序时,尽量避免频繁的访问外设和传输数据,可以有效减少系统的功耗。

同时,合理控制系统的进程调度和休眠策略,避免程序长时间运行或者在系统空闲时进入休眠模式,也是保证系统低功耗的必备措施。

另外,在嵌入式系统中,尽量利用硬件加速器来减少系统功耗也是一个有效策略。

通过合理设计硬件加速器的功能和使用场景,可以将部分高功耗任务交给硬件加速器来完成,减轻处理器的计算压力,从而降低系统功耗。

此外,采用合适的传输协议和数据压缩技术,也可以有效减少系统在数据传输时的功耗消耗。

最后,为了实时监测系统功耗情况,可以在系统中集成功耗监测模块,随时监控系统各组件的功耗情况。

通过实时监测系统的功耗消耗情况,可以及时发现系统中存在的功耗瓶颈和问题,从而采取相应措施进行优化,保证系统的最佳功耗状态。

综上所述,嵌入式系统中的低功耗设计策略涉及多个方面,包括硬件设计、软件设计、利用硬件加速器、传输协议选择以及功耗监测等各个环节。

只有在全面考虑各个方面的因素并采取相应措施的情况下,才能够确保嵌入式系统在功耗上取得最佳性能,满足用户对于低功耗和高性能的需求。

嵌入式系统中的功耗优化方法

嵌入式系统中的功耗优化方法

嵌入式系统中的功耗优化方法嵌入式系统已经成为现代科技发展中不可或缺的关键技术。

在嵌入式系统的设计中,功耗优化是一个至关重要的方面。

随着嵌入式设备越来越普及,对电池寿命和能源消耗的需求也越来越高。

因此,开发人员需要采取一系列的方法来降低系统的功耗。

本文将介绍一些嵌入式系统中常用的功耗优化方法。

首先,一种常见的功耗优化方法是动态电压频率调整(DVFS)。

通过降低处理器的工作电压和频率,可以显著降低功耗。

这种方法的关键是在不降低系统性能的前提下,根据应用程序的需求动态地调整处理器的电压和频率。

这种方法可以根据不同的应用负载来平衡性能和功耗之间的关系。

第二种常见的功耗优化方法是系统睡眠和唤醒的管理。

嵌入式系统通常由一些低功耗的处理器、传感器和外设组成。

当系统处于闲置状态时,通过将处理器和其他外设置于睡眠状态可以显著降低功耗。

此外,通过优化系统的唤醒机制,可以尽可能地减少唤醒次数,进一步降低功耗。

这种方法可以通过重新设计系统的电源管理策略来实现,从而在保持系统响应能力的同时降低功耗。

第三种功耗优化方法涉及对系统中的任务进行调度和优化。

通过合理的任务调度,可以减少处理器的运行时间,从而降低功耗。

例如,使用优先级调度算法可以确保高优先级的任务在低优先级任务之前完成,从而减少处理器的空闲时间。

此外,可以采用一些优化算法来将任务分配给不同的处理器,以提高系统的并行度和利用率。

通过对任务进行调度和优化,可以显著提高系统的功耗效率。

第四种常见的功耗优化方法是使用低功耗电子元件和器件。

在嵌入式系统的设计中,选择低功耗的电子元件和器件是至关重要的。

例如,采用低功耗的处理器和传感器可以有效降低功耗。

此外,选择低功耗的存储器和其他外设也可以进一步降低系统的功耗。

这种方法需要对系统进行全面的电子元件和器件的选型,并在设计阶段充分考虑功耗优化的因素。

最后,一种常用的方法是使用节能的算法和数据结构。

在嵌入式系统的软件设计中,选择节能的算法和数据结构可以显著降低功耗。

《嵌入式系统的低功耗与可靠性技术研究》

《嵌入式系统的低功耗与可靠性技术研究》

《嵌入式系统的低功耗与可靠性技术研究》一、引言随着物联网、智能设备以及移动计算技术的快速发展,嵌入式系统作为各种智能设备的核心部分,其低功耗与可靠性问题逐渐成为了重要的研究课题。

在面对能源短缺、环境污染以及设备稳定性要求日益严格的今天,嵌入式系统的低功耗与可靠性技术显得尤为重要。

本文将详细探讨嵌入式系统的低功耗和可靠性技术的研究现状及未来发展趋势。

二、嵌入式系统低功耗技术研究1. 硬件低功耗设计硬件低功耗设计是嵌入式系统低功耗技术的关键。

设计者在硬件设计阶段应考虑采用低功耗芯片、合理的电源管理策略等手段降低系统的整体功耗。

此外,选择合理的元器件及封装方式也能有效降低功耗。

在设计中还可以使用动态电源管理技术,根据系统运行状态调整电源供应,以达到节能目的。

2. 软件优化软件优化是降低嵌入式系统功耗的另一重要手段。

通过优化算法、减少不必要的计算和通信等措施,可以有效降低系统的运行功耗。

此外,合理设计系统任务调度策略,根据任务优先级进行任务分配和调度,也可以实现功耗的降低。

3. 休眠与唤醒机制休眠与唤醒机制是降低嵌入式系统功耗的有效手段。

通过在系统空闲时进入休眠状态,可以有效降低系统的功耗。

当系统需要再次工作时,再从休眠状态唤醒,以恢复工作状态。

这种机制在嵌入式系统中得到了广泛应用。

三、嵌入式系统可靠性技术研究1. 硬件冗余与容错设计硬件冗余与容错设计是提高嵌入式系统可靠性的重要手段。

通过采用冗余硬件和容错技术,可以在系统出现故障时保证系统的正常运行。

例如,采用双机热备、三模冗余等技术,可以提高系统的可靠性和稳定性。

2. 软件容错与恢复技术软件容错与恢复技术是提高嵌入式系统可靠性的另一重要手段。

通过设计容错算法、实现软件故障的自恢复等功能,可以在软件出现故障时及时恢复系统的正常运行。

此外,通过定期更新和修复软件漏洞,也可以提高系统的安全性与稳定性。

3. 系统级可靠性设计系统级可靠性设计是提高嵌入式系统可靠性的综合手段。

嵌入式系统中存储模块的低功耗研究

嵌入式系统中存储模块的低功耗研究
关 键 词 :存 储 模 块 ; 内 存 访 问 ;低 功 耗 ; 嵌 入 式 系 统 ;C ce ah
O 引言
近年来 .嵌 入式 系统 设计态 的 变 化 需 要 时 问 而产 生 的 ;漏 电 电流 功 耗是 电路 的物 理 构成 所 引起 的 。
第9 卷
第2 期
电子元 器 件 主 用
El cr nc Co p n n e to i m o e t& De c pl a ins vieAp i to c
Vo. . 1 No2 9 Fb o 7 e .2 0
20年2 o 7 月
存 储单 元 。甚 至可 以说 ,没有存 储 模块 的嵌 入式 系统不 能成 为一个 完整 的嵌入式 系 统 。 由此 可看 出存 储模块 与嵌 入式系统 的密切 程度 。 因为嵌 入式 系统 中大 部分 “ 作” 都需 要存 动 储 模块 的参 与 ,所 以其能 量 消耗也 就 自然 占 了很
而与软 件没 有什 么关 系 。这样 的认 识 。正 如认 为 只有汽 车在 消耗 汽油 而不 是驾驶 员 在 消耗 汽油 一 样 。殊 不知 .不 同的驾驶 员驾驶 相 同的汽 车行 驶 同样 的路 程所 消 耗 的汽油 量是 一定 不一 样 的 。为
C U 时钟 和供 电 电压 的关 系来 达 到 降低 处理 器 P的
功 耗 .从而 减少 系统 的功耗 。
此 ,本 文讨论 了一种从 存储 模块 访 问方 面来 降低
嵌入 式 系统 中能量消耗 新方 法 。
2 嵌 入 式 系统 存 储 模 型 与 功 耗 的 关 系
1 电路 能 量 消 耗 原 理
21 存储 模块 的能 量消耗 . 目前 .数 字 电路 主要 是 以C S 术 来 构 成 MO 技 电路 。相对 曾经大量使 用 的1r 电路 来说 .C S T L MO 电路 有其 自身 的许 多优 点 .其 中之一 是具 有 更低 的 电路功 耗 。该类 型 电路 的功耗 主要 包含 动 态功 耗 、短 路 电流功 耗 和 漏 电 电流 功 耗 三种 。其 中 。 动态 功耗 是 由电路 的等 效 电容产 生 的 .短路 电流

嵌入式系统中的功耗分析和优化

嵌入式系统中的功耗分析和优化

嵌入式系统中的功耗分析和优化随着科技的不断发展,嵌入式系统在现代生活中起着越来越重要的作用。

我们在日常生活中用到的许多电子设备,如智能手机、智能家居、智能手表、智能电视等,都是嵌入式系统的典型代表。

然而,随着这些设备的功能越来越强大,功耗问题也愈加引人关注。

本文将探讨嵌入式系统中的功耗分析和优化。

一、嵌入式系统中的功耗问题功耗问题是嵌入式系统设计面临的主要挑战之一。

随着嵌入式系统中集成电路技术的迅速发展,系统的计算能力和性能越来越强大,但功耗问题却越来越严重。

嵌入式系统的功耗问题主要来源于以下几个方面:1.电池容量的限制许多嵌入式设备都是由电池驱动的,因此电池容量的限制成为了制约嵌入式设备功耗的关键因素。

随着设备功能的不断拓展和人们对长时间使用的需求,为了保证设备的续航时间,需限制设备的功耗。

2.高性能的处理器和应用程序现在许多嵌入式设备都含有高性能的处理器,并支持各种繁琐的应用程序。

例如,智能手机中具有多媒体和视频功能的应用程序和游戏等都需要更高的处理能力,这不仅会增加设备的功耗,而且还会导致设备在短时间内电池耗尽。

3.温度、电压和环境噪声等因素在嵌入式系统设计中,电子元件工作的温度也会对设备的功耗产生显著影响。

此外,不同电压下,电子元器件的功耗也有所不同。

在噪声环境中,许多嵌入式系统设计都需要考虑该环境对元器件的影响。

噪声干扰的严重程度可能导致电子元件无法正常工作,这将影响设备的功耗。

二、功耗分析嵌入式设备的功耗分析是发现系统耗电量的过程,也是构建可降低功耗的系统的关键。

对于功耗分析,通常分为以下两类:1.软件功耗分析软件功耗分析是对软件程序的功耗分析过程。

软件系统通常包括控制逻辑和计算逻辑。

在软件系统中,程序中的每个模块都会消耗功耗。

因此在嵌入式系统中,所使用的软件及其算法决定了系统的功耗消耗。

软件功耗分析的目的是减少功耗。

它需要对软件程序进行全面的分析,考虑从算法、模块、数据结构和电源管理策略方面入手,以实现功耗最小化目标。

嵌入式系统的低功耗技术研究

嵌入式系统的低功耗技术研究

p we —c n u t n t c n l ge r r s n e . o r o s mp i e h o o i s ae p e t d o e
Ke r s: e e d d s se ;C y wo d mb d e y tm MOS c r ut o e n u t n e a u t n;p w rc n u t n me a ;p w rc n u t n o t - ic i;p w rc s mp i v a o o o l i o e o s mp i d l o e o s mp i p i o o mi
z to a in
1 引 言
以往对 电子 系统 的研究 主 要集 中于在满 足 功能
的能耗。不同的研究领域会针对研究侧重点的差异 具体选择使用哪个概念 。 电子 系统 的能 耗研究 主要集 中在 3个 方 面 : ( )嵌入式系统的低功耗技术 。嵌入式系统 , 1 尤其是手持计算设备 ( 如移动电话 ) 功耗 敏感 例 是 的领 域 。该领 域 的研究 主要 考 虑 了用于 给 系统 提 供 能量 的电池系统受到重量和体积的严格限制 ,储能 能力有限的约束 ,必须进行 电子器件的低功耗技术 研究 。通过优化设备在单位时间内的能量消耗 ,来 尽可能多地延长有限电源情况下系统的使用时间。 ( )便携式设备 的供 电系统 技术。便 携式设 2 备( 例如 笔 记 本 电脑 ) 嵌 入 式 系 统 相 比 ,对 系 统 与 的重量和体积的要求有所降低 。因为便携式系统采
这 部分 热 能在 电子系 统 中往 往是 没有 用处 的 ,而 且 还 会产 生 一些 干扰 , 比如 积 聚过 多 的热量 会导 致 电
子系统 的工作 温度升 高 ,影 响 电子器 件 的电气性
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嵌入式系统的低功耗问题分析研究
【摘要】本文介绍了新低功耗技术在当代微控制器中的应用,特别是深度睡眠模式操作技术的应用。

通过分析减少功耗的因素,讨论如何配置微控制器来实现极低功耗的嵌入式设计。

【关键词】低功耗;省电模式;睡眠模式;深度睡眠模式
1.引言
随着越来越多的电子设备由电池供电,低功耗问题已越来越受到关注。

近年来,微控制器制造商也不断在使用新的方式来控制功耗,比如说设计各种各样的电子开关。

通过从电子开关芯片的部件上减小功率,可以极大减少能耗的输出。

另外在电压监控电路方面也有一些研究,持续使用也可以有效的减少能耗。

因此,
对于任何电气系统的设计,功耗都是其重要的考虑因素。

尤其是对于位于无数现代设备核心的嵌入式系统和能使这些大部分系统工作的微控制器。

嵌入式系统在市场中的拓展应用,应用的领域如便携式电子产品,计量应用和医疗设备,使得功耗成为嵌入式系统设计的最重要的考虑之一。

重要的是,一个微控制器不仅消耗尽可能少的功率,并且还有允许最小功耗设计的功能。

为了设计出最好的系统,工程师必须了解一个微控制器可能提供的所有的节电功能,功能包括选择最好的设备,以及如何利用利用这些特性来达到最经济的能源利用。

2.影响微处理器的能耗因素
影响微处理器的能耗因素主要有两个:动态功率和静态功率。

动态功率的消耗目前是由数字逻辑开关引起的,这时微控制器处于主动模式。

动态功率主要受到时钟速度的影响,另外是受到电压和温度的影响。

因此,动态功率的控制在很大程度上是时钟速度的控制。

静态功率的消耗是当主时钟被禁用时,微控制器处于断电模式引起的。

静态功率主要是由晶体管漏和电压控制器所使用的电流产生的。

对于许多的微控制器来说,还需要必要的逻辑时钟来从静态功耗模式中恢复操作(比如看门狗定时器)。

静态功率主要受到电压高低和温度的影响,这两者也是对晶体管漏电流产生的重要因素。

因此,尽管大部分的静态功耗取决于设备的设计和制造过程。

通过以上分析电压对动态功率和静态功率都有影响,最低供电电压对微控制器的低功耗来说是非常关键的。

可以通过公式1得到平均电流。

平均电流可以用来评估低功率性能。

平均电流越小,低功率性能越好。

平均电流
= ((iActive x tActive)+(iSleep x tSleep))/(tActive+ tSleep)(1)
3.新低功耗技术
从现有的技术发展上看,目前已实现让微控制器进入睡眠模式来降低应用中的功耗。

但是随着微控制器变得越来越复杂,使用上也越来越先进,该方式的不足之处也随之出现。

把传统的微控制器和市场上未来10年到20年所需要的由电池供电的产品相比,传统的睡眠模式已不再适用。

现在大多数电子产品均需要极低功率消耗。

最近,制造商在微控制器中采用了更新模式来减少低功耗,这种微控制器可以抵消由日益复杂化和几何图形日益变小带来的负面影响。

这种模式称之为深度睡眠模式。

在高级模式中,处于深度睡眠的各种各样的装置都在以同样的方式运行。

使用嵌入式软件控制开关的芯片的重要区域,不再有能量消耗。

通过去除了芯片某些领域的功率,晶体管漏也被删除,电池寿命显著延长。

尽管制造商们改进睡眠模式的程度有所提高,但是睡眠电流降低80%是常见的。

事实上,现在一些微控制器可以在睡眠模式中实现低达20nA的电流。

将低电流和可以低自放电率的电池联系起来,深度睡眠模式可以作为应用程序存在很长时间。

4.低功耗的实现
1)尽可能的使微控制器处于断电模式
处于操作模式的微控制器会比处于断电模式的微控制器消耗更多的电流。

如方程式2所描述的,我们可以使微控制器处于断电模式来减少平均电流。

通常我们使用低功率指令来达到断电模式,使用WDT使微控制器从睡眠模式恢复过来。

我们可以配置WDT的时长来达到一种长时间的断电状态。

对于某些微控制器来说,WDT时期可以长达多天。

我们可以通过长时间的断电来达到低功耗。

2)在睡眠模式时减少外围设备的使用可以降低功耗
睡眠模式的电力消耗(数码睡眠)是由电流断电和外围电流断电引起的。

如果一个外围模块式活跃的,它将消耗一些电流,甚至是当微控制器处于睡眠模式时。

在进入睡眠模式之前,禁用不必要的模块,可以降低数码睡眠模式的电流,同时有助于低功率设计。

一些重要的模块,比如BOR,可能仍然活跃在睡眠模式中,由于睡眠状态有很长的工作周期,这是降低平均电流的重要因素,对于低功耗高性能也非常重要。

3)降低工作电压
减少设备的工作电压,即Vdd,是一个降低整体功耗的有用步骤。

当开始消耗功耗时,功耗主要受时钟速度的影响。

当设备处于睡眠模式时,晶体管的漏电流是关键。

在低电压时,切换系统时钟需要少的电流,晶体管漏也需要少的电流。

重要的是,要注意如何降低工作电压降低的最大允许操作的频率。

选择允许应用程序以其最大速度运行的最优电压。

请参考所给定设备电压的最大工作频率的设备数据表。

4)使用新的极端低功率模式
在深度睡眠模式或LPM5模式下,CPU 和所有外围设备,除了RTCC、DSWDT和液晶(LCD设备)外,都不提供电源。

此外,深度睡眠模式会降低Flash,SRAM和电压监控电路的功率。

这显示深度睡眠模式比其他的任何操作模式都能降低功耗。

大多数设备的典型睡眠模式电流小于50nA。

四个字节的数据保留在DSGPRx寄存器中,这个寄存器可以用来保存一些应用程序的关键数据。

在深度睡眠模式中,I/Q系统和32kHz晶体振荡器(Timer1和SOSC)仍处于运行状态,所以深度睡眠模式不中断应用程序的操作。

中断RTCC,唤醒超低功耗,DSWDT超时,外部中断O(INTO),MCLR或POR可以唤醒在深度失眠模式的设备。

在唤醒设备的同时,恢复工作复位向量。

深度睡眠模式允许一个设备达到尽可能低的静态功率。

代价是,固件苏醒后必须重新初始化。

因此,深度睡眠模式最好用于需要长寿电池和长时间睡眠的应用程序。

5)正确配置端口针
微控制器都有双向I/Q针,这些针有模拟输入功能。

值得注意的是,将信号应用于这些针,就能消耗最少的功率。

A.配置未使用的端口针
如果一个端口针未被使用,它会被孤立起来毫无联系性,但它会被配置为输出针的高状态和低状态。

或者它被配置为有外部电阻(大约10 kΩ)的输入。

如果配置为输入,只有针输入泄露电流通过针口(如果针与Vdd或Vss直接连接,相同的电流则会流过)。

两个选项允许针被推后使用,可以对硬件的输入或者输出不做修改。

B.数字输入
数字输入插口消耗最少的功率时,是在输入电压靠近Vdd附近或Vss附近。

如果输入电压之间的中点附近Vdd,Vss,数字输入缓冲区内的晶体管偏见在线性区域会消耗大量的电流。

如果这样就可以配置为模拟输入,数字缓冲是关闭,减少电流以及总控制器电流。

C.模拟量输入
模拟输入有一个非常高阻抗,所以他们消耗很少的电流。

他们将当前消费低于一个数字输入,如果应用电压通常会集中Vdd和Vss之间。

有时是适当的和可能的数字输入配置为模拟输入时,数字输入必须去一个低功率状态。

D.数字输出
没有额外的电流被数字输出接脚除了当前经历销权力外部电路。

密切关注外部电路来减少他们当前的消费。

6)使用高价值上拉电阻
更多情况下使用较大的上拉电阻等I / O别针MCLR,I2C?信号,开关和不同电阻规格。

例如,一个典型的I2C牵引为4.7 k。

然而,当I2C传输和拉一条线低,这对每个总线电流消耗近700 uA 3.3 v。

通过增加大小的I2C引体向上10 k,当前可以减半。

这种技术是特别有用的情况下牵引可以增加到一个非常高的电阻如100k或1M。

5.总结
通过引入新的低功耗技术,我们可以继续关注能耗作为一个关键设计目标。

结果是不仅令人印象深刻的设备功能和性能,但功耗低于长期行业最低。

当创建一个低功耗应用程序,方法是很重要的从低功率的角度设计的所有方面。

本文讨论的都是什么导致功耗,在新的低功耗模式进行了初步调查,介绍了方法来达到极端的低功耗设计。

参考文献:
[1]Jason Tollefson,“Achieving extremely low power for portable apps”,Electronic PRODUCTS,Feb.2010. (references).
[2]E. Schlunder,“Deep Sleep Mode on Microchip PIC18 and PIC24 Microcontrollers”
[3]“MSP430F21x2 Mixed Signal Microcontroller Data Sheet” (SLAS578D),Texas Instruments Inc.,2007.
[4]Brant Ivey,nanoWatt and nanoWatt XLP? Technologies:An Introduction to Microchip’s Low-Power Devices.
注:
本课题为湖北省高等学校2013年省级大学生创新创业训练计划项目(编号201311798014)。

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