c8051f020端口配置说明书
品诺电子C8051F仿真器产品说明书
品诺电子C8051F仿真器产品说明书目录目录 (2)一、产品概述 (3)1.1 C8051F调试工具简介 (3)1.2 产品性能 (4)1.3 仿真器接口定义 (4)二、在KEIL下使用USB Debug Adapter (5)三、使用批量下载工具 (7)3.1 U-EC5中文下载程序 (7)3.2 Silicon Laboratories Flash Utility (8)3.3 Silicon Labs MCU Production Programmer (9)四、EC6固件更新 (10)一、产品概述1.1 C8051F调试工具简介C8051F系列单片机是Silabs公司推出的一系列增强型51单片机，其指令集兼容传统MCS-51。
内核采用增强型CIP-51，其最大指令速率达到100MIPS，丰富的外设以及灵活的交叉开关，形成一个SOC，为目前绝大多数8位单片机所不能比拟。
C8051F单片机目前正在高速增长，由于具有兼容传统51的先天优势，已经被越来越多的爱好者和设计者所青睐，C8051F单片机已经进入大学课堂，成为大学单片机教材。
C8051F单片机开发工具经过多个版本发展，经历了并口、串口、USB-串、USB。
目前，以及发展到真正的USB通信，不再使用串并口或者虚拟串口。
C8051F开发工具还包括U-PDC等，但是使用最方便、最普遍的仍然是U-EC6。
品诺电子U-EC6仿真器采用国外原装电路改进而来，可实现支持单步、连续单步、断点、观察点、堆栈监视器, 可以观察/修改存储器和寄存器, 下载程序到Flash存储器等功能，兼容国内任何一家的C8051F调试工具。
多次得到高校的批量订单，使用效果反馈良好。
请定期去官方网站件，以达到更好的使用效果。
也可以在国内代理商下载。
1.2 产品性能 - 可与Keil 、silabs 官方推出的各种软件，如Silicon Laboratories IDE ，FLASH UtilityProgrammer ，Product Programmer ，新华龙U-EC5中文下载程序软件等软件实现无缝连接调试。
C8051F020概述
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12-位 模拟---数字转换器(ADC0)
12-bit片上 逐次逼近型(SAR) 模拟—数字转换器 (ADC0) 9通道多路输开关和可编程的增益放大器 ADC 通过它专用寄存器编程 一个输入通道连接到内部温度传感器,其他的8个通则连接到 外部的输入引脚
14
8-Bit 模拟—数字转换器(ADC1)
CIP-51 介绍
CIP-51 是 Silicon Labs 公司的 C8051F020 MCU的CPU CIP-51实现了标准的 8051 结 构和定制的外设。 在25 MHz时,其峰值速度可达到 25MIPS CIP-51总共有 109 指令
3
C8051F020 系统概览
Silicon Labs 公司的 C8051F020是一款高集成 度的单芯片片上系统的混 合信号芯片，100引脚封装
98 90 88 80
ADC1CF
AMX1SL
P3IF
P2
SCON0 P1 TCON
EMI0TC
SBUF0 TMR3CN TMOD SPI0CFG TMR3RLL TL0
EMI0CF
SPIODAT TMR3RLH TL1
P0MDOUT
ADC1 TMR3L TH0
P1MDOUT
SPI0CKR TMR3H TH1
ADC1 也可以使用模拟电源 电压(AV+)作为参考电压。
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内部参考电压发生器
内部参考电压电路由一个1.2 V 的带隙基准电压发生器和一个 2倍增益的输出缓冲放大器组成(2.4 V 输出)
内部的参考电压可以通过VREF引脚连到应用系统中的外部器 件也可以连到芯片的其它电压参考上
内部参考电压的使能/禁止及ADC0,ADC1的参考电压的选择 是通过参考电压控制寄存器REF0CN来配置的.
C8051F020实验指导书
单片机实验指导书目录第一章：实验设备简介............................ 错误!未定义书签。
系统实验设备的组成......................... 错误!未定义书签。
Silicon Labs C8051F 单片机开发工具简介..... 错误!未定义书签。
DICE-C8051F嵌入式实验/开发系统简介........ 错误!未定义书签。
第二章集成开发环境KEIL C软件使用指南......... 错误!未定义书签。
2．1 KEIL C软件具体使用说明................ 错误!未定义书签。
第三章实验指导................................. 错误!未定义书签。
C8051F 单片机I/O 口交叉开关设置.......... 错误!未定义书签。
数字I/O端口实验.......................... 错误!未定义书签。
定时器实验................................. 错误!未定义书签。
外部中断实验............................... 错误!未定义书签。
键盘显示实验............................... 错误!未定义书签。
六位动态LED数码管显示实验................ 错误!未定义书签。
RS3232串口通讯实验....................... 错误!未定义书签。
综合设计.................................. 错误!未定义书签。
使用特别说明：(1) 每次实验前，请仔细阅读实验指导，连线完毕，检查无误后，方可打开电源。
即连线时必须在断电状态下。
(2) 程序运行过程中，不要关闭电源，如果要断电，必须停止运行程序，并且退出程序调试状态，否则会引起KEIL C软件非正常退出，甚至引起DICE-EC5仿真器工作异常。
C8051F020入门指导解读
MCU 的程序存储器包含64K 字节的FLASH。该存储器 以512 字节为一个扇区，可以在系统编程，且不需特别的 外部编程电压。
1.3 JTAG 调试和边界扫描
C8051F020系列具有片内JTAG边界扫描和调试电路， 通过4脚JTAG接口并使用安装在最终应用系统中的产品器 件就可以进行非侵入式、全速的在系统调试。 该JTAG接口完全符合IEEE1149.1规范，为生产和测试 提供完全的边界扫描功能。 Silicon Labs的调试系统支持观察和修改存储器和寄 存器，支持断点、观察点、堆栈指示器和单步执行。
在一个标准的8051 中，除MUL 和DIV 以外所有指令 都需要12 或24 个系统时钟周期，最大系统时钟频率为 12-24MHz。 而对于CIP-51 内核，70%的指令的执行时间为1 或2 个系统时钟周期，只有4 条指令的执行时间大于4 个系统 时钟周期。
1.1.3 增加的功能
扩展的中断系统向CIP-51 提供22 个中断源（标准8051 只有7 个中断源），允许大量的模拟和数字外设中断微控 制器。 MCU 可有多达7 个复位源：一个片内VDD 监视器、一 个看门狗定时器、一个时钟丢失检测器、一个由比较器0 提供的电压检测器、一个软件强制复位、CNVSTR 引脚 及/RST 引脚。 MCU 内部有一个独立运行的时钟发生器，在复位后被默 认为系统时钟。如果需要，时钟源可以在运行时切换到外 部振荡器，外部振荡器可以使用晶体、陶瓷谐振器、电容、 RC 或外部时钟源产生系统时钟。
1.4 可编程数字I/O 和交叉开关
该系列MCU具有标准8051的端口（0、1、2和3）。在 F020/2中有4个附加的端口（4、5、6和7），因此共有64 个通用端口I/O。 每个端口I/O引脚都可以被配置为推挽或漏极开路输出。 数字交叉开关。
C8051F020入门指导
DAC为电压输出方式，有灵活的输出更新机制。这一机制允许
用软件写和定时器2、定时器3及定时器4的溢出信号更新DAC输出。
C8051F020/2的DAC之电压基准由专用的VREFD输入引脚提供，而
C8051F021/3的DAC之电压基准由器件内部的电压基准提供。DAC在
作为比较器的参考电压或为ADC差分输入提供偏移电压时非常有用。
➢
真正8 位500 ksps 的ADC，带PGA 和8 通道模拟多路开关
➢
两个12 位DAC，具有可编程数据更新方式
➢
64K 字节可在系统编程的FLASH 存储器
➢
4352（4096+256）字节的片内RAM
➢
➢
可寻址64K 字节地址空间的外部数据存储器接口
硬件实现的SPI、SMBus/ I2C 和两个UART 串行接
I/O 引脚（C8051F021/3）。下面列出了一些主要特性:
➢
高速、流水线结构的8051 兼容的CIP-51 内核（可达25MIPS）
➢
全速、非侵入式的在系统调试接口（片内）
➢
真正12 位（C8051F020/1）或10 位（C8051F022/3）、 100
ksps 的8 通道ADC，带PGA和模拟多路开关
➢
端口0–3中所有未被交叉开关分配的引脚都可以作为通用I/O
（GPI/O）引脚，通过读或写相应的端口数据寄存器访问。
➢
被交叉开关分配的那些端口引脚的输出状态受使用这些引脚
的数字外设的控制。
➢
不管交叉开关是否将引脚分配给外设，读一个端口数据寄存器
（或端口位）将总是返回引脚本身的逻辑状态。
➢
C8051F020使用说明书
Precision Mixed Signal Copyright © 2007 by Silicon Laboratories11.02.2007Analog Peripherals12-Bit ADC-±1 LSB INL; no missing codes-Programmable throughput up to 100 ksps-8 external inputs; programmable as single-ended or differential -Programmable amplifier gain: 16, 8, 4, 2, 1, 0.5-Data-dependent windowed interrupt generator -Built-in temperature sensor (±3 °C)8-Bit ADC-±1 LSB INL; no missing codes-Programmable throughput up to 500 ksps -8 external inputs-Programmable amplifier gain: 4, 2, 1, 0.5Two 12-Bit DACs-Can synchronize outputs to timers for jitter-free waveform generationTwo ComparatorsInternal Voltage ReferenceV DD Monitor/Brown-out DetectorOn-Chip JTAG Debug & Boundary Scan-On-chip debug circuitry facilitates full speed, non-intrusive in-system debug (no emulator required)-Provides breakpoints, single stepping, watchpoints, stack monitor -Inspect/modify memory and registers-Superior performance to emulation systems using ICE-chips, target pods, and sockets-IEEE1149.1 compliant boundary scanHigh-Speed 8051 µC Core-Pipelined instruction architecture; executes 70% of instructions in 1 or 2 system clocks-Up to 25 MIPS throughput with 25 MHz system clock -22 vectored interrupt sourcesMemory-4352 bytes data RAM-64 kB Flash; in-system programmable in 512-byte sectors (512 bytes are reserved)-External parallel data memory interfaceDigital Peripherals-64 port I/O; all are 5 V tolerant-Hardware SMBus™ (I2C™ compatible), SPI™, and two UART serial ports available concurrently-Programmable 16-bit counter/timer array with 5 capture/compare mod-ules- 5 general-purpose 16-bit counter/timers-Dedicated watchdog timer; bidirectional reset -Real-time clock mode using Timer 3 or PCA Clock Sources-Internal programmable oscillator: 2–16 MHz -External oscillator: Crystal, RC, C, or Clock -Can switch between clock sources on-the-fly Supply Voltage: 2.7 to 3.6 V-Typical operating current: 10 mA at 25 MHz-Multiple power saving sleep and shutdown modes100-Pin TQFPTemperature Range: –40 to +85 °CPrecision Mixed Signal Copyright © 2007 by Silicon Laboratories 11.02.2007Silicon Laboratories and Silicon Labs are trademarks of Silicon Laboratories Inc.Other products or brandnames mentioned herein are trademarks or registered trademarks of their respective holdersSelected Electrical Specifications(T A = –40 to +85 C°, V DD = 2.7 V unless otherwise specified)Package InformationC8051F020DK Development Kit。
C8051F020实验指导书
单片机真验指挥书籍之阳早格格创做目录第一章：真验设备简介11.1 系统真验设备的组成11.2 Silicon Labs C8051F 单片机开垦工具简介11.3 DICE-C8051F嵌进式真验/开垦系统简介3第二章集成开垦环境KEIL C硬件使用指北7 2．1 KEIL C硬件简曲使用证明7第三章真验指挥193.1 C8051F 单片机I/O 心接叉开关树坐193.2 数字I/O端心真验213.3 定时器真验233.4 中部中断真验253.5 键盘隐现真验273.6 六位动背LED数码管隐现真验293.7 RS3232串心通讯真验313.8 概括安排33使用特天证明：(1) 屡屡真验前，请小心阅读真验指挥，连线完成，查看无误后，圆可挨开电源.即连线时必须正在断电状态下.(2) 步调运止历程中，不要关关电源，如果要断电，必须停止运止步调，而且退出步调调试状态，可则会引起KEIL C硬件非仄常退出，以至引起DICE-EC5仿真器处事非常十分.(3) 如出现上述（2）的的误支配，引起DICE-EC5仿真器处事非常十分，可对于DICE-EC5仿真器举止复位.（正在光盘中找到文献夹“USB Reset”中的“USB Debug AdapterFirmware Reset”文献，单打运止，正在弹出的对于话框中面打“Update firmware”按钮，正在提示乐成后，面打“OK”按钮，退出复位步调.DICE-EC5仿真器即可仄常处事.正在下一次调试、下载步调时会提示“Do you want to update serial adapternow? ”,面打“决定”即可.第一章：真验设备简介1.1 系统真验设备的组成DICE-C8051F嵌进式真验/开垦系统由C8051F020 CPU 板、DICE-EC5仿真器战系统真验板三部分组成，应用该设备可举止片上系统单片机较典型应用的真验，请拜睹以下介绍.1.2 Silicon Labs C8051F 单片机开垦工具简介1.2.1 开垦工具概括Silicon Labs 的开垦工具真量上便是估计机IDE 调试环境硬件及估计机USB 到C8051F单片机JTAG 心的协议变换器(DICE-EC5)的推拢.SiliconLabs C8051F 系列所有的单片机片内均安排有调试电路，该调试电路通过鸿沟扫描办法获与单片机片内疑息，通过4 线的JTAG接心与开垦工具对接以便于举止对于单片机正在片编程调试.DICE-C8051F嵌进式真验/开垦系统中的C8051F020 CPU 板上的单片机为C8051F 系列中的F020.仿真器(DICE-EC5)一端与估计机贯串，另一端与C8051F 单片机JTAG 心贯串，应用Keil 的uVision2 调试环境便不妨举止非侵进式、齐速的正在系统编程(ISP)战调试.Silicon Labs 开垦工具支援瞅察战建改死存器战寄存器支援断面、瞅察面、堆栈指示器、单步、运止战停止下令.调试时不需要特殊的目标RAM、步调死存器、定时器大概通疑通讲，而且所有的模拟战数字中设皆仄常处事.1.2.2 开垦工具主要技能指标●支援的目标系统：所有C8051Fxxx 系列单片机.●系统时钟：最大可达25Mhz.●通过USB 接心与PC 机对接.●支援汇编谈话战C51 源代码级调试.●工具支援（Keil C）.1.2.3 IDE 硬件运止环境央供PC 机不妨运止开垦工具硬件并能与串止适配器通疑.对于PC 机犹如下系统央供：● Windows 95/98/Me/NT/2000/XP 支配系统● 32Mb RAM● 40Mb 自由硬盘空间●空忙的USB 心1.2.4 开垦工具与PC 机硬件对接正在系统编程战调试环境如图下所示.硬件对接及硬件拆置：●将USB 串止电缆的一端与教教机的DICE-EC5仿真器USB接心对接；●对接USB 串止电缆的另一端到PC；●给目标系统上电；●拔出CD 并运止“”，将IDE 硬件拆置到您的PC 机；●正在PC 机的开初菜单的“步调”项中采用keil uVision2图标，运止IDE 硬件.1.3 DICE-C8051F嵌进式真验/开垦系统简介1.3.1 C8051F020 CPU 板概括C8051F020 CPU 板是为了便于拆置而安排的;C8051F020 CPU 板是将C8051F020的所有引足(100 个引足)引到四个单排针;该四组单排针可与分歧用户安排的应用系统对接,如正在该教教系统上将战系统真验板对接.证明: C8051F020 CPU 板是将C8051F020的所有引足(100 个引足)引到四个单排针,分别为JX1、JX2、JX3、JX4，四个单排针的内圈100个排针（内圈每个引足证明引足含意）与C8051F020芯片的对于应引足对接.而四个单排针的中圈100个排针（中圈标有引足号）部分引足悬空，而大部分引足已经与真验仪上的真验模块对接.（简曲对接请瞅硬件对接本理图）.果此，本真验/开垦系统大部分真验模块只消将其相映引足的短路块插佳，即可真止与C8051F020单片机系统的对接.而一部分独力真验模块，必须通过导线与C8051F020单片机对接，对接前把要用到的引足上的短路块拔掉，而后用导线将内圈对于应引足与中部模块对接.真验完成后再把相映的短路块插佳.1.3.2 C8051F020 片上系统单片机片内资材①、模拟中设(1) 逐次迫近型8 路12 位ADC0变换速率最大100ksps可编程删益搁大器PGA温度传感器(2) 8 路8 位ADC1 输进与P1 心复用变换速率500ksps可编程删益搁大器PGA(3) 二个12 位DAC(4) 二个模拟电压比较器(5) 电压基准里里提供中部基准可输进(6) 透彻的VDD 监视器②、下速8051 微统造器内核流火线式指令结构速度可达25MIPS22 个矢量中断源③、死存器片内4352 字节数据RAM64KB Flash 步调死存器可做非易得性死存中部可扩展的64KB 数据死存器接心④、数字中设8 个8 位的端心I/OI2C、SPI、2 个巩固型UART 串心可编程的16 位计数器/定时器阵列(PCA)5 个通用16 位计数器/定时器博用的瞅门狗WDT更小心资料可拜睹Silicon Labs C8051F02x datasheet1.3.3DICE-C8051F嵌进式真验/开垦系统硬件组成（1）CPU板：CPU核心模块采与C8051F020芯片，该芯片是C8051F系列单片机中功能最为其齐的一款；（2）片内：64K FLASH， 4K XRAM片中扩展：256K FLASH， 32K XRAM（3）CPU板C8051F020芯片I/0引足局部引出，不妨战用户中部电路对接；（4）真验系统戴有JTAG接心，并配有DICE-EC3型USB下速通讯仿真器，通过4足的JTAG接心不妨举止非侵进式、齐速的正在线系统调试、仿真；（5）4*4阵列式键盘；（6）8位逻辑电仄开关输出、8位LED逻辑电仄隐现；（7）6位动背八段LED数码管；（8）2路单脉冲旗号爆收电路战1路8MHZ时钟爆收电路；（9）时钟分频电路；（10）模拟量爆收器电路战逻辑笔电路；（11）8*8LED面阵及启动电路；（12）128*64 LCD液晶隐现屏；（13）蜂鸣器电路；（14）曲流电机测速电路；（15）四相步进电机及启动电路；（16）继电器电路及接心；（17）单通讲RS-232 接心；（18）SPI 接心，LED 数码管隐现；（19）IIC 接心，接24C01 串止EEPROM；（20）IIC 接心，PCF8563日历时钟；（21）8 路12 位AD，2 路12 位DA 接心；（22）D12 USB 从机通疑；（23）SL811 USB 主机通疑；（24）RTL8019 10M 以太网通疑；1.3.4DICE-C8051F嵌进式真验/开垦系统天面及初初化证明●天面调配如下：0x0000-0x7fff,数据死存器SRAM天十范畴0x8000-0x87ff,D12_CS片选0x8800-0x8fff,SL811_CS片选0x9000-0x97ff,RTL8019_CS片选0x9800-0x9fff,LCD_CS片选0xA000-0xA7ff，死存0xA800-0xAfff，死存0xB000-0xB7ff，死存0xB800-0xBfff，死存0xc000-0xffff(x16),Flash,片选天面由P4 矮4 位端心决定●系统初初化：C8051F020 CPU板使用中部22.1184M 晶振，系统初初化后应用中部22.1184M 晶振，如果不举止系统初初化，系统将使用里里晶振，默认值为2M，也不妨通过树坐OSCICN 寄存器改变里里晶振的大小（可选值为2M、4M、8M、16M）.●端心初初化：咱们根据c8051F020 CPU板及真验系统安排规划，摆设接叉开关，为UART0、SPI、SMBus、UART1、CEX0、CP0、T0、T1、INT0、INT1、INT2 战INT3 调配端心引足.其余，咱们将中部死存器接心摆设为复用办法并使用下端心.摆设步调如下：(1) 按CP0E=1,ECI0E=0,PCA0ME=001,UART0EN=1,SPI0EN=1,SMB0EN=1 树坐XBR0=0x8f；(2) 按SYSCKE=0,T2EXE=0,T2E=0,INT1E=1,T1E=1,INT 0E=1，T0E=1，CPI1E=0 树坐XBR1=0x1e；(3) 按WEAKPUD=0,XBARE=1,位5为0 用T4EXE=0,T4E=0,UART1E=1,EMIFLE=0,CNVSTE=0 树坐XBR2=0x44(4) 将中部死存器接心摆设为复用办法，并使用下端心，有PRTSEL=1,EMD2=0.(5) 将动做数字输进的端心1 引足摆设为数字输进办法，树坐P1MDIN 为0xFF.(6) 通过树坐P0MDOUT=0x34 、P1MDOUT=0xfd 、P2MDOUT= 0xf0 、P3MDOUT = 0xff，将矮端心输出办法树坐为推挽办法.树坐下端心输出办法P74OUT=0xf7;总线输出办法应试虑处事频次战启动本领，正在下速战下启动时总线应树坐为推挽办法，正在矮速战矮启动时漏极开路也可谦足央供，但是宁静性不下.(7) 树坐中部死存器摆设EMI0CF=0x2d；树坐中部死存器时序统造EMI0TC=0x9e；如果LCD 不克不迭仄常隐现不妨使EMI0CF=0x2f，EMI0TC=0xff 树坐为最大值；也不妨减小中部晶振大概使用里里晶振.第二章集成开垦环境KEIL C硬件使用指北2．1 KEIL C硬件简曲使用证明Keil C 拆置:睹..\tools\KeilC51v751a_Full\拆置证明.txt;拆置完成后，如果要使用DICE-EC5仿真器去仿真C8051F系统单片机，还需要拆置启动步调：加进“”，面打“SiC8051F_uv2”，曲至拆置完成.加进 Keil C51 后，屏幕如下图所示.几秒钟后出现编写界开用Keil C51时的屏幕加进Keil C51后的编写界里简朴步调的调试：教习步调安排谈话、教习某种步调硬件，最佳的要领是间接支配试验.底下通过简朴的编程、调试，带领大家教习Keil C51硬件的基础使用要领战基础的调试本领. 1)建坐一个新工程单打Project菜单，正在弹出的下推菜单中选中New Project选项2)而后采用您要死存的路径,输进工程文献的名字,比圆死存到C51目录里,工程文献的名字为C51.如下图所示,而后面打死存.3)那时会弹出一个对于话框,央供您采用单片机的型号,您不妨根据您使用的单片机去采用,keil c51险些支援所有的51核的单片机,尔那里仍旧以大家用的比较多的Atmel 的89C51去证明,如下图所示,采用89C51之后,左边栏是对于那个单片机的基础的证明,而后面打决定.（注意：咱们真验系统使用的单片机为Silicon Laboratories公司的C8051F020芯片）.4)完成上一步调后，屏幕如下图所示到目前为止，咱们还不编写一句步调，底下开初编写咱们的第一个步调.5)正在下图中，单打“File”菜单，再正在下推菜单中单打“New”选项新建文献后屏幕如下图所示此时光标正在编写窗心里闪烁，那时不妨键进用户的应用步调了，但是笔者提议最先死存该空黑的文献，单打菜单上的“File”，正在下推菜单中选中“Save As”选项单打，屏幕如下图所示，正在“文献名”栏左侧的编写框中，键进欲使用的文献名，共时，必须键进透彻的扩展名.注意，如果用Ｃ谈话编写步调，则扩展名为(.c)；如果用汇编谈话编写步调，则扩展名必须为(.asm).而后，单打“死存”6)回到编写界里后，单打“Target1”前里的“＋”号，而后正在“Source Group 1”上单打左键，弹出如下菜单而后单打“Add File to Group ‘Source Group 1’”屏幕如下图所示选中Test.c，而后单打“Add”屏幕佳下图所示“Source Group 1”文献夹中多了一身材项“Text1.c”了吗？子项的几与所减少的源步调的几相共 .7)目前，请输进如下的C谈话源步调: #include<reg52.h> //包罗文献#include<stdio.h>void main(void) //主函数{SCON=0x52;TMOD=0x20; TH1=0xf3;TR1=1; //此止及以上3止为PRINTF函数所必须printf(“Hello I am KEIL. \n”);//挨印步调真止的疑息printf(“I will be your friend.\n”);while(1);} 正在输进上述步调时，读者已经瞅到了预先死存待编写的文献的佳处了吧，即Keil c51会自动辨别关键字，并以分歧的颜色提示用户加以注意，那样会使用户少犯过得，有用处普及编程效用.步调输进完成后，如下图所示:8)正在上图中，单打“Project”菜单，再正在下推菜单中单打“Built Target”选项（大概者使用快速键F7），编译乐成后，再单打“Project”菜单，正在下推菜单中单打“Start/Stop Debug Session”（大概者使用快速键Ctrl+F5）,屏幕如下所示 :9)调试步调:正在上图中，单打“Debug”菜单，正在下推菜单中单打“Go”选项，（大概者使用快速键F5），而后再单打“Debug”菜单，正在下推菜单中单打“Stop Running”选项（大概者使用快速键Esc）；再单打“View”菜单，再正在下推菜单中单打“Serial Windows #1”选项，便不妨瞅到步调运止后的截止，其截止如下图所示至此，咱们正在Keil C51上搞了一个完备工程的齐历程.但是那不过杂硬件的开垦历程，怎么样使用步调下载器瞅一瞅步调运止的截止呢？下一节咱们将介绍Keil C硬件与DICE-EC3仿真器的摆设证明.2．2 KEIL C 硬件与DICE-EC5仿真器摆设证明1．本摆设是针对于本公司的仿真开垦工具DICE-EC5的摆设要领；2．Keil C 硬件摆设如下：挨开Keil 硬件，新建一工程，采用Silicon Laboratories公司的C8051F020 动做CPU(根据本量CPU)：（1）采用摆设如下图：（2）隐现如下图：（3）OUTPUT选项摆设：（4）A51汇编选项：（5）DEBUG选项：面打”Settings”此时必须决定DICE-EC5仿真器与PC处于联机状态！！！面打决定，完成树坐.第三章真验指挥3.1 C8051F 单片机I/O 心接叉开关树坐劣先权接叉开关译码器，大概称为“接叉开关”，按劣先权程序将端心0 – 3 的引足调配给器件上的数字中设（UART、SMBus、PCA、定时器等）.端心引足的调配程序是从开初，不妨背去调配到P3.7.UART0有最下劣先权，而CNVSTR具备最矮劣先权.为数字中设调配端心引足的劣先权程序列于下图.当接叉开关摆设寄存器XBR0、XBR1 战XBR2 中中设的对于应允许位被树坐为逻辑‘1’时，接叉开关将端心引足调配给中设，相关的特殊功能寄存器的定义睹数据脚册大概相关书籍籍.接叉开关引足调配示例：正在本例中，咱们将摆设接叉开关，为UART0、SMBus、UART1、/INT0 战/INT1 调配端心引足（共8 个引足）.其余，咱们将中部死存器接心摆设为复用办法并使用矮端心.咱们还将、P1.3 战P1.4 摆设为模拟输进，以便用ADC1 丈量加正在那些引足上的电压.摆设步调如下：（1）按UART0EN = 1、SMB0EN = 1、INT0E = 1、INT1E = 1 战EMIFLE =1 树坐XBR0、XBR1 战XBR2，则有：XBR0 = 0x05，XBR1 = 0x14，XBR2 = 0x02.（2）将中部死存器接心摆设为复用办法并使用矮端心，有：PRTSEL = 0，EMD2 = 0.（3）将动做模拟输进的端心1 引足摆设为模拟输进办法：树坐P1MDIN 为0xE3（、P1.3 战P1.2 为模拟输进，所以它们的对于应P1MDIN 被树坐为逻辑‘0’）.（4）树坐XBARE = 1 以允许接叉开关：XBR2=0x42.●UART0 有最下劣先权，所以P0.0 被调配给TX0，P0.1 被调配给RX0.●SMBus 的劣先权次之，所以P0.2 被调配给SDA，P0.3 被调配给SCL.●接下去是UART1，所以P0.4 被调配给TX1.由于中部死存器接心选正在矮端心（EMIFLE = 1），所以接叉开关跳过P0.6(/RD)战P0.7(/WR).又果为中部死存器接心被摆设为复用办法，所以接叉开关也跳过P0.5(ALE).下一个已被跳过的引足P1.0 被调配给RX1.●接下去是/INT0，被调配到引足.●将P1MDIN 树坐为0xE3，使、P1.3 战P1.4 被摆设为模拟输进，引导接叉开关跳过那些引足.●底下劣先权下的是/INT1，所以下一个已跳过的引足P1.5 被调配给/INT1.●正在真止对于片中支配的MOVX 指令功夫，中部死存器接心将启动端心2 战端心3.（5）咱们将UART0 的TX 引足（TX0，）、UART1 的TX 引足（TX1，）、ALE、/RD、/WR（P0.[7:3]）的输出树坐为推挽办法，通过树坐P0MDOUT = 0xF1 去真止.（6）咱们通过树坐P2MDOUT = 0xFF 战P3MDOUT = 0xFF 将EMIF 端心（P2、P3）的输出办法摆设为推挽办法.咱们通过树坐P1MDOUT = 0x00（摆设输出为漏极开路）战P1 = 0xFF（逻辑‘1’采用下阻态）克制3 个模拟输进引足的输出启动器.3.2 数字I/O端心真验一、真验脚段掌握C8051F020 I/0的使用，教习延时子步调的编写.二、真验真量P1心输出心，接八只收光二极管，编写步调，使收光二极管循环面明.三、真验本理介绍C8051F020有8位端心构造的64个数字I/O引足.矮端心（P0、P1、P2、P3）既不妨按位觅址，也不妨按字节觅址.下端心（P4、P5、P6、P7）只可按字节觅址.所有引足皆耐5V电压，皆不妨被摆设为漏极开路大概推挽输出办法战强上推.C8051F020器件有洪量的数字资材需要通过4个矮端I/O端心P0，P1，P2，P3才搞使用.但是本真验中主要介绍的I/O心主要动做通用的端心I/O （GPIO）引足去使用.每个端心引足的输出办法皆可被摆设为漏极开初大概推挽办法，缺省状态为漏极开路.正在推挽办法，背端心数据寄存器中的相映位写逻辑0将使端心引足被启动到GND，写逻辑1将使端心引足被启动到VDD.正在漏极开路办法，背端心数据寄存器中的相映位写逻辑0将使端心引足被启动到GND，写逻辑1将使端心引足处于下阻状态.当系统中分歧器件的端心引足有共享对接，即多个输出对接到共一个物理线时（比圆SMBus对接中的SDA旗号），使用漏极开路办法不妨预防分歧器件之间的争用.I/O端心的输出办法由PnMOUT寄存器中的对于应位决断.本真验中咱们用P1心启动收光二极管面明，果此必须将P1心定义为推挽办法.四、电路本理图五、真验步调框图六、真验步调步调功能：由P1心启动收光二极管循环面明.P1.0~P1.7接L1~L8（JP14）3.3 定时器真验一、真验脚段掌握C8051F020里里定时器/计数器的应用.二、真验真量本文献是LED灯闪烁真验步调；使用定时器0定时1秒，LED灯每隔1秒明1秒；使用中部22.1184MHz晶振.三、真验本理介绍C8051F020里里有5个计数器/定时器T0，T1，T2，T3战T4.那些计数器/定时器皆是16位，其中T0、T1、T2与尺度8051中的计数器/定时器兼容.T3、T4可用于ADC、SMBus大概动做通用定时器使用，T4还可用做C8051F02x中第二串心（UART1）的波特率爆收器.那些计数器/定时器不妨用于丈量时间隔断，对于中部事变计数大概爆收周期性的中断哀供.定时器0战定时器1险些真足相共，有4种处事办法.定时器2减少了一些时器0战定时器1中所不的功能.定是器3与定时器2类似，但是不捕获战波特率爆收器办法.定时器4与定时器2真足相共，可用做UART1的波特率爆收器.下表所列为定时器的处事办法：本真验中使定时器0处事正在办法1（TMOD=0x01）,TIM0定时器时钟为系统时钟的1/12（CKCON=0x00）.简曲寄存器定义请参照教科书籍.四、真验步调框图（注：真验时不需要液晶隐现）五、真验步调确认P3.5心与引足49上插有短路块，则收光二极管L1与P3.5已连.调进步调、拆载、运止，瞅察收光二极管是可每隔1秒明1次.3.4 中部中断真验一、真验脚段认识C8051F020 中部中断6/7 的使用.二、真验真量此步调尝试C8051F020的中断6、7，可正在相映的二其中断中设断面瞅察，当单脉冲按钮按下之后，加进中断处理时P4.4统造蜂鸣器鸣喊一声，收光二极管也共时闪烁一次.三、真验本理介绍CIP-51包罗一个扩展的中断系统，支援22其中断源，每其中断源有二个劣先级.中断源正在片内中设与中部输进之间的调配随器件的分歧而变更.每其中断源不妨正在一个SFR中有一个大概多其中断标记.当一其中设大概中部源谦足灵验的中断条件时，相映的中断标记被置为逻辑1.如果中断被允许，正在中断标记被置位时爆收中断.一朝目前指令真止完，CPU爆收一个LCALL到预约天面，开初真止中断服务步调（ISR）.每个ISR必须以RETI指令中断，使步调回到中断前真止的那条指令的下一条指令.如果中断已被允许，中断标记将被硬件忽略，步调继承仄常真止（中断标记置1与可不受中断允许/克制状态的做用）.每一其中断源皆不妨用一个SFR（IE~EIE2）中的相关中断允许位去允许大概克制，但是必须先将EA位（IE.7）置1，以包管每个单独的中断允许位灵验.不管每其中断允许位的树坐怎么样，EA位浑0将克制所有中断.本真验主要介绍C8051F020 中部中断6/7（对于应P3.6战P3.7）.P3.6战P3.7可被摆设为边沿触收的中断源.用IE6CF（P3IF.2）战IE7CF （P3IF.3）位不妨将那二其中断源摆设为下落沿大概降下沿触收.当检测到引足P3.6战P3.7有下落沿大概降下沿爆收时，P3IF寄存器中对于应的中部中断标记（IE6大概IE7）将被置1.如果对于应的中断被允许，将会爆收中断，CPU将转背对于应的中断背量天面.端心3中断标记位：位7 IE7 中部中断7标记位0当检测到P3.7引足的下落沿大概降下沿时，该标记由硬件置位位6 IE6 中部中断6标记位0当检测到P3.7引足的下落沿大概降下沿时，该标记由硬件置位位5~4 已使用.读=00b,写=忽略位3 IE7CF 中部中断7边沿摆设位0中部中断7由IE7输进的下落沿触收1中部中断7由IE7输进的降下沿触收位2 IE6CF 中部中断6边沿摆设位0中部中断6由IE6输进的下落沿触收1中部中断6由IE6输进的降下沿触收位1~0 已使用.读=00b,写=忽略四、真验步调框图五、真验步调P2.0接L7；P2.1接L8；P3.6接JP7；P3.7接JP7；P4.4用短路块接蜂鸣器.按下单脉冲按钮,JP7爆收一个下落沿脉冲,加进中断后,蜂鸣器鸣喊一声,相映收光二极管也共时闪烁一次.3.5键盘隐现真验一、真验脚段掌握止列式键盘的处事本理.二、真验真量每按下一个键，蜂鸣器响一声，并正在LED数码管上隐现相映的字符.三、真验本理介绍正在键盘中按键数量较多时，为了缩小I/O心的占用，常常将按键排列成矩阵形式，也便是常道的止列式键盘.止列式键盘中的键本量上便是一个板滞开关，该开关位于止线战列线的接面处.当键被按下时，其接面的止线战列线接通，相映止线大概列线上的电仄爆收变更，进而决定被按下的功能键.时常使用的键辨别要领有：止扫描法、线翻转法战利用8279键盘接心的中断法.前二种要领相称于查询法，需要反复查询按键的状态，会占用洪量的CPU时间；后一种要领正在有键按下时背CPU申请中断，通常本去不需要占用CPU时间.本真验中咱们介绍止扫描法，其按键识别的历程如下：A：将局部止线SEL0~SEL3置为矮电仄，而后检测列线的状态.只消有一列的电仄为矮，则表示键盘中有键被按下，而且关合的键位于矮电仄线与4根止线相接叉的4个按键之中.若所列线均为下电仄，则键盘中无键按下.B：推断关合键天圆的位子.正在确认有键按下后，即可加进决定简曲关合键的历程.其要领是：依次将止线置为矮电仄，即正在置某根止线为矮电通常，其线为下电仄.正在决定某根止线位子为矮电仄后，再逐止检测各列线的电仄状态.若某列为矮，则该列线与置为矮电仄的止线接叉处的按键便是关合的按键.四、真验本理图五、真验步调框图（注：真验时只需LED数码管隐现）六、真验步调定义16个键为'0'~'F'，每按下一个键，蜂鸣器响一声，并正在LED数码管上隐现相映的字符.P5.0~P5.3接SEL0~SEL3，P5.4~P5.7接RL0~RL3，P4.4接ALARM，P3.5接L1(JP14)（以上连线里里已经连佳，只消将对于应的短路块插上即可.），P1.0~P1.7接a~dp(JP18，LED段码端)，P0.0接LED大众端所有一端(JP17).3.6 六位动背LED数码管隐现真验一、真验脚段认识并掌握LED七段数码管的处事本理，并掌握动背数码管的步调编写.二、真验真量本真验主假如六位八段LED数码管动背隐现，例步调隐现“123456”.三、真验本理介绍正在单片机应用系统中可利用LED隐现块机动天形成所央供位数的隐现器.N位LED隐现器有N 根位选线战8×N根段选线.根据隐现办法的分歧，位选线战段选线的对接要领有所分歧.段选线统造字符采用，位选线统造隐现位的明大概暗.LED隐现器有二种隐现办法：固态隐现战动背隐现.本真验介绍动背LED数码管的处事本理.LED动背隐现是将所有位的段选线并接正在一个I/O心上，共阳极度大概共阳极度分别由相映的I/O心线统造.每一位的段选线皆接正在一个I/O心上，所以每支一个段选码，每位LED数码管皆隐现共一个字符，那种隐现器是不克不迭用的.办理此问题的要领是利用的视觉滞留，从段选线上按位次分别支隐现字符的段选码，正在位选统造心也按相映的序次分别选通相映的隐现位（共阳极支矮电仄，共阳极支下电仄），选通位便隐现相映字符，并脆持几亳秒的延时，已选通位不隐现字符（脆持燃烧）.那样，对于诸位隐现便是一个循环历程.从估计机的处事去瞅，正在一个瞬时惟有一位隐现字符，而其余位皆是燃烧的，但是果为人的视觉滞留，那种动背变更是觉察不到的.从效验上瞅，诸位隐现器能连绝而宁静天隐现分歧的字符.那便是动背隐现.四、真验本理图五、真验步调框图六、真验步调本步调主假如六位八段LED数码管动背隐现，例步调隐现“123456”.p1.0~p1.7接JP18（a~dp LED段码端）;p0.0~p0.5接JP17（L1~L6 LED大众端）；注意：拿掉相映足的短路块，用导线对接，并注意引足程序.3.7 RS3232串心通讯真验一、真验脚段掌握RS-232 串心通疑步调的安排战支配.二、真验真量（1）此例程是用UART0 动做串心通疑，硬件将其摆设到P0.0 战；（2）UART0是串心的中接心，为举止串心通疑，正在PC 端用串心调试帮脚硬件协共调试（利用其余串心通疑步调也不妨），用一根串心线将UART0串止心共PC 的串心贯串，波特率牢固为115200，通疑要领：1 位起初位，8 位数据位，1 位停止位.（3）MAX3232芯片将单片机收出的TTL 电仄转移为RS-232 电仄旗号，支/收旗号从9 芯插座UART0通过RS-232 电缆传递到PC 机.三、真验本理介绍每个C8051F MCU皆有能举止同步传输的串止心（UART）.C8051F020有二个功能真足相共的UART（分别为UART0战UART1），它们除了具备8051尺度串止心的功能中，还具备帧过得检测战天面辨别硬件，称为巩固型串止心UART.UART不妨处事正在齐单工同步办法大概半单工共步办法，而且支援多处理器通疑.接支数据被久存于一个脆持寄存器中，那便允许UART 正在硬件尚已读与前一个数据字节的情况下开初接支第二个输进数据字节.一个接支覆盖位用于指示新的接支数据已被锁存到接支慢冲器而前一个接支数据尚已被读与.对于UART的统造战考察是通过相关的特殊。
C8051F020单片机说明
C8051F020开发板说明书V1.0.02012年3月22日目录第一章 概述 (1)第二章 开发板简介 (2)2.1 开发板原理框图 (2)2.2 开发板实物图 (2)2.2.1 本开发板的外扩展资源和扩展接口 (2)2.2.2 本开发板的平面图 (3)第三章 开发板硬件电路说明 (4)3.1 硬件电路简介 (4)3.2 电源电路 (4)3.3单片机复位电路 (4)3.4 ZLG7289电路原理图 (5)3.5 LED电路原理图 (6)3.6 LCD接口电路 (7)第四章 开发板注意事项 (8)4.1注意事项 (8)4.2开发板跳线使用方法 (8)第一章 概述本说明书是C8051F020开发板的硬件使用说明书，详细描述了020开发板的硬件构成、原理，以及它的使用方法。
开发板用USB JTAG对C8051F020芯片进行编程，C8051F020有64个I/O而我们开发板通过排针引出了其中的44个I/O口，板上有标识（也可查看原理图或PCB图）。
引出来的I/O口可以供用户配置。
第二章 开发板简介2.1 开发板原理框图本开发板主要用到了C8051F020芯片（内置A/D D/A和比较器等）和周立功的ZLG7289芯片，020芯片通过SPI方式和ZLG7289完成数据传递，ZLG7289控制按键和数码管显示。
原理框图如下：图2-1 开发板原理框图2.2 开发板实物图2.2.1 本开发板的外扩展资源和扩展接口部分接口说明：JTAG接口：本板卡和USB Debug Adaptor仿真器连接，通过本接口用户可实现在线仿真。
LCD接口： 本板液晶用MzL05-12864AD/DA接口：本板的AD/DA接口都来自020内置的AD/DA另外的外扩资源和接口如下图所示：数码管AD 接口比较器接口P7口P3.0~ P3.6P0口P2口P1口3.2 JTAG3.3V/GNDDAC 接口LCD 接口LED ZLG72895vGNDP6口C8051F0203.3V/GND 按键电源开关复位键开发板实物图2.2.2 本开发板的平面图平面图上的位置和板卡的位置一一对应，详细的说明请看后面章节的图2-2 说明。
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C8051F的每个I/O口引脚都可以被配置为推挽或漏极开路输出。
同时引入了数字交叉开关，允许将部数字系统资源映射到P0、P1、P2和P3 的端口引脚。
通过设置交叉开关寄存器可将片的计数器/定时器、串行总线、硬件中断、ADC转换启动输入、比较器输出以及微控制器部的其他数字信号配置为出现在端口I/O引脚。
必须在访问这些外设的I/O之前配置和允许交叉开关。
注意的问题：1.低端口既能按位寻址，也可以按字节寻址；高端口只能按字节寻址。
2.没有被分配到的引脚作为一般的数字通用I/O口。
3.P1口还可以用作ADC1的模拟输入。
4.P0MDOUT~P3MDOUT用于控制I/O端口每一位的输出状态。
5.EMIF（外部存储器接口）是用于CPU与片外XRAM之间的数据传输通道，通过寄存器EMI0CF 和EMI0CN选择和管理端口实现数据的传输。
6.为了能访问片外存储器空间，必须设置EMI0CN寄存器的容为片外存储器的空间页地址。
7.如果把外部存储器接口（EMIF）设置在高端口则首先要把EMI0CF的PRTSEL位设置为1，选择高端口，同时选择地址的复用或非复用方式，在把XBR的外部寄存器的EMIFLE位设置为0。
8.复用方式配置：在复用方式下，数据总线和地址总线的第8位共用相同的引脚（AD0~AD7）。
在该方式下，要用一个外部锁存器（如74HC373或相同功能的锁存器）保持RAM地址的低8位。
外部锁存器由ALE(地址锁存使能)信号控制，ALE信号由外部存储器接口逻辑驱动。
9.在总线复用时，需要把地址数据复用端口配置为漏极开路。
10.ALE高/低脉宽占1个SYSCLK周期，地址建立/保持时间占0个SYSCLK周期，/WR和/RD占12个SYSCLK周期，EMIF工作在地址/数据复用方式，即：EMI0CF |= 0x2c;EMI0TC |= 0x2c;配置EMIF的步骤是：先将EMIF选到低端口或高端口；然后选择复用方式或非复用方式；再选择存储器的模式（只用片存储器、不带块选择的分片方式、带块选择的分片方式或只用片外存储器）；然后设置EMI0TC；最后通过寄存器PnMDOUT和P74OUT选择所期望的相关端口的输出方式。
如：void PORT_Init (void){XBR2 = 0x40; /*使能交叉开关和弱上拉*/P74OUT |= 0xff; /*使能P4~P7推挽输出*/EMI0CF |= 0x2c; /*EMIF工作在地址/数据复用方式，只用外部存储器，ALE高/低脉宽占1个SYSCLK周期*/EMI0TC |= 0x6c; /*地址建立/保持时间占0个SYSCLK周期，/WR和/RD占12个SYSCLK周期*/P3MDOUT |= 0xdf; /*使能P3.5推挽输出*/}11.避免高端口处于“浮空”状态，以避免因输入浮空为无效逻辑电平而导致不必要的功率消耗，为此应采取如下措施的任何一种：a.将XBR2.7位设置为逻辑0选择弱上拉状态R/W R/W R/W R/W R/W R/W R/W R/W 复位值WEAKPUD XBARE - T4EXE T4E UART1E EMIFLE CNVSTE 00000000位7 位6 位5 位4 位3 位2 位1 位0 SFR地址位7 WEAKPUD 弱上拉禁止位0 弱上拉全局允许1 弱上拉全局禁止位6 XBARE 交叉开关允许位0 交叉开关禁止端口0 1 2 和3 的所有引脚被强制为输入方式1 交叉开关允许位5 未用读0 写=忽略位4 T4EXE T4EX 输入允许位0 T4EX 不连到端口引脚1 T4EX 连到端口引脚位3 T4E T4 输入允许位0 T4 不连到端口引脚1 T4 连到端口引脚位2 UART1E UART1 I/O 允许位0 UART1 I/O 不连到端口引脚1 UART1 TX 和RX 连到两个端口引脚位1 EMIFLE 外部存储器接口低端口允许位0 P0.7 P0.6 和P0.5 的功能由交叉开关或端口锁存器决定1 如果EMI0CF.4 = 0 外部存储器接口为复用方式则P0.7 (/WR) P0.6 (/RD)和P0.5 (/ALE)被交叉开关跳过它们的输出状态由端口锁存器和外部存储器接口决定1 如果EMI0CF.4 = 1 外部存储器接口为非复用方式则P0.7 (/WR)和P0.6 (/RD)被交叉开关跳过它们的输出状态由端口锁存器和外部存储器接口决定位0 CNVSTE 外部转换启动输入允许位0 CNVSTR 不连到端口引脚1 CNVSTR 连到端口引脚；b.令P74OUT=0xFF，将高端口输出方式配置为推拉方式(P74OUT为高端口输出方式寄存器)；c.向高端口数据寄存器P4、P5、P6和P7写0。
12.配置端口引脚的输出方式每个端口引脚的输出方式都可被配置为漏极开路或推挽方式。
在推挽方式下向端口数据寄存器中的相应位写逻辑0 将使端口引脚被驱动到GND 写逻辑1 将使端口引脚被驱动到VDD ，在漏极开路方式下向端口数据寄存器中的相应位写逻辑0 将使端口引脚被驱动到GND 写逻辑1 将使端口引脚处于高阻状态，当系统中不同器件的端口引脚有共享连接即多个输出连接到同一个物理线时（例如SMBus 连接中的SDA 信号），使用漏极开路方式可以防止不同器件之间的冲突。
（推挽方式在有些书中称为推拉方式）关于开漏、推挽方式，漏级开路即高阻状态，适用于输入/输出，其可独立输入/输出低电平和高阻状态，若需要产生高电平，则需使用外部上拉电阻或使用如LCX245等电平转换芯片。
有些朋友，尤其是未学过此方面知识的朋友，在实际工作中将I/O口设置为漏开，并想输出高电平，但向口线上写1后对方并未认出高电平，但用万用表测量引脚确有电压，这种认为是不对的，对于高阻状态来说，测量电压是无意义的，正确的方法应是外加上拉电阻，上拉电阻的阻值=上拉电压/芯片引脚最大灌（拉）电流。
推挽方式可完全独立产生高低电平，推挽方式为低阻，这样，才能保证口线上不分走电压或分走极小的电压（可忽略），保证输出与电源相同的高电平，推挽适用于输出而不适用于输入，因为若对推挽（低阻）加高电平后，I=U/R，I会很大，将造成口的烧毁。
对与C8051F的很多型号片子，将I/O口设置为推挽方式的做法为：PnMDOUT=0xff，Pn=0x00，这样设置I/O口为推挽，并输出低电平（可降低功耗）将I/O口设置为漏开方式的做法为：PnMDOUT=0x00，Pn=0x11，这样设置I/O口为漏开。
如果学过三极管放大电路一定知道，前置单管放大器和功放末级放大电路的区别。
单片机部的逻辑经过部的逻辑运算后需要输出到外面，外面的器件可能需要较大的电流才能推动，因此在单片机的输出端口必须有一个驱动电路。
这种驱动电路有两种形式:其中的一种是采用一只N型三极管（npn或n沟道），以npn三极管为例，就是e接地，b接部的逻辑运算，c引出，b受部驱动可以控制三极管是否导通但如果三极管的c极一直悬空，尽管b极上发生高低变化，c极上也不会有高低变化，因此在这种条件下必须在外部提供一个电阻，电阻的一端接c(引出脚）另一端接电源，这样当三极管的b有高电压是三极管导通，c电压为低，当b为低电压时三极管不通，c极在电阻的拉动下为高电压，这种驱动电路有个特点：低电压是三极管驱动的，高电压是电阻驱动的（上下不对称），三极管导通时的ec阻很小，因此可以提供很大的电流，可以直接驱动led甚至继电器，但电阻的驱动是有限的，最大高电平输出电流=(vcc-Vh)/r；另一种是互补推挽输出，采用2只晶体管，一只在上一只在下，上面的一只是n型，下面为p型（以三极管为例），两只管子的连接为：npn（上）的c连vcc，pnp（下）的c接地，两只管子的ee,bb相连，其中ee作为输出（引出脚），bb接部逻辑，这个电路通常用于功率放大点路的末级（音响），当bb接高电压时npn管导通输出高电压，由于三极管的ec电阻很小，因此输出的高电压有很强的驱动能力，当bb接低电压时npn截至，pnp导通，由于三极管的ec电阻很小因此输出的低电压有很强的驱动能力，简单的例子，9013导通时ec电阻不到10欧，以Vh=2.5v，vcc=5v计算，高电平输出电流最大=250MA，短路电流500ma，这个计算同时告诉我们采用推挽输出时一定要小心千万不要出现外部电路短路的可能，否则肯定烧毁芯片，特别是外部驱动三极管时别忘了在三极管的基极加限流电阻。
推挽输出电路的形式很多，有些单片机上下都采用n型管，但部逻辑提供互补输出，以上的说明仅仅为了说明推挽的原理，为了更深的理解可以参考功率放大电路。
振荡器问：部时钟振荡器是否稳定？是否可以用于产生波特率的时基？答：不同器件的部时钟振荡器的精度是不同的(±20%)。
随电源电压变化，它也将发生变化（6.5%/V）。
但基本不随温度变化（<1%温度变化围-40℃~+85℃）。
由于不同器件部振荡器的离散性较大，所以不能用于产生波特率，应该外接标准晶体。
而有些器件，如C8051F3xx/f12x/f04x/f06x部振荡器精度为±2%，可用于产生波特率。
问：片/外振荡器如何配置？答：正确步骤：1、允许外部振荡器；2、等待1ms；3、查询XTLVLD '0'->'1'4、切换到外部振荡器。
注意：振荡器频率的选择，即OSCXCN寄存器的配置（外部振荡器频率控制位的设置）。
关于更多的信息以及源代码可以参看应用笔记AN002《配置部和外部振荡器》。
应用笔记可以从我公司下载：.xhl..问：C8051F MCU的指令执行速度为多少？答：C8051F MCU的CIP-51核采用流水线结构，与标准的8051结构相比，指令执行速度有很大的提高。
标准的8051单片机执行一个单周期指令需要12个系统时钟周期，而C8051F MCU执行一个单周期指令只需要一个系统时钟周期。
如果系统时钟频率为25MHz，执行一个单周期指令所需时间为40ns。
问：切换外部晶振时应注意哪些问题？答：首先要允许外部振荡器，但此时的系统时钟源仍应是部时钟，直到外部振荡器稳定后，才可将系统时钟源切换到外部振荡器上，否则会出现切换不过去，系统死机的情况。
问：使用外部晶振应注意哪些问题？答：1、所有的模拟和数字电源引脚都应接电源（2.7~3.6V）；2、C8051F3xx系列器件的晶振引脚间应跨接一个10M电阻（在新华龙的“主页”—“原理图/PCB库”中有C8051F系列单片机的典型接线图）；3、晶振、电容等相关器件尽量靠近单片机的晶振引脚。
问：系统时钟切换到外部时钟后，部的时钟是否应关闭？答：可以选择关闭或不关闭，但是从降低功耗的角度来说，应该关闭。