论ASIC与FPGA之争
ASIC与CPU、GPU、FPGA区别？
ASIC与CPU、GPU、FPGA区别？继4月初联发科宣布扩大ASIC产品阵线，推出业内首个7nm 56G PAM4 SerDes IP之后，4月24日，在联发科深圳办公室，联发科举行了一场小型的媒体会，联发科副总经理暨智能设备事业群总经理游人杰及联发科智能显示暨客制化芯片事业部行销处处长彭建凯首次揭秘了联发科的ASIC业务。
什么是ASIC芯片？近年随着以比特币为代表的虚拟货币市场的火爆，催生了一大批生产“挖掘”虚拟货币设备的“矿机”厂商，其中最为知名的要属比特大陆了。
而比特大陆之所以能够在矿机市场异军突起，则主要得益于其自主设计的针对比特币矿机的ASIC芯片。
因为相对于CPU、GPU来说，采用专用的ASIC芯片来“挖矿”更具效率。
以比特大陆的Antminer S9矿机为例，其内部集成了189个ASIC芯片（BM1387），而且采用的是台积电16nm FinFET制程。
同样，目前主流的矿机厂商都采用的是定制的ASIC芯片。
这也使得ASIC芯片开始被大众所熟知。
但是ASIC芯片并不仅仅能被用于“挖矿”，还被用于包括人工智能在内等众多领域。
那么什么才是ASIC芯片？它与我们常见的CPU、GPU等通用型芯片相比又有何不同？早在1981年3月，Sinclair公司推出了一款8位个人电脑ZX81，其所采用的Z80处理器则被认为是最早的ASIC原型。
实际上ASIC是Application-Specific In te grated Circuit（应用型专用集成电路）的缩写，是一种专用芯片，是为了某种特定的需求而专门定制的芯片的统称。
比如专用的音频、视频处理器，同时目前很多专用的AI芯片业可以看作是ASIC 的一种。
与CPU、GPU、FPGA相比如何？CPU与GPU都是我们常见的通用型芯片，它们在各自领域都可以高效地完成任务，但当同样应用于通用基础计算领域时，设计架构的差异直接导致了两种芯片性能的差异。
CPU作为通用处理器，除了满足计算要求，为了更好的响应人机交互的应用，它要能处理复杂的条件和分支，以及任务之间的同步协调，所以芯片上需要很多空间来进行分支预测与优化(control)，保存各种状态(cache)以降低任务切换时的延时。
asic与fpga芯片电平标准
asic与fpga芯片电平标准ASIC和FPGA芯片是常见的数字电路设计和实现解决方案。
它们的设计和制造都需要定义和统一的电平标准，以保证它们的互操作性和可靠性。
下面我们将深入探讨ASIC和FPGA芯片的电平标准。
ASIC芯片的电平标准一般是由芯片制造商或业内相关组织定义的。
ASIC芯片一般采用的是标准的CMOS工艺，因此它们的电平标准也可以采用CMOS的电平标准。
在CMOS电路中，逻辑0和逻辑1分别对应着电平低和电平高。
通常逻辑0的电平标准是接近于0V的电压，而逻辑1的电平标准则是接近于芯片供电电压的电压。
以3.3V的供电电压为例，逻辑1的电平标准一般为2.5V（高电平）。
FPGA芯片的电平标准不同于ASIC芯片，因为FPGA芯片的每一项电路功能都可以通过程序来定制，因此需要更加灵活的电平标准。
通常FPGA芯片采用的是LVCMOS（Low Voltage CMOS）电平标准。
LVCMOS 电平标准的特点是能够支持多个不同的电压标准，包括3.3V、2.5V、1.8V、1.5V等等。
此外，LVCMOS电平标准还提供了不同的速度等级，以满足不同应用场景的需求。
在实际的应用中，ASIC和FPGA芯片的电平标准需要被统一协调，以保证它们之间的兼容性和可靠性。
通常这个问题通过引入中间转接电路来解决。
比如在ASIC芯片和FPGA芯片之间，可以加入一个外部的FPGA芯片作为中间转接电路，以转换电平标准并实现信号的适配。
总之，ASIC和FPGA芯片的电平标准是它们设计和实现中非常重要的一部分。
其定义和统一是保证芯片互操作性和可靠性的重要手段。
芯片设计师和制造商需要严格按照定义的电平标准进行设计和实现，以保证芯片的正确运行和稳定性。
结构化ASIC与FPGA争夺市场
今 产 品 应 用 当 中 的 很 多 芯 片 都 属 于 此 列 。 随 着 御 Ｆ Ｇ Ｐ Ａ的进 攻 。 半 导 体 技 术 的 日益 精 进 ， 不 断 从 ９ 纳 米 向 ６ 纳 ０ ５ 米 甚 至 ４ 纳 米 深 入 ，ＡＳ Ｃ的 功 能 越 来 越 强 大 ， ５ Ｉ 随之 而来 的是 成本 也 日益 攀 升 。
Ｆ ＰＧＡ ｖ ｓＡＳＩ Ｃ
美 元 ，６ ｎ ５ ｍ要 ２ ０ 元 ，４ ｎ ６美 ５ ｍ则 要 ５ ０ 元 ０美 以 上 。 很 明 显 ， 即 使 首 次 量 产 （ｉｓ ｉ ｃ ｎ ｔ ｆｒｔｓｌ ｏ ｏ ｉ ｐ ｏ ｕ ｔｏ ） 成 功 ，这 样 高 额 的 花 费 也 不 是 中 ｒ ｄ ｃｉｎ 就 小 业 者 所 能 承 受 得 起 ， 更 何 况 首 次 量 产 的 成 功 率 本就 不 是 很 高 。 ＡＳＣ另外 一个 让 人 挠 头 的 问题 在 于 它 的 设计 Ｉ
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即使 保 守估 计 至 少也 需 要数 百 万 美 元 。
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率发生问题，而是逻辑或功能性错误导致 。
批量 系统 提高 系统 集成 度 、可靠性 的 最佳 选择
之一 。
ＦＧ Ｐ Ａ的优势与不足
由于Ｆ ＧＡ采用了逻 辑单元阵￣Ｌ Ａ （ ｏ ｉ Ｐ ］ ＩＣ Ｌ ｇｃ Ｃ ｌＡｒａ ）这样 一个概念 ，内部包 括可配置逻 ｅｌ ｒｙ 辑模块Ｃ Ｂ （ ｎ ｇ ｒｂｅＬ ｇｃＢｏ ｋ 、输出 Ｌ Ｃｏ ｆ ｕａ ｌ ｏ ｉ ｌｃ ） ｉ 输入模块Ｉ Ｂ （ ｐ ｔ ｔｕ ｏ ｋ Ｏ Ｉ ｕ ｐ ｔ ｃ ）和 内部连线 ｎ Ｏｕ Ｂｌ （ｎｅｃ ｎ ｅｔ Ｉｔｒｏ ｎ ｃ）三个部分 ，所以Ｆ ＧＡ就具备 了 Ｐ
FPGA和ASIC比较谈
ASIC与FPGA比较谈专用集成电路(ASIC)采用硬接线的固定模式，而现场可编程门阵列(FPGA)则采用可配置芯片的方法，二者差别迥异。
可编程器件是目前的新生力量，混合技术也将在未来发挥作用。
与其他技术一样，有关ASIC技术过时的报道是不成熟的。
新的ASIC产品的数目可能有大幅度下降，但其销售额仍然相当高，尤其是在亚太区。
此外，采用混合式方法，如结构化ASIC，也为该技术注入了新的活力。
同时，FPGA(和其他可编程逻辑器件)也在发挥作用，赢得了重要的大众市场，并从低端应用不断向上发展。
每种技术都有它的支持者。
一般来说，ASIC用于大型项目，而对于需要快速投放市场且支持远程升级的小型项目，FPGA则更为适合。
ASIC和FPGA供应商对这两种技术孰优孰劣不能达成共识，对适合的应用领域也持不同看法。
上述技术及其衍生技术将可能在今后一段时间内长期存在。
Altera Corp的高密度FPGA高级总监David Greenfield指出，FPGA技术的主要优势仍是产品投放市场的时间较短。
他说：“在目前新增的设计方案中，对FPGA的选择倾向超过ASIC。
ASIC技术有其价值所在，它的性能、密度和单位容量都相当出色，不过随着FPGA的发展和ASIC的开发成本不断上升，将会导致ASIC的市场份额不断缩小。
”在上述趋势之后发挥作用的，正是FPGA在性能、密度和制造成本上的发展。
Greenfield指出，高性能曾经是ASIC超出FPGA的优势，当时FPGA在性能和功能上都较逊色。
随着芯片的制造工艺从180nm发展到130nm甚至90nm，上述情况发生了很大变化，现在FPGA的性能已经能够满足大多数应用的需要（要求最高的应用除外），而密度水平则达到逻辑设计的80%。
他解释说：“某些系统设计师也认识到，ASIC的市场领域在于极高性能/密度的产品，这种市场领域风险非常大。
NRE （非重复性工程设计）和开发成本对这种设备而言是最高的。
采用 CPU,ASIC,FPGA和NP网络处理器的网络交换机体系结构的比较
通用CPU,ASIC,FPGA和NP网络处理器这四种网络交换机体系结构的详细比较分析使用NP+ASIC的体系设计方式是最为完美的选择。
使用ASIC芯片高速处理各种传统的业务，如二层交换、三层路由、ACL、QoS以及组播处理等等，满足核心交换机对于交换机处理性能的需求；而利用NP实现各种非传统或未成熟的业务，根据需要灵活支持IPV6、Load Balancing、VPN、NAT、IDS、策略路由、MPLS、防火墙等多种业务功能，满足核心交换机对于业务按需叠加的需求……多层交换体系结构的引入有效地提高了局域网的速度，对多层交换体系结构排队模型、交换实施和交换结构等方面的了解，可以更深刻地认识到局域网交换机在性能上的提高。
首先明确几个基本概念：排队模型交换结构是指数据从一个端点到达另一个端点的“高速路”，排队是一种用于控制拥塞的缓冲机制，当交换结构出现拥塞时，会在很大程度上直接影响交换机的性能，所以进行拥塞管理是非常有必要的。
在多个端口争用同一个端口时就需要拥塞管理，对信息包进行排队处理。
排队可以采用动态缓冲区排队或固定缓冲区排队，其中动态缓冲区排队时缓冲区长度为固定增量（如每次64K字节），可以更有效地利用缓冲区资源；而固定缓冲区排序时缓冲区的长度是固定的，这样缓冲区的使用效率不高，但比定制控制器（custom conollers）成本低。
排队可以在交换结构的输入端口进行，即输入排队，也可在交换结构的输出端口进行，即输出排队。
在输入排队时，信息包在进入端口处得到缓冲，最高可将吞吐量减少60％，但会造成线路端阻塞；在输出排队时缓冲区设在输出端口，无线路阻塞，但在流量高峰期间会造成缓冲区溢出。
交换实施交换实施用来说明交换决策的地点和方式：是在本地还是在中央地点，是最长匹配还是准确匹配。
交换决策的地点是中央地点时，就是集中交换。
集中交换采用集中发送表，针对交换和识别提供集中控制，为达到实施的快速处理，查询由ASIC完成，集中交换可以执行第2层或第3层查询。
FPGA的配置及其接口电路的设计
第21卷 第2期电子测量与仪器学报V ol 121 N o 12JOURNAL O F EL ECTRON I C 2007年4月M EASUR E M EN T AND I N STRUM EN T・109 ・本项目为福建省教育厅科技资助项目(编号:JA03005)和福建省自然科学基金计划资助项目(编号:Z0512003)。
本文于2005年12月收到。
王灵芝:硕士研究生;黄春晖:教授。
FPGA 的配置及其接口电路的设计王灵芝 林培杰 黄春晖(福州大学物理与信息工程学院,350002)摘 要:本文介绍对X I L I N X 公司Spartan Ⅱ系列的XC2S50的FPG A 配置数据的方法。
提出了利用CP LD 和F LASH 组成串行配置系统实现对FPG A 的上电配置以及通过计算机并口实现数据的传送和监测的方法。
对内部的控制电路的电路结构、软件设计等方面进行了阐述。
在此系统之上实现了计算机串口与S DRAM 之间的相互通信。
实验结果表明系统功能可靠、实用。
经测试系统最大时钟频率可以达到761923MHz,F LAS H 的读写速率可达到111Mbs 。
与基于单片机配置的方法比较,高速安全的完成对FPG A 的上电配置。
关键词:FPG A,CP LD,F LAS H,串行配置中图分类号:T N43 文献标识码:BConf i gura ti on of FPGA and D esi gn of Its I n terface C i rcu itW ang L ingzhi L in Peijie Huang Chunhui(College of Physics and I nfor mati on Engineering of fuzhou university Fuzhou 350002,China )Abstract:The article intr oduces a configurati on method f or XC2S50FPG A,which is a me mber of Spartan Ⅱfa m ily fr om X I L I N X cor porati on .The configurati on method uses a serial syste m composed of CP LD&F LASH,and realizes data trans m itting and monit oring thr ough the parallel port of a computer .The circuit structure of the contr ol circuit and the s oft w are design are ex p lained .The interface bet w een S DRM and FPG A was designed,and mutual communicati on bet w een the serial port of the computer and S DRAM was realized .Experi m ent result indicates that the syste m functi ons stably and reliably and is p ractical;thr ough testing,the maxi m um syste m cl ock frequency rea 2ches t o 76.923MHz,the reading and writing s peed of F LASH reaches up t o 111Mbs .Compared with m icr ocon 2tr oller configurati on method,the p r oposed method can safely configure FP AG with high s peed during power on .Keyword:FPG A,CP LD ,F LASH,serial configurati on 1 FPG A /CP LD 既继承了ASI C 的大规模、高集成度、高可靠性的优点,又克服了普通ASI C 周期长、投资大、灵活性差的缺点,逐步成为复杂数字硬件电路的理想选择[1-2]。
FPGA与ASIC在电子设计中的比较
FPGA与ASIC在电子设计中的比较在电子设计领域中，FPGA（Field Programmable Gate Array）和ASIC （Application-Specific Integrated Circuit）是两种常见的集成电路设计技术，它们在设计复杂电路时起着重要作用。
本文将对FPGA和ASIC在电子设计中的比较进行阐述，以帮助读者更好地了解两者之间的特点和适用场景。
首先，从设计灵活性方面来看，FPGA具有明显优势。
FPGA是一种可编程的硬件，用户可以通过编程来实现不同的功能，并且可以多次重编程。
这种灵活性使得FPGA适用于快速原型设计和产品开发阶段，能够应对需求变化和快速迭代的设计要求。
相比之下，ASIC是一种定制集成电路，设计固定在硅片上，不具备可编程性。
ASIC的设计和制造过程复杂且成本高昂，适用于量产和对性能要求高、功耗和成本要求低的应用场景。
其次，就性能和功耗方面而言，ASIC往往比FPGA具有更高的性能和更低的功耗。
由于ASIC是定制化设计，可以优化电路结构和布局，达到更高的工作频率和更低的功耗。
ASIC通常用于对性能要求非常高的应用，如通信、计算等领域。
而FPGA在性能和功耗上一般不如ASIC，因为FPGA的可编程逻辑存在一定的延迟，且硬件资源有限，但适用于那些对性能要求不是特别苛刻的应用场景。
此外，成本也是影响选择FPGA或ASIC的关键因素之一。
由于FPGA具有可编程性和灵活性，其设计周期短、开发成本低，适合小规模生产和快速原型设计。
而ASIC的设计和制造成本较高，适合大规模生产和长期稳定的产品。
因此，在选择FPGA还是ASIC时，需要综合考虑设计需求、市场定位、生产规模等因素，对成本做出合理评估。
在实际应用中，通常会根据具体的项目需求和设计要求来选择FPGA或ASIC。
当需要快速原型验证、设计迭代频繁或产品生命周期较短时，FPGA是一个较好的选择；而当需要大规模生产、对性能要求极高或产品长期稳定时，ASIC更适合。
FPGA、CPU、GPU、ASIC性能对比
FPGA、CPU、GPU、ASIC性能对比对比传统CPU、GPU、ASIC芯片，FPGA具有高性能、低消耗和灵活性等特点，具有广泛的应用市场。
与CPU/GPU相比，单位功耗性能和计算耗时均成量级提升，同时可实现出色的I/0集成。
1．FPGA、CPU、GUP对计算密集型和通信密集型任务耗时的比较
2．CPU、GPU、FPGA不同线程下处理速度的综合对比
与ASIC定制芯片相比，主要优势为“可重构”
•FPGA和ASIC芯片上都有大量的逻辑单元，能够实现复杂的、高吞吐量的金融模型计算。
•ASIC的逻辑功能无法做二次更改，其成本随工艺的提升指数增长。
•FPGA的逻辑块和连接可以多次编辑，完成不同的逻辑功能，灵活的实现功能扩展和升级，极大减少了开发成本。
A SIC芯片设计成本随着制程提升呈指数级上升。
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收稿日期：2004-01-12 E-mail：hjg@
部器件速率，片间的I/O数率达到225 MHz。多达82 944 b的双口 RAM，45 个时钟控制网络，4个PLL, 多种I/O 协议。Quicklogic 提 供32和64位的PCI 接口，并且提供一个含有MIPS32 core和高速DSP 产品系列。
(3) FPGA产品的支持软件的发展
Altera最新的FPGA设计支持软件是Quartus II 。它提供了一个 设计平台，其中包括嵌入式软件、数字信号处理、板级分析和综合
工具。设计者可以利用基于总线的各个部件如处理器、外设控制 器、甚至设备驱动程序和操作系统内核。Altera的DSP Builder 把 Matlab 和Simulink等同算法开发、模拟和验证结合起来。用户可以 利用信号处理工具箱和滤波器设计工具箱设计算法，然后用
FPGA是一种可编程器件(PLD)。简单可编程器件(SPLD 或 PAL)是在20年前出现的。2003年IC市场约为1 318亿美 元，2002年ASIC销售额约增至138亿美元，而2002 年 PLD 市场的销售额大约为 23 亿美元。2002 年，FPGA 的销售额 为 18 亿美元。复杂的可编程逻辑器件(CPLD)目前占有PLD 的35%的市场，FPGA占据PLD市场的53%。有人预计PLD市 场在系统级可编程芯片(SOPC)技术的推动下，在几年内的 市场将会有10倍的增长。
1 FPGA的发展
1.1FPGA的分类 按照制造技术，FPGA一般分为以下几类：
(1)反熔丝型 FPGA。控制布线结构用反熔丝进行一次性配置。 当下电后仍然保持配置，而不需要外部配置存储器。但是由于工艺 问题很难做到百万门规模，配置时间长达几分钟。小批量可以代替 ASIC。
(2) Flash FPGA，可以配置几千次，不挥发，在几秒内完成现 场升级，但是价格较贵。
(3) SRAM FPGA是当前最主流的技术，可以无限次配置，利用 片内的锁存器存储配置编码，但加电后需要辅助电路。一般的每个 逻辑单元具有多个二值输入，输出1-2个逻辑函数，这些逻辑函数 的物理实现可能利用小规模的查找表(LUT)存储器或者多路器和逻 辑门。
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存储器的输出再控制传输晶体管实现连接。LUT比较灵 活，输入比较多，但是传输延迟较大。配置时间一般为毫秒 级，可以用于可重配置计算，以适应新的协议的变化。 1.2 FPGA产品的最新的发展
(2) PGA低端产品的发展
在 低 端 产 品 方 面 ， Xilinx公 司 的 Spartan 系 列 产 品 的 密 度 从 5 000到30万系统门。其价格从2.55美元起，适合低成本、大批 量生产的应用。最新的Spartan-IIE 系列支持多达19种 I/O标准，包 括LVDS和LVPECL，片上时钟和分布式RAM，以及用于片级和板 级时钟管理的4个数字延迟锁相环。为快速设计低成本的下一代消 费类数字化的集成产品提供了芯片、开发工具和IP核。
级定时分析。Quartus II对高速的信号的完整性分析和电磁效应分 析、功耗分析和优化等都提供支持。
ISE Foundation 是Xilinx的EDA软件包，提供设计输入、综合、 实现和验证以及板级集成。除电路图外还支持状态机产生、IP核 和 DSP设计。还包括定时分析器，约束编辑器，另外还有支持模块设 计、增量设计、团队设计管理能力等，也支持第三方工具的集成。 该公司最新的集成软件环境(ISE)软件ISE 5.2i版和 ChipScope Pro 5.2i版比最接近的竞争产品性能提高20%，逻辑利用率提高15%，设 计成本降低50%。此外，新的可提供ASIC能力的设计工具可帮助工
近年来，各个厂家普遍采用0.25、0.13和0.09μm CMOS 工艺，继续向高密度、大容量发展。FPGA的规模发展到 100万门～1 000万门的水平。 I/O接口采用模拟电路达到1～ 10Gbps的接口数据传输数率，片内时钟频率可以达到200 ～ 400MHz。由于低端产品在工艺和结构上创新，性能的提高 和价格的降低都是令人惊叹的。
(1) PGA高端产品的发展
Xilinx和Altera目前是世界上两个最大的PLD供应商。Xilinx 的 Virtex-II Pro 是 一 个 标 志 性 高 端 产 品 系 列 ， 它 提 供 4 个 PowerPC RISC 核 ， 每 个 核 在 400 MHz 时 运 算 能 力 为 600MIPS ， 并 支 持 IBM CoreConnect 片 内 总 线 结 构 。 在 I/O 接 口 方 面 ， 提 供 16 收 发 器(transceiver)模块, 波特率达到3.125 Gbps, 双工数据数率为 80 Gbps, 另外还具有4 Mbits 的 DRAM, 706 kbits 的 SelectRAM 和 216个18×18-bit 的乘法器模块。
CPLD 继 承 了 PAL 的 与 或 门 结 构 ， 引 脚 之 间 的 延 迟 很 小。它们很适合设计编码器、同步状态机以及计数器，其设 计软件非常简单，编译速度很快。但是由于结构的原因， CPLD在规模上受到限制。CPLD只提供很少的触发器，不 能扩展为大规模的阵列，而且一般的功耗很大。 FPGA 是 一种包含很多相同的逻辑单元的集成电路,在结构上和 ASIC 相似,具有很多触发器和分布的布线资源。逻辑单元通过连 线阵列和可编程开关实现互联。用户在设计时规定逻辑单元 实现的逻辑函数，并且选择性地接通互连阵列的连线，从而 实现自己的简单设计，结合这些简单的设计就能实现复杂的 设计。不同的产品系列的逻辑单元的结构很不相同。FPGA 设计软件能自动地对用户输入的电路图，或硬件描述语言程 序进行翻译，然后进行布局布线。利用设计库里大量的复杂 的宏函数可以帮助用户优化设计。
Actel 推出了 ProASIC Plus 系列产品，采用0.22μm flash工 艺 ， 支持100万门和198kb的SRAM ，分为88 个块，每块256×9B。 由 第三方支持的IP包括总线、通信协议、微处理器、微控器和外设控 制器。
可见，高端的FPGA产品包含微处理器核、内嵌存储器和大规 模的逻辑阵列、外部设备的接口以及面向各种应用的IP核，甚至把 模拟电路的核也包含进来。在几年前，上述的功能只能用ASIC 实 现。现在，FPGA已经可以提供比较完整的平台。各个领域的设计 工程师可以根据需求的变化，利用这些设计平台不断更新和改进自 己的终端产品。
Altera的高端产品Stratix系列采用1.5V, 0.13μm 全铜工艺，在单 个芯片上提供多达114 140逻辑元件，具有10 Mb的嵌入式存储器。 优化的DSP 模块和高性能的I/O模块。Stratix GX 系列器件内含4到 20个 高 速 收 发 器 通 道 ， 每 一 个 通 道 都 内 含 有 “ 时 钟 数 据 恢 复 ” (CDR)部件和3.125Gbps并-串/串-并转换器(SERDES)。
(西安邮电学院计算机系，西安 710061) 摘 要：论述现场可编程门阵列（FPGA）产品的发展情况和对于专用集成电路（ASIC）的影响。介绍了目前国际上对FPGA和ASIC的竞争 问题的讨论，同时对ASIC和FPGA进行了简单的比较，并对FPGA的新的应用领域作了介绍。最后提出发展我国FPGA产业的建议。 关键词： 现场可编程门阵列；专用集成电路；可编程系统芯片
Racing of ASIC VComputer, Xi'an Institute of Posts and telecommunications，Xi'an 710061) 【 Abstract】 This paper discusses the development of FPGA products , the effect on ASICs,and the racing of FPGAs versus ASICs. The paper also
Quicklogic的 Eclipse 系列提供系统级的功能包括600 MHz的内
基 金 项 目 ： 国 家 “ 十 五 ” 攻 关 项 目 （ 2002BA106B） ； 国 家 自 然 科 学基金资助项目（90207015） 作者简介：韩俊刚(1943－)，男，教授、博导，主要研究领域 :VLSI 设计和验证
第30卷 第8期 Vol.30 № 8
计 算 机 工 程 Computer Engineering
2004年4月 April 2004
·发展趋势/热点技术·
文章编号： 1000— 3428(2004)08 —0010— 03 文献标识码：A
中 图 分 类 号 ：TN47
论ASIC与FPGA之争
韩俊刚
Altera推 出 的 最 新 低 端 产 品 Cyclone 宣 称 可 以 和 业 界 最 快 的 FPGA相匹敌。它的可编程结构是专门为低价位设计的，包含内嵌 存储器和各种外部存储器接口、串行口、总线接口、网络接口、多 种通信协议、用于定时内嵌PLL，单端和差分I/O接口Nios嵌入式处 理器。并且提供软件工具QuartusII 的支持。
程师快速容易地实现时序分析，从而降低总体设计成本以及设计周
期。用户可以利用增强千兆位级串行I/O收发器和成本优化的90nm FPGA进行设计。