触发器及其应用
数电实验报告触发器及其应用(共10篇)
数电实验报告触发器及其应用(共10篇)1、实验目的：掌握触发器的原理和使用方法，学会利用触发器进行计数、存储等应用。
2、实验原理：触发器是一种多稳态数字电路，具有存储、计数、分频、时序控制等功能。
常见的触发器有RS触发器、D触发器、T触发器、JK触发器等。
RS触发器是由两个交叉互连的反相器组成的，它具有两个输入端R(复位)和S(置位)，一个输出端Q。
当输入R=1，S=0时，Q=0;当输入R=0，S=1时，Q=1;当R=S=1时，无法确定Q的状态，称为禁态。
JK触发器是将RS触发器的两个输入端合并在一起而成，即J=S，K=R，当J=1，K=0时，Q=1;当J=0，K=1时，Q=0;当J=K=1时，Q反转。
JK触发器具有启动、停止、颠倒相位等功能。
D触发器是由单个输入端D、输出端Q和时钟脉冲输入端组成的，当时钟信号上升沿出现时，D触发器的状态发生改变，如果D=1，Q=1;如果D=0，Q=0。
T触发器只有一个输入端T和一个输出端Q，在每个时钟脉冲到来时，T触发器执行T→Q操作，即若T=1，则Q取反；若T=0，则Q保持不变。
触发器可以组成计数器、分频器、存储器、状态机等各种数字电路，被广泛用于计算机、控制系统等领域。
3、实验器材：数码万用表、示波器、逻辑分析仪、CD4013B触发器芯片、几个电阻、电容、开关、信号发生器等。
4、实验内容：4.1 RS触发器测试利用CD4013B芯片来测试RS触发器的功能，在实验中将RS触发器的输入端分别接入CD4013B芯片的端子，用示波器观察输出端的波形变化，并记录下输入输出关系表格，来验证RS触发器的工作原理。
具体实验步骤如下：将CD4013B芯片的端子按如下接线方式连接：RST1,2脚接入+5V电源，C1个100nF的电容与单位时间5 ns的外部时钟信号交替输入接口CLK，以模拟器件为master时，向器件提供单个时钟脉冲。
测试时选择适宜的数据输入，R1和S2另一端程+5V，S1和R2另一端连接接地GND,用万用表测量各端电压，电容缓存的电压。
实验五触发器及其应用(仿真)一、实验目的
实验五 触发器及其应用（仿真）一、实验目的1．掌握JK 触发器和D 触发器的逻辑功能。
2．掌握触发器相互转换的方法。
3．掌握集成JK 触发器和集成D 触发器的使用方法。
二、实验相关知识1．JK 触发器数字集成触发器74112内部有两个独立的下降沿触发的JK 触发器，其逻辑符号和仿真元件引线排列如图5-1所示。
CLR 是异步置0端D R ， PRE 是异步置1端D S 。
特性方程是：2．D 触发器数字集成触发器7474内部有两个独立的上升沿触发的D 触发器，其逻辑符号和仿真元件引线排列如图5-2所示。
其特点是次态（Q n+1）输出仅取决于CP 上升沿到达时D 端输入信号的状态，而与在此以前或以后D 的状态无关。
其特性方程是： Q n+1 = D三、实验预习要求与思考1．阅读实验相关知识。
2．按要求设计“实验内容”中的电路，画出逻辑图。
n n n Q KQ J Q 1（b ） 仿真元件引线排列（a ） 逻辑符号图5-1 74112的逻辑符号和仿真元件引线排列1J C1 1K Q＞ J CP K R D S DRSQ（a ） 逻辑符号（b ） 仿真元件引线排列图5-2 7474的逻辑符号和仿真元件引线排列四、实验内容1．设计电路验证JK触发器74112的逻辑功能。
建议示波器A通道接时钟脉冲、B通道接输出端Q，Q 和Q端接指示灯。
表5-1 JK触发器逻辑功能验证表（1）由表5-1可以得出PRE’和CLR’的优先级哪个高？（2）由表5-1可以得出JK触发器的特性方程：。
2．设计电路验证D触发器7474的逻辑功能。
建议示波器A通道接时钟脉冲、B通道接输出端Q，Q 和Q端接指示灯。
表5-2 D触发器逻辑功能验证表（1）比较7474和74112的复位、置位端的异同。
（2）由表5-2可以得出D触发器的特性方程： 。
3．比较D触发器、JK触发器逻辑表达式，用适当的逻辑门实现D触发器与JK触发器的逻辑功能互相转换，并验证之。
触发器及其应用实验注意事项
触发器及其应用实验注意事项概述触发器是计算机科学中的一个重要概念，它是一种特殊的机制，用于在系统内部或外部事件发生时自动执行某些操作。
触发器广泛应用于各种领域，包括数据库管理系统、物联网、自动化控制系统等。
本文将重点探讨触发器的定义、分类、工作原理以及应用实验注意事项。
触发器的定义触发器是一种存储在数据库中的特殊对象，它绑定到表上的某个事件并在该事件发生时自动执行一系列操作。
触发器可以在数据插入、更新或删除时触发，从而实现对数据的自动处理。
通过使用触发器，可以在不干预应用程序的情况下实现数据的完整性约束、业务逻辑处理等功能。
触发器的分类触发器根据事件的类型可以分为三种：插入触发器、更新触发器和删除触发器。
1.插入触发器：当在表中插入新的行时触发。
可以用于自动计算某些列的值，或者生成与其他表相关的数据。
2.更新触发器：当在表中更新现有的行时触发。
可以用于更新其他表的数据、记录审计信息等。
3.删除触发器：当从表中删除行时触发。
可以用于级联删除相关数据、记录删除日志等。
触发器的工作原理触发器的工作原理可以分为两个阶段：触发事件的发生和触发器的执行。
1.触发事件的发生：当表上的特定事件发生时，触发器被激活。
常见的触发事件包括数据的插入、更新或删除。
2.触发器的执行：在触发事件发生后，系统会自动调用与该事件相关的触发器。
触发器中定义的操作将被执行，可以包括更新其他表的数据、生成新的数据等。
应用实验注意事项在进行触发器的应用实验时，需要注意以下几点：1.数据备份：在实验前，应对实验数据进行备份，以防止实验过程中数据的丢失或损坏。
备份数据可用于实验结束后的数据恢复和比对分析。
2.实验环境：选择合适的实验环境进行触发器实验。
实验环境应具备完整的数据库管理系统及其它相关软件，确保实验过程的稳定性和可靠性。
3.实验设计：在进行触发器实验时，应合理设计实验方案，明确实验的目的和操作流程。
可以通过编写实验报告、绘制流程图等方式对实验进行规划和记录。
什么是触发器及其在电路中的应用
什么是触发器及其在电路中的应用触发器是一种电子器件或电路，用于接收输入信号并根据特定条件来触发输出信号。
触发器通常由逻辑门电路或者其他电子元件构成，可以在电路中实现存储和控制功能。
触发器在数字系统、计算机、通信系统等领域广泛应用。
一、触发器的基本概念触发器是一种同步逻辑电路，能够储存和稳定输入信号的状态，并在满足特定条件时产生输出信号。
触发器的输入可以是电流、电压或者其它物理量。
触发器的输出可以是开关、逻辑位或者电路状态的改变。
触发器按照其功能和构造可以分为多种类型，例如RS触发器、D 触发器、JK触发器和T触发器等。
这些触发器都有各自的特点和适用场景。
二、触发器在电路中的应用触发器在电子电路中有广泛的应用，主要可以分为存储功能和控制功能两个方面。
1. 存储功能：触发器能够在特定的时刻存储输入信号的状态，这种存储功能可以用于数字系统的数据存储。
例如，D触发器可以储存一个位的数据，并在时钟信号的作用下改变其状态。
多个触发器可以组合成寄存器、存储器等用于大规模数据存储的器件。
2. 控制功能：触发器的输出信号可以用于控制电路的工作状态。
例如，JK触发器可以根据输入信号的变化来控制电路的动作，实现时序逻辑的功能。
触发器还可以用于时序电路的设计，比如在计数器、时钟发生器、锁存器等电路中广泛使用。
三、触发器的特性和应用注意事项触发器具有一些特性和应用注意事项，需要在设计和使用时加以考虑。
1. 触发器的稳定性：触发器应该具有稳定的输出状态，能够在一定的时间内保持其存储的状态。
触发器的设计和器件的选取需要考虑这一点。
2. 触发器的时序特性：触发器在输入和输出信号之间有一定的时间延迟，需要在电路设计中合理考虑这个延迟时间，以保证电路的正常工作。
3. 触发器的电源和工作电压：触发器的工作电源和电压范围需要满足设计要求，在实际应用中需要注意。
4. 触发器的逻辑功能：不同类型的触发器具有不同的逻辑功能和特性，需要根据具体需求选择合适的触发器类型。
数字电子技术实验五触发器及其应用（学生实验报告）
数字电⼦技术实验五触发器及其应⽤（学⽣实验报告）实验三触发器及其应⽤1．实验⽬的(1) 掌握基本RS、JK、D和T触发器的逻辑功能(2) 掌握集成触发器的逻辑功能及使⽤⽅法(3) 熟悉触发器之间相互转换的⽅法2．实验设备与器件(1) ＋5V直流电源(2) 双踪⽰波器(3) 连续脉冲源(4) 单次脉冲源(5) 逻辑电平开关(6) 逻辑电平显⽰器(7) 74LS112（或CC4027）；74LS00（或CC4011）；74LS74（或CC4013）3．实验原理触发器具有 2 个稳定状态，⽤以表⽰逻辑状态“1”和“0”，在⼀定的外界信号作⽤下，可以从⼀个稳定状态翻转到另⼀个稳定状态，它是⼀个具有记忆功能的⼆进制信息存贮器件，是构成各种时序电路的最基本逻辑单元。
(1) 基本RS触发器图4-5-1为由两个与⾮门交叉耦合构成的基本RS触发器，它是⽆时钟控制低电平直接触发的触发器。
基本RS触发器具有置0 、置1 和保持三种功能。
通常称S为置“1”端，因为S＝0（R＝1）时触发器被置“1”；R为置“0”端，因为R＝0（S＝1）时触发器被置“0”，当S=R=1时状态保持；S＝R＝0时，触发器状态不定，应避免此种情况发⽣，表4-5-1为基本RS触发器的功能表。
基本RS触发器。
也可以⽤两个“或⾮门”组成，此时为⾼电平电平触发有效。
图4-5-1 基本RS触发器(2) JK触发器在输⼊信号为双端的情况下，JK触发器是功能完善、使⽤灵活和通⽤性较强的⼀种触发器。
本实验采⽤74LS112双JK触发器，是下降边沿触发的边沿触发器。
引脚功能及逻辑符号如图4-5-2所⽰。
JK触发器的状态⽅程为Q n+1＝J Q n＋K Q nJ和K是数据输⼊端，是触发器状态更新的依据，若J、K有两个或两个以上输⼊端时，组成“与”的关系。
Q与Q为两个互补输出端。
通常把 Q＝0、Q＝1的状态定为触发器0 状态；⽽把Q＝1，Q＝0定为 1 状态。
图4-5-2 74LS112双JK触发器引脚排列及逻辑符号下降沿触发JK触发器的功能如表4-5-2注：×— 任意态↓— ⾼到低电平跳变↑— 低到⾼电平跳变Q n （Q n ）— 现态 Q n+1（Q n+1）— 次态φ— 不定态JK 触发器常被⽤作缓冲存储器，移位寄存器和计数器。
实验八门电路,触发器及其应用(分析“应用”文档)共7张PPT
实验八 门电路、触发器及其应用
实验内容：
1. 检查导线、发光二极管、数字开关；
2. 检查与非门（74LS00、74LS20）； 3. 检查4D触发器（74LS175）（图8-8，T’触发器）；
4. 连接竞赛抢答电路，观察竞赛抢答电路的工作情况，分 析其工作原理。
实验八 门电路、触发器及其应用
竞赛抢答电路：
2、了解集成触发器的应用。
接发光二极管
(1/4)74LS00
QD Q DQ Q DQ Q DQ QR 实检检检1(实检3实2注检检 1实(2实检实 1实11、 、 、 、 、 、//验查查查验查验意查查验验查验验44检本了检了检))八 导 导 导 八 与 八 事 4与八 八 与 八八77测次解D测解测44线线线非项非 非LL触集实集集集集SS门门门门门门 门、、、门：门 门发00成验成成成成电电电电电电 电00发发发（（ （1器与（触与触与、路路路路路路 路光光光777（4非竞发非发非44每、、、、、、 、二二二LLL7门赛器门器门块SSS触触触触触触 触47极极极000L4及抢的及的及集发发发发发发 发000S管管管L、、 、集 答 应 集 应 集成1器器器器器器 器S、、、7777成情用成用成块15及及及及及及 及数数数444）7触况。触。触LLL都其其其其其其 其字字字5SSS（发）发发需222应应应应应应 应开开开图000器需器器要用用用用用用 用）） ）关关关8的由的的电-；； ；；；；8逻教逻逻源，42 辑师辑辑、T’1触功验功功接31发能收能能地1器。。。。才）能22；正常2工3作3 ；3
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检查与非门（74LS00、74LS20）；
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实验四触发器及其应用
实验四触发器及其应用实验四实验四实验目的1.掌握基本RS触发器、JK触发器、D触发器和T触发器的逻辑功能。
2.熟悉各类触发器之间逻辑功能的相互转换方法。
3.了解触发器的应用。
实验四实验内容1.测试基本RS触发器的逻辑功能★选做2.测试双JK触发器74LS73逻辑功能3.测试双D触器74LS74的逻辑功能★选做4.触发器的转换①②将JK触发器加上门电路转化成D触发器。
将D触发器加上连接，构成T’触发器。
5.触发器的应用，利用74175的D触发器构成下面电路。
①竞赛抢答电路①移位寄存器实验四实验原理触发器是组成时序逻辑电路的基本单元之一，具有记忆功能的二进制信息存贮器件。
在外加信号的作用下，触发器可以从一个稳定状态转变为另一个稳定状态。
RS触发器：图6—1所示电路为由两个“与非”门交叉耦合而成的基本RS触发器，它是无触发器：触发器时钟控制低电平低电平直接触发的触发器，有直接置位、复位的功能，是组成各种功能触发器低电平的最基本单元。
基本RS触发器也可以用两个“或非”门组成，它是高电平高电平直接触发的触高电平发器。
011100011置1保持置零保持实验四实验原理JK触发器：JK触发器：本实验采用74LS73型双JK触发器，其引脚排列如图6-3所示。
它是下降边沿触发器触发的边沿触发器，即在CP脉冲下降沿(“1→0”)触发翻转，有强迫置“0”功能R(RD),没有强迫置“1”的功能，在置D=1时，根据下表可以测试出其逻辑功能。
保持置1置0翻转翻转异步清零实验四实验原理D触发器：是另一种使用广泛的触发器，它的基本结构多为维持阻塞型。
D触发器触发器：触发器是在CP脉冲上升沿触发翻转，触发器的状态取决于CP脉冲到来之前D端的状态，状态方程为Qn+1=D本实验采用74LS74型双D触发器,是上升边沿触发的边沿触发器。
它采用维持阻塞结构，在CP脉冲上升沿(“0→1”)触发翻转。
触发器的次态Qn+1取决于CP脉冲的上升来到之前D的状态，但是S=0,R=1时强行置1,S=1,R=0时强行置0。
触发器及其应用实验总结
触发器及其应用实验总结
触发器是数据库管理系统中的一种特殊类型的存储过程，它能够在数据库中自动执行特定的操作，例如在对表进行插入、更新或删除操作时触发某些事件。
触发器在数据库管理中起到了非常重要的作用，可以用于实现数据的完整性约束、数据的自动更新等功能。
在数据库应用中，触发器被广泛应用于各种场景，如审计日志记录、数据验证、数据同步等。
在实验中，我们首先创建了一个简单的数据库表，包含了员工的姓名、工号、部门和工资信息。
然后我们编写了一个触发器，当向这个表中插入新的记录时，触发器会自动计算出员工的年薪，并将其更新到表中。
这样就实现了在数据库中自动计算员工年薪的功能，提高了数据的准确性和完整性。
除了上面的例子，触发器还可以应用于很多其他场景。
例如，在一个银行系统中，可以通过触发器实现当用户转账时自动更新账户余额；在一个电商系统中，可以通过触发器实现当订单状态改变时自动发送邮件通知用户等。
触发器的应用不仅提高了数据库管理的效率，还可以减少人为操作带来的错误。
然而，在使用触发器时，也需要注意一些问题。
首先是触发器的性能问题，过多复杂的触发器可能会影响数据库的性能；其次是触发器的逻辑问题，需要确保触发器的逻辑正确，不会导致
数据错误或不一致。
总的来说，触发器是数据库管理中一个非常有用的工具，可以帮助我们实现很多自动化的功能。
在实际应用中，我们需要根据具体的业务需求来设计和使用触发器，合理地利用触发器可以提高数据库管理的效率和数据的准确性。
希望通过本次实验的总结，读者能够对触发器及其应用有更深入的理解，为实际工作中的数据库管理提供参考和帮助。
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实验四触发器及其应用
一：实验目的
1．掌握基本RS。
JK。
D和T触发器的逻辑功能
2．掌握集成触发器的逻辑功能及使用方法
3．熟悉触发器之间互相转化的方法
二：实验原理：
触发器具有两个稳定状态。
用以表示逻辑状态“1”和“0”，在一定的外界信号作用下，可以从一个稳定状态翻转到另一个稳定状态，它是一个具有记忆功能的二进制信息存贮器件，是构成各种时序电路的最基本逻辑单元
1．基本RS触发器
图8-1为由两个与非门交叉耦合构成的基本RS触发器，它是无时钟控制低电平直接触发的触发器。
基本RS触发器具有置“0”。
置“1”和保持三种功能。
通常称为置“1”端，因为=0（=1）时触发器被置“1”；为置“0”端，因为=1（=0）时触发器被置“0”，但==1时状态保持；==0时，触发器状态不稳定，应避免此种情况发生，表9-1为基本RS触发器的功能表。
基本RS触发器。
也可以用两个“或非门”组成，此时为高电平触发有效。
表8-1：
图8-1 基本RS触发器
输入输出
0 1 1 0
1 0 0 1
1 1
0 0
2．JK触发器
在输入信号为双端的情况下，JK触发器是功能完善.使用灵活和通用性较强的一种触发器。
本实验采用74LS112双JK触发器，是下降边沿除法的边沿触发器。
引脚功能和逻辑符号如图8-2所示。
JK触发器的状态方程为
J和K是数据输入端是触发器状态更新的依据，若J。
K有两个或两个以上输入端时，组成“与”的关系。
Q和为两个互补输出端。
通常把Q=0，=1的状态顶为触发器“0”状态；而把Q=1，=0定为“1”状态。
16 15 14 13 12 11 10 9
图8-2 74LS112双JK触发器引脚排列及逻辑符号
下降沿触发JK触发器的功能表如8-2所示表8-2
输入输出
CP J K
0 1 ××× 1 0
1 0 ×××0 1
0 0 ×××
1 1 ↓0 0
1 1 ↓ 1 0 1 0
1 1 ↓0 1 0 1
1 1 ↓ 1 1
1 1 ↑××
注：×—任意态↓—高到低电平跳变↑—低到高电平跳变
（）—现态（）—次态￠—不定态
JK触发器常被用作缓冲存储器，位移寄存器和计数器
3．D触发器
在输入信号为单端的情况下，D触发器用来最为方便，其状态方程为=，其输出
状态的更新发生在CP脉冲的上升沿，故又称为上升沿触发的边沿触发器，触发器的状态只
取决于时钟到来前D端的状态，D触发器的应用很广，可用作数信号的寄存，位移寄存，分
频和波形发生等。
有很多种型号可供各种用途的需要而选用。
如双D74LS74。
四D74LS175，
六D74LS174等
图8-3为双D74LS74的引脚排列及逻辑符号。
功能表如表8-3。
图8-3 74LS74引脚排列及逻辑符合
表8-4
输入输出
CP T
0 1 ×× 1
1 0 ××0
1 1 ↓0
1 1 ↓ 1
4．触发器之间的相互转换
在集成触发器的产品中，每一种触发器都有自己固定的逻辑功能。
但可以利用转换的方法获得其它功能的触发器。
例如将J。
K触发器的J，K两端连在一起，并认它为T端，就得到所需的触发器。
如图8—4（a）所示，其状态方程为：
图8-4 JK 触发器转换为T，触发器
T触发器的功能如表8—4。
由功能表可见，当T=0时，时钟脉冲作用后，其状态保持不变；当T=1时，时钟脉冲状态翻转。
所以，若将T触发器T端置“1”，如8—4（b）所以，既得T’触发器得CP端每来一个CP脉冲信号，出发器的状态就翻转一次，故称之为反转触发器广乏用于计数电路中。
同样，若将D触发器端与D端相连，便转换为T触发器，如图8-5所示。
JK触发器也可转换为D触发器，如图8-6。
输入输出
CP D
0 1 ×× 1 0
1 0 ××0 1
0 0 ××
1 1 ↑ 1 1 0
1 1 ↑0 0 1
1 1 ↓×
5．CMOS触发器
（1）CMOS边沿型D触发器
CC4013是由CMOS传输门构成的边沿型D触发器。
它是上升沿触发的双D触发器，表8-5为其功能表，图8-7为引脚排列。
表8-5
输入输出
S R CP D
1 0 ×× 1
0 1 ××0
1 1 ××
0 0 ↑ 1 1
0 0 ↑0 0
0 0 ↓×
（2）。
边沿型JK触发器
4027是由CMOS传输门构成的边沿型JK触发器，它是上升沿触发的双JK触发器，
表8-6为其功能表
表8-6
输入输出
S R CP J K
1 0 ××× 1
0 1 ×××0
1 1 ×××
0 0 ↑0 0
0 0 ↑ 1 0 1
0 0 ↑0 1 0
0 0 ↑ 1 1
0 0 ↓××
CMOS触发器的直接置位，复位输入端S和R是高电平有效，当S=1（或R=1）时，触发器将不受其他输入端所处状态的影响，使触发器直接置1（或置0），但直接置位，复位输入端S和R必须遵守RS=0的约束条件。
CMOS触发器在按逻辑功能工作时，S和R必须均置0。
三：实验设备与器件
1，+5V直流电源 2，双踪示波器
3，连续脉冲源 4，单次脉冲源
5，逻辑电平开关 6，逻辑电平显示器
7，74LS112（或CC4027）
74LS00（或CC4011）
74LS74（或CC4013）
四：实验内容
1，测试基本RS触发器的逻辑功能
图8-1用两个与非门组成基本RS触发器，输入端，按逻辑开关的输出插口，输出端Q，按逻辑电平显示输入插口，按表8-7要求测试，记录之。
表8-7
Q
1 1↑0
0↑1
1↑0 1
0↑1
0 0
2．测试双JK触发器74LS112逻辑功能
（1）测试，的复位，置位功能
任取一只JK触发器，，，J，K端接逻辑开关输出插口，CP冲源，Q，端接至逻辑电平显示输入插口。
要求改变，（J，K任意状态），并在=0（=1）或=0
（=1）作用期间任意状态及CP的状态，观察Q，状态。
自拟表格并记录之（2）。
测试JK触发器的逻辑功
按表8-8的要求改变J，K，CP端状态，观察Q。
状态变化，状态更新是否发生在CP
脉冲的下降沿（既CP由1↑0），记录之。
（3）。
将JK触发器的J。
K端连在一起，构成T触发器
在CP端输入1HZ连续脉冲，观察Q端的变化
在CP端输入1KHZ连续脉冲，用双踪示波器观察CP。
Q，端波形的相位关系，描绘
之。
表8-8
J K CP
=0 =1
0 0 0↑1
1↑0
0 1 0↑1
1↑0
1 0 0↑1
1↑0
1 1 0↑
1↑0
3．测试双D触发器74LS74的逻辑功能
（1）。
测试，的复位。
置位功能
测试方法同实验内容2。
1），自拟表格记录之。
（2）测试D触发器的逻辑功能
按表8-9要求进行测试，并观察触发器状态更新是否发生在CP脉冲的上升沿（0↑1）记录之。
（3）将D触发器的端与D段相连接，构成触发器。
测试方法同实验内容2。
3），记录之
表8-9
D CP
=0 =1
0 0↑1
1↑0
1 0↑1
1↑0
4．双相时钟脉冲电路
用JK触发器及与非门构成的双时钟脉冲电路如图8-9所示，此电路是用来将时钟脉冲
CP转换成两相时钟脉冲和CP，其频率相同。
相位不同。
分析电路工作原理，并按8-9接线，用双踪示波器同时观察CP，；CP，及，波形，并描绘之。
5．乒乓球练习电路
电路功能要求：模拟二名运动员在练球时，乒乓球能往返运转。
提示：采用双D触发器74LS74设计实验线路，两个CP端触发脉冲分别由两名运动员操作，两触发器的输出状态用逻辑电平显示器显示。
五：实验预习要求
1．复习有关触发器内容
2．列出各触发器功能测试表格
3．按实验内容4。
5的要求设计线路，拟定实验方案。
六：实验报告
1．列表整理各类触发器的逻辑功能
2．总结观察到的波形，说明触发器的触发方式。
3．体会触发器的应用
4．利用普通的机械开关组成的数据开关所产生的信号是否可作为触发器的时钟脉冲信号？为什么？是否可以用作触发器的其它输入端的信号？又是为是为什么？。