《数字逻辑电路》复习资料
数字逻辑电路基础知识整理(属于个人笔记)
让信念坚持下去，梦想就能实现！！ Cx5692855@
1
定正飞的收藏
编/译码器主要有 2/4、3/8 和 4/16 译码器 74X139、 74X138、74X154 等。 4：计数器 计数器主要有同步计数器 74 X161 和异步计数器 74X393 等。 5：寄存器 寄存器主要有串-并移位寄存器 74X164 和并-串寄存器 74X165 等。 6：触发器 触发器主要有 J-K 触发器、带三态的 D 触发器 74X374、不带三态的 D 触发器 74X74、 施密特触发器等。 7：锁存器 锁存器主要有 D 型锁存器 74X373、寻址锁存器 74X25 9 等。 8：缓冲驱动器 缓冲驱动器主要有带反向的缓冲驱动器 74X24 0 和不带反向的缓冲驱动器 74X244 等。 9：收发器 收发器主要有寄存器收发器 74X543、通用收发器 74X245、总线收发器等。 10：总线开关 < br />总线开关主要包括总线交换和通用总线器件等。 11：背板驱动器 背板驱动器主要包括 TTL 或 LVTTL 电平与 GTL/GTL+（GTLP）或 BTL 之间的电平转换 器件。 12：包含特殊功能的逻辑器件 A．总线保持功能（Bus hold） 由内部反馈电路保持输入端最后的确定状态,防止因输入端浮空的不确定而导致器 件振荡自激损坏;输入端无需外接上拉或下拉电阻,节省 PCB 空间,降低了器件成本开销 和功耗。ABT、LVT、ALVC、ALVCH、 ALVTH、LVC、GTL 系列器件有此功能。 命名特征为 附加了“H& rdquo;如：74ABTH16244。
定正飞的收藏
高级 CMOS 逻辑器件 与 TTL 电平兼容高级 CMOS 逻辑器件 高级高速 CMOS 与 TTL 电平兼容高级高速 CMOS 高级低压 CMOS 技术 高级超低压 CMOS 逻辑器件 高级超低功耗 CMOS 逻辑 高级超低压 CMOS 逻辑器件 低压高带宽总线开关技术 低压转换器总线开关技术 Crossbar 技术 具有下冲保护的 CBT 低压 Crossbar 技术 CMOS 逻辑器件 快速 CMOS 技术 发射接收逻辑器件（GTL+） 高速 CMOS 逻辑器件 与 TTL 电平兼容高速 CMOS 逻辑器件 其电路含 AC、ACT 及 FCT 系列 低压 CMOS 技术 低压 CMOS 技术 低压 CMOS 技术 内部集成电路 内部集成电路 残余连续终结低压逻辑器件
数字逻辑电路总复习
128
16
4 2 1
二、常用逻辑关系及运算
1. 三种基本逻辑运算：与 、或、非 2. 四种复合逻辑运算： 与非 、或非、与或非、异或 真值表 函数式 逻辑符号
三、逻辑代数的公式和定理
是推演、变换和化简逻辑函数的依据，有些与普通代数相 同，有些则完全不同，要认真加以区别。这些定理中，摩根定 理最为常用。
第一章 逻辑代数基础
一、数制和码制 1. 数制：计数方法或计数体制（由基数和位权组成）
种类 十进制
二进制 八进制
基数 09
0 ，1 07
位权 10i
2i 8i
应用 日常
数字电路 计算机程序
备注
2 = 21 8 = 23
十六进制 0 9，A F
16i
计算机程序
16 = 24
各种数制之间的相互转换，特别是十进制→二进制的转换， 要求熟练掌握。
逻辑代数的基本公式 1. 关于常量与变量关系公式
A 0 A （1） A1 A （1’） A 1 1 （2） A 0 0 （2’）
2. 若干定律 交换律：
A B B A （3） A B B A （3’）
( A B) C A ( B C )
2. 码制：常用的 BCD 码有 8421 码、2421 码、5421 码、余 3 码等，其中以 8421 码使用最广泛。
1.十进制数到N进制数的转换 整数部分：除以N看余数 小数部分：乘以N看向整数的进位 2. N进制数转换为十进制数:方法：按权展开 3.基本逻辑和复合逻辑: (1)异或逻辑:特点：相同为0、相异为1 逻辑函数表达式：P = AB＝AB+AB (2)同或逻辑:特点：相同为1、相异为0 逻辑函数表达式：P = A⊙ B ＝AB+AB 异或逻辑与同或逻辑是互非关系：
数字逻辑复习题
《数字逻辑》复习题一选择题1．逻辑表达式Y=AB可以用 ( C ) 实现。
A.正或门B.正非门C.正与门D.负或门2．在( A )的情况下，“或非”运算的结果是逻辑 1 。
A．全部输入是0 B.全部输入是1C.任一输入为0，其他输入为1D.任一输入为13．CMOS数字集成电路与TTL数字集成电路相比突出的优点是( A )。
A. 微功耗B. 高速度C. 高抗干扰能力D. 电源范围宽4.在下列逻辑电路中，不是组合逻辑电路的有( D )。
A. 译码器B. 编码器C. 全加器D. 寄存器5．一块数据选择器有三个地址输入端，则它的数据输出端最多应有（ D ）。
A.3B.6C.7D.86．组合逻辑电路的特点是（ B ）。
A. 输出与以前输入有关B. 输出只由当时输入决定C. 输出与原来输出有关D. 输出由当时和以前输入共同决定7．若在编码器中有90个编码对象，则要求输出二进制代码位数为( C )位。
A.5B.6C.7D.88．数据选择器，某瞬间在选择变量作用下，从多路信号中选出（ C ）。
A.2路B.全部C.1路D. 4路9．八路数据分配器，其地址输入端有( C )个。
A.1B.2C.3D.4E.810．同步计数器和异步计数器比较，同步计数器的显著优点是( A )。
A.工作速度高 B.触发器利用率高 C.电路简单 D.不受时钟CP控制11．8 位移位寄存器，串行输入时经( D )个脉冲后，8位数码全部移入寄存器中。
A.1B.2C.4D.812．只读存储器ROM中的内容，当电源断掉后又接通，存储器中的内容( D )。
A.全部改变B.全部为0C.不可预料D.保持不变13．基本的逻辑运算是（ C ）。
A. 异或B. 与非C. 与、或、非D. 或非14．格雷码的特点是位置相邻的数码中只有（ A ）。
A. 一位不同B. 二位不同C. 高位相同，其他全不同D. 各位全不同15．函数F= <!--[if !vml]--><!--[endif]-->的反函数是（ A ）。
数字逻辑电路复习题与答案
_、单选题1、十进制整数转换为二进制数一般采用（）。
A.除2取整法B.除10取余法C.除2取余法D.除10取整法正确答案：C2、将十进制小数转换为二进制数一般采用（）。
A.乘2取整法B.乘10取余法C.乘2取余法D.乘10取整法正确答案：A3、十进制数"13",用三进制表示为（）。
A.211B.111C.112D.101正确答案：B4、将十进制数18转换成八进制是（）.A.20B.24C.22D.21正确答案：C5、十进制数25用8421 BCD码表示为（）A.10 010100B.0010 0101C.10 101D.10 000101正确答案：B6、以下代码中为恒权码的是()。
A.余3循坏码B右移码C.5211 码D.余3码正确答案：C7、T立八进制数可以用()位二进制数来表示。
A.4B.3C.1D.2正确答案：B&十进制数43用8421BCD码表示为()。
A.10011B.0100 0011C.101011D.1000011正确答案：B9、A+BC=()A.AB+ACB.BCC・(A+B)(A+C)正确答案：C10、4变量逻辑函数的真值表，表中的输入变量的取值应有()种。
A.4B.2C.16D.8正确答案：C11、f 16选1的数据选择器,其选择控制(地址)输入端有()个，数据输入端有16个，输出端有1个。
A.4B.16C.1D.2正确答案：A12、一个译码器若有100个译码输出端,则译码输入端至少有()个。
A.5B.8C.7D.6正确答案：C13、能实现并-串转换的是()。
A.数据选择器B.数据分配器C.译码器D.数值比较器正确答案：A14、欲设计一个3位无符号数乘法器（即3x3），需要6位输入及（）位输出信号。
B.6C.4D.5正确答案：B15、4位输入的二逬制译码器，其输出应有（）位。
A.4B.1C.8D.16正确答案：D16、对于8线一3线优先编码器，下面说法正确的是（）A.有8根输入线,8根输出线B.有8根输入线,3根输出线C.有3根输入线,8根输出线D.有3根输入线,3根输出线正确答案：B17、3线-8线译码电路是（）译码器A.八进制B.三进制C.三位二进制D.H-A进制正确答案：C18、实现多输入、单输出逻辑函数,应选（）。
《数字逻辑电路》试题及参考答案
《数字逻辑电路》在线作业参考资料一、单选题1. 一位8421BCD计数器，至少需要（B）个触发器A 3B 4C 5D 102. 在（A）的情况下，函数运算的结果是逻辑“1”A全部输入是“0” B任一输入是“0” C任一输入是“1” D全部输入是“1”3. 表示两个相邻脉冲重复出现的时间间隔的参数叫（A ）A.脉冲周期B.脉冲宽度C.脉冲前沿D.脉冲后沿4. 只能读出不能写入，但信息可永久保存的存储器是（A）A.ROMB.RAMC.RPROMD.PROM5. 在（D）的情况下，函数Y=AB运算的结果不是逻辑“0”。
A全部输入是“0”B任一输入是“0”C任一输入是“1”D全部输入是“1”6. 下列哪些信号一定不属于数字信号（A）A.正弦波信号B.时钟脉冲信号C.音频信号D.视频图像信号7. 在（B）的情况下，函数Y=/（AB）运算的结果不是逻辑“0”。
A全部输入是“0”B任一输入是“0”C任一输入是“1”D全部输入是“1”8. 符合六变量m5的相邻最小项，有下列（C ）说法成立A. 共有5 个相邻最小项B. m0、m4、m7、m13是它的相邻项C. 共有6 个相邻最小项D. m4、m21、m13、m38是它的相邻项9. 下列器件中，属于时序部件的是（A）A.计数器B.译码器C.加法器D.多路选择器10. 在n变量的逻辑函数F中，有（C ）A. 若mi为1，则Mi也为1B. 若F所有mi为0，则F为1C. 若F所有Mi为1，则F为1D. F的任一最小项标记为mni( i = 1~2n )11. 半加器的逻辑功能是（A）A. 两个同位的二进制数相加B. 两个二进制数相加C. 两个同位的二进制数及来自低位的进位三者相加D. 两个二进制数的和的一半12. 1路—4路数据分配器有（A）A.一个数据输入端，两个选择控制端，四个数据输出端B.四个数据输入端，两个选择控制端，一个数据输出端C.一个数据输入端，一个选择控制端，四个数据输出端D.四个数据输入端，一个选择控制端，一个数据输出端13. 全部的最小项之和恒为（B）A.0B.1C.0或1D.非0非114. 对于四变量逻辑函数，最小项有（D）个A.0B.1C.4D.1615. 逻辑表达式A+BC=( C )A. ABB. A+CC. (A+B)(A+C)D. B+C16.在（A）的情况下，函数运算的结果不是逻辑“1”A全部输入是“0” B 任一输入是“0”C任一输入是“1” D全部输入是“1”17. 十进制数25用8421BCD码表示为(B )。
数字逻辑期末复习资料
第一章 数制与编码1、二、八、十、十六进制数的构成特点及相互转换；二转BCD ：二B 到十D 到BCD ，二B 到十六H ，二B 到八O2、有符号数的编码；代码的最高位为符号位，1为负，0为正3、各种进制如何用BCD 码表示；4、有权码和无权码有哪些？BCD 码的分类：有权码：8421,5421,2421 无权码：余3码，BCD Gray 码 例：1、〔1100110〕B =〔0001 0000 0010〕8421BCD =〔102〕D =〔 66 〕H =〔146〕O〔178〕10=〔10110010〕2=〔0001 0111 1000 〕8421BCD =〔B2 〕16=〔 262〕8 2、将数1101.11B 转换为十六进制数为〔 A 〕A. D.C HB. 15.3HC. 12.E HD. 21.3H 3、在以下一组数中，最大数是〔 A 〕。
A.(258)D1 0000 0010B.(100000001 )B 257C.(103)H 0001 0000 0011259D.(001001010111 )8421BCD 2574、假设用8位字长来表示，〔-62〕D =( 1011 1110)原5、属于无权码的是〔B 〕A.8421 码B.余3 码 和 BCD Gray 的码C.2421 码D.自然二进制码 6、BCD 码是一种人为选定的0～9十个数字的代码，可以有许多种。
〔√〕 第二章 逻辑代数根底1、根本逻辑运算和复合逻辑运算的运算规律、逻辑符号；F=AB 与 逻辑乘 F=A+B 或 逻辑加F=A 非 逻辑反2、逻辑代数的根本定律及三个规则；3、逻辑函数表达式、逻辑图、真值表及相互转换；4、最小项、最大项的性质；5、公式法化简；卡诺图法化简〔有约束的和无约束的〕。
例：1、一个班级中有四个班委委员，如果要开班委会，必须这四个班委委员全部同意才能召开，其逻辑关系属于〔 A 〕逻辑关系。
A 、与B 、或C 、非 2、数字电路中使用的数制是〔 A 〕。
数字逻辑电路复习题
数字逻辑电路复习题1、数制与编码（-21）10 =（ ）10补（78.8）16=（ ）10（0.375）10=（ ）2（65634.21）8=（ ）16（121.02）16=（ ）4（49）10 =（ ）2=（ ）16（-1011）2 =（ ）反码=（ ）补码四位二进制数1111的典型二进制格林码为（ ）2、化简逻辑函数F （A 、B 、C 、D ）=∏M （0、2、5、7、8、10、13、15）。
3、说明同步时序逻辑电路的分析步骤。
4、说明什么是组合逻辑电路。
5、说明什么是Moore 型时序逻辑电路。
6、完成下列代码之间的转换：（1）（0101 1011 1101 0111.0111）8421BCD ＝（ ）10；（2）（359.25）10＝（ ）余3；（3）（1010001110010101）余3＝（ ）8421BCD 。
7、试写出下列二进制数的典型Gray 码：101010，10111011。
8、用逻辑代数公理和定理证明：①C B A ⊕⊕=A ⊙B ⊙C②)B A (⊕⊙B A AB = ③C AB C B A C B A ABC A ++=⋅ ④C A C B B A C A C B B A ++=++ ⑤1B A B A B A AB =+++9、将下列函数转化成为最小项表达式和最大项表达式①F （A 、B 、C 、D ）=)D C )(C B A )(B A )(C B A (++++++②F （A 、B 、C ）=C A C B A BC A C AB +++③F （A 、B 、C 、D ）=)B AC )(C B (D D BC ++++④F （A 、B 、C 、D ）=ABCD D C B A D B A B C +++10、利用卡诺图化简逻辑函数F （A 、B 、C 、D ）=4m (10,11,12,13,14,15)∑ 11、将下列函数简化，并用“与非”门和“或非”门实现该电路并判断有无竞争冒险现象，并予以消除。
数字逻辑电路考试复习
作业题 P70 题1.11(b)、(d)、(f) 题1.12 ⑴、⑶ P71 题1.13 ⑵ 题1.14 ⑵、⑷ 题1.15 ⑶、⑹
（1-5）
作业题 P71 题1.16(a) P72 题1.17 画出[题1.4] ⑴中函数的逻 辑图
（1-6）
作业题 P135 题2.2 P136 题2.3(a)
Y1 A B 0 A B
Y2 A B
Y3 AB 0 （AB 2-10）
作业题 P139 题2.13 P140 题2.15 P141 题2.16
（2-11）
一、填空题 1、使用(三态门 )可以实现总线结构；使用(OC )门可 实现“线与”逻辑。 2、TTL门输入端口为 “与” 逻辑关系时，多余的 输入端可(悬空 )处理；TTL门输入端口为 “或” 逻 辑关系时，多余的输入端应接(低)电平；CMOS门输 入端口为“与”逻辑关系时，多余的输入端应接(高 ) 电平，具有“或”逻辑端口的CMOS门多余的输入端 应接( 低)电平；即CMOS门的输入端不允许( 悬空)。 3、TTL与非门的电路结构由(输入级)、(中间放大级) 和(输出级 )三部分组成。
5、8个输入的编码器，按二进制编码，其输出的编码 有( 3 ) 位。 6、3个输入的译码器，最多可译码出( 8 ) 路输出。
（3-19）
二、单项选择题 1、在二进制译码器中，若输入有4位代码，则输出有 ( D )信号。 A、 2 个 B、 4个 C、 8个 D、16个 2、若在编码器中有50个编码对象，则要求输出二进 制代码位数为( B )位。 A、5 B 、6 C、10 D、50 3、在在大多数情况下,对于译码器而言( A )。 A、其输入端数目少于输出端数目 B、其输入端数目多于输出端数目 C、其输入端数目与输出端数目几乎相同
- 1、下载文档前请自行甄别文档内容的完整性，平台不提供额外的编辑、内容补充、找答案等附加服务。
- 2、"仅部分预览"的文档,不可在线预览部分如存在完整性等问题,可反馈申请退款(可完整预览的文档不适用该条件!)。
- 3、如文档侵犯您的权益，请联系客服反馈,我们会尽快为您处理(人工客服工作时间：9:00-18:30)。
成考复习资料《数字逻辑电路》 复习资料1一、逻辑函数化简1.用代数法化简， C B A ABCDE ABC Y ++++=2.用卡诺图法化简， ),,Σd(1,5)4,,Σm(0,Y(A,B,C,D)11,10,9321113+=, ∑d 为无关项 二、分析题1、分析下图所示逻辑电路，列出真值表，说明其逻辑关系。
2、分析下图所示同步时序逻辑电路，作出状态转移表和状态图，说明这个电路能对何种序列进行检测？三、设计题1.设计一个三输入的组合逻辑电路，当输入的二进制码小于5时，输出为0，大于等于5时，输出为1。
要求： （1）列出真值表；（2）写出逻辑函数的最简与或式； （3）用非门和与非门实现该电路；（4）用74LS138实现该电路。
74LS138功能表2、设计一个按自然顺序变化的7进制加法计数器，计数规则为逢7进位，产生一个进位输出。
要求：选用边沿JK触发器设计实现该功能的同步时序逻辑电路，并画出逻辑电路图。
成考复习资料答案一、逻辑函数化简1. ABC+(ABC)+(ABCDE)=1''2.AC AD B A Y ++=二、分析题1. 逻辑表达式：1Y A B CI =⊕⊕2((()))()Y A B CI AB A B CI AB ''=⊕+=⊕+由逻辑表达式计算出真值表：A B C Y Y 0 0 0 0 0 0 1 0 1 0 0 1 1 0 1 1 0 0 1 0 1 0 1 0 1 1 1 0 0 1 1 1 11 1这是一个全加器电路。
2. 答：电路的状态方程和输出方程为：状态表和状态转移图如下:凡在输入序列中出现两个或两个以上“1” 之后再出现一个 “0” ，输出就为“1” ； 否则，输出为“0” 。
由电路图可得输出方程为：10Y XQ Q =驱动方程为：01100110()()()J X Q J X Q K XQ K X Q ⎧⎧''''==⎪⎪⎨⎨'''''==⎪⎪⎩⎩将驱动方程代入JK 触发器的特性方程中可得状态方程为：*01010*10101()Q X Q Q XQ Q Q X Q Q X Q Q ⎧''=++⎪⎨''''=+⎪⎩成考复习资料1001检测器，能够自启动三、设计题1. 解：（1）真值表：设输入A、B、C，输出FABC F0 0 0 00 0 1 00 1 0 00 1 1 01 0 0 01 0 1 11 1 0 11 1 1 1（2）逻辑函数的最简与或式；ACABABCCABCBAF+=++=（3）用非门和与非门实现ACABACABF⋅=+=用非门和与非门实现该电路的逻辑图如下图（a）所示（4）用74HC138实现A、B、C从A2、A1、A输入，令,1123===EEE765765765YYYmmmmmmABCCABCBAF⋅⋅=⋅⋅=++=++=用74HC138实现该电路的逻辑图见下图（b）图（a ） 图（b ）2. （1）、解：状态转换图如下：由状态转换图可画出电路的次态卡诺图 Q 2Q 1Q 3 00 01 11 10 0 1 Q 2Q 1Q 3 00 01 11 10 0 1Q 3卡诺图 Q 2Q 1Q 3 00 01 11 10 0 1Q 2卡诺图 Q 2Q 1Q 3 00 01 11 10001 010 100 011 101 110 XXX 0000 0 1 0 1 1 X 00 1 0 1 0 1 X 0001 000010 011100101 110 111 Q 3Q 2Q 11Q1卡诺图画出分解的次态卡诺图，并化简求出电路的状态方程Q 3*=Q3Q2’+Q3’Q2Q1=（Q2Q1）Q3’+（Q2）’Q3Q 2*=Q1Q2’+Q3’Q2Q1’=（Q1）Q2’+（Q3’Q1’）Q2Q 1*=Q2’Q1’+Q3’Q1’=（Q2Q3）’Q1’+（1’）Q1与JK触发器特性方程比较得出驱动方程：J 3=Q2Q1； K3=Q2J 2=Q1； K2=（Q3’Q1’）’J 1=（Q2Q3）’； K1=1输出方程为：根据驱动方程画出电路图如图：Q 3Q1Q1=111 时，代入状态方程得：Q3*Q1*Q1*=000，所以该电路能自启动.1 0 0 11 0 X 032QQY⋅=复习资料2一、单选题1. 一个8选一数据选择器的数据输入端有个。
A. 1B. 2C. 3D. 4E. 82. 以下表达式中符合逻辑运算法则的是。
A. C·C=C2B. 1+1=10C. 0＜1D. A+1=13. 欲使D触发器按Qn+1=Qn工作，应使输入D=________________。
A. 0B. 1C. QD.4. 在下列逻辑电路中，不是组合逻辑电路的有。
A. 译码器B. 编码器C. 全加器D. 寄存器5. 某存储器具有8根地址线和8根双向数据线，则该存储器的容量为__________。
A. 8×3B. 8K×8C. 256×8D. 256×2566. 一个16选1的数据选择器，其地址输入（选择控制输入）端有个。
A. 1B. 2成考复习资料C. 4D. 167. 用二进制码表示指定离散电平的过程称为_________。
A. 采样B. 量化C. 保持D. 编码8. 4位倒T型电阻网络DAC的电阻网络的电阻取值有_________种。
A. 1B. 2C. 4D. 89. 将幅值上、时间上离散的阶梯电平统一归并到最邻近的指定电平的过程称为_________。
A. 采样B. 量化C. 保持D. 编码10. 当逻辑函数有n个变量时，共有个变量取值组合？A. nB. 2nC. n2D. 2 n11. 要构成容量为4K×8的RAM，需要__________片容量为256×4的RAM。
A. 2B. 4C. 8D. 3212. 对于JK触发器，若J=K，则可完成__________触发器的逻辑功能。
A. RSB. DC. TD. Tˊ13. 以下电路中常用于总线应用的有________________。
A. TSL门B. OC门C. 漏极开路门D. CMOS与非门14. A+BC = 。
A. A+BB. A+CC. (A+B)(A+C)D. B+C15. 以下四种转换器，_________是A/D转换器且转换速度最高。
A. 并联比较型B. 逐次逼近型C. 双积分型D. 施密特触发器二、判断题1 权电阻网络D/A转换器的电路简单且便于集成工艺制造，因此被广泛使用。
（）2 主从JK触发器、边沿JK触发器和同步JK触发器的逻辑功能完全相同。
（）3 PROM的或阵列（存储矩阵）是可编程阵列。
（）4 RS触发器的约束条件RS=0表示不允许出现R=S=1的输入。
（）5若要实现一个可暂停的一位二进制计数器，控制信号A=0计数，A=1保持，可选用T触发器，且令T=A。
（）三、问答题1. 分析下图所示电路，试问输入信号A、B、C不同组合时，电路中P点和输出端F的状态。
2 门电路输出波形四、设计题成考复习资料1. 设计一个四人表决电路，当四人中有三人或三人以上赞成时表决通过，否则表决失败。
要求：（1）写出逻辑函数的最小项之和的形式，并利用卡诺图化简法写出最简与或式；（2）画出利用与非门实现该逻辑问题的电路图。
（3）利用8选1数据选择器74HC151来实现四人表决电路。
输入输出D A2A1A0S'Y Y'×××× 1D0 0 0 0 0D1 0 0 1 0D2 0 1 0 0D3 0 1 1 0D4 1 0 0 0D5 1 0 1 0D6 1 1 0 0D7 1 1 1 00 1D0D'D11D'D22D'D33D'D44D'D55D'D66D'D77D'74HC151功能表 74HC151逻辑功能示意图2. 设计一个按自然顺序变化的6进制加法计数器，计数规则为逢6进位，产生一个进位输出。
要求：（1）选用边沿JK触发器设计实现该功能的同步时序逻辑电路，并画出逻辑电路图。
（2）利用二-五-十进制异步计数器进行设计，画出逻辑电路图。
74LS290的功能表 74LS290的逻辑示意图答案一、 1-5 EDDDC 6-10 CDBBD 11-15 DCACA二、判断题1-5 FTTTF三、问答题1解：当C=1时，三态门输出为高阻状态。
从TTL与非门电路可知，输入为高阻态（等同于悬空）时，相当于输入为高电平2解：设与门的输出为F1，或门的输出为F2。
对于与门：“有低出低，全高出高”；对于或门：“有高出高，全低出低”。
它们的输出波形如下图所示。
四、设计题1. 解：（1）真值表：设输入A、B、C、D，取值为0表示不同意，取值为1表示同意，输出Y=0表示表决不通过，Y=1表示表决通过。
由题意可列出真值表：A B C D Y0 0 0 0 00 0 1 0 00 0 1 1 00 1 0 0 00 1 0 1 00 1 1 0 00 1 1 1 11 0 0 0 01 0 0 1 01 0 1 0 0 1 1 0 0 0 1 1 1 1 1 1 1 1 1 1 1 1 1标准与或表达式：Y A BCD AB CD ABC D ABCD ABCD ''''=++++ 卡诺图逻辑函数的最简与或式；Y BCD ACD ABD ABC =+++（3）用非门和与非门实现(()()()())Y BCD ACD ABD ABCBCD ACD ABD ABC =+++'''''=用非门和与非门实现该电路的逻辑图如下图（a ）所示，利用74HC151实现该电路的逻辑图如下图（b ）所示。
（a ） （b ）2. （1）解：状态转换图如下：Q 3Q 2Q 1由状态转换图可画出电路的卡诺图*2102010202Q Q Q Q Q Q Q Q Q Q'''=+=+001000 010 011100101111 110成考复习资料*11021020101Q Q Q Q Q Q Q Q Q Q Q''''''=+=+*00Q Q'=20C Q Q=与JK触发器特性方程比较得出驱动方程：21011202011011J Q Q JJ Q QK Q KK Q⎧'==⎧⎧⎪=⎨⎨⎨===⎩⎩⎪⎩根据驱动方程以及输出方程画出电路图如图所示：001000 010 011100101111Q3Q2Q1110由状态图可知该电路能自启动（2）74LS290具有异步清零和异步置九的功能。