《数字逻辑电路》试题2
[答案][福建师范大学]2020秋《数字逻辑》在线作业二
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1.若干个具有三态输出的电路输出端接到一点工作时，必须保证()。
A.任何时候最多只能有一个电路处于三态，其余应处于工作态B.任何时候最多只能有一个电路处于工作态，其余应处于三态C.任何时候至少要有两个或三个以上电路处于工作态D.以上说法都不正确答案：B2.在下列逻辑电路中，不是组合逻辑电路的有()。
A.译码器B.编码器C.全加器D.寄存器答案：D3.一片四位二进制译码器，它的输出函数有()。
A.1B.8C.10D.16答案：D4.三极管作为开关使用时，下列选项不能提高开关速度是()。
A.降低饱和深度B.增加饱和深度C.采用有源泄放回路D.采用抗饱和三极管答案：B5.组合逻辑电路中的险象是由于()引起的。
A.电路未达到最简B.电路有多个输出C.电路中的时延D.逻辑门类型不同答案：C6.以下电路中常用于总线应用的有()。
A.TSL门B.OC门C.漏极开路门D.CMOS与非门答案：A7.MOS集成电路采用的是()控制，其功率损耗比较小。
A.电压B.电流C.灌电流D.拉电流答案：A8.在何种输入情况下，“与非”运算的结果是逻辑0()。
A.全部输入是0B.任一输入是0C.仅一输入是0D.全部输入是1答案：D9.八路数据选择器应有()个选择控制器。
A.2B.3C.6D.8答案：B10.Moore和Mealy型时序电路的本质区别是()。
A.没有输入变量B.当时的输出只和当时电路的状态有关，和当时的输入无关C.没有输出变量D.当时的输出只和当时的输入有关，和当时的电路状态无关答案：B11.以下代码中为恒权码的为()。
A.循环码B.5421BCD码C.余三码D.格雷码答案：B12.以下各电路中，()可以产生脉冲定时器。
A.多谐振荡器B.单稳态触发器C.施密特触发器D.石英晶体多谐振荡器答案：B13.逻辑函数的表示方法中具有唯一性的是()。
A.真值表B.表达式C.逻辑图D.时序图答案：A14.TTL与非门的多余脚悬空等效于()。
《数字逻辑电路》试题及参考答案
《数字逻辑电路》在线作业参考资料一、单选题1. 一位8421BCD计数器，至少需要（B）个触发器A 3B 4C 5D 102. 在（A）的情况下，函数运算的结果是逻辑“1”A全部输入是“0” B任一输入是“0” C任一输入是“1” D全部输入是“1”3. 表示两个相邻脉冲重复出现的时间间隔的参数叫（A ）A.脉冲周期B.脉冲宽度C.脉冲前沿D.脉冲后沿4. 只能读出不能写入，但信息可永久保存的存储器是（A）A.ROMB.RAMC.RPROMD.PROM5. 在（D）的情况下，函数Y=AB运算的结果不是逻辑“0”。
A全部输入是“0”B任一输入是“0”C任一输入是“1”D全部输入是“1”6. 下列哪些信号一定不属于数字信号（A）A.正弦波信号B.时钟脉冲信号C.音频信号D.视频图像信号7. 在（B）的情况下，函数Y=/（AB）运算的结果不是逻辑“0”。
A全部输入是“0”B任一输入是“0”C任一输入是“1”D全部输入是“1”8. 符合六变量m5的相邻最小项，有下列（C ）说法成立A. 共有5 个相邻最小项B. m0、m4、m7、m13是它的相邻项C. 共有6 个相邻最小项D. m4、m21、m13、m38是它的相邻项9. 下列器件中，属于时序部件的是（A）A.计数器B.译码器C.加法器D.多路选择器10. 在n变量的逻辑函数F中，有（C ）A. 若mi为1，则Mi也为1B. 若F所有mi为0，则F为1C. 若F所有Mi为1，则F为1D. F的任一最小项标记为mni( i = 1~2n )11. 半加器的逻辑功能是（A）A. 两个同位的二进制数相加B. 两个二进制数相加C. 两个同位的二进制数及来自低位的进位三者相加D. 两个二进制数的和的一半12. 1路—4路数据分配器有（A）A.一个数据输入端，两个选择控制端，四个数据输出端B.四个数据输入端，两个选择控制端，一个数据输出端C.一个数据输入端，一个选择控制端，四个数据输出端D.四个数据输入端，一个选择控制端，一个数据输出端13. 全部的最小项之和恒为（B）A.0B.1C.0或1D.非0非114. 对于四变量逻辑函数，最小项有（D）个A.0B.1C.4D.1615. 逻辑表达式A+BC=( C )A. ABB. A+CC. (A+B)(A+C)D. B+C16.在（A）的情况下，函数运算的结果不是逻辑“1”A全部输入是“0” B 任一输入是“0”C任一输入是“1” D全部输入是“1”17. 十进制数25用8421BCD码表示为(B )。
《数字逻辑电路》试题及答案
、填空题( 1-5小题每空 1分， 6-10 小题每空 2分，共20分)1.(16.25) 10 = ( _____________________ ) 2 = ( ) 8 = ( ) 162．三态门输出的三种状态分别为：、和。
3.基本 RS 触发器的约束条件是______________ 。
4.多谐振荡器是一种波形_______ 电路，它没有稳态，只有两个_______ 。
5.把 JK 触发器改成 T 触发器的方法是____________ 。
6.F(A,B,C,D) A (B C (D E) ) 的对偶式为________________________________ 7．十进制数( -12 )的补码形式为_____________________ 。
8.某信号采集系统要求一片 A/D 转换器集成芯片在 1S内对 16 个热电偶的输出电压分时进行 A/D 转换。
已知热电偶输出电压范围为 0~0.025V(对应 0~450 o C温度范围)，需要分辨的温度为 0.1 o C，试问选用位的 A/D 转换器。
9.RAM 存储器地址线 4 条，数据线 8 条，其存储容量为_______ 。
10.写出下图有 ROM 构成的组合逻辑函数式 Y2= ____________________ 。
二、逻辑函数化简证明题(共 3题，共 20 分)1.(6 分)用公式法化简下面逻辑函数为最简与或式F(A,B,C) (ABC) (AB )2.(6 分)证明下面逻辑恒等式，方法不限。
(A C )(B D)(B D ) AB BC3．(8 分)用卡诺图法求下面逻辑函数的反函数，用最简与或式表示。
F(A,B,C,D) ABC ABD C D ABC ACD ACD三、电路分析题（共 4题，共 30 分）1.（6 分）分析如图所示组合逻辑电路的功能。
（1）写出 Y 的输出表达式；（ 2）列出输入 A、B、C 和输出 Y 之间关系的真值表；（3）说明电路的逻辑功能。
《数字逻辑电路》试题及参考答案
一、填空题（共15空，每空2分，共30分）1.二进制数（1110.0111）2对应的等值十六进制数为____E.7_______。
2. 十进制数 -13的8位二进制补码为____11110011________。
3.与普通二进制代码相比，格雷码最大优点是相邻两个代码之间有___1_____位发生变化。
4. 逻辑表达式''=++()Y AB C D 的反演式为(())Y A B C D '''''=+。
5. 若使JK 触发器的J=K ，构成的新触发器称为____T_____触发器。
6. 基本RS 触发器的约束条件是_____RS=0____。
7. 写出两个逻辑变量A 、B 的全部最小项,,,AB A B AB A B ''''。
8. 三态门逻辑符号如下图，写出输出Y 与输入A 和EN '之间的关系01A E N Y EN ''=⎧=⎨'=⎩高阻态。
9. 下图所示由T 触发器构成的电路中，初始状态为Q=0，写出在连续4个时钟信号作用下，Q 的4个输出结果依次为___1 0 1 0____。
8题图 9题图10.如下面真值表所示，写出Y 与A 、B 逻辑表达式的最简与或形式：Y(A,B)=+A B ''。
11.8线-3线优先编码器输入为I 0-I 7，当优先级别最高的I 7有效时，输出210Y Y Y '''=__000__。
12.一个四输入端或非门，使其输出为1的输入变量取值组合有__15___种。
13.四位左移寄存器预置1011，其串行输入端固定接0，在2个移位脉冲作用下，得新的四位数据为__1100__。
14. A/D 转换过程中，量化级越多，电路越复杂，转换精度越__高___。
15. 若10位D/A 转换器的V REF =-10V ，输入数字量最高位为1，其它位均为0，求输出模拟电压值___5V___。
《数字逻辑》在线作业二
B.错误
11.利用反馈归零法获得N进制计数器时，若为异步置零方式，则状态SN只是短暂的过渡状态，不能稳定而是立刻变为0状态。
A.正确
B.错误
12.在同步时序电路的设计中，若最简状态表中的状态数为2^N，而又是用N级触发器来实现其电路，则不需检查电路的自启动性。
A.正确
B.错误
36.在同步计数器中，各触发器的CP输入端应接统一的时钟脉冲
A.正确
B.错误
37.用二进制异步计数器从0做加法，计到十进制数178，则最少需要（）个触发器
A.2
B.6
C.7
D.8
38.同步二进制计数器的电路比异步二进制计数器复杂，所以实际应用中较少使用同步二进制计数器
A.正确
D.数据选择器
27.某移位寄存器的时钟脉冲频率为100KHZ，欲将存放在该寄存器中的数左移8位，完成该操作需要（）时间。
A.10us
B.80us
C.100us
D.800ms
28.用二进制异步计数器从0做加法，计到十进制数178，则最少需要（）个触发器
A.2
B.6
C.7
D.8
《数字逻辑》在线作业二-0002
试卷总分:100 得分:0
一、 单选题 (共 40 道试题,共 100 分)
1.N进制计数器可以实现N分频
A.正确
B.错误
2.计数器的模是指对输入的计数脉冲的个数。
A.正确
B.错误
3.N个触发器可以构成能寄存（）位二进制数码的寄存器。
A.触发器
B.晶体管
C.MOS管
D.电容
数字逻辑考题及答案
数字逻辑试题1答案一、填空：（每空1分，共20分）1、（20.57）8=（10.BC）162、(63.25)10=(111111.01)23、（FF）16=(255)104、[X]原=1.1101，真值X=-0.1101，[X]补=1.0011。
5、[X]反=0.1111，[X]补=0.1111。
6、-9/16的补码为1.0111，反码为1.0110。
7、已知葛莱码1000，其二进制码为1111，已知十进制数为92，余三码为110001018、时序逻辑电路的输出不仅取决于当时的输入，还取决于电路的状态。
9、逻辑代数的基本运算有三种，它们是_与_、_或__、_非_。
10、FAB1，其最小项之和形式为_。
FA B AB11、RS触发器的状态方程为_Q n1SRQ n_，约束条件为SR0。
12、已知F1AB、F2ABAB，则两式之间的逻辑关系相等。
13、将触发器的CP时钟端不连接在一起的时序逻辑电路称之为_异_步时序逻辑电路。
二、简答题（20分）1、列出设计同步时序逻辑电路的步骤。
（5分）答：（1）、由实际问题列状态图（2）、状态化简、编码（3）、状态转换真值表、驱动表求驱动方程、输出方程（4）、画逻辑图（5）、检查自起动2、化简FABABCA(BAB)（5分）答：F03、分析以下电路，其中RCO为进位输出。
（5分）答：7进制计数器。
4、下图为PLD电路，在正确的位置添*，设计出FAB函数。
（5分）15分注：答案之一。
三、分析题（30分）1、分析以下电路，说明电路功能。
（10分）解：XY m(3,5,6,7)m(1,2,4,7)2分ABCiXY0000000101010010111010001101101101011111该组合逻辑电路是全加器。
以上8分2、分析以下电路，其中X为控制端，说明电路功能。
（10分）解：FXA B C XABCXABCXABCXABCXABC4分FX(ABC)X(A B C ABC)4分所以：X=0完成判奇功能。
数字逻辑电路2
数字逻辑电路（二）一、单项选择题1．八进制（273）8中，它的第三位数2 的位权为___B___。
答案：B A．(128)10B．(64)10C．(256)10 D．(8)102. 计算机键盘上有101个键，若用二进制代码进行编码，至少应为（）位。
A) 6 B) 7 C) 8 D) 51答案：B3. 在函数F=AB+CD的真值表中，F=1的状态有（）个。
A) 2 B) 4 C) 6 D) 7答案：D4．连续异或1985个1的结果是____B_____。
A．0B．1 C．不确定D．逻辑概念错误答案：B5．下列器件中，属于时序部件的是_____A_____。
答案：AA．移位寄存器B．译码器C．加法器D．多路选择器6.全高出低的电路是逻辑电路为( )。
A) “与非”门B) “与”门C)“或”门D) “或非”门答案：A7 组合逻辑电路的竞争-冒险是由于（）引起的。
答案：CA电路不是最简B．电路有多个输出C．电路中存在延迟D．电路使用不同的门电路8. 能实现从多个输入端中选出一路作为输出的电路称为（）。
答案：CA触发器B．计数器C．数据选择器D．译码器9. 可以用来暂时存放数据的器件是（）。
答案：BA计数器B．寄存器C．全加器D．序列信号检测器10. 在下列器件中，不属于时序逻辑电路的是（）。
答案：CA计数器B．移位寄存器C．全加器D．序列信号检测器二填空题1.N个输入端的二进制译码器，共有__2n___个输出端。
2.存储12位二进制信息需要___4____个触发器。
3. 时序逻辑电路由组合逻辑电路和触发器两部分组成。
4. 时序逻辑电路的功能表示方法有特性表、特性方程、状态图、波形图5时序逻辑电路按触发器时钟端的连接方式不同可以分为异步和同步两类。
6. 可以用来暂时存放数据的器件叫寄存器。
三、分析题1，设计一个三变量判偶电路，当输入变量A ，B ，C 中有偶数个1时，其输出为1；否则输出为0。
请列出真值表并写出逻辑函数，并用3/8线译码器74HC138和适当门电路实现该电路。
(完整版)数电1-10章自测题及答案(2)
第一章绪论一、填空题1、根据集成度的不同，数字集成电路分位以下四类：小规模集成电路、中规模集成电路、大规模集成电路、超大规模集成电路。
2、二进制数是以2为基数的计数体制，十六体制数是以16为基数的计数体制。
3、二进制数只有0和1两个数码，其计数的基数是2，加法运算的进位规则为逢二进一。
4、十进制数转换为二进制数的方法是：整数部分用除2取余法，小数部分用乘2取整法，十进制数23.75对应的二进制数为10111.11。
5、二进制数转换为十进制数的方法是各位加权系数之和，二进制数10110011对应的十进制数为179。
6、用8421BCD码表示十进制时，则每位十进制数可用四位二进制代码表示，其位权值从高位到低位依次为8、4、2、1。
7、十进制数25的二进制数是11001，其对应的8421BCD码是00100101。
8、负数补码和反码的关系式是：补码=反码+1。
9、二进制数+1100101的原码为01100101，反码为01100101，补码为01100101。
-1100101的原码为11100101，反码为10011010，补码为10011011。
10、负数-35的二进制数是-100011，反码是1011100，补码是1011101。
二、判断题1、二进制数有0~9是个数码，进位关系为逢十进一。
（）2、格雷码为无权码，8421BCD码为有权码。
（√）3、一个n位的二进制数，最高位的权值是2^n+1。
（√）4、十进制数证书转换为二进制数的方法是采用“除2取余法”。
（√）5、二进制数转换为十进制数的方法是各位加权系之和。
（√）6、对于二进制数负数，补码和反码相同。
（）7、有时也将模拟电路称为逻辑电路。
（）8、对于二进制数正数，原码、反码和补码都相同。
（√）9、十进制数45的8421BCD码是101101。
（）10、余3BCD码是用3位二进制数表示一位十进制数。
（）三、选择题1、在二进制技术系统中，每个变量的取值为（A）A、0和1B、0~7C、0~10D、0~F2、二进制权值为（B ）A、10的幂B、2的幂C、8的幂D、16的幂3、连续变化的量称为（B ）A、数字量B、模拟量C、二进制量D、16进制量4、十进制数386的8421BCD码为（B）A、0011 0111 0110B、0011 1000 0110C、1000 1000 0110D、0100 1000 01105、在下列数中，不是余3BCD码的是（C ）A、1011B、0111C、0010D、10016、十进制数的权值为（D ）A、2的幂B、8的幂C、16的幂D、10的幂7、负二进制数的补码等于（D ）A、原码B、反码C、原码加1D、反码加18、算术运算的基础是 （ A ）A 、加法运算B 、减法运算C 、乘法运算D 、除法运算9、二进制数-1011的补码是 （ D ）A 、00100B 、00101C 、10100D 、1010110、二进制数最高有效位（MSB ）的含义是 （ A ）A 、最大权值B 、最小权值C 、主要有效位D 、中间权值第二章 逻辑代数基础一、填空题1、逻辑代数中三种最基本的逻辑运算是与运算、或运算、非运算。
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《数字逻辑电路》试题2
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2004级 数字逻辑电路 课程试题（B 卷）
合分人： 复查人：
一、填空题：（每题 2 分，共 20 分）
分数
评卷人
1．十进制数35的二进制数是 ，十六进制数4C 的十进制数是 。
2．正逻辑与门实现负逻辑的运算关系是 。
3．TTL 门电路中能实现线与运算是 。
4．一位全加器和一位半加器的区别是 。
5．T
触发器的特征方程
是 。
题号 一 二 三 四 五 六 七 八 九 十 总分 分数
6．四位计数器的有效状态个数最多是。
7．顺序脉冲产生电路中计数器的有效状态个数由确定。
8．存贮器的片选信号无效时，其数据线呈现状态。
9．由555定时器中构成的多谐振荡器输出波形是。
10．八位D/A转换器的分辨率是。
二、简答题（每题 5 分，共30 分）分
数
评卷
人
1．化简逻辑函数
F（A，B，C）=∑（0, 1, 2, 5, 6，7）F=A-B+-A C+D+-C-D
共 9 页第 3 页
2. 写出下图所示逻辑图的逻辑关系式：
3．用3-8线地址译码器实现逻辑函数F= （1，2，5，6）。
4．画出将JK 触发器转换为D触发器的电路。
5．电路如下图所示，画出Q波形。
共 9 页第 4 页
共 9 页
第 5 页
J
Q
Q
K
SET
CLR
A
A
CP
CP
6．用一片十六进制计数器设计一个十进制计数器。
三、（10 分）
分
数 评卷
人
已知多输出函数真值表(见下表)，用一片3-8线地址译码器和若干逻辑门实现。
共 9 页
第 6 页
A B C 00000001000100001101100101011011011111
1
2L 1
L
四、（ 10 分）
分
数
评卷人
分析下面电路的逻辑功能，写出其真值表。
共 9 页
第 7 页
A i
B i
C i
&
=1
&
=1
≥1
C i+1
S i
C.
74138
7
6543210F F F F F F F F &
123
21A A A S S S D.
F
五、（共 10 分）
分数
评卷人
电路如下图所示，设初态Q1=0、Q2=0、Q3=0，.试分析下图所示电路的逻辑功能，画出 状态转移图.
Q
Q SET
CLR
D
Q
Q SET
CLR
D
Q
Q
SET
CLR
D
六、（10分）分
数
评卷
人
设计产生下图顺序脉冲信号的电路。
共 9 页第 8 页
七、（共10 分）分
数
评卷
人
画出实现下列逻辑函数PLA阵列图。
1．F1（A,B,C）=A⊕B+BC+A-C 2．F2（A,B,C,D）=AB+A-C+BD
共 9 页第 9 页。