实验1 门电路功能测试及组合逻辑电路设计
数电逻辑门电路实验报告doc
数电逻辑门电路实验报告篇一：组合逻辑电路实验报告课程名称：数字电子技术基础实验指导老师：樊伟敏实验名称：组合逻辑电路实验实验类型：设计类同组学生姓名：__________ 一、实验目的和要求（必填）二、实验内容和原理（必填）三、主要仪器设备（必填）五、实验数据记录和处理七、讨论、心得一．实验目的1.加深理解全加器和奇偶位判断电路等典型组合逻辑电路的工作原理。
2.熟悉74LS00、74LS11、74LS55等基本门电路的功能及其引脚。
3.掌握组合集成电路元件的功能检查方法。
4.掌握组合逻辑电路的功能测试方法及组合逻辑电路的设计方法。
二、主要仪器设备74LS00（与非门） 74LS55（与或非门） 74LS11（与门）导线电源数电综合实验箱三、实验内容和原理及结果四、操作方法和实验步骤六、实验结果与分析（必填）实验报告(一)一位全加器1.1 实验原理：全加器实现一位二进制数的加法，输入有被加数、加数和来自相邻低位的进位；输出有全加和与向高位的进位。
1.2 实验内容：用 74LS00与非门和 74LS55 与或非门设计一个一位全加器电路，并进行功能测试。
1.3 设计过程：首先列出真值表，画卡诺图，然后写出全加器的逻辑函数，函数如下： Si = Ai ?Bi?Ci-1 ；Ci = Ai Bi +(Ai?Bi)C i-1异或门可通过Ai ?Bi?AB?AB,即一个与非门；（74LS00），一个与或非门（74LS55）来实现。
Ci = Ai Bi +(Ai?Bi)C再取非，即一个非门（i-1?Ai Bi +(Ai?Bi)Ci-1，通过一个与或非门Ai Bi +(Ai?Bi)Ci-1，用与非门）实现。
1.4 仿真与实验电路图：仿真与实验电路图如图 1 所示。
图11实验名称：组合逻辑实验姓名：学号：1.5 实验数据记录以及实验结果全加器实验测试结果满足全加器的功能，真值表：(二)奇偶位判断器2.1 实验原理：数码奇偶位判断电路是用来判别一组代码中含 1 的位数是奇数还是偶数的一种组合电路。
组合逻辑电路实验报告
组合逻辑电路实验报告图6-1：O型静态险象如图6-1所示电路其输出函数Z=A+A，在电路达到稳定时，即静态时，输出F 总是1。
然而在输入A变化时（动态时）从图6-1（b）可见，在输出Z的某些瞬间会出现O，即当A经历1→0的变化时，Z出现窄脉冲，即电路存在静态O型险象。
进一步研究得知，对于任何复杂的按“与或”或“或与”函数式构成的组合电路中，只要能成为A+A或AA的形式，必然存在险象。
为了消除此险象，可以增加校正项，前者的校正项为被赋值各变量的“乘积项”，后者的校正项为被赋值各变量的“和项”。
还可以用卡诺图的方法来判断组合电路是否存在静态险象，以及找出校正项来消除静态险象。
实验设备与器件1．+5V直流电源2．双踪示波器3．连续脉冲源4．逻辑电平开关5．0-1指示器（3）根据真值表画出逻辑函数Si、Ci的卡诺图（4）按图6-5要求，选择与非门并接线，进行测试，将测试结果填入下表，并与上面真值表进行比较逻辑功能是否一致。
4．分析、测试用异或门、或非门和非门组成的全加器逻辑电路。
根据全加器的逻辑表达式全加和Di =（Ai⊕Bi）⊕Di-1进位Gi =（Ai⊕Bi）·Di-1+Ai·Bi可知一位全加器可以用两个异或门和两个与门一个或门组成。
（1）画出用上述门电路实现的全加器逻辑电路。
（2）按所画的原理图，选择器件，并在实验箱上接线。
（3）进行逻辑功能测试，将结果填入自拟表格中，判断测试是否正确。
5．观察冒险现象按图6-6接线，当B=1，C=1时，A输入矩形波（f=1MHZ 以上），用示波器观察Z输出波形。
并用添加校正项方法消除险象。
数字电路实验
实验一基本门电路（验证型）一、实验目的（1）熟悉常用门电路的逻辑功能；（2）学会利用门电路构成简单的逻辑电路。
二、实验器材数字电路实验箱 1台；74LS00、74LS02、74LS86各一块三、实验内容及步骤1、TTL与非门逻辑功能测试（1）将四2输入与非门74LS00插入数字电路实验箱面板的IC插座上，任选其中一与非门。
输入端分别输入不同的逻辑电平（由逻辑开关控制），输出端接至LED“电平显示”输入端。
观察LED亮灭，并记录对应的逻辑状态。
按图1－1接线，检查无误方可通电。
图1－1表1－1 74LS00逻辑功能表2、TTL或非门、异或门逻辑功能测试分别选取四2输入或非门74LS02、四2输入异或门74LS86中的任一门电路，测试其逻辑功能，功能表自拟。
3、若要实现Y=A′, 74LS00、74LS02、74LS86将如何连接，分别画出其实验连线图，并验证其逻辑功能。
4、用四2输入与非门74LS00实现与或门Y=AB+CD的功能。
画出实验连线图，并验证其逻辑功能。
四、思考题1.TTL与非门输入端悬空相当于输入什么电平？2.如何处理各种门电路的多余输入端？附：集成电路引出端功能图实验二组合逻辑电路（设计型）一、实验目的熟悉简单组合电路的设计和分析过程。
二、实验器材数字电路实验箱 1台，74LS00 三块，74LS02、74LS04、74LS08各一块三、实验内容及步骤1、设计一个能比较一位二进制A与 B大小的比较电路，用X1、X2、X3分别表示三种状态：A>B时，X1=1;A<B时X2=1;A=B时X3＝1。
(用74LS04、74LS08和74LS02实现）要求：（1）列出真值表；（2）写出函数逻辑表达式；（3) 画出逻辑电路图，并画出实验连线图；（4）验证电路设计的正确性。
2、测量组合电路的逻辑关系：（1）图3-2电路用3块74LS00组成。
按逻辑图接好实验电路，输入端A、B、C 分别接“逻辑电平”，输出端D、J接LED“电平显示”；图3-2 表3－2（2）按表3－2要求，将测得的输出状态和LED显示分别填入表内；（3）根据测得的逻辑电路真值表，写出电路的逻辑函数式，判断该电路的功能。
数字电路-实验指导书汇总
数字电路-实验指导书汇总TPE-D型系列数字电路实验箱数字逻辑电路实验指导书实验⼀门电路逻辑功能及测试实验⼆组合逻辑电路（半加器、全加器及逻辑运算）实验三时序电路测试及研究实验四集成计数器及寄存器实验⼀门电路逻辑功能及测试⼀、实验⽬的1、熟悉门电路逻辑功能。
2、熟悉数字电路实验箱及⽰波器使⽤⽅法。
⼆、实验仪器及器件1、双踪⽰波器；2、实验⽤元器件74LS00 ⼆输⼊端四与⾮门 2 ⽚74LS20 四输⼊端双与⾮门 1 ⽚74LS86 ⼆输⼊端四异或门 1 ⽚74LS04 六反相器 1 ⽚三、预习要求1、复习门电路⼯作原理及相应逻辑表达式。
2、熟悉所⽤集成电路的引线位置及各引线⽤途。
3、了解双踪⽰波器使⽤⽅法。
四、实验内容实验前检查实验箱电源是否正常。
然后选择实验⽤的集成电路，按⾃⼰设计的实验接线图接好连线，特别注意Vcc 及地线不能接错(Vcc=+5v，地线实验箱上备有)。
线接好后经实验指导教师检查⽆误可通电实验。
实验中改动接线须先断开电源，接好后在通电实验。
1、测试门电路逻辑功能⑴选⽤双四输⼊与⾮门74LS20 ⼀只，插⼊⾯包板（注意集成电路应摆正放平），按图接线，输⼊端接S1～S4(实验箱左下⾓的逻辑电平开关的输出插⼝)，输出端接实验箱上⽅的LED 电平指⽰⼆极管输⼊插⼝D1～D8中的任意⼀个。
⑵将电平开关按表置位，分别测出输出逻辑状态值及电压值填表。
表2、异或门逻辑功能测试⑴选⼆输⼊四异或门电路74LS86，按图接线，输⼊端1、2、4、5 接电平开关输出插⼝，输出端A 、B 、Y 接电平显⽰发光⼆极管。
⑵将电平开关按表的状态转换，将结果填⼊表中。
表3、逻辑电路的逻辑关系⑴⽤ 74LS00 双输⼊四与⾮门电路，按图、图接线，将输⼊输出逻辑关系分别填⼊表，表中。
⑵写出两个电路的逻辑表达式。
4、逻辑门传输延迟时间的测量⽤六反相器（⾮门）按图接线，输⼊80KHz 连续脉冲（实验箱脉冲源），⽤双踪⽰波器测输⼊、输出相位差。
组合逻辑电路(半加器全加器及逻辑运算)实验报告
电子通信与软件工程系2013-2014学年第2学期《数字电路与逻辑设计实验》实验报告--------------------------------------------------------------------------------------------------------------------- 班级：姓名：学号：成绩：同组成员：姓名：学号：---------------------------------------------------------------------------------------------------------------------一、实验名称：组合逻辑电路（半加器全加器及逻辑运算）二、实验目的：1、掌握组合逻辑电路的功能调试2、验证半加器和全加器的逻辑功能。
3、学会二进制数的运算规律。
三、实验内容：1．组合逻辑电路功能测试。
（1）．用2片74LS00组成图4.1所示逻辑电路。
为便于接线和检查．在图中要注明芯片编号及各引脚对应的编号。
（2）．图中A、B、C接电平开关，YI，Y2接发光管电平显示．（3）。
按表4。
1要求，改变A、B、C的状态填表并写出Y1，Y2逻辑表达式．（4）．将运算结果与实验比较．2．测试用异或门（74LS86）和与非门组成的半加器的逻辑功能．根据半加器的逻辑表达式可知．半加器Y是A、B的异或，而进位Z是A、B相与，故半加器可用一个集成异或门和二个与非门组成如图4.2．（1）．在学习机上用异或门和与门接成以上电路．接电平开关S．Y、Z接电平显示．（2）．按表4．2要求改变A、B状态，填表．3．测试全加器的逻辑功能。
（1）．写出图4．3电路的逻辑表达式。
（2）．根据逻辑表达式列真值表．（3）．根据真值表画逻辑函数S i 、Ci的卡诺图．（4）．填写表4．3各点状态（5）．按原理图选择与非门并接线进行测试，将测试结果记入表4．4，并与上表进行比较看逻辑功能是否一致．实验结果：表4．1输入输出A B C Y1 Y20 0 0 1 1 1 1 0 0111111111111111111Y1=A+B Y2=（A’·B）+（B’·C）表4．2输入端 A 0 1 0 1B 0 0 1 1输出端Y 0 1 1 0Z 0 0 0 1 表4Ai BiC1 i Y Z X1 X2 X3 S i C i0 0 0 0 0 1 1 1 0 00 1 0 1 0 1 0 1 1 01 0 0 1 0 1 0 1 1 0 1 1 0 0 0 1 1 1 0 1 0 0 1 0 1 1 1 0 1 00 1 1 1 1 0 1 1 0 11 0 1 1 1 0 1 1 0 1 1 1 1 0 1 1 1 0 1 1表4．4输入端Ai0 0 0 0 1 1 1 1Bi0 0 1 1 0 0 1 1C1 i0 1 0 1 0 1 0 1输出端Ci0 0 0 1 0 1 1 1Si0 1 1 0 1 0 0 1 Y=A’B+AB’Z=CX1=A’B+C’+AB X2=A’B’+AB+C X3=A’B+AB’+C’Si=A’B’C+A’BC’+AB’C+ABC Ci=AC+AB+BC实验总结：此实验中因本就缺少一块74LS00的芯片导致线路不完整，原本打算用74LS20来代替74LS00，但电路还是出现了问题，原以为是电路接线的问题，也重新接线过，但是情况毫无变化。
西电数电实验1组合逻辑电路设计研究一
WORD格式整理版数字电子技术实验报告学院班级：软件学院131213班学生学号： 13121228学生姓名：黄雯同作者: 吴青霞实验日期： 2014年4月27日实验题目：组合逻辑电路的研究一．实验目的：1.了解三变量表决器的真值表、卡诺图，用数字电路板实现电路2.掌握一位全加器的真值表、卡诺图，用数字电路板实现电路3．掌握用MSI器件实现四位全加器的方法，并掌握全加器的应用。
二、实验环境：数字电路实验板三、实验内容及实验原理、（一）基本命题1. 用四2输入与非门74LS00和三输入与非门74HC11组成电路。
输入加逻辑开关，实现三变量多数表决器的功能，记录真值表，画出卡诺图和逻辑电路图2.用四2输入异或门74LS86和四2输入与非门74LS00组成一位全加器电路，输入加逻辑开关，测试其功能,并记录真值表，画出卡诺图和逻辑电路图。
3.用74LS283实现四位全加器电路，用数码管显示其全加和，并将结果填入表1中。
（二）实验原理与实验步骤a.三变量表决器1.实验原理：三变量表决器真值表如表1所示真值表（表1）根据三变量表决器真值表，画出三变量逻辑卡诺图。
如图1所示三变量表决器参考电路如图2所示图2用门电路实现的多数表决电路由真值表和卡诺图得出三变量表决器的逻辑表达式为：F= AC BC ⋅⋅AB2.实验步骤：用逻辑开关当做A B C 三个变量，将A 接到1A ，B 接到1B, 将A 接到2A ，将C 接到2B, 将B 接到3A ，C 接到3B, 将1Y 接到74HC10的1A ，2Y 接到1B, 将3Y 接到1C ，将1Y 与与led 灯相连，将开关打到“1”，观察led 灯是否闪亮，以此检验电路图的正确性。
74SL00A BCF74HC10b.设计一位全加器1.实验原理：一位全加器真值表如表2所示：真值表Array（表2）根据一位全加器的真值表，画出三变量卡诺图，如图3所示：S i 的卡诺图 C i+1的卡诺图（图3）一位全加器的参考如图4所示：图 4一位全加器电路图4所示电路是由四2输入与非门74LS00和四2输入异或门74LS86组成的 一位全加器电路。
数字逻辑实验报告武大(3篇)
第1篇一、实验目的1. 理解数字逻辑的基本概念和原理；2. 掌握数字逻辑电路的基本分析方法；3. 熟悉数字电路仿真软件的使用；4. 培养实验操作能力和问题解决能力。
二、实验内容及步骤1. 实验一：组合逻辑电路设计（1）设计2选1多路选择器（MUX21）1）根据教材5.1节流程，利用Quartus II完成MUX21的文本编辑输入（MUX21.v）；2）进行仿真测试，给出仿真波形；3）在实验系统上硬件测试，验证设计功能；4）引脚锁定及硬件下载测试，a和b分别接来自不同的时钟，输出信号接蜂鸣器；5）编译、下载和硬件测试实验，通过选择键1，控制s，可使蜂鸣器输出不同音调。
（2）设计三人表决电路1）根据教材5.1节流程，利用Quartus II完成三人表决电路的文本编辑输入（图5-36）；2）进行仿真测试，给出仿真波形；3）在实验系统上硬件测试，验证设计功能；4）引脚锁定及硬件下载测试，ABC[2..0]分别接自键3、键2、键1；CLK接自时钟CLOCK0(256Hz)，输出信号X接D1，输出信号Y接蜂鸣器；5）编译、下载和硬件测试实验，通过按下键3、键2、键1，控制D1的亮灭。
2. 实验二：时序逻辑电路设计（1）设计‘101’序列检测器1）验证RS/D/JK/T触发器的功能；2）熟悉逻辑分析仪、字发生器的使用；3）形成原始的状态图和状态表；4）采用Mealy型同步时序逻辑电路实现序列检测器的功能；5）初始状态：A，状态1：B，状态2：C；6）状态化简（用隐含表）；7）状态编码（优先级1>2>3的顺序编码）；8）确定激励函数和输出函数，并画出逻辑电路图；9）在Ni Multisim上实现电路的仿真；10）记录实验现象，采用截屏波形的方法。
（2）设计RISC-V五级流水线CPU1）了解数字逻辑与组成原理实践教程；2）设计32位RISC-V五级流水线CPU代码；3）使用Modelsim进行仿真；4）提供项目源代码、测试数据、设计图和指令集；5）编写实验报告，包括实验目的、环境介绍、系统设计、实验步骤和结果分析。
东南大学第2章-计算机逻辑实验报告-门电路组合逻辑
东南大学电工电子实验中心实验报告一、实验目的（1）掌握TTL和CMOS器件的静态特性和动态特性测量方法及这些特性对数字系统设计的影响；（2）掌握通过数字器件手册查看器件静态和动态特性参数；（3）掌握不同结构的数字器件之间的互连；（4）掌握OC门和三态门的特性和使用方法；（5）加深示波器测量技术的训练；（6）掌握小规模组合逻辑的工程设计方法；（7）了解竞争和冒险的产生原因，消除方法，掌握用示波器和逻辑分析捕捉毛刺的方法。
二、实验仪器三、实验原理实验原理见教材第2章。
预习思考题如下：1、下图中的两个电路在实际工程中经常用到，其中反相器为74LS04，电路中的电阻起到了保证输出电平的作用。
分析电路原理，并根据器件的直流特性计算电阻值的取值范围。
N 个N 个（a ）（b ）答：①电路(a)使用条件是驱动门电路固定输出为低电平当OL V V =时，如果有N 个负载门且20>N ，将使max max OL IL I NI >，而m a x OL I I >将使max OL OL V V >，所以需如图（a ）所示接下拉电阻R 。
()()Ω=-=-≤≤-≤=12584.05.030max max max maxmax max max2N OL IL OL OL OL IL OL mAN VI NI V R V R I NI V R I②电路(b)使用条件是驱动门电路固定输出为高电平当OH V V =时，如果有N 个负载门且20>N ，将使max max O H IH I NI >，而m ax OH I I >将使min O H O H V V <，所以需如图（b ）所示接上拉电阻R 。
()()()Ω=--=--≤≥--≥-=k 5.114.002.07.2555530max max min minmax max min2N OH IH OH OH OH IH OH mAN VI NI V V R V R I NI V V R I V2、下图中的电阻起到了限制前一级输出电流的作用，根据器件的直流特性计算电阻值的取值范围。
组合逻辑电路实验分析
实验四组合逻辑电路实验分析一、实验目的1．掌握组合逻辑电路的分析方法与测试方法；2．了解组合电路的冒险现象及消除方法；3．验证半加器、全加器的逻辑功能。
二、预习要求1．复习组合逻辑电路的分析方法；2．复习用与非门和异或门等构成的半加器、全加器的工作原理；3．复习组合电路冒险现象（险象）的种类、产生原因，如何消除？三、实验原理1．组合逻辑电路由很多常用的门电路组合在一起，实现某种功能的电路，它在任意时刻的输出，仅取决于该时刻输入信号的逻辑取值，而与信号作用前电路原来的状态无关。
2．组合逻辑电路的分析是指根据所给的逻辑电路，写出其输入与输出之间的逻辑函数表达式或真值表，从而确定该电路的逻辑功能。
其分析步骤为：3．组合电路的冒险现象(1)实际情况下，由于器件的延时效应，在一个组合电路中，输入信号发生变化时，输出出现瞬时错误的现象，把这现象叫做组合电路中的冒险现象，简称险象。
这里研究静态险象，即电路达到稳定时，出现的险象。
可分为0型静态险象（如图4-1）和1型静态险象（如图4-2）:图4-1 0型静态险象其输出函数Y=A+A,在电路达到稳定时，即静态时，输出Y总是1。
然而在输入A变化时，输出Y的某些瞬间会出现0，Y出现窄脉冲，存在有静态0型险象。
图4-2 1型静态险象其输出函数Y=A+A,在电路达到稳定时，即静态时，输出Y总是O。
然而在输入A变化时，在输出Y的某些瞬间会出现1，Y出现窄脉冲，存在有静态1型险象。
（2）进一步研究得知，对于任何复杂的组合逻辑电路，只要能成为A+A或A A的形式，必然存在险象。
为了消除险象，通常用增加校正项的方法，如果表达式中出现A+A形式的电路，校正项为被赋值各变量的“乘积项”；表达式中出现A A形式的电路，校正项为被赋值各变量的“和项”。
例如：逻辑电路的表达式为Y=A B+AC；当B=C=1时，Y=A+A，Y正常情况下，稳定后应输出1，但实际中出现了0型静态险象。
这时可以添加校正项BC，则Y A B+AC+ BC=A+A+1=1,从而消除了险象。
【数字电路设计实训】实验指导书
数字电路设计实训实验指导书编写人：许一男审核人：金永镐延边大学工学院电子信息通信学科目录一、基础实验部分实验一门电路逻辑功能及测试 (1)实验二组合逻辑电路（半加器、全加器及逻辑运算） (5)实验三R-S,D,JK触发器 (9)实验四三态输出触发器，锁存器 (12)实验五集成计数器及寄存器 (15)实验六译码器和数据选择器 (18)实验七555时基电路 (21)二、选做实验部分实验八时序电路测试机研究 (26)实验九时序电路应用 (29)实验十四路优先判决电路 (31)三、创新系列（数字集成电路设计）实验部分实验十一全加器的模块化程序设计与测试 (33)实验十二串行进位加法器的模块化程序设计与测试 (35)实验十三N选1选择器的模块化程序设计与测试 (36)实验一门电路逻辑功能及测试一、实验目的1. 熟悉门电路逻辑功能2. 熟悉数字电路学习机及示波器使用方法二、实验仪器及材料1. 双踪示波器2. 器件74LS00 二输入端四与非门2片74LS20 四输入端双与非门1片74LS86 二输入端四异或门1片74LS04 六反相器1片三、预习要求1. 复习门电路工作原理及相应逻辑表达式。
2. 熟悉所用集成电路的引线位置及引线用途。
3. 了解双踪示波器的使用方法。
四、实验内容实验前按学习机使用说明先检查学习机电源是否正常，然后选择实验用的集成电路，按自己设计的实验电路图接好连线，特别注意Vcc及接地线不能接错。
线接好后经实验指导教师检查无误方可通电实验。
实验中改动接线需先断开电源，接好线后再通电实验。
1. 测试门电路逻辑功能图1.1（1）选用四输入与非门74LS20一只，插入面包板，按图1.1接线，输入端接S1~S4（电平开关输出端口），输出端接电平显示发光二极管（D1~D8任意一个）。
（22.异或门逻辑功能测试。
图1.2（1）选二输入四异或门电路74LS86，按图1.2接线，输入端1、2、4、5接电平开关，输出端A、B、Y接电平显示发光二极管。
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实验1 门电路功能测试及组合逻辑电路设计
2.1.1实验目的
（1） 掌握常用门电路的逻辑功能及测试方法。
（2） 掌握用小规模集成电路设计组合逻辑电路的方法。
2.1.2实验仪器设备与主要器件
数字电路实验箱一个;双踪示波器一台；稳压电源一台；数字万用表。
74LS00(四2输入与非门)一片；74LS10(三3输入与非门)一片；74LS20(二4输入与非门)
一片。
2.1.3实验原理
TTL集成逻辑电路的种类繁多，现以74LS00为例介绍其内部电路结构和工作原理。
如图所示，当输入信号A、B中有一个是低电平时，T1必有一个发射结导通，并将T1
的基极电位钳在0.9V（设定VIL=0.2V,VBE=0.7V）。这是T2不会导通。（由于T1集电极回路
电阻是R2和T2的b-c结反向电阻之和，阻值非常大，所以T1工作在深度饱和状态，使VCE
（sat）≈0）。T2截止后VC2为高电平，VE2为低电平，从而使T4导通，T5截止，输出端F
为高电平VOH。
当输入信号A、B均为高电平（VIH=3.4V）时，如果不考虑T2的存在，则
Vb1=3.4V+0.7V=4.1V。然而T2和T5不但存在，而且必然导通。一旦T2和T5导通后Vb1
便被钳在了2.1V（3×0.7V），所以T1的基电极实际不是4.1V，而只能是2.1V左右。这样，
T2导通使VC2降低而VE2升高，导致T4截止，T5导通，输出变为低电平VOL。与非门输入
输出关系见表。
使用时应对选用的器件进行简单的逻辑功能检查，以保证实验的顺利进行。
测试门电路有静态测试动态测试两种方法。静态测试时，门电路输入端加固定高（H）（L）
电平，用示波器，万用表或发光二级管（LED）测出门电路的输出响应。动态测试时，门电
路的一个输入端加脉冲信号，用示波器观察输入波形和输出波形的同步关系。下面以74LS00
为例简述测试方法。
74LS00为四2输入与非门，与非门的电路如图2-1-1所示。74LS00将4个2输入与非
门封装在一个集成芯片中，共14条引线。使用时必须在第14引脚上加+5V电压，第7引脚
与地接好。整个测试过程包括静态测试、动态测试和主要参数测试三部分。
1.静态逻辑功能测试
静态逻辑功能测试用来检验门电路的真值表，确认门电路逻辑功能是否正确。实验时，
可将74LS00中的一个与非门输入端A、B分别作为输入逻辑变量，加高、低电平，观察输出
电平是否符合2-1-2的与非门真值表。测试电路如图2-1-2所示。实验输入端A、B输入的
电平由数字电路实验箱中的逻辑电平产生电路产生，输出F可直接插至逻辑电平指示电路的
某一路进行显示。
2.动态逻辑功能测试
动态逻辑功能测试输入信号波形和电路图分别如图2-1-3及图2-1-4所示。
动态测试适用于数字系统运行中逻辑功能的检查。测试时，电路输入串行数字信号，用
示波器比较输入与输出信号的波形，以此确定电路的功能。试验时与非门输入端A加1KHz
2
的脉冲信号Vi，如图2-1-3所示，另一端加上开关信号，观察F输出波形是否符合功能要
求。
组合电路的设计要从给定的逻辑功能要求出发，设计出符合该逻辑功能要求的电路，如
图2-1-5所示。设计步骤如下：
（1） 根据设计任务列出真值表；
（2） 通过对卡诺图或逻辑表达式的化简，得出最简逻辑表达式；
（3） 选择合适的标准器件实现逻辑函数。
2.1.4实验内容
1.对74LS00进行功能测试，按图2-1-2实现静态测试，测试结果与表2-1-2对照，说
明其逻辑功能是否正确；按图2-1-4实现动态测试，画出输入输出同步波形图，并说明实验
所得波形是否符合要求。
（1）静态测试：
仿真图：
74LS00与非门真值表
A B F
0 0 1
0 1 1
1 0 1
0 0 0
（2）动态测试：
仿真图：
3
示波器输入输出波形：
2.分析测试图2-1-8所示电路的逻辑功能，将测试结果填入表2-1-4的F列中，并写出逻辑
表达式。
逻辑图：
4
测试结果表
A B C F
0 0 0 0
0 0 1 0
0 1 0 0
0 1 1 1
1 0 0 0
1 0 1 1
1 1 0 1
1 1 1 1
3、设计一个控制楼梯电灯的开关控制器。设楼上楼下各装一个开关，要求两开关均可控制
楼梯间的一个电灯。设楼上楼下开关分别用K1、K2表示，1表示开关闭合，0表示开关断开；
灯的状态用Y表示，1表示亮，0表示灭，则开关和灯的控制关系可参照表2-1-5所示的真
值表。写出逻辑表达式，画出逻辑电路并接线调试，观察输出状态是否正确。
K1 K2 Y
Y
0 0 0 1
0 1 1 0
1 0 1 0
1 1 0 1
由题意知K1、K2是异或的关系
仿真图：
学号：2012119032
专业：通信工程
姓名：余海东