2017年4月电子电路EDA技术参考答案
EDA技术课后参考答案

第一章的英文全称及其中文含义是什么?答:EDA是Electronic Design Automation,其中文含义是“电子设计自动化”。
2.什么叫EDA技术?简述EDA技术的发展历程。
答:EDA技术有狭义和广义之分,狭义EDA技术就是以大规模可编程逻辑器件为设计载体,以硬件描述语言为系统逻辑描述的主要表达方式,以计算机、大规模可编程逻辑器件的开发软件及实验开发系统为设计工具,通过有关的开发软件,自动完成用软件的方式设计的电子系统到硬件系统的逻辑编译、逻辑化简、逻辑分割、逻辑综合及优化、逻辑布局布线、逻辑仿真,直至完成对于特定目标芯片的适配编译、逻辑映射、编程下载等工作,最终形成集成电子系统或专用集成芯片的一门新技术,或称为IES/ASIC自动设计技术。
3.简述用EDA技术设计电路的设计流程。
答 EDA设计流程包括:设计准备、设计输入、设计处理、设计校验、器件编程、器件测试和设计验证。
4.什么叫”综合”和”网表文件”?答: (A)在电子设计领域中综合的概念可以表示为:将用行为和功能层次表达的电子系统转换为低层次的便于具体实现的模块组合装配的过程。
(1)从自然语言转换到 VHDL 语言算法表示,即自然语言综合。
(2)从算法表示转换到寄存器传输级(RegisterTransport Level,RTL),即从行为域到结构域的综合,即行为综合。
(3)从 RTL 级表示转换到逻辑门(包括触发器)的表示,即逻辑综合。
(4)从逻辑门表示转换到版图表示(ASIC 设计),或转换到 FPGA 的配置网表文件,可称为版图综合或结构综合。
综合在电子设计自动化中处于核心地位。
(B)网表文件是描述电路的连接关系的文件,一般以文本文件的形式存在。
英文为netlist file格式有cdl, spice, aucdl...等5.从使用的角度来讲,EDA技术主要包括几个方面的内容?这几个方面在整个电子系统的设计中分别起什么作用?答: EDA技术的学习主要应掌握4个方面的内容:① 大规模可编程逻辑器件;② 硬件描述语言;③ 软件开发工具;④ 实验开发系统。
eda技术实用教程期末考试题及答案

eda技术实用教程期末考试题及答案一、选择题(每题2分,共20分)1. EDA技术中,FPGA代表的是()。
A. 现场可编程逻辑阵列B. 现场可编程门阵列C. 现场可编程逻辑器件D. 现场可编程门器件答案:B2. 在EDA技术中,VHDL是一种()。
A. 硬件描述语言B. 软件描述语言C. 系统描述语言D. 网络描述语言答案:A3. 下列哪个不是EDA工具的主要功能()。
A. 逻辑综合B. 电路仿真C. 代码编译D. 布局布线答案:C4. 在VHDL中,下列哪个关键字用于定义并行语句()。
A. ifB. beginC. loopD. process答案:B5. 在EDA技术中,用于测试和验证数字电路的EDA工具是()。
A. 逻辑综合工具B. 电路仿真工具C. 布局布线工具D. 测试生成工具答案:B6. 下列哪个不是FPGA的配置方式()。
A. 在系统可编程B. 串行配置C. 并行配置D. 网络配置答案:D7. 在VHDL中,用于定义信号的关键字是()。
B. constantC. signalD. type答案:C8. 在EDA技术中,用于描述数字电路行为的模型是()。
A. 结构模型B. 数据流模型C. 行为模型D. 混合模型答案:C9. 在VHDL中,下列哪个关键字用于定义过程()。
A. procedureB. functionD. entity答案:C10. 在EDA技术中,用于优化电路性能的EDA工具是()。
A. 逻辑综合工具B. 电路仿真工具C. 布局布线工具D. 测试生成工具答案:C二、填空题(每题2分,共20分)1. EDA技术中的“EDA”代表的是______、______和______。
答案:电子设计自动化2. VHDL中的并发语句包括______、______、______和______。
答案:信号赋值、条件信号赋值、选择信号赋值、元件实例化3. 在FPGA设计中,______是用于存储配置数据的非易失性存储器。
EDA课后习题答案

1-5 叙述EDA的FPGA/CPLD设计流程,以及涉及的EDA工具及其在整个流 程中的作用。 答:完整地了解利用EDA技术进行设计开发的流程对于正确地选择和使用 EDA软件、优化设计项目、提高设计效率十分有益。一个完整的、典型的 EDA设计流程既是自顶向下设计方法的具体实施途径,也是EDA工具软件 本身的组成结构。
1-4 IP在EDA技术的应用和发展中的意义是什么? 答:IP就是知识产权核或知识产权模块的意思,在EDA技术和开 发中具有十分重要的地位。美国著名的Dataquest咨询公司将半 导体产业的IP定义为“用于ASIC或FPGA中的预先设计好的电路功 能模块”。IP分软IP、固IP和硬IP。 软IP是用HDL等硬件描述语言描述的功能块,但是并不涉 及用什么具体电路元件实现这些功能。 固IP是完成了综合的功能块。它有较大的设计深度,以网 表文件的形式提交客户使用。 硬IP提供设计的最终阶段产品——掩模。随着设计深度的 提高,后续工序所需要做的事情就越少;当然,灵活性也就越小。 不同的客户可以根据自己的需要订购不同的IP产品。
1-9 为什么说用逻辑门作为衡量逻辑资源大小的最小单元不准确。 答:专业习惯是将OLMC及左侧的可编程与阵列合称一个逻辑宏单元,即标 志PLD器件逻辑资源的最小单元,由此可以认为GAL16V8器件的逻辑资源是 8个逻辑宏单元,而目前最大的FPGA的逻辑资源达数十万个逻辑宏单元。也 有将逻辑门的数量作为衡量逻辑器件资源的最小单元,如某CPLD的资源约 2000门等,但此类划分方法误差较大。 1-10 标志FPGA/CPLD逻辑资源的逻辑宏单元包含哪些结构? 答: CPLD( MAX7000S)系列中的 逻辑宏单元由3个功能块组成:逻辑阵列、 乘积项选择矩阵和可编程寄存器,它们可以被单独地配置为时序逻辑和组合逻 辑工作方式。其中逻辑阵列实现组合逻辑,可以给每个逻辑宏单元提供5个乘 积项。“乘积项选择矩阵”分配这些乘积项作为到“或门”和“异或门”的主 要逻辑输入,以实现组合逻辑函数;或者把这些乘积项作为宏单元中寄存器的 辅助输入:清零(Clear)、置位(Preset)、时钟(Clock)和时钟使能控制 (Clock Enable)。 FPGA(Cyclone III)器件的可编程资源主要来自逻辑阵列块LAB,而每个LAB都 由多个逻辑宏单元(Logic Element,LE)构成。LE是Cyclone III FPGA器件 的最基本的可编程单元,LE主要由一个4输入的查找表LUT、进位链逻辑、寄 存器链逻辑和一个可编程的寄存器构成。
EDA试题答案

学习使人进步1.1.1(1)什么叫EDA(P1)?EDA技术是一种以计算机为工作平台,结合计算机图形学、拓扑逻辑学、计算方法学及人工智能等多项计算机应用科学的最新成果而开发出来的一套软件工具。
1.1.2(2)EDA技术在硬件硬件方面融合了哪些技术(P1)?大规模集成电路制造技术、IC版图设计技术、ASIC (专用集成电路)测试和封装技术、FPGA和CPLD编程下载技术、自动测试技术等1.1.3(3)EDA技术在计算机辅助工程方面融合了哪些技术(P1)?计算机辅助设计(CAD)、计算机辅助制造(CAM)、计算机辅助测试(CAT)、计算机辅助工程(CAE)技术以及多种计算机语言的设计概念。
1.1.4(4)EDA技术在现代电子学方面融合了哪些内容(P1)?如:电子线路设计理论、数字信号处理技术、嵌入式系统和计算机设计技术、数字系统建模和优化技术及微波技术等1.1.5(5)EDA技术在21世纪的突出表现有哪5个方面(P2)?●使电子设计产品以自主知识产权方式得以明确表达和确认成为可能。
●在仿真验证和设计两方面都支持标准硬件描述语言的功能强大的EDA软件不断推出。
●电子技术全方位进入EDA领域。
●EDA使得电子领域各学科的界限更加模糊,更加互为包容。
●不断推出更大规模的FPGA和CPLD。
●基于EDA工具的用于ASIC设计的标准单元已涵盖大规模电子系统及复杂IP核模块。
●软硬件IP核在电子领域得以进一步确认。
●SoC高效率低成本设计技术日益成熟。
●系统级、行为验证级硬件描述语言使复杂电子系统的设计特别是验证趋于高效和简单。
1.2.1(6)画图说明EDA技术实现目标是什么(P3)?1.3.1(7)目前常用的HDL主要有哪些?其中使用最多的是谁(P4)?VHDL;Verilog HDL;SystemVerilog ;System C 1.3.2(8)与Verilog相比VHDL有哪两方面优势?有哪三方面不足(P5)?优势:1.语法比Verilog更严谨,通过EDA工具自动语法检查,以排除许多设计中的疏忽;2.有很好的行为级描述能力和一定的系统级描述能力,而Verilog建模时,行为与系统级抽象及相关描述能力不及VHDL。
EDA技术实用教程课后习题答案

第一章1-1 EDA 技术与ASIC 设计和FPGA 开发有什么关系?答:利用EDA 技术进行电子系统设计的最后目标是完成专用集成电路ASIC 的设计和实现;FPGA 和CPLD 是实现这一途径的主流器件。
FPGA 和CPLD 通常也被称为可编程专用IC,或可编程ASIC。
FPGA 和CPLD 的应用是EDA 技术有机融合软硬件电子设计技术、SoC(片上系统)和ASIC 设计,以及对自动设计与自动实现最典型的诠释。
1-2 与软件描述语言相比,VHDL 有什么特点? P6答:编译器将软件程序翻译成基于某种特定CPU 的机器代码,这种代码仅限于这种CPU 而不能移植,并且机器代码不代表硬件结构,更不能改变CPU 的硬件结构,只能被动地为其特定的硬件电路结构所利用。
综合器将VHDL程序转化的目标是底层的电路结构网表文件,这种满足VHDL 设计程序功能描述的电路结构,不依赖于任何特定硬件环境;具有相对独立性。
综合器在将VHDL(硬件描述语言)表达的电路功能转化成具体的电路结构网表过程中,具有明显的能动性和创造性,它不是机械的一一对应式的“翻译”,而是根据设计库、工艺库以及预先设置的各类约束条件,选择最优的方式完成电路结构的设计。
l-3 什么是综合?有哪些类型?综合在电子设计自动化中的地位是什么? 什么是综合? 答:在电子设计领域中综合的概念可以表示为:将用行为和功能层次表达的电子系统转换为低层次的便于具体实现的模块组合装配的过程。
有哪些类型? 答:(1)从自然语言转换到VHDL 语言算法表示,即自然语言综合。
(2)从算法表示转换到寄存器传输级(RegisterTransport Level,RTL),即从行为域到结构域的综合,即行为综合。
(3)从RTL 级表示转换到逻辑门(包括触发器)的表示,即逻辑综合。
(4)从逻辑门表示转换到版图表示(ASIC 设计),或转换到FPGA 的配置网表文件,可称为版图综合或结构综合。
电子科技《EDA技术》在线作业1辅导答案

电子科技《EDA技术》在线作业1
单选题
一、单选题(共 20 道试题,共 100 分。
)
1. 根据VHDL语法规则,下面哪个标识符是非法的标识符
A. not—Ack
B. constant
C. FFT_1024_1
D. state0
-----------------选择:B
2. MAX+PLUS的文本文件类型是(后缀名)是
A. *.scf
B. *.vhd
C. *.gdf
D. *.sof
-----------------选择:B
3. 字符串型文字O“1234”的长度为___________。
A. 12
B. 4
C. 8
D. 16
-----------------选择:A
4. 值为“1110”的标准逻辑矢量,进行sla运算后值为____________ 。
A. 1100
B. 1101
C. 1110
D. 1000
-----------------选择:B
5. 一个完整的VHDL程序,至少应包括三个基本组成部分是
A. 实体、子程序、配置
B. 实体、结构体、配置、函数
C. 结构体、状态机、程序包和库
D. 实体、结构体、程序包和库
-----------------选择:D
6. 在元件例化语句中,用_______符号实现名称映射,将例化元件端口声明语句中的信号与PORT MAP()中的信号名关联起来。
A. =
B. :=
C. <=
D. =>
-----------------选择:D
7. 实体说明中包括端口说明,那么端口的模式可分为以下哪几种。
EDA技术习题集及答案

第一章 EDA概述一、填空题1.2000年推出的Pentium 4微处理器芯片的集成度达——万只晶体管。
2.一般把EDA技术的发展分为——、——和——三个阶段。
3.在EDA发展的——阶段,人们只能借助计算机对电路进行模拟、预测,以及辅助进行集成电路版图编辑、印刷电路板(PcB)布局布线等工作。
4.在EDA发展的——阶段,人们可以将计算机作为单点设计工具,并建立各种单元库,开始用计算机将许多单点工具集成在一起使用。
5.EDA设计流程包括——、——、——和——四个步骤。
6.EDA的设计验证包括——、——和——三个过程。
7.EDA的设计输入主要包括——、——和———。
8.文本输入是指采用——进行电路设计的方式。
9.功能仿真是在设计输入完成之后,选择具体器件进行编译之前进行的逻辑功能验证,因此又称为——。
10.时序仿真是在选择了具体器件并完成布局、布线之后进行的时序关系仿真,因此又称为——或——。
11.当前最流行的并成为1EEE标准的硬件描述语言包括————和——。
12.采用PLD进行的数字系统设计,是基于芯片的设计或称之为——的设计。
13.硬件描述语言HDL给PLD和数字系统的设计带来了更新的设计方法和理念,产生了目前最常用的并称之为——的设计法。
14.EDA工具大致可以分为——、——、———、———和——等五个模块。
15.将硬件描述语吉转化为硬件电路的重要工具软件称为——————。
二、单项选择题1.将设计的系统或电路按照EDA开发软件要求的某种形式表示出来,并送入计算机的过程称为( )。
①设计输入②设计输出③仿真④综合2.一般把EDA技术的发展分为( )几个阶段。
①2 ②3 ③4 ④53.AHDL属于( )描述语言。
①普通硬件②行为③高级④低级4.vHDL属于( )描述语言。
①普通硬件②行为③高级④低级5.包括设计编译和检查、逻辑优化和综合、适配和分割、布局和布线,生成编程数据文件等操作的过程称为( )。
电子电路eda技术自考试题及答案

电子电路eda技术自考试题及答案一、单项选择题(每题2分,共20分)1. EDA技术中的“EDA”代表什么?A. Electronic Design AutomationB. Electronic Data ApplicationC. Electronic Document AnalysisD. Electronic Device Application答案:A2. 在EDA技术中,下列哪项不是设计流程的一部分?A. 原理图绘制B. 电路仿真C. 电路测试D. 电路维修答案:D3. 下列哪个软件不是EDA工具?A. CadenceB. MATLABC. Adobe PhotoshopD. Altium Designer答案:C4. 在EDA技术中,PCB代表什么?A. Printed Circuit BoardB. Personal Computer BoardC. Programming Control BoardD. Power Control Board答案:A5. VHDL是一种用于什么目的的硬件描述语言?A. 软件编程B. 电路设计C. 数据库管理D. 图像处理答案:B二、多项选择题(每题3分,共15分)1. 下列哪些是EDA技术的优势?A. 提高设计效率B. 减少设计错误C. 降低设计成本D. 增加设计复杂性答案:ABC2. 在EDA技术中,以下哪些步骤是设计流程的一部分?A. 原理图绘制B. 电路仿真C. 电路测试D. 电路维修答案:ABC3. 下列哪些是常见的EDA工具?A. CadenceB. MATLABC. Adobe PhotoshopD. Altium Designer答案:ABD三、填空题(每题2分,共10分)1. 在EDA技术中,______是用于描述数字电路行为的一种语言。
答案:VHDL2. EDA技术可以用于设计______、模拟电路和混合信号电路。
答案:数字电路3. PCB设计中,______是用于连接电子元件的导电路径。
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2017.4电子电路EDA
一、单项选择题
1.B
2.A
3.B
4. B
5. A
6.C
7.A
8.A
9.C 10. A
11.D 12.C 13.C 14.B 15.D
二、名词解释题
16.专有集成电路
17.寄存器传输级
18.片上可编程系统
三、判断改错题
19.正确
20.错误
把功能仿真改为时序仿真。
21.正确
22错误
把片外改为片上
四、简答题
23.状态机模式:可以无外设、无总线结构和无实时操作系统,达到最低的成本,应用于VGA和LCD控制等,达到可高或可低的性能。
单片机模式:包括一定的外设,可以利用实时操作系统和总线结构,以中等的成本,应用于控制和仪表,达到中等的性能。
定制嵌入模式:高度集成扩充的外设,实时操作系统和总线结构,达到高性能,应用于网络和无线通信等。
24.阻塞赋值“可以看作一步进程:
当没有其它可以打断赋值的描述时,估计等式右边的值并赋予左边。
其完成后,才进行下一条语句的执行
“非阻塞赋值”
非阻塞赋值在赋值开始时计算表达式右边的值,到了本次仿真周期结束时才更新被赋值变量,且也许其它语句的同时赋值。
不影响其赋值结果
非阻塞赋值为寄存器数据类型而设,所以只能被允许在程序块里面出现,比如initial块和always块。
不允许持续性赋
25.知识产权
IP核有三种不同的存在形式:HDL语言形式,网表形式、版图形式。
分别对应我们常说的三类IP内核:软核、固核和硬核。
26.传统的设计方法都是自底向上的;EDA设计方法是自顶向下。
不同点在于:
(1)传统设计方法采用的是手动设计,而EDA设计方法是自动设计;
(2)传统设计方法硬、软件分离,而EDA设计方法打破了硬、软件屏障;
(3)传统设计方法设计周期长,而EDA设计方法设计周期短。
27.答:功能仿真是直接对HDL语言、原理图描述或其它描述形式描述的逻辑功能进行测试模拟,以了解其实现的功能是否满足原设计的要求。
它是由设计输入的行为级或RTL级代码、测试数据参与的测试程序以及调用模块的行为仿真模型共同参与完成逻辑功能的验证。
功能仿真没有延时信息,仿真过程不涉及任何具体器件的硬件特性。
时序仿真是在选择了器件之后,由适配器完成布局、布线并得到HDL网表和标准延时文件,以及FPGA基本单元仿真模型和测试程序,它们共同参与时序仿真。
时序仿真包含了器件的硬件特性参数和内部连线时延的仿真,是接近真实器件运行特性的仿真,因而仿真精度高。
五、程序分析题
28.
(1)data_in3,endtask,1’b0,1’b1
六、编程题
29.
30.
//子模块
module Dflop (d,rset,clk ,q);
input d,reset,clk;
output q;
reg q;
always @ (posedge clk )
begin
if (reset==1)
q <= 0;
else
q <= d;
end
endmodule
顶层模块程序设计
Module(xin,clk,yout);
Input clk;
Input xin;
Output yout;
Reg yout
Wire temp1,temp2,temp3;
Assign temp2<=temp1 or xin;
Dflop u1(ck,yout,temp1);
Dflop u2(ck,temp2,yout);
endmodule
31.
Module fsm(clk,reset,in_a,flag_out); Input clk,reset;
Input in_a;
Output flag_out;
Reg flag_out;
reg c_state;
parameter st0=2’d0, st1=2’d1; st2=2’d2; always@(posedge clk)
begin
if reste==1
c_state<=st0;
flag_out<=1’b0;
end
else
begin
case (c_state)
st0:if(in_a==1’b0)
begin
c_stat<=st0;
flag_out<=1’b0;
end
else
begin
c_stat<=st1;
flag_out<=1’b0; end;
st1: if(in_a==1’b0) begin
c_stat<=st0;
flag_out<=1’b0;
end
else
begin
c_stat<=st2;
flag_out<=1’b0; end;
st2: if(in_a==1’b0) begin
c_stat<=st0;
flag_out<=1’b1; end
else
begin
c_stat<=st0;
flag_out<=1’b0; end;
endcase
endmodule。