第4章节Avalon总线bus的规范
smbus系统管理总线规范--中文版

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系统管理总线规范-中译版
目 录
SMBus 系统管理总线规范.....................................................................................................................- 1 1. 前言.............................................................................................................................................. - 5 1.1 概要..................................................................................................................................- 5 1.2 读者..................................................................................................................................- 5 1.3 范围.............................
精选chap4微机总线技术规范与总线标准管理khn

4.2.1 SoC的片内总线
片上总线特点简单高效结构简单:占用较少的逻辑单元时序简单:提供较高的速度接口简单:降低IP核连接的复杂性灵活,具有可复用性地址/数据宽度可变、互联结构可变、仲裁机制可变功耗低信号尽量不变、单向信号线功耗低、时序简单片内总线标准ARM的AMBA 、IBM的CoreConnectSilicore的Wishbone、Altera的Avalon
高速IO总线
低速IO总线
微机系统中的内总线(插板级总线)
微机系统中的外总线(通信总线)
总线分类
按所处位置(数据传送范围)
片内总线
芯片总线(片间总线、元件级总线)
系统内总线(插板级总线)
系统外总线(通信总线)
非通用总线(与具体芯片有关)
通用标准总线
地址总线
控制总线
按总线功能
数据总线
并行总线
串行总线
特点:各主控模块共用请求信号线和忙信号线,其优 先级 别由其在链式允许信号线上的位置决定;优点:具有较好的灵活性和可扩充性;缺点:主控模块数目较多时,总线请求响应的速度较慢;
菊花链(串行)总线仲裁
主控模块1
主控 模块2
主控模块N
允许BG
请求BR
忙BB
总线仲裁器
……
三线菊花链仲裁原理
任一主控器Ci发出总线请求时,使BR=1任一主控器Ci占用总线,使BB=1,禁止BG输出主控器Ci没发请求(BRi=0),却收到BG(BGINi=l),则将BG向后传递(BGOUTi=l)当BR=1,BB=0时,仲裁器发出BG信号。此时,BG=1,如果仲裁器本身也是一个主控器,如微处理器,则在发出BG之前BB=0时,它可以占用一个或几个总线周期若Ci同时满足:本地请求(BRi=1);BB=0;检测到BGINi端出现了上升沿。接管总线。Ci接管总线后,BG信号不再后传,即BGOUTi=0
第3章AVALON总线

从端口流控读传输
从端口流控写传输
主端口流控读写时序
三态传输
三态从端口使用双向数据信号data,而不是分开的、 单向的readdata和writedata。Data是可以三态 的,可以使多个三态外围设备共同连接到数据总线 上,而不会造成信号拥堵。 这种方式下,常采用负极性信号,如read_n、 chipselect_n 和 outputenable_n,用于和典型 存储器芯片匹配。 从三态口不能使用变延迟流水线属性;不能使用流 控信号;不支持突发传输(Burst)
具有变等待周期的读传输
说明: (1)变等待周期需要从端口加入输出信号:waitrequest,从端口在允许读 数据前使能waitrequest。
(2)等待的周期数没有上限,但应避免无限期的等待。
具有建立时间的从端口读周期
说明; (1)某些设备要求在发出read信号前,address和Chipselect等信号要稳 定几个周期,此时,可以使用这一方式 (2)系统互连结构经过Tsu时间后,再使能read (3) 如果一个设备同时具有可读写功能,则建立时间适用于两者 (4)这一方式不能与变周期同时使用。
复位控制信号
Avalon总线提供了可以使系统互连结构复位外围 设备以及外围设备复位系统的信号。 主端口和从端口设备可以被系统互连结构在任何时 候采用reset信号完成复位。复位脉冲要宽于1个 clk周期。 主从端口可以使用resetrequest信号复位全部 Avalon总线连接的系统。 Resetrequest对类似 看门狗的定时器非常有用, resetrequest有效会 使系统互连结构通过reset复位系统中的其他外围 设备。
变延迟流水线
从端口增加了 readdatavalid信 号表示数据有效。
Avalon-ST总线规范要点

Avalon-ST总线规范6.1介绍Avalon流传输(Avalon-ST)接口可以被用户用来作为各组件的数据通信接口,该接口具有高带宽、低延时和非双向的特点。
典型应用场合包括多数据流、数据包和DSP数据的传输。
Avalon-ST接口信号可以被描述成传统的数据流接口,即支持传输单个数据流而不需关心通道数和数据包的大小范围。
接口也支持更加复杂的协议,包括突发传输,和数据包在多个通道间交错传输等功能。
图6.1显示了典型的Avalon-ST接口应用。
图6.1 Avalon-ST接口——典型例子所有的Avalon-ST源端口和目标端口不可以与第三个端口互相相连(译者注:只能两两相连)。
但是,如果两个端口对一个应用空间提供了兼容的功能,自适应逻辑可以允许这些端口互连。
6.1.1 性能指标下面是Avalon-ST的一些突出的性能指标:⏹低延迟,高吞吐量的点到点数据传输⏹支持多通道传输和灵活的在多个通道间交错传输⏹单边的信号传输信道,提供数据包错误、数据包开始和结束的标志⏹支持数据突发传输⏹自适应接口6.1.2 术语和概念本节定义了Avalon-ST总线协议中的术语和协议。
⏹Avalon-ST流传输系统——Avalon流传输系统包括一个或多个Avalon-ST端口,用来发送或接收数据流。
流传输系统如图6.1所示。
包括Avalon-ST接口,用来从系统输入端接收数据并传输到输出端;和Avalon-MM接口,用来允许软件控制其中的控制和状态寄存器。
⏹Avalon-ST流传输组件——典型的系统中,使用Avalon-ST接口连接的多个功能模块叫做组件。
设计者需要同时配置组件和接口,以完成一个系统。
⏹源端口、目标端口和连接——当两个组件连接时,数据从源端口流向目标端口。
源端口和目标端口的互连叫做连接。
⏹反馈——反馈是一种机制,目标端口可以发送信号,使得发送端口停止发送数据。
当目标组件的FIFO已经是满状态或者它的输出口被阻塞时,目标端口通常使用反馈信号停止数据流。
4.总线(BUS)简介

32
无限制 109 可
32/64
3 120 可
(5)总线的标准与规范 总线标准 所谓总线标准就是对总线的插座尺寸、引线数目、 信号和时序所作的统一规定。
机械特性:规定模板尺寸、插头、连接器的形 状、尺寸等规格位置 电气特性:规定信号的逻辑电平、最大额定负 载能力、信号传递方向及电源电压等 功能特性:每个引脚名称、功能、时序及协议 时间特性:总线中任一根线在什么时间内有效
第五章 计算机总线技术
主要内容
1 总线的基本概念 总线分类、性能指标、标准、控制… 2 常用内部总线 STD、ISA、PCI、AGP… 3 常用外部总线 IEEE488、RS232、USB…
4 现场总线
PROFIBUS、FF、HART…
1 总线的基本概念
• • • •
总线的分类 总线的主要性能指标 总线的标准与规范 总线控制与总线传输
原来ISA总线的98条信号线上又增加了98条信号
线,也就是在两条ISA信号线之间添加一条EISA 信号线。在实用中,EISA总线完全兼容ISA总线 信号。
EISA总线(Extension Industry Standard Architecture) – 32位数据总线,支持32位地址通路
– 数据传输速率为33Mbit/s
MCA
IBM个人 机与 工作站 33MB/s 32位 10MHz 异步
PCI
586个人机, PowerPC, Alpha工作站 133MB/s 32位 20~33MHz 同步
总线宽度 总线频率 同步方式
地址宽度
负载能力 信号线数 64位扩展
24
8 98 不可
32
6 143 无规定
24
Avalon总线规范

Avalon总线规范1 A valon总线基本从端口读传输时序2 A valon总线基本从端口写传输时序3 A valon总线上的基本主端口读传输时序4 A valon总线上的基本主端口写传输时序Nios采用的Avalon总线是一种相对简单的总线结构,主要用于连接片内处理器和外设,以构成可编程单芯片上系统。
它描述了主从构件间的端口连接关系,以及构件间通信的时序关系。
Avalon总线拥有多种传输模式,以适应不同外设的要求。
它的基本传输模式是在一个主外设和一个从外设之间进行单字节、半字或字(8、16或32位)的传输,每次只传送一个单元的数据。
当一次传输结束后,不论新的传输过程是否还在同样的外设间进行,Avalon总线总是可以在下一个时钟周期立即开始另一次传输。
所有Avalon从传输的信号时序都源自从端口的基本传输模式,同样,主端口的基本传输模式是所有Avalon主传输的基础。
Avalon总线的端口分为主端口和从端口。
主端口是主外设用于在Avalon总线上发起传输的一组信号。
从端口是用于接受来自另一个Avalon外设主端口的总线传输的一组信号,主端口和从端口都直接连接到Avalon总线模块上。
Avalon总线规范定义了主端口和从端口之间通过Avalon总线模块传输数据所需的信号和时序。
构成Avalon总线模块和外设之间接口的信号随着传输模式的不同而不同。
Avalon总线规范提供了各种选项来剪裁总线信号和时序,以满足不同类型外设的需要。
1 Avalon总线基本从端口读传输时序基本从端口传输模式是所有Avalon从端口传输的基础。
所有其他的从端口传输使用的信号都包含了基本从端口传输的信号,并扩展了基本从端口的操作时序。
基本从端口传输由Avalon总线模块发起,然后从端口向Avalon总线模块传输一个单元的数据。
基本从端口读传输没有延迟。
在clk的第一个上升沿,Avalon总线向目标外设传递address、byteenable_n 和read_n信号。
canbus标准

CAN总线(CAN-bus)是一种串行通信总线系统,被广泛应用于汽车和工业自动化领域,CAN总线的物理层定义了总线的位速率、位定时、电气特性、传输介质等。
CAN总线的位速率可以根据实际需要进行设置,常见的有500Kbps和250Kbps等。
CAN总线的位定时决定了通信的可靠性和稳定性,需要满足一定的时序要求。
数据链路层是CAN总线的重要组成部分,包括逻辑链路控制、媒体访问控制和差错控制等子层。
逻辑链路控制子层负责建立和维护通信节点之间的逻辑连接;媒体访问控制子层采用CSMA/CD协议,实现总线访问控制和数据传输;差错控制子层用于检测和处理总线上的错误。
在实际应用中,CAN总线可以采用单线或双线模式,根据实际情况选择合适的线数和线型。
同时,为了提高总线的可靠性和稳定性,可以采用一些措施,如波特率自适应、节点故障检测和自动重发等。
总之,CAN总线是一种广泛应用于汽车和工业自动化领域的串行通信总线系统,具有高可靠性和稳定性。
CAN总线标准定义了总线的物理层和数据链路层,为实际应用提供了重要的支持和保障。
avalon总线接口信号定义 pdf

avalon总线接口信号定义
Avalon总线是一种Intel提出的用于系统级集成(System-on-Chip,SoC)的通信接口协议。
它提供了一个统一的标准接口,用于连接和通信不同的IP核(Intellectual Property Core)。
以下是Avalon总线接口的一些常见信号定义:
1. Clock(时钟)信号:
- clk:主时钟信号,驱动总线操作的时钟。
2. Reset(复位)信号:
- reset:复位信号,用于对整个总线进行复位。
3. Control(控制)信号:
- startofpacket(SOP):指示数据包的开始。
- endofpacket(EOP):指示数据包的结束。
- valid:有效性信号,指示数据是否有效。
- ready:就绪信号,指示接收方是否准备好接收数据。
- error:错误信号,指示传输是否出现错误。
4. Address(地址)信号:
- address:地址信号,指定传输的目标设备或寄存器。
5. Data(数据)信号:
- readdata:读数据信号,从目标设备或寄存器中读取数据。
- writedata:写数据信号,将数据写入目标设备或寄存器。
- readdatavalid:读数据有效性信号,指示读取的数据是否有效。
- writedataready:写数据准备就绪信号,指示写入数据是否准备就绪。
这些是一些常见的Avalon总线接口信号定义,具体信号定义可以根据具体
的应用和设计进行调整。
要了解更多信号定义和详细规范,请参考Intel的Avalon总线规范文档。
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SOPC Builder利用最少的FPGA资源,产生新的最佳Avalon交 换架构。
4.2 Avalon总线基本概念
4.2.1 Avalon外设和交换架构 一个基于Avalon接口的系统会包含很多功能 模块,这些功能模块就是Avalon存储器映射 外设,通常简称Avalon外设。所谓存储器映 射外设是指外设和存储器使用相同的总线来 寻址,并且CPU使用访问存储器的指令也用 来访问I/O设备。为了能够使用I/O设备, CPU的地址空间必须为I/O设备保留地址。
4.2.3 主端口和从端口
Avalon端口就是完成通信传输的接口所包含的一组Avalon 信号。Avalon端口分为主端口和从端口,主端口可以在 Avalon总线上发起数据传输,目标从端口在Avalon总线上 响应主端口发起的数据传输。一个Avalon外设可能有一个 或多个主端口,一个或多个从端口,也可能既有多个主端口, 又有多个从端口。 Avalon的主端口和从端口之间没有直接的连接,主、从端 口都连接到Avalon交换架构上,由交换架构来完成信号的 传递。在传输过程中,主端口和交换架构之间传递的信号与 交换架构和从端口之间传递的信号可能有很大的不同。所以, 在讨论Avalon传输的时候,必须区分主从端口。
第4章 Avalon总线规范
4.1 Avalon总线简介
Avalon总线由ALTERA公司提出,用于在基于 FPGA的片上系统中连接片内处理器和片内外设的总线 结构。 连接到Avalon总线的设备分为主从设备,并各 有其工作模式。 简单性,易于理解、易于使用。 占用资源少,减少对FPGA片内资源的占用。 高性能,Avalon总线可以在每一个总线时钟周期 完成一次数据传输。 专用的地址总线、数据总线和控制总线:这样 Avalon总线模块和片上逻辑之间的接口的得以简化, Avalon外设不需要识别数据和地址周期。
将Avalon外设连接起来,构成一个大的系统的片上
互连逻辑就是Avalon交换架构。
Avalon交换架构是一种可自动调整的结构,
随着设计者不同设计而做出最优的调整。可以 看到外设和存储器可以拥有不同的数据宽度, 并且这些外设可以工作在不同的时钟频率。 Avalon交换架构支持多个主外设,允许多个 主外设同时在不同的从外设进行通信,增加了 系统的带宽。这些功能的实现都是靠Avalon 交换架构中的地址译码、信号复用、仲裁、地 址对齐等逻辑实现的。 本章重点讨论Avalon外设和Avalon交换架构 之间的互连,主要研究接口级的行为,不关注 其内部实现。
Avalon外设包括存储器,处理器、UART、
PIO、定时器和总线桥等。还可以有用户自定 义的Avalon外设,用户自定义的外设能称之 为Avalon外设,要有连接到Avalon结构的 Avalon信号。 Avalon外设分为主外设和从外设,能够在 Avalon总线上发起总线传输的外设是主外设, 从外设只能响应Avalon总线传输,而不能发 起总线传输。主外设至少拥有一个连接在 Avalon交换架构上的主端口,主外设也可以 拥有从端口,使得该外设也可以响应总线上其 它主外设发起的总线传输。
4.2.4 传输
传输是指在Avalon端口和Avalon交换架构之间的 数据单元的读/写操作。Avalon传输一次可以传输 高达1024位的数据,需要一个或多个时钟周期来完 成。在一次传输完成之后,Avalon端口在下一个时 钟周期可以进行下一次的传输。 Avalon的传输分成两个基本的类别:主传输和从传 输。Avalon主端口发起对交换架构的主传输。 Avalon从端口响应来自交换架构的传输请求。传输 是和端口相关的:主端口只能执行主传输,从端口 只能执行从传输。
4.2.2 Avalon信号
Avalon 接口定义了一组信号类型 ( 片选、读使能、 写使能、地址、数据等 ) ,用于描述主 / 从外设上基 于地址的读写接口。 Avalon 信号的可配置特性是 Avalon 接口与传统总 线接口的主要区别之一。Avalon外设可以使用一小 组信号来实现简单的数据传输,或者使用更多的信 号来实现复杂的传输类型。例如ROM接口只需要地 址、数据和和片信号就可以了, 而高速的存储控制 器可能需要更多的信号来支持流水线的突发传输。
continue
支持高达1024位的数据宽度,支持不是2的偶数幂 的数据宽度。 支持同步操作,所有Avalon外设的接口与Avalon交 换架构的时钟同步,不需要复杂的握手/应答机制。 简化了Avalon接口的时序行为,而且便于集成高速 外设。 支持动态地址对齐,可以处理具有不同数据宽度的 外设间的数据传输,Avalon总线的自动地址对齐功 能将自动解决数据宽度不匹配的问题,不需要设计 者的干预。 Avalon总线规范是一个开放的标准,用户可以在未 经授权的情况下使用Avalon总线接口来自定义外设。
4.3 Avalon信号
Avalon接口规范定义了Avalon外设使用的信号类型,如地 址、数据、片选信号等等。根据外设逻辑接口的需求, Avalon外设可以使用任何类型的Avalon信号。 Avalon接口规范还定义了每种信号类型的行为。Avalon端 口上的信号和信号类型是一一对应的,Avalon主/从端口的 每一个信号必定属于某类的Avalon信号类型。一个Avalon 端口每一种信号类型只能有一个信号实例。 根据端口的属性,可以将Avalon信号类型分为主信号或者 从信号。有些信号在主端口和从端口的接口上都存在,但是 信号的行为是不相同的。
4.2.5 主从端口对
主从端口对是指在数据传输过程中,通过
Avalon交换架构相连接起来的主端口和从端 口。 在传输过程中,主端口的控制和数据信号通 过Avalon交换架构和从端口相交互。
4.2.6 周期
周期是时钟的基本单位,定义为特定端口的
时钟信号的一个上升沿到下一个上升沿之间 的时间。完成一次传输最少要一个时钟周期。