FPGA技术教程(通俗易懂)

合集下载

FPGA概述PPT课件

FPGA概述PPT课件
•11
6.底层内嵌功能单元 内嵌专用硬核是相对于底层嵌入的软核而言 的,硬核(Hard Core)使FPGA具有强大 的处理能力,等效于ASIC电路。
•12
1.3 IP核简介
IP(Intelligent Property)核
是具有知识产权的集成电路芯核总称,是 经过反复验证过的、具有特定功能的宏模 块,与芯片制造工艺无关,可以移植到不 同的半导体工艺中。
通道绑定原 理示意图
•28
5.预加重技术 在印制的电路板上,线路是呈现低通滤波 器的频率特性的,为解决高频部分的损失, 就要采取预加重技术。
预加重技术的思想是:在传输信号时,抬高 信号的高频信号,以补偿线路上高频分量的 损失。
•29
没有预加重 的发送波形
•30
预加重后的 发送波形
没有预加重 的接收波形
典型的IOB内部结构示意图
2.可配置逻辑块(CLB)
CLB是FPGA内的基本逻辑单元 .
CLB的实际数量和特性会依据器件的不同而不同,但是每 个CLB都包含一个可配置开关矩阵,此矩阵由选型电路(多 路复用器等)、触发器和4或6个输入组成。
典型的CLB结 构示意图
3. 数字时钟管理模块(DCM)
目前FPGA中多使用4输入的LUT,所以每一 个LUT可以看成是一个有4位地址线的RAM。当用 户通过原理图或HDL语言描述一个逻辑电路以后, PLD/FPGA开发软件会自动计算逻辑电路的所有可 能结果,并把真值表(即结果)写入RAM,这样,每 输入一个信号进行逻辑运算就等于输入一个地址去 进行查表,找出地址对应的内容,然后输出即可。
DLL简单模 型示意图
Xilinx DLL的典 型模型示意图
在FPGA设计中,消除时钟的传输延迟,实现高扇出 最简单的方法就是用DLL,把CLK0与CLKFB相连 即可。 利用一个DLL可以 实现2倍频输出

《FPGA入门学习》课件

《FPGA入门学习》课件
时序控制。
LED闪烁设计
总结词
通过LED闪烁设计,掌握FPGA的基本控制功能和数字逻辑设计。
详细描述
LED闪烁设计是FPGA入门学习的基本项目之一,通过该设计,学习者可以了解FPGA的基本控制功能 ,掌握数字逻辑设计的基本原理和方法。LED闪烁设计通常涉及到LED灯的驱动和控制,需要学习者 掌握基本的数字逻辑门电路和时序控制。
FPGA具有并行处理和高速计算的优点,适 用于数字信号处理中的实时信号处理和算 法加速。
数字滤波器设计
频谱分析和正交变换
FPGA可以实现高性能的数字滤波器,如 FIR滤波器和IIR滤波器,用于信号降噪和特 征提取。
FPGA可以高效地实现FFT等正交变换算法 ,用于频谱分析和信号频率成分的提取。
图像处理应用
优化设计技巧
时序优化
讲解如何通过布局布线、时序分析等手段优化 FPGA设计,提高时序性能。
资源共享
介绍如何通过资源共享减少FPGA资源占用,提 高设计效率。
流水线设计
讲解如何利用流水线设计技术提高系统吞吐量。
硬件仿真与调试技术
仿真工具使用
介绍常用HDL仿真工具(如ModelSim)的使用方法 。
03
CATALOGUE
FPGA开发实战
数字钟设计
总结词
通过数字钟设计,掌握FPGA的基本开发流程和硬件描述语言的应用。
详细描述
数字钟设计是FPGA入门学习的经典项目之一,通过该设计,学习者可以了解FPGA开 发的基本流程,包括设计输入、综合、布局布线、配置下载等。同时,数字钟设计也涉 及到硬件描述语言(如Verilog或VHDL)的应用,学习者可以掌握基本的逻辑设计和
基础语言。
FPGA开发流程

FPGA入门培训教材共45张PPT课件

FPGA入门培训教材共45张PPT课件
# STEP#2: run synthesis, report utilization and timing synth_design -top bft -part xc7k70tfbg484-2 write_checkpoint -force $outputDir/post_synth report_timing_summary -file $outputDir/post_synth_timing_summary.rpt report_power -file $outputDir/post_synth_power.rpt # STEP#3: run placement and logic optimzation, report utilization and timingestimates, write checkpoint design opt_design place_design phys_opt_design write_checkpoint -force $outputDir/post_place report_timing_summary -file $outputDir/post_place_ti家!
# STEP#4: run router, report actual utilization and timing, write checkpoint design, run drc, write verilog and xdc out route_design write_checkpoint -force $outputDir/post_route report_timing_summary -file $outputDir/post_route_timing_summary.rpt report_timing -sort_by group -max_paths 100 -path_type summary -file $outputDir/post_route_timing.rpt report_clock_utilization -file $outputDir/clock_util.rpt report_utilization -file $outputDir/post_route_util.rpt report_power -file $outputDir/post_route_power.rpt report_drc -file $outputDir/post_imp_drc.rpt write_verilog -force $outputDir/bft_impl_netlist.v write_xdc -no_fixed_only -force $outputDir/bft_impl.xdc

FPGA创建工程及烧录程序简单教程

FPGA创建工程及烧录程序简单教程

FPGA创建工程及烧录程序简单教程(适用于IntelCycloneII EP2C35F672C8N)1.双击应用程序2.创建一个新工程(文件夹、工程名、文件名及文件路径中都不要带中文)最后finish,工程就建好了3.创建文件点击file~>new~>Design Files~>VHDL File或Verilog HDL File,然后请开始你的表演!(编写程序)(VHDL文件名应与工程名一致4.引脚编辑引脚如何编辑在FPGA自带的光盘中有提及,请在其中寻找并编辑。

(在光盘文件中也有流水灯的引脚文件waterled.qsf,找到并替换工程文件夹下的qsf文件即可实现引脚编辑)这时打开Quartus II 的Pin Planner可以看见引脚分配5.调试程序程序调试成功后会产生waterled.sof与waterled.qof文件6.烧录程序到软件中在烧录程序时应将电源线与USB-blaster如图示插入并打开电源。

打开Programmer后,应如下图所示6.(1)如果未自动弹出hardware,点开Hardware Setup,双击USB-Blaster,然后Close即可。

6.(2)如果没有USB-Blaster,可能是因为没有安装驱动程序右键安装或更新驱动程序文件路径不尽相同,Quartus II 安装在哪个盘就去哪个盘里面找在解决了驱动的问题后我们继续烧录程序Add Device:双击下图箭头位置添加文件(之前调试产生的waterled.sof文件):箭头位置的Program Configure一定要选上!!!然后点击Start,烧录程序烧录成功!!!!!。

FPGA的基本原理(详细+入门)

FPGA的基本原理(详细+入门)
十、 FPGA的集成度
门阵等效门:一个门阵等效门定义为一个两输入端的“与非”门。 系统门:是芯片上门的总数,是厂家指定给器件的一个门数。
十一、FPGA的封装
1、引脚数:FPGA芯片总的引脚数。 2、用户I/O数:指除了电源引脚、特殊功能引脚外的引脚,这些引脚可根据用户的需要进行配置。 3、 I/O驱动电流:8mA 或10mA。 4、时钟网络数:FPGA芯片可能包含1个、2个或4个时钟网络。 5、封装:PLCC,PQFP,CPGA等封装形式。 6、工作温度范围:FPGA芯片一般有商用、工业用及军用等不同的工作温度范围。 7、工作环境:一般分普通工作环境和航天工作环境。
ACT1模块是如何实现三输入与门的?
2、查表型FPGA结构 两输入与门: 4 X 1 RAM 表:
A
B
C
0
0
0
0
1
0
1
0
0
1
1
1
A1
A0
(二)、 什么是FPGA? FPGA是英语(Field programmable Gate Array)的缩写,即现场可编程门阵。它的结构类似于掩膜可编程门阵(MPGA),由可编程逻辑功能块和可编程I/O模块排成阵列组成,并由可编程的内部连线连接这些逻辑功能块和I/O模块来实现不同的设计。 1、FPGA与MPGA的区别: MPGA利用集成电路制造过程进行编程来形成金属互连,而FPGA利用可编程的电子开关实现逻辑功能和互连。 2、FPGA与CPLD的区别: 1) 结构不同:FPGA是由可编程的逻辑模块、可编程的分段互连线和I/O模块组成,而CPLD是由逻辑阵列块、可编程连线阵列和I/O模块组成。 2) CPLD延时可预测(Predictable),FPGA的延时与布局布线情况有关。 3) CPLD 组合逻辑多而触发器较少,而FPGA触发器多。

FPGA开发入门教程

FPGA开发入门教程

FPGA开发入门教程FPGA(Field-Programmable Gate Array)是一种可重新配置的集成电路,能够根据用户需求实现不同的功能。

作为硬件开发的重要技术之一,FPGA具有灵活性高、性能强、功耗低等优点,因此受到了广泛的关注和应用。

本文将介绍FPGA开发的入门教程,帮助初学者快速上手FPGA开发。

第一步:了解FPGA第二步:选择开发工具和开发板FPGA开发需要选择合适的开发工具和开发板。

常用的FPGA开发工具有Xilinx的Vivado和Altera的Quartus等。

这些工具提供了图形化界面以及一些示例代码,方便用户进行开发和调试。

开发板是用户在FPGA开发中搭建硬件平台的重要部分,通过开发板可以将FPGA芯片与其他外设相连接,进行实际的验证和测试。

选择开发工具和开发板时要考虑到自己的需求和预算。

第三步:学习HDL编程语言HDL(Hardware Description Language)是用于描述数字电路的编程语言,FPGA开发中常用的HDL有Verilog和VHDL。

要掌握FPGA开发,我们必须学习和熟悉HDL编程语言。

HDL语言可以描述数字电路的结构、功能和时序等信息,通过HDL编写的代码可以被FPGA开发工具转化成对应的硬件电路。

学习HDL编程语言需要掌握其语法规则和基本概念,理解时序逻辑和组合逻辑的原理,并通过练习和实践进行巩固。

第四步:学习FPGA开发流程第五步:完成第一个FPGA项目通过以上几个步骤的学习和实践,我们已经具备了进行FPGA开发的基本能力。

接下来我们可以尝试完成一个简单的FPGA项目,例如实现一个LED闪烁的功能。

我们可以使用HDL语言编写一个简单的计数器,将计数值输出到FPGA开发板上的LED灯,通过改变计数值的频率实现LED的闪烁。

完成这个项目可以加深对FPGA开发流程的理解,并为后续更复杂的项目奠定基础。

总结FPGA开发入门需要掌握FPGA的基本概念和工作原理,选择合适的开发工具和开发板,学习HDL编程语言,了解FPGA开发流程,并通过实践完成一个简单的FPGA项目。

FPGA技术概述

FPGA技术概述
• 这些逻辑块之间有着丰富的可配置的互连资源, • 设计者可以通过对这些资源进行不同的配置和编程
来达到自己所要实现的目标。
第一章 FPGA设计基础
首先,FPGA名称中的“现场可编程”是指编程“在现场”进行 (与那些内部功能已被制造商固化的器件正相反)。 这意味着FPGA的编程具有更强的灵活性和创新性, 可以在实验室进行配置, 或者可以对已经应用于实际的电子系统中的某些功能进行改进, 或者可以根据用户需求, 实现新的协议或者标准来对当前应用作进一步的完善和改进。 总之, FPGA的现场可编程特性满足了用户实现任意数字逻辑的愿望, 成为用户灵活“武装”自己产品的最有效的武器。
第一章 FPGA设计基础
对于ASIC公司来说,FPGA经常用于提供一个硬件验证 平台来验证新算法新协议的物理层实现。比如,许多行业的 开创性公司使用FPGA制定新的协议标准,并进行产品化, 迎来市场的新增值点。同时,FPGA为许多小型公司带来机 遇。这些公司利用FPGA开发低成本高智力投入的产品并快 速推向市场,迎来新的发展机遇。FPGA技术的发展将创造 性的逻辑设计任务从昂贵的ASIC公司搬到了普通的工作室。
Integrated Circuit,专用集成电路)技术已经在飞速发展。但 是在很多应用场合,昂贵的ASIC费用不是广大客户所想要 的,而且ASIC流片的风险太大,周期太长,在不确定芯片 需求量很大的情况下,人们是非常谨慎的。而CPLD技术虽 然有飞跃,但是依然不能实现复杂的功能,尤其是无法实现 复杂逻辑运算的功能。ASIC与CPLD之间的鸿沟越来越明显。 幸运的是,1984年世界上首款FPGA在Xilinx诞生。首款 FPGA基于CMOS工艺,并且采用SRAM单元,最小单元由 一个3输入查找表(LUT)与寄存器组成。首款FPGA的诞生, 已经给人们发出了一个信息,除了ASIC和CPLD之外,另外 一种新型结构的可编程逻辑器件会给逻辑设计带来新的活力。

《FPGA入门学习》课件

《FPGA入门学习》课件
的结构测试工具, 用于验证FPGA设计的正确性。
FPGA基础知识
硬件描述语言HDL FPGA的逻辑单元 FPGA的时钟网络
使用HDL编写硬件描述,描述FPGA的功能和 逻辑。
FPGA由大量逻辑单元(Look-Up Tables)和 触发器组成,用于实现各种逻辑功能。
时钟网络是FPGA中一种重要的信号分发网络, 用于同步各个逻辑单元的操作。
FPGA在医疗器械中实现数据 采集、信号处理和控制等关 键功能。
FPGA在军事装备中 的应用
FPGA可用于军事雷达、通信 设备、导航系统等关键领域, 在高可靠性和性能要求下发 挥作用。
总结
FPGA的未来发展
FPGA技术将随着科技的进步不断发展,将在更 多领域发挥重要作用。
FPGA入门学习路线图
通过按照学习路线图逐步学习,您可以掌握 FPGA开发的核心知识和技能。
FPGA的优缺点
FPGAs具有高度灵活性和 可重配置性,但其资源利 用率和功耗可能相对较高。
FPGA的应用领域
FPGAs广泛应用于通信、 嵌入式系统、信号处理、 图像处理等领域。
开发环境准备
FPGA开发板
选择适合您需求的FPGA开发 板以进行实验和项目开发。
Quartus Prime软件 安装
安装Intel提供的Quartus Prime软件用于FPGA的设计 和编程。
《FPGA入门学习》PPT课 件
FPGA入门学习是介绍Field-Programmable Gate Array(可编程门阵列)的 课程。本课件将帮助你了解FPGA的基础知识、开发环境准备以及FPGA的应 用领域。
简介
什么是FPGA
FPGA是一种可编程硬件, 可以根据需要被重新编程 和配置以执行不同的功能。
  1. 1、下载文档前请自行甄别文档内容的完整性,平台不提供额外的编辑、内容补充、找答案等附加服务。
  2. 2、"仅部分预览"的文档,不可在线预览部分如存在完整性等问题,可反馈申请退款(可完整预览的文档不适用该条件!)。
  3. 3、如文档侵犯您的权益,请联系客服反馈,我们会尽快为您处理(人工客服工作时间:9:00-18:30)。

第二章 CPLD/FPGA概述
一、 二、 三、 四、 五、 简单的PLD 结构 FPGA/CPLD的结构 FPGA/CPLD的基本原理 FPGA的设计方法 FPGA设计流程
•二维的逻辑块阵列,构成了PLD器件的逻 辑组成核心。 •输入/输出块:· 连接逻辑块的互连资源 •连线资源:由各种长度的连线线段组成,其中也有 一 些可编程的连接开关,它们用于逻辑块之间、逻辑块 输入/输出块之间的连接
3. 从编程工艺上分为: 1)熔丝(Fuse)型器件:编程过程就是根据设计的熔丝图文件来烧断 对应的熔丝,来达到编程的目的。编程后即使系统断电,它们中存 储的 编程信息不会丢失 。 2)反熔丝(Antifuse)型器件:由Actel公司推出,在编程处通过击穿漏 层使得两点之间获得导通。反熔丝PLD抗辐射,耐高低温,功耗低, 速度快,在军品和宇航上有较大优势。前两种都属OTP器件。 3)EPROM型:紫外线擦除电可编程逻辑器件,它用较高的编程电 压进行编程,当需要再次编程时,用紫外线擦除。前三种较少使用。 4)EEPROM型:电可擦除可编程逻辑器件。CPLD采用此编程工艺。 5)SRAM型:SRAM查找表结构的器件,大部分的FPGA采用此编程 工艺。断电后编程信息会丢失,每次上电时,需从器件外部存储器将 编程数据重新写入SRAM中。允许无限次编程。 6)Flash(Fastflash)型:即闪存技术,由Actel公司推出。采用此编 程工艺的器件,可以实现多次可编程,也可以做到掉电后不需要重新 配置。CPLD采用此编程工艺。
早期 FPGA
可编程阵列逻辑(PAL)
可编程逻辑阵列(PLA)
现在
Altera的CPLD
Xilinx的FPGA
一、可编程器件大致的发展过程如下:
1)20世纪70年代,出现了熔丝编程的PROM 和PLA器件。70 年代末,AMD 公司对PLA进行了改进,推出了PAL器件。 2)20世纪80年代初,Lattice(莱迪思)公司发明了电可擦写的, 比PAL更灵活的GAL通用阵列逻辑器件。 3)20世纪80年代中期,Xilinx公司提出现场可编程概念,生 产出了世界上第一片FPGA器件。FPGA是改变内部连接的布 线来编程。 4)20世纪80年代末,Lattice公司又提出在系统可编程概念 (ISP),并推出了一系列具有在系统可编程能力的CPLD器 件。CPLD的设计是修改具有固定内部连接电路的逻辑功能 来编程。 5)20世纪90年代后期,可编程集成电路技术飞速发展,器 件的可用逻辑门数超过了百万门,并出现了内嵌复杂功能模 块(如加法器,乘法器,RAM,CPU核,DSP核等)的 SOPC。
自顶向下设计方法学
顶层模块
子模块1
子模块2
子模块3
叶单元
叶单元
叶单元
叶单元
叶单元
叶单元
五、FPGA设计流程
RTL代码
调用模块 的黑盒子 接口
设置综合目 标和约束条 件
测试数据
(1)设计定义 (2)设计输入 (3)功能仿真 (4)逻辑综合 (5)前仿真 (6)布局布线
HDL网表 (netlist)
第三章 Verilog HDL语言
一、 二、 三、 四、 五、 构成 Verilog HDL的语句 Verilog HDL描述方式 Verilog HDL设计流程 用Verilog HDL描述数字电路的实例
硬件描述语言( HDL )就是可以描述硬件电路 的功能、信号连接关系及定时(时序)关系的语言, 也是一种用形式化方法来描述数字电路和设计数字 系统的。 常用的硬件描述语言有VHDL、Verilog HDL,已 成为 IEEE 的工业标准硬件描述语言,得到了众多 EDA公司的支持。
VHDL VHDL 主要用于描述数字系统的结构、行为、功 能和接口。 Verilog HDL Verilog HDL是在C语言的基础上发展而来的硬件 描述语言,具有简洁、高效、易用的特点。
语言 设计层次 系统级 RTL级
Verilog HDL 行为描述 系统算法
VHDL 结构描述 系统逻辑框图 寄存器、ALU、 ROM等分模块描 述
这种FPGA的结构可分为三块:宏单元 (Macrocell)、可编程连线(PIA)和I/O控制块。 宏单元是器件的基本结构,由它来实现基本的逻辑 功能;可编程连线负责信号传递,连接所有的宏单 元;I/O控制块负责输入输出的电气特性控制,比如 可以设定集电极开路输出,摆率控制,三态输出等。
宏单元具体结构
4.PLD中或阵列的表示
5. 阵列线连接表示
编程前
编程后
6.PROM的PLD阵列图
二、FPGA/CPLD的结构
FPGA/CPLD的结构各有其特点和长处,但概括起来,它们是由三 大部分组成的: 1.逻辑阵列块 LAB (Logic Array Block)或CLB(Configurable Logic Block),构成了PLD器件的逻辑组成核心。 2.输入/输出块 IOB(I/O Block) 3.连接逻辑块的可编程连线阵列 PIA (Programmable Interconnect Array)或互连资源 IR(Interconnect Resources).它由各种长度的连线 线段组成,也有一些可编程的连接开关,用于逻辑块之间、逻辑块与 输入/输出块之间的连接。
PLD(CPLD/FPGA)的优点:
•规模大,能够完成任何数字逻辑的功能,实现系统集成 •在投片前验证设计的正确性,开发成本低 •修改设计而不用改动硬件电路,开发周期短 •减少PCB面积,提高系统可靠性
CPLD和FPGA的区别
•制造工艺不同 FPGA:查找表技术,SRAM工艺 CPLD:乘积项技术,Flash/EEPROM工艺 •实现功能不同 FPGA:时序逻辑电路 CPLD:组合逻辑电路
一. 简单PLD的结构 任何组合函数都可以表示为与-或表达式:如 F=AB+BCD 。PLD由“与门阵列”和“或门阵列”加上输 入输出电路构成。 早期的PLD有些是“与”阵列可编程, 有些是“或”阵列可编程,还有些是“与”和“或”阵列 都可编程。
1.输入缓冲器
2.PLD的互补输入
3.PLD中与阵列表示
一、 Verilog HDL设计模块的基本结构
• Verilog HDL程序设计由模块(module)构成的, 设计模块的基 本结构如图,一个完整的Verilog HDL设计模块包括端口定义、 I/O声明、信号类型声明和功能描述4个部分。
1 模块端口的定义 • 模块端口定义用来声明电路设计模块 的输入/输出端口,端口定义格式如下: module 模块名 (端口1,端口2,端口3,…); • 在端口定义的括号中,是设计电路模块与外界联系的全部输入 /输出端口信号或引脚,是设计实体对外的一个通信界面,是外 界可以看到的部分(不包含电源和接地端),多个端口之间用 “,”分隔。例如1位全加器adder模块的端口定义为module adder (S, CO, A, B, CI); 模块名adder
Xilinx Spartan-II内部结构
Altera的FLEX/ACEX等芯片的内部结构
查找表结构的逻辑实现原理
f=(A+B)*C*!D=A*C*!D+B*C*!D
选择FPGA还是CPLD?
CPLD组合逻辑的功能很强,一个宏单元就可以 分解十几个甚至20-30多个组合逻辑输入。而FPGA 的一个LUT只能处理4输入的组合逻辑,因此, CPLD适合用于设计译码等复杂组合逻辑。 但FPGA 的制造工艺确定了FPGA芯片中包含的LUT和触发器 的数量非常多,往往都是几千上万,CPLD一般只能 做到512个逻辑单元,而且如果用芯片价格除以逻辑 单元数量,FPGA的平均逻辑单元成本大大低于 CPLD。
与或阵列,每一个交叉点都是 可编程熔丝,导通实现与逻辑
“或”阵列 可编程D触发器
乘积项结构的逻辑实现原理
f=f1+f2= A*C*!D+B*C*!D
查找表(Look-Up-Table)的原理和结构
查找表LUT实质上是一个RAM,n位地址线可以配置为n×1的RAM。当用户描 述了一个逻辑电路后,软件会计算所有可能的结果,并写入RAM。每一个信号 进行逻辑运算,就等于输入一个地址进行查表,找出地址对应的内容,输出结果
设置布局布线 测试程序 约束条件 (test bench)
测试数据
(test bench)
调用模块 的行为仿 真模型
FPGA厂家工具 逻辑仿真器 逻辑仿真器
RTL代码
测试程序 (test bench)
测试数据
(9)在系统测试
下载/编程文件
HDL网表 (netlist)
SDF文件 (标准延时格式)
逻辑仿真器 (modelsim) (7)后仿真 (8)静态时序分析
布尔等式设计,原理图设 计,HDL语言设计
EDIF网表 SDF文件 EDIF 网表 ( netlist) (标准延时格式) (netlist) HDL网表 (netlist)
逻辑综合器
RTL代码中引用的由 厂家提供的宏模块 /IP 调用模块的 测试程序
行为仿真模型
HDL网表 FPGA基本单 调用模块的 (netlist) 元仿真模型 综合模型
FPGA技术
第一章 可编程逻辑器件发展历程 第二章 CPLD/FPGA概述 第三章 硬件描述语言VHDL/Verilog HDL简介
第四章 Quartus II的Verilog HDL建模与仿真
第一章 可编程逻辑器件的发展历程
一、 二、 可编程逻辑器件的发展历程 可编程逻辑器件的分类
可编程逻辑器件(PLD)
• 二、可编程器件的分类
1.按集成度来划分,分为高密度和低密度PLD器件。 • • • • • 1)集成度小于1000 门/每片的LDPLD,又称简单PLD。 PROM(可编程只读存储器) PLA (可编程逻辑阵列 ,Programmable Logic Array) PAL (可编程阵列逻辑 ,Programmable Array Logic) GAL (通用阵列逻辑,Generic Array Logic)
相关文档
最新文档