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第三章 DSP定点运算

第三章 DSP定点运算
第三章 DSP定点运算
数的定标 高级语言 DSP定点算术运算 非线性运算的定点快速实现 小 结
3.1.1 数的定标
在定点DSP芯片中,采用定点数进行数 值运算,其操作数一般采用整型数来表 示。 一个整型数的最大表示范围取决于DSP 芯片所给定的字长,一般为16位或24位。 显然,字长越长,所能表示的数的范围 越大,精度也越高。
虽然有时需要使用混合表示法,但是,更通常 的是全部以Q15格式表示的小数或以Q0格式表 示的整数来工作。 这一点对于主要是乘法和累加的信号处理算法 特别现实,小数乘以小数得小数,整数乘以整 数得整数。 乘积累加时可能会出现溢出现象,在这种情况 下,程序员应当了解数学里面的物理过程以注 意可能的溢出情况。 返回
3.4.2 查表法
在实时DSP应用中实现非线性运算,一般都采取适当 降低运算精度来提高程序的运算速度。查表法是快速 实现非线性运算最常用的方法。 查表法:根据自变量的范围和精度要求事先制作一张 表格,根据输入值确定表的地址,根据地址就可得到 相应的值。 显然输入的范围越大,精度要求越高,则所需的表格 就越大,即存储量也越大。 查表法求值所需的计算就是根据输入值确定表的地址, 因而运算量较小。 查表法比较适合于非线性函数是周期函数或已知非线 性函数输入值范围这两种情况 。
3.3 DSP定点算术运算
定点DSP芯片的数值表示是基于2的补码表示形 式。 每个16位数用1个符号位、i个整数位和15-i个小 数位来表示。 例如数00000010.10100000表示的值为 21 + 2 −1 + 2 −3 =2.625, 这个数可用Q8格式(8个小数位)来表示,它表 示的数值范围为-128~+127.996,一个Q8定点 数的小数精度为1/256=0.004。

DSP课程复习资料整理PPT课件

DSP课程复习资料整理PPT课件
8、掌握重复操作指令 R P T, R P T B , R P T Z
第15页/共27页
1、下面哪条指令是端口寻址指令?
(A)LD #0,A
(B)MVKD EXAM1,*AR5
(C)PORTR FIFO,*AR5 (D)READA 60H
2、 下面哪个间接寻址单操作数表示循环寻址?
(A)*AR2-0B
8、桶形移位寄存器的任务是为输入的数据_____ , 包括在ALU运算前对来自数据存储器的操作数或 累加器的值进行_____ ﹑对累加器的值进行_____ ﹑ _____等。
9、C54X CPU的乘法器/加法器单元包含一个 _____ 位乘法器和_____位加法器可以,在一个流 水线状态周期内完成一次_____运算。
(B)*AR2-0%
(C)*AR2(5) (D)*+AR2(5)
3、请解释下列指令的功能并比较异同。
(1)LD #60H,A (2)LD 60H,A
(3)LD *(60H),A第16页/共27页
4、指令解释。 (1)READA Smem (2)WRITA Smem 5、程序中给出如下两条指令,请问实际寻址的数据存
能够画出各段存储器分布图。
6、汇编器在段处理中的作用 ?
第19页/共27页
7、掌握链接器对段的处理。 8 、 掌 握 M E M O R Y, S E C T I O N 伪 指 令 的 作 用 。
给出存储器的描述,能够用MEMORY进行表达。 9、掌握编写DSP汇编源程序的格式。 10、掌握伪指令,比如.def .mmregs 的作用。 11、宏定义、宏调用以及宏展开方法? 12、TI公司DSP集成开发环境(CCS)有哪几种工作模
2、通过编程可以控制定时器产生定时中断,定时中断的周期为_____ 。

DSP第三章.ppt

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RPT后面的一条指令重复执行多次。
二、程序地址的产生
程序地址产生的情况
▲ 顺序操作:程序的地址来源于PC程序计数器(程序地址+1) ▲ 空(哑)周期:程序的地址来源于PAR (程序地址+1) ▲ 从子程序返回:程序的地址来源于栈顶(TOS) ▲ 从表传送或块传送返回:程序的地址来源于转移或调用指
PSC
TDDR
R-0
D15
PSCH
D8 D7
R/W-0
D0
TDDRH
R-0
R/W-0
一、时钟及系统控制
看门狗及其应用
F2812的看门狗与240x的基本相同,当8位的看门狗计数 器计数到最大值时,看门狗模块产生一个输出脉冲(512个振荡 器时钟宽度)。如果不希望产生脉冲信号,用户需要屏蔽计数 器,或用软件周期向看门狗复位控制寄存器写“0x55+0xAA", 该寄存器能够使看门狗计数器清零。
SUBC(条件减)
希望同学们坚信:
数据存储区中建立一个堆栈。
二、程序地址的产生
堆 栈 例 子
二、程序地址的产生
堆栈例子
二、程序地址的产生

堆 ▲ 一级深、16位宽,操作不可见,即无指令,只有程序

地址产生逻辑才能够使用微堆栈。
▲ 程序地址产生逻辑在执行BLDD、BLPD、MAC、MACD、 TBLR 和TBLW 这些串(块)操作指令时利用微堆栈保 存返回地址。
WDCHK
R/W-0
R/W-0
D0
WDCNTR
R/W-0
D0
WDKEY
R/W-0
D8
D3 D2
D0
R/W-0WDPS
二、程序地址的产生

DSP芯片技术及应用

DSP芯片技术及应用

DSP总结:以下总结仅针对宁波大学DSP芯片技术及应用(通信类非控制类)这门课,个人根据重点、考点总结的,用于期末复习(请结合课本以及PPT的例子),不足之处请见谅,基本能过就是,如若其中有错请联系QQ:493288964。

还是建议您平时学点,理解为先!!!将该文章用于百度等兑换积分的行为是可耻的!第一章绪论(简介)1、DSP芯片特点:采用哈佛结构;多总线结构;流水线技术;专用的硬件乘法器;特殊的DSP指令;快速的指令周期;硬件配置强;支持多处理器结构1)CPU是冯.诺伊曼结构;DSP是数据和地址空间分开的哈佛结构。

冯.诺依曼结构:单存储空间;统一的程序和数据空间;共享的程序和数据总线;程序指令只能串行执行单指令周期:100ns,现在单指令周期为:10ns哈佛结构:双存储空间;程序存储器和数据存储器分开;程序总线和数据总线分开;独立编址、独立访问改进型哈佛结构:双存储空间、多条总线;多条数据总线;高速缓冲器(重复指令,只需读入一次)2)采用多总线结构:TMS320C54X:4组总线;单机器周期内可完成的操作;3)流水线操作4)专用的硬件乘法器硬件乘法累加器是DSP区别于通用微处理器的一个重要标志MAC(乘累加)单元(独立的乘法器和加法器;单周期内完成一次乘法和一次加法运算;MPY,MAC,MACA, MACSU等指令)分类:工作时钟和指令类型:静态和一致性DSP芯片;用途分:通用和专用型;数据格式分:定点和浮点型2、DSP按数据格式分为定点型和浮点型定点DSP芯片:数据长度16位/24位TMS320C2000/5000/6000价格便宜、功耗较低、但运算精度稍低。

浮点DSP芯片:数据长度32位/40位MS320C3X/4X/VC33/C67X/C8X价格稍贵、功耗较大、但运算精度高。

3、芯片简介TMS320VC5416PGE160 主处理器芯片的性能:频率:160MHz 速度:160MIPS 周期:6.25ns第二章:TMS320C54X的硬件结构1、C54X:为低功耗,高性能而专门设计的16位定点DSP芯片C54基本结构:中央处理器(CPU)、内部总线结构、存储器、片内外设。

哈工程DSP专业课课件第三章

哈工程DSP专业课课件第三章

8个辅助寄存器(AR7-AR0)提供了灵活多变以 及功能强大的间接寻址。使用辅助寄存器中的一 个16-bit地址就可访问64K数据存储空间的任意单 元。
通过向状态寄存器ST0的一个3-bit辅助寄存器 指针(ARP)设置一个从0到7的值,就可以选择所需 的辅助寄存器。
设置 数值 的方 法有
MAR指令 它只修改辅助寄存器及ARP
存储器)的值相乘
接收乘法器的乘积
在将PREG的值送入 CALU之前,乘积移位
器将对PREG值进行 定标操作
3.3.1 乘法器
在一个机器周期内,16-bit * l6-bit硬件乘 法器可以产生一个带符号或不带符号的32-bit乘 积。
除在无符号乘法(MPYU指令)周期外,被 乘的两个数作二进制补码处理。
3.1 概述
本章讲述中央处理单元(CPU)的主要组成
CPU 的 三 个 基 本 部 分 (3.2节~3.4节)
包括:输入定标部分、乘法 部分、中央算术逻辑部分
辅助寄存器算术单元 (ARAU)(3.5节)
状态寄存器ST0和ST1 (3.5节)
ARAU实现对8个辅助寄存 器的算术运算。
状态寄存器决定处理器工作 方式、寻址指针以及显示不 同的处理器状态和算术逻辑
中央算术逻辑单元
3.4.1 中央算术逻辑单元(CALU)
中央算术逻辑单元(CALU)执行一系列的算 术和逻辑运算,数字运算是在一个时钟周期内 进行。
这些算术和逻辑运算分为四类:
16-bit加法 16-bit减法 布尔逻辑运算 位测试、移位和循环
鉴于CALU可执行布尔运算,因此可以进行位处理。 CALU使用累加器进行移位和循环。 它具有独立的算术单元和辅助寄存器算术单元。

第3章TMS320C54XDSP寻址方式09.10

第3章TMS320C54XDSP寻址方式09.10

ARx包含了数据存储器地址 访问后,ARx以循环寻址方式减1 ARx包含了数据存储器地址 访问后,ARx以循环寻址方式减去 AR0 ARx包含了数据存储器地址 访问后,ARx以循环寻址方式加1 ARx包含了数据存储器地址 访问后,ARx以循环寻址方式加上 AR0 ARx加上16位长偏移量作为数据 存储器地址 访问后,ARx中内容不变 ARx加上16位长偏移量作为数据 存储器地址 访问后,ARx中内容加上16位长 偏移量 ARx以循环寻址方式加上16位长 偏移量作为数据存储器地址, 同时修改ARx中内容 以无符号16位长偏移量作为数据 存储器地址 (绝对地址)
19
单操作数 3 间接寻址 y0 a i x i a0 x0 a1 x1 a 2 x 2 a3 x3 编程举例: i 0 .mmregs .bss x, 4 .word 1, 2, 3, 4 STM #a, AR1 STM #x, AR2 LD #0, A LD *AR1+,T MAC *AR2+,A LD *AR1+,T MAC *AR2+,A LD *AR1+,T MAC *AR2+,A LD *AR1,T MAC *AR2,A …..
第一条指令表示将数据存储器中以DATA符号为地址单元中 的数据传送到由辅助寄存器ARl所指向的数据存储单元中去。 DATA代表数据存储单元的地址dmad。 第二条指令表示将程序存储器中以TABLE符号为地址单元中 的数据传送到由辅助寄存器AR2所指向的数据存储单元中去。 TABLE代表程序存储单元的地址pmad。 第三条指令表示将地址为0F2F0H的端口中的数据传送到由 辅助寄存器AR5所指向的数据存储单元中去。
17序号间址类型功能说明arxaddrarxarx包含了数据存储器地址arxaddrarxarxarx1arx包含了数据存储器地址访问后arx中地址减1arxaddrarxarxarx1arx包含了数据存储器地址访问后arx中地址加1arxaddrarx1arxarx1寻址前arx中地址加1arx0baddrarxarxbarxar0arx包含了数据存储器地址访问后arx以位倒序方式减去ar0arx0addrarxarxarxar0arx包含了数据存储器地址访问后arx中减去ar0arx0addrarxarxarxar0arx包含了数据存储器地址访问后arx中加上ar0arx0baddrarxarxbarxar0arx包含了数据存储器地址访问后arx以位倒序方式加上ar0号表示间址32位字时增减为2寻址前变址只用于写操作指令18arxaddrarxarxcircarx1arx包含了数据存储器地址访问后arx以循环寻址方式减1arx0addrarxarxcircarxar0arx包含了数据存储器地址访问后arx以循环寻址方式减去ar010arxaddrarxarxcircarx1arx包含了数据存储器地址访问后arx以循环寻址方式加111arx0addrarxarxcircarxar0arx包含了数据存储器地址访问后arx以循环寻址方式加上ar012arxlkaddrarxlkarxarxarx加上16位长偏移量作为数据存储器地址访问后arx中内容不变13arxlkaddrarxlkarxarxlkarx加上16位长偏移量作为数据存储器地址访问后arx中内容加上16位长偏移量14arxlkaddrcircarxlkarxcircarxlkarx以循环寻址方式加上16位长偏移量作为数据存储器地址同时修改arx中内容15lkaddrlk以无符号16位长偏移量作为数据存储器地址绝对地址lk不允许mmr寻址19间接寻址时

DSP第三章4-习题ppt课件

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1)x(n)(n)
N 1
N 1
X(K ) x(n)W N K n (n)W N K n1 K0,1,..N..1
n0
n0
2)x(n)(nn0)
0n0 N
X (K ) N 1 x (n ) W N K n N 1(n n 0 ) W N K W nN K 0 ne j2 N K 0n
x % e ( n ) 0 R e [ X % ( k ) ] 0 x % ( n ) x % o ( n ) j I m [ X % ( k ) ]
x%( n )为共轭反对称序列,即满足实部奇对称,虚 部偶对称(以 n 0 为轴)。 又由图知,x%( n ) 为实序列,虚部为零,故 x%( n ) 应 满足奇对称: x % (n)x % (n)
而 x(0)x(N1)
x(1)x(N2)
x(N1 )x(N1N1 )x(N )
2
2
2
X(N) 0得证 2
.
例4. 已知序列 x n a n u n ,0 a 1 ,现对于x(n)
的 z 变换在单位圆上 N 等分抽样,抽样值为
X k X z zWNkej2Nk 试求有限长序列的N点 IDFTXk
对 X(z)在 单 位 圆 上 N 点 等 间 隔 抽 样 , 得 周 期 序 列 :
X % (k)X(z)zW N k x(n)W N nk n
X % (k)的 IDFS:
x% N(n)x(nrN)
r
N 点 X ( k ) X % ( k ) R N ( k )
x '( n ) I D F T [X ( k ) ]
相当于 X (e j ) 的单位园上10个等间隔采样,求y(n)
解:y(n)x(nrN)R(N) r

DSP原理与应用---第3章 EMIF

DSP原理与应用---第3章 EMIF
335335we触发模式下异步读周期的时序335we触发模式下异步写周期的时序335选择触发模式下异步读周期的时序335选择触发模式下异步写周期的时序emif与sdrm和flash的硬件连接图flash有三个地址输入源采用轮询法对flash编程和擦除emwe引脚接到了flash的we输入端emif运行在选择触发模式下34sdram时序寄存器sdtimr的设置字段公式sdram数据手册上的值计算值trfctrfc68nsmintrptrp20nsmintrcdtrcd20nsmintwrtwr20nsmintrastras49nsmintrctrc68nsmintrrdtrrd14nsmin101001068sdram自刷新退出时序寄存器sdsretr的设置字段公式sdram数据手册上的值计算值txstxs68nsminsdram刷新控制寄存器sdrcr的设置字段公式sdram数据手册数值计算值rrrrcycles4096100mhzrr1562周期0x61a周期sdram配置寄存器sdcr的设置字段目的sr0b避免emif进入自刷新状态nm1b配置emif为16位数据总线cl011b选择cas延迟3位119lock1b允许写入cl区ibank010b选择4个内部sdram存储区pagesize0b选择256字的页面flashemif到flash的读时序交流特性器件定义minmax单位suemif建立时间在emclk变高电平之前读emd数据65nsemif数据保持时间在emclk变高电平之后读emd数据emif输出延迟时间emclk为高电平时输出有效信号
实用文档
NAND flash和NOR flash的对比
接口差别 NOR 闪存带有SRAM接口,有足够的地址引脚来寻址,可以 很容易地存取其内部的每一个字节。 NAND闪存使用复杂的I/O口来串行地存取资料,各个产品 或厂商的方法可能各不相同。8个引脚用来传送控制、地 址和资料信息。NAND读和写操作采用512字节的块,这一 点有点像硬盘管理此类操作,很自然地,基于NAND的闪存 就可以取代硬盘或其它块设备。
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证明:如何修改x(n),以获得一个新序列x1(n),使 x1(n)的DFT对应所希望的X(Z)取样。
解: 对于右图,
例3、令X(K)为N点序列x(n)的N点DFT 1)证明:若x(n)=-x(N-1-n),则X(0)=0 2)当N为偶数时,若x(n)=x(N-1-n),则X(N/2)=0
证:1)
k
j
1
1 bN bWNN
k
*
RN (k )
1 2j
1 aN
1 aWNk
j
1 bN 1 bWNk
1aN 1 a WNk
*
j 1 bN 1 b WNk
*
RN
(k
)
1 bN 1 bWNk RN (k )
1
bWNk
1 bWNk
N
RN (k)
N 1
bnWNkn RN (k )
n0
y(n)
bnRN (n)
2 F k 1 jN
X (k) DFT[x(n)] DFT{Re[ f (n)]}
Fep (k)
1 2
F (k)
F *((N
k ))N
RN
(k)
1 2
1
jN
1
jN
*
RN
(k
)
1 1
2
jN
1
jN RN (k)
RN (k )
x(n) (n)
Y (k) DFT[ y(n)] DFT{Im[ f (n)]}
(
2 N
k
0
)
j0N j0N
j0N
e
j
1 2
(
2 N
e
k 0
)
2
(e
(e
j1( 2
2 N
2 k
0 )
e
2 j
e
1 2
)( 2 NFra bibliotekk0
)
)
RN
(k
)
1 2
a
sin(0N )
2
sin(
N
k
1 2
0
)
e
j
N
k
j
N210
sin(0N )
2
sin(
N
k
1 2
0
)
e
j k N
j N210
k
0
)
n
n0
N 1
e
n0
j
(
2 N
k
0
)
n
RN
(k)
1 2
a
1
1
e j0
j( 2 k
eN
N 0
)
1 e j0N
1
e
j
(
2 N
k
0
)
RN
(k
)
j0N j0N
j0N
1 2
a
e
e 2 (e 2 e 2 )
(e e ) j
1 2
(
2 N
k
0
)
j
1 2
(
2 N
k
0
)
j
1 2
anRN (n)
对X (z)在单位圆上N点等间隔抽样,得周期序列:
X%(k ) X (z) zWNk
x(n)WNnk
n
X%(k )的IDFS:
x%N (n) x(n rN )
r
N点 X (k) X%(k)RN (k)
x '(n) IDFT[X (k)]
N越大,
x`(n)越逼 近x(n)
Re[ X%(k )] j Im[X%(k)] 0
x%(n)为共轭对称序列,即满足实部偶对称,虚部 奇对称(以 n 0 为轴)。
又由图知,x%(n)为实序列,虚部为零,故 x%(n)应 满足偶对称: x%(n) x%(n)
即 x%(n) 是以 n 0 为对称轴的偶对称
故第二个序列满足这个条件
N 1
Y (k) x(i)WNik i0
0 k N 1 0 k rN 1
故 Y (k) X ((k))N RrN (k)
离散时域每两点间插
入 r -1个零值点,相 当于频域以N为周期 延拓r次,即Y(k)周期 为rN。
例10.设有一谱分析用的信号处理器,抽样点数必须为 2的整数幂,假定没有采用任何特殊数据处理措施, 要求频率分辨力 1,0H如z 果采用的抽样时间间 隔为0.1ms,
(2)要使 X%(k) 为虚数,根据DFT的性质:
x%e (n) 0 x%(n) x%o (n)
Re[X%(k)] 0 j Im[X%(k)]
x%(n)为共轭反对称序列,即满足实部奇对称,虚 部偶对称(以 n 0 为轴)。
又由图知,x%(n)为实序列,虚部为零,故 x%(n)应 满足奇对称: x%(n) x%(n)
N
RN (k)
N 1
a
W n kn N
RN
(k
)
n0
x(n) anRN (n)
Y (k) DFT[ y(n)] DFT{Im[ f (n)]}
1 j
Fop (k )
1 2j
F (k)
F *((N
k ))N
RN
(k)
1 2j
1aN
1
aWNk
j
1 bN 1 bWNk
1
1 aN aWNN
x%N (n)RN (n)
anrN u(n rN )RN (n) anrN RN (n)
r
r0
an
r0
aN
r
RN (n)
1 1 aN
an RN (n)
例5、令:
表示
的傅氏变换
y(n)表示长度为10的一个有限长序列,Y(K)=DFT[y(n)]
相当于
的单位园上10个等间隔采样,求y(n)
解:由 X
(k)
DFT[x(n)]
N 1
x(n)e
j 2 N
nk
,0
k
N
1
n0

rN 1
Y (k ) DFT[ y(n)] y(n)WrnNk
N 1
x(n)WrnNk
n0
n0
N 1
x(n)e
j 2 rN
nk
N
1
x(n)e
j 2 N
nk r
n0
n0
X
k r
k lr, l 0,1,..., N 1
解:
讨论:
例6. 试求以下有限长序列的 N点 DFT(闭合形式):
(3) x(n) anRN (n)
N 1
解:X (k ) x(n)WNnk RN (k )
n0
N 1 ane
j 2 N
nk
RN
(k)
n0
N 1
j 2 k n
ae N RN (k )
n0
1 aN
j 2 k
RN (k )
解:由 X (k) DFT[x(n)] x(n)WNnk ,0 k N 1 n0
得 Y (k) DFT[ y(n)] rN1 y(n)WrnNk n0
N 1
N 1
x(ir r)WriNrk x(i)WNik
i0
i0
0 k rN 1
N 1
Q X (k) x(n)WNnk n0
DFT[x(n)] jDFT[ y(n)] X (k) jY (k)
由共轭对称性得
X (k) DFT[x(n)] DFT{Re[ f (n)]}
Fep (k)
1 2
F (k)
F *((N
k ))N
RN
(k)
X
(k
)
1 2
F
(k)
F
* (( N
k
)) N
RN
(k)
1 1aN
2
1
aWNk
1 F k
1 aN 1 aWNk
j
1 bN 1 bWNk
2 F k 1 jN
其中 a,b 为实数。试用 F k 求 X k DFT xn, Y k DFT y n, xn, yn
1
F k
1 aN 1 aWNk
j
1 bN 1 bWNk
解:由DFT的线性性 F(k) DFT[ f (n)] DFT[x(n) jy(n)]
例 14:长度为N的一个有限长序列x(n)的N点DFT为 X(k)。 另一个长度为2N的序列y(n) 定义为
1 j
Fop (k )
1 2
F (k)
F *((N
k ))N
RN (k )
1 2j
1
jN
1
jN
*
RN
(k
)
1 1
2j
jN
1
jN RN (k)
NRN (k )
y(n) N (n)
例12:书P122-13 解:

K=0,1,2,….15
C图
例13:书P122-15
n=0,1,,,,,6不同 n=7-19相同
序列2:
X%2 (k)
2 j nk
e4
n0
j 3 k
1e 4
j k
1e 4
当 k 2,4,6,... 时,X%1(k) 0
序列3: x%3(n) x%1(n) x%1(n 4)
根据序列移位性质可知
X%3
(k
)
X%1(k
)
e
j k
X%1(k
)
(1
e
j
k
)
1
(1)k
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