数电复习资料复习进程
数电实验-译码器复习进程
数电实验-译码器实验八译码器及其应用一、实验目的:1、掌握中规模集成译码器逻辑功能分析及测试方法；2、学会中规模集成译码器的连接使用方法；3、熟悉数码管的使用方法。
二、实验原理:1、译码器是一个多输入、多输出的组合逻辑电路。
它的作用是把给定的代码进行“翻译”，变成相应的状态，使输出通道中相应的一路有信号输出。
译码器在数字系统中有着广泛的用途，不仅适用于代码的转换，终端的数字显示，而且还适用于数据分配，存储器寻址和组合控制信号等方面。
2、译码器可分为通用译码器和显示译码器两大类。
通用译码器又分为变量译码器和代码变换译码器。
（1）、变量译码器（又称二进制译码器），用以表示输入变量的状态，如2/4线译码器、3/8线译码器和4/16线译码器。
若有n个输入变量，则有2n个不同的状态组合，就有2n个输出端供其使用。
而每一个输出状态所代表的函数就对应一个n变量的最小项表达式。
图8-1 3-8译码器74LS138逻辑图及列脚排列以3/8线译码器74LS138为例进行分析，图8-1（a）、（b）分别为其逻辑图和引脚排列图。
A2、A1、A0为地址输入端，Y0~Y7是译码器输出端，S1、S2、S3是使能端。
表8-1为74LS138功能表，当S1=1，S2+S3=0时，器件使能端有效，地址码所指定的输出端有信号（为0）输出，其它所有输出端均无信号（为1）输出。
当S1=0，S2+S3=X时或S1=X，S2+S3=1时，译码器被禁止，所有输出同时为1。
表8-1二进制译码器实际上也就是负脉冲输出的脉冲分配器。
若利用使能端中的一个输入端输入数据信息，器件就成为一个数据分配器（又称多路分配器），如图8-2所示。
若在S1输入端输入数据信息，S2=S3=0，地址码所对应的输出是S1数据信息的反码；若从S2输入端输入数据信息，令S1=1，S3=0，地址码所对应的输出就是S2端数据信息的原码。
若数据信息是时钟脉冲，则数据分配器便成为时钟脉冲分配器。
数字电路复习要求
《数字电路》复习要求第一章逻辑代数基础第一节二←→十进制数之间的转换，二←→十六进制数之间的转换;码制，8421BCD代码，十进制数←→8421BCD代码之间的转换。
第二节与逻辑运算、或逻辑运算、非逻辑运算的定义以及与、或、非、与非、或非、与或非、异或、同或逻辑运算的真值表、表达式、图形符号。
第三节逻辑代数的基本公式和常用公式。
第四节代入定理反演定理对偶定理。
第五节逻辑函数的真值表、逻辑函数式、逻辑图以及各种表示方法间的相互转换，最小项的性质，逻辑函数的最小项之和形式，由最小项之和形式求最大项之积形式的方法。
第六节熟练运用公式和定理把逻辑函数化为最简与或形式，最简与或形式化为最简与非与非形式。
第七节逻辑函数的卡诺图表示法，用卡诺图化简逻辑函数。
第八节约束项，具有约束项的逻辑函数及其化简。
第二章门电路第一节高电平、低电平、正逻辑、负逻辑的概念。
第二节半导体二极管、三极管、MOS管的开关特性。
（导通条件，导通时的特点，截止条件，截止时的特点）。
第三节最简单的二极管与门、二极管或门、三极管非门电路的电路结构和工作原理（以后碰到二极管与门阵列要认识）。
第四节TTL反相器的静态输入特性和输出特性，TTL反相器的输入负载特性，注意其他类型的TTL门电路（与非门、或非门、与或非门、异或门、OC门、TS门）的静态输入特性与TTL反相器的静态输入特性有何不同，OC门和TS门的符号、逻辑功能以及应用。
第六节CMOS反相器的工作原理，认识其他类型的CMOS门电路（与非门、或非门、漏极开路门、三态门、CMOS传输门和双向模拟开关），了解CMOS门电路的正确使用方法。
第三章组合逻辑电路第一节组合逻辑电路的特点组合逻辑电路逻辑功能的描述方法。
第二节组合逻辑电路的分析方法和设计方法。
第三节掌握3线—8线译码器74LS138、数据选择器74LS151、74LS153 以及4位加法器74LS283的逻辑功能。
掌握用译码器、数据选择器、加法器设计组合逻辑电路的方法，分析方法。
数字电路复习资料
数字电路复习资料数字电路复习资料数字电路作为计算机科学与工程领域中的重要基础知识，对于理解计算机硬件原理以及设计和实现数字系统至关重要。
本文将为大家提供一份数字电路复习资料，帮助大家巩固和加深对数字电路的理解。
一、数字电路基础知识1. 逻辑门逻辑门是数字电路中最基本的组件，用于实现逻辑运算。
常见的逻辑门包括与门、或门、非门、异或门等。
它们通过输入的电平状态，经过逻辑运算后产生输出。
掌握逻辑门的真值表和逻辑运算规则是理解数字电路的基础。
2. 布尔代数布尔代数是一种用于描述和分析逻辑运算的数学工具。
通过布尔代数，我们可以利用逻辑运算符号和规则对数字电路进行分析和设计。
熟练掌握布尔代数的基本运算规则和定理，对于理解数字电路的功能和性能至关重要。
3. 组合逻辑电路组合逻辑电路是由逻辑门组成的数字电路，其输出仅取决于当前输入的状态，与过去的输入状态无关。
掌握组合逻辑电路的设计原理和常见的组合逻辑电路，如译码器、多路选择器、加法器等，对于理解数字系统的功能和实现至关重要。
4. 时序逻辑电路时序逻辑电路是由组合逻辑电路和触发器组成的数字电路，其输出不仅取决于当前输入的状态，还取决于过去的输入状态。
掌握时序逻辑电路的设计原理和时钟信号的作用，对于理解数字系统的时序性和同步性至关重要。
二、数字电路设计与实现1. 数字电路设计方法数字电路的设计是指根据给定的功能要求，通过逻辑门和触发器的组合，设计出满足要求的数字电路。
常见的数字电路设计方法包括真值表法、卡诺图法和状态转换图法。
掌握这些设计方法，可以帮助我们高效地设计和实现数字电路。
2. 逻辑门的扩展与简化逻辑门的扩展与简化是数字电路设计中常用的技巧。
通过逻辑门的扩展与简化，我们可以减少逻辑门的数量和延迟，提高数字电路的性能。
掌握逻辑门的扩展与简化方法，对于设计和优化数字电路至关重要。
3. 数字系统的设计与实现数字系统是由多个数字电路组成的复杂系统。
数字系统的设计与实现需要考虑系统的功能需求、性能指标和资源约束。
数电复习要点修订版
数字电路的组成
数字电路由逻辑门、触发 器、寄存器等基本逻辑元 件组成。
数字电路的分类与特点
组合逻辑电路
微处理器和控制器
组合逻辑电路由逻辑门组成，用于实 现逻辑函数。其特点是输出仅与当前 输入有关。
微处理器和控制器是实现计算机功能 的电路，由指令集、控制单元、运算 器等组成。
时序逻辑电路
时序逻辑电路由触发器和寄存器组成， 具有记忆功能。其特点是输出不仅与 当前输入有关，还与过去的输入有关。
组合逻辑电路的分析与设计
组合逻辑电路的分析步骤
确定输入和输出变量，列出真值表，化简逻辑表达式，根据表达式 画出逻辑图。
组合逻辑电路的设计步骤
根据实际需求确定输入和输出变量，根据功能要求列出真值表，根 据真值表写出逻辑表达式，根据逻辑表达式画出逻辑图。
组合逻辑电路的设计方法
卡诺图法、代数法、波形图法等。
数电基本门电路
与门、或门、非门
与门
当所有输入都为高电平时， 输出才为高电平；否则， 输出为低电平。
或门
当至少一个输入为高电平 时，输出就为高电平；否 则，输出为低电平。
非门
输入与输出的状态总是相 反。
与非门、或非门、异或门
与非门
当所有输入都为高电平时，输出 为低电平；否则，输出为高电平。
或非门
当至少一个输入为高电平时，输出 为低电平；否则，输出为高电平。
填空题2
在二进制数制中，最大的数是________。
3
填空题3
在逻辑代数中，与非运算可以表示为________运 算。
简答题
简答题1
简述数字电路的特点和优点。
简答题2
简述二进制数制的优点和缺点。
简答题3
《数字电路》考研复习大纲
《数字电路》考研复习大纲一.考试要求掌握逻辑基础，掌握组合逻辑分析及设计，掌握时序逻辑特征，掌握时序逻辑电路分析和设计，掌握中规模逻辑电路的应用，掌握脉冲信号的产生和整形，了解A/D和D/A的基本特性及其应用。
二.考试方式和考试时间1．考试方式：硕士研究生入学数字电路考试为笔试，总分75，考试时间为90分钟。
2.参考书：康华光电子技术基础（数字部分）（第五版）高等教育出版社3.试题分数分配：一. 组合电路分析 15分二. 组合电路设计 15分三. 时序电路分析 15分四. 时序电路设计 15分五．其他 15分三、考试内容、考试要求第一章制数、码制与半导体器件开关运用特性（1）熟知数制与码制的概念、表示方法、性质及相互转换，（2）掌握二极管、三极管MOS管的开关运用特性。
第二章逻辑代数基础（1）逻辑代数的基本定理和规则，（2）逻辑函数的化简。
第三章逻辑门电路（1）熟知基本逻辑门电路以及集成逻辑门电路工作原理和外特性，（2）熟练掌握TTL与非门及其它功能的TTL、 CMOS逻辑门。
第四章组合逻辑电路（1）熟练掌握组合逻辑电路的分析方法，（2）深刻理解全加器、代码转换、数值比较、译码、数据选择、数据分配、奇偶检测等典型电路的概念和功能，掌握它们的分析和设计方法。
第五章触发器（1）深刻理解触发器的性质，熟练掌握其功能，（2）理解触发器的结构，熟练其触发方式。
第六章时序逻辑电路（1）同步时序逻辑电路的分析；（2）同步时序逻辑电路的设计；（3）典型同步时序逻辑电路设计举例。
第七章采用中规模集成电路的逻辑设计（1）深刻理解几种常见的中规模集成电路（译码器、多路选择器、数值比较器、加法器、寄存器、计数器）的外部特性和逻辑功能，（2）熟练应用中规模集成电路进行逻辑电路设计。
第八章半导体存储器和可编程逻辑器件（1）RAM容量的扩展方法；(2) 可编程逻辑器件的基本特征及编程原理。
第九章脉冲的产生和整形（1）深刻理解555定时器的电路组成和功能；（2）熟练掌握施密特触发器、单稳态触发器及多谐振荡器电路构成及其应用。
数字电路复习资料.
数字电路复习资料.数字电路复习资料第⼀部分：基本要求和基本概念第⼀章半导体器件的基本知识⼀，基本要求1，了解半导体PN结的形成及特性，了解半导体⼆极管的开关特性及钳位作⽤。
2，了解半导体三极管的输⼊特性和输出特性，熟悉半导体三极管共发射极电路的三个⼯作区的条件及特点，掌握三极管开关电路分析的基本⽅法。
3，了解绝缘栅场效应管（MOS）的结构、符号、⼯作原理及特性。
⼆，基本概念1，按导电率可以把材料分为导体、绝缘体和半导体。
2，半导体中有空⽳和⾃由电⼦两种载流⼦。
3，纯净半导体称为本征半导体。
4，P型半导体中的多数载流⼦是空⽳；少数载流⼦是⾃由电⼦。
5，N型半导体中的多数载流⼦是⾃由电⼦；少数载流⼦是空⽳。
6，PN结是⼀个⼆极管，它具有单项导电性。
7，⼆极管电容由结电容和扩散电容构成。
8，⼆极管的截⽌条件是V D＜0.5V，导通条件是V D≥0.7V。
9，三极管的截⽌条件是V BE＜0.5V，截⽌的特点是I b=I c≈0；饱和条件是I b≥（E C-Vces）/（β·R C），饱和的特点是V BE≈0.7V，V CE=V CES≤0.3V。
第⼆章门电路⼀，基本要求1，熟悉分⽴元件“与”“或”“⾮”“与⾮”“或⾮”门电路的⼯作原理、逻辑符号和功能。
2，熟悉TTL集成与⾮门的结构、⼯作原理及外部特性，熟悉OC门三态门和异或门的功能及主要⽤途，掌握各种门电路输出波形的画法。
2，熟悉PMOS门NMOS门和CMOS门的结构和⼯作原理，熟悉CMOS门的外部特性及主要特点，掌握MOS门电路的逻辑功能的分析⽅法。
⼆，基本概念1，门是实现⼀些基本逻辑关系的电路。
2，三种基本逻辑是与、或、⾮。
3，与门是实现与逻辑关系的电路；或门是实现或逻辑关系的电路；⾮门是实现⾮逻辑关系的电路。
4，按集成度可以把集成电路分为⼩规模（SSI）中规模（MSI）⼤规模（LSI）和超⼤规模（VLSI）集成电路。
5，仅有⼀种载流⼦参与导电的器件叫单极型器件；有两种载流⼦参与导电的器件叫双极型器件。
数字电子技术复习资料
数字电子技术复习资料数字电子技术复习资料数字电子技术是现代电子技术中的重要分支，它以数字信号的处理和传输为核心，广泛应用于计算机、通信、控制等领域。
本文将为大家提供一份数字电子技术的复习资料，希望能够帮助大家系统地回顾和巩固相关知识。
一、数字电路基础知识数字电路是数字电子技术的基础，了解数字电路的基本概念和特点对于深入理解数字电子技术至关重要。
1. 逻辑门：逻辑门是数字电路的基本构建单元，常见的逻辑门包括与门、或门、非门等。
它们通过逻辑运算实现不同的功能，如与门实现与运算，或门实现或运算。
2. 布尔代数：布尔代数是描述逻辑运算的数学工具，它通过与、或、非等逻辑运算符号表示逻辑关系。
深入理解布尔代数的基本原理和运算规则，对于设计和分析数字电路至关重要。
3. 真值表：真值表是逻辑函数的一种表示形式，它列出了逻辑函数在不同输入组合下的输出值。
通过真值表可以直观地了解逻辑函数的逻辑关系。
二、组合逻辑电路组合逻辑电路是一种由逻辑门构成的数字电路，它的输出仅依赖于当前的输入。
了解组合逻辑电路的基本原理和设计方法，对于理解和设计复杂的数字电路至关重要。
1. 真值表和逻辑函数：通过真值表可以得到逻辑函数的表达式，通过逻辑函数可以设计出对应的组合逻辑电路。
2. 卡诺图：卡诺图是一种用于简化逻辑函数的工具，通过画出逻辑函数的卡诺图，可以直观地找出逻辑函数的最简表达式。
3. 编码器和解码器：编码器和解码器是常用的组合逻辑电路。
编码器将多个输入信号转换为较少的输出信号，解码器则将较少的输入信号转换为多个输出信号。
三、时序逻辑电路时序逻辑电路是一种在组合逻辑电路的基础上加入了时钟信号的数字电路，它的输出不仅依赖于当前的输入，还依赖于过去的输入。
了解时序逻辑电路的基本原理和设计方法，对于理解和设计时序电路至关重要。
1. 触发器：触发器是时序逻辑电路的基本构建单元，它可以存储和传输信息。
常见的触发器包括RS触发器、D触发器、JK触发器等。
数电复习提纲
数电复习提纲数字电路复习提纲第⼀、⼆章逻辑代数基础1、熟练掌握数制之间的相互转换（8421BCD 码、余3码的表⽰）。
2、熟悉逻辑函数的基本运算（基本运算法则以及逻辑函数的卡诺图化简）。
例题：1、（10011010.1000）余3 BCD= ( )D =( )B 2、(10010100.00100101)8421 BCD = ( )D =( )B3、逻辑函数的对偶函数，反函数。
4、写出函数F （A ，B ，C ，D ）=∑m(0,4,6,8,9,12,14)+ ∑d (1,3,7,15) 的最简与或表达式。
第三章门电路1、会计算、、、以及扇出系数N 。
2、熟悉三态门的符号及功能，会画出三态门的输出波形。
3、熟悉OC （OD ）门的符号、特点。
例题：1、有⼀两端输⼊的TTL 与⾮门带同类负载门的个数为N,已知门电路的|I IL |=1.5mA ，I IH =10µA ，|I OL |=15mA ， |I OH |=400µA 则该)(M IN IH V )(M AX I L V N H V NL V B A AB F ''+=电路能带负载门个数N=_______。
2、低电平使能有效的三态反相器，当使能有效时，其输出为，当使能⽆效时，其输出为。
3、⽤表⽰⾼电平，⽤表⽰低电平，称为正逻辑。
4、OC门的主要特点是。
第四章组合逻辑电路1、了解组合逻辑电路的特点。
2、熟悉门电路组成的组合逻辑电路的分析与设计。
3、熟悉加法器的⼯作原理。
4、熟悉译码器的⼯作原理，熟记74138的功能和符号，熟悉其应⽤。
5、熟悉选择器的⼯作原理，熟记74151的功能和符号，熟悉其应⽤。
6、了解编码器的⼯作原理，会看懂符号的功能。
7、熟悉⽐较器的⼯作原理，学会⽐较器的应⽤。
例题：1、实现两个⼀位⼗进制（8421BCD码表⽰）的加法电路需要74LS283加法器和74LS85⽐较器的⽚数分别为（）A. 1，1B.1，2C. 2，1D. 2，22、优先编码器在输⼊有两个或两个以上同时有效的情况下，其中起作⽤的输⼊端是（）A．⾼电平 B. ⾼优先级 C．低电平 D. ⾼频率3、属于组合逻辑电路的是（）A．触发器B. 全加器C．移位寄存器 D. 计数器4、试分析下图所⽰逻辑电路，写出表达式，列出真值表，说明逻辑功能。
- 1、下载文档前请自行甄别文档内容的完整性，平台不提供额外的编辑、内容补充、找答案等附加服务。
- 2、"仅部分预览"的文档,不可在线预览部分如存在完整性等问题,可反馈申请退款(可完整预览的文档不适用该条件!)。
- 3、如文档侵犯您的权益，请联系客服反馈,我们会尽快为您处理(人工客服工作时间：9:00-18:30)。
数字电子技术典型题选一、填空题 （基础型）1．在数字电路中，逻辑变量的值只有 2 个。
2．在逻辑函数的化简中，合并最小项的个数必须是 2^n 个。
3．化简逻辑函数的方法，常用的有 公式 和 卡诺图 。
4．逻辑函数A 、B 的同或表达式为A ⊙B= /A/B+AB 。
T 触发器的特性方程Q n+1= T/Qn+/TQn 。
5.已知函数CA B A Y +=，反函数Y = （A+/B ）*/（/A+C ），对偶式Y ’= （/A+B ）*/（A+/C ） 。
6．4线—10线译码器又叫做 2-10 进制译码器，它有 4 个输入端和 个输出端, 6 个不用的状态。
7．组合逻辑电路的输出仅取决于该电路当前的输入信号,与电路原来的状态 有关 。
8．TTL 三态门的输出有三种状态：高电平、低电平和 高阻态 状态。
9．组成计数器的各个触发器的状态，能在时钟信号到达时同时翻转，它属于 同步 计数器。
10．四位双向移位寄存器74LS194A 的功能表如表所示。
由功能表可知，要实现保持功能， 应使 ，当 RD=1；S1=1,S0=0时 ，电路 功能。
S 1S 0 工作状态 0 1 1 1 1× ×0 0 0 11 0 1 1置 零保 持右 移左 移 并行输入个触发器，它有 个无效状态。
12．根据触发器结构的不同，边沿型触发器状态的变化发生在CP 边沿 时，其它时刻触发器保持原态不变。
13．用中规模集成计数器构成任意进制计数器的方法通常有三种，它们是级连法， 和 。
14．由555定时器构成的单稳态触发器，若已知电阻R=500KΩ，电容C=10μF ，则该单稳态触发器的脉冲宽度tw ≈ 。
15．在555定时器组成的施密特触发器、单稳态触发器和多谐振荡器三种电路中，电路能自动产生脉冲信号，其脉冲周期T≈。
16. 用555定时器组成的三种应用电路如图所示，其中图（a）、（b）、（c）分别对应的电路名称是（a），（b），（c）17. A/D转换器的转换过程包括，，，四个步骤。
一、填空题（综合提高型）1．施密特触发器有 2 个稳定状态.，单稳态触发器有 1 个稳定状态.，多谐振荡器有0 个稳定状态。
2．欲对160个符号进行二进制编码，至少需要位二进制数；16路数据分配器，其地址输入端有个；2n选1的MUX，其地址端有______个，其数据输入端有_________个．3．欲构成可将1kHZ的脉冲转化为50HZ的脉冲的分频器，该电路至少需要用 5 个触发器；该电路共有20 个有效状态。
某计数器的状态转换图如图所示，该计数器为进制法计数，它有个有效状态，该电路（有或无）自启动能力？4．随机存储器RAM的电路结构主要由、和三部分组成。
为构成4096×8的RAM，需要片1024×4的RAM芯片，并需要用位地址码以完成寻址操作。
5. 8位移位寄存器，串行输入时经个CP脉冲后，将得到8位数据的并行输出；欲将其串行输出，需经个CP脉冲后，数码才能全部输出。
6．分别写出图1（a）、（b）、（c）、（d）所示电路中的输出函数表达式：Y1=nQT Y2= /(AB) ；Y3= /(AB) ；Y4= /(AB)*/(BC) ；7．如图所示电路的逻辑表达式DCBAF+⊕⊕=，F=1时的全部输入变量取值组合有12 个．A BC D =1=1≥11οF8．如图2所示的组合逻辑电路中的74138为3线-8线译码器，写出图2所示电路中各输出函数的最简与或表达式：F1= Y0+Y1+Y2= F2= Y4+Y7=9.图3是某ROM存储阵列的点阵图，A3、A2、A1、A0为地址线，D3、D2、D1、D0为数据线。
试分别写出D3、D2、D1关于A3、A2、A1、A0的逻辑表达式。
图中的点‘·’表示在行线和列线交叉处连接了存储元件。
851512141311123Y Y D Y Y Y D Y Y Y D +=++=++= Y4AB CDY3ABCD A B C D Y2AC BDY1A B Y0C D'=+''''=+=+=⊕=e 图310. 由四位并行进位加法器74LS283如图所示，当A=0时，X 3X 2X 1X 0=0111，Y 3Y 2Y 1Y 0=0100，Z 3Z 2Z 1Z 0=_____________，W=_____________ 。
电路功能为有符号数求和运算（加减运算）：A Co W ⊕=； A A Y X Z +⊕+= A ＝0时： Z ＝X ＋Y ＝1011； W ＝Co ＝0；二、选择题：请将正确答案的序号填在横线上。
1．下列一组数中，是等值的。
①（A7）16 ②（10100110）2 ③（166）10A．①和③ B. ②和① C. ②和③2.在逻辑函数中的卡诺图化简中，若被合并的最小项数越多（画的圈越大），则说明化简后。
A．乘积项个数越少 B. 实现该功能的门电路少C．该乘积项含因子少3．指出下列各式中哪个是四变量Ａ、Ｂ、Ｃ、Ｄ的最小项（）A、ＡＢＣ；B、Ａ＋Ｂ＋Ｃ＋Ｄ；C、ＡＢＣＤ；D、Ａ＋Ｂ＋Ｄ4．的最小项之和的形式是。
A.B.C.5. 在下列各种电路中，属于组合电路的有。
A．编码器 B. 触发器 C. 寄存器6．74LS138是3线-8线译码器，译码输出为低电平有效，若输入A2A1A0=100时，输出= 。
Ａ.00010000， B. 11101111 C. 111101117．8线—3线优先编码器74LS148的优先权顺序是I7，I6，……I1，I0 ，输出 Y2 Y1 Y0 ，输入低电平有效，输出为三位二进制反码输出。
当 I7I6，……I1I0 为11100111时，输出 Y2 Y1 Y0为。
A．011 B.100 C. 1108．在以下各种电路中，属于时序电路的有。
A．反相器 B. 编码器C. 寄存器D.数据选择器9．RS触发器当R=S=0时，Qn+1= 。
A．0 B.1 C.Qn D. Q10．施密特触发器常用于对脉冲波形的。
A．延时和定时 B. 计数与寄存 C．整形与变换11. CPLD是基于，FGPA是基于A 乘积项，查找表B查找表，乘积项C乘积项，乘积项D查找表，查找表12.以下单元电路中，具有“记忆”功能的单元电路是A 、加法器；B 、触发器；C 、TTL 门电路；D 、译码器；13.对于CMOS 与门集成电路，多余的输入端应该 A 接高电平 B 接低电平 C 悬空 D 接时钟信号 如果TTL 电路的输入端开路，相当于接入 A 逻辑1 B 逻辑0C 无法预测D 有可能是逻辑1，也有可能是逻辑0。
14..摩根定律（反演律）的正确表达式是： A 、;A B A B +=⋅ B 、;B A B A +=+ C 、;B A B A +=+ D 、;B A B A ⋅=+．15.JK 触发器实现T 触发器的功能时，J ，K 应该怎样连接 A ．J=K=T B ．J=K=D. C ．J=0，K=1 D ．J=D ，K=D16.同步时序电路和异步时序电路比较，其差异在于后者 。
A.没有触发器 B.没有统一的时钟脉冲控制C.没有稳定状态D.输出只与内部状态有关17. 要使JK 触发器的输出Q 从1变成0，它的输入信号JK 应为（ ）。
A. 00 B. 01 C. 10 D. 无法确定 18．对于T 触发器，若原态Q n =1，欲使新态Q n+1=1，应使输入T= 。
A.0 B.1 C.Q D.Q 19. 下列触发器中，没有约束条件的是 。
A.基本RS 触发器B.主从RS 触发器C.同步RS 触发器D.边沿D 触发器 20. 逻辑函数的表示方法中具有唯一性的是 。
A .真值表 B.表达式 C.逻辑图 D.卡诺图21.8—3线优先编码器（74LS148）中，8条输入线0I ~7I 同时有效时，优先级最高为I7线，则输出2Y 1Y 0Y 是（ ）A. 000B. 010C. 101D. 111 22. 七段显示译码器是指（ ）的电路。
A. 将二进制代码转换成0~9个数字B. 将BCD 码转换成七段显示字形信号C. 将0~9个数转换成BCD 码D. 将七段显示字形信号转换成BCD 码 23. 逻辑数F=A C +A B +B C ，当变量的取值为（ ）时，将出现冒险现象。
A. B=C=1 B. B=C=0 C. A=1，C=0 D. A=0，B=024.用n 个触发器构成计数器，可得到最大计数模值是（ ） A. n B. 2n -1 C . 2n D. 2n-1三、逻辑函数化简与变换：1. 试求逻辑函数F 的反函数的最简与或式， 并用与或非门实现电路解：2．证明下列各逻辑函数式：AC B A C A B A +=++))((左式=BC A B AC A A +++ =BC A A B A AC )(+++=)1()1(B AC C B A +++ =AC B A +=右式 原式成立3. 将下列逻辑函数化简成最简与或及与非-与非表达式（答案略）四． 组合逻辑电路的分析与设计1、4选1数据选择器74LS153的功能表达式为 ：⎪⎩⎪⎨⎧=+=∑0)8,6,4,2(D C AB C B A m F ×ABCD 00011110×1010×0010001000011110(a )D≥1&(b )B CA FACAB D F ++=试写出下图电路输出z 的逻辑函数式。
/A/B+/AC+A/C2、设计一位8421BCD 码的判奇电路，当输入码中，1的个数为奇数时，输出为1，否则为0。
（1）画出卡诺图，并写出最简“与－或表达式”；（2）用一片8选1数据选择器74LS151（功能符号见图）加若干门电路实现，画出电路图。
解：（1）卡诺图：最简“与－或式”：BCD D C B D C B D C B A D C B A Y ++++=；（2）电路图：3、某组合逻辑电路的芯片引脚图如题图所示。
1．分析题图所示电路，写出输出函数F 1、F 2的逻辑表达式，并说明该电路功能。
2．假定用四路数据选择器实现题图所示电路的逻辑功能，请确定下图所示 逻辑电路中各数据输入端的值，画出完善的逻辑电路图。
解：1．写出电路输出函数F 1BC B A C A BC B A C A F ABCC B A C B A C B A C B A F 21++=⋅⋅=+++=⊕⊕=2．假定用四路数据选择器实现该电路的逻辑功能，请确定给定逻辑电路中各数据 输入端的值，完善逻辑电路。
1D ,A D ,A D ,0D F C D ,C D ,C D ,C D F 3210232101========：：4． 3线-8线译码器74LS138逻辑功能表达式为 ，，……，，，正常工作时，S 1 =1, S 2=S 3=0 。