PCB的阻抗控制.
高速PCB设计中的阻抗控制
高速数字电路PCB设计中的阻抗控制（转载）随着半导体工艺的飞速发展，IC器件集成度和工作时钟频率不断提高。
以往在一块比较复杂的PCB上的高速网线只有几根或几十根，现在则是在一块PCB上只有几根或几十根网线不是高速信号线；以往认为数字电路设计只要把握逻辑正确，物理连线似乎只要连接上就能使电路正常工作；而现在越来越多的电子产品设计体现出高速、高性能、高密度和高复杂度的特点，尤其在通讯、计算机、航空航天以及图象处理等领域。
系统的主频越来越高，更加严重的挑战来自半导体工艺技术的进步，日渐精细的工艺技术使得晶体管尺寸越来越小，因而器件的信号跳变沿也就越来越快，从而导致更加严重的高速数字电路系统设计领域的信号完整性问题：传输线效应(反射、时延、振铃、及信号的过冲与欠冲)、信号问串扰等。
为此，电子系统设计师必须从传统的设计方法向现代的电子系统设计方法转变，这既是形势需要，也是发展的必然趋势。
1 高速数字电路概念1．1 什么是高速数字电路PCB上的高速电路设计，主要是以器件和连接器件的印制线为主要分析对象的。
以往在器件的时钟频率不是很高、时钟的上升或下降沿变化不是很陡的情形下，可以用集总参数的形式来表示印制线，而当器件的时钟频率变得很高时(比如：超过50MHz)，时钟的上升或下降沿很小时(一般地在1ns～5ns之间)，这时就不能将印制线用集总参数来表示，必须引入分布参数来表示印制线特性，这就是传输线的概念(图1)。
关于传输线的分析是高速PCB 设计当中最基本也是最核心的部分，下面简要介绍传输线的定义和高速电路设计相关的一些概念。
国际上通常对PCB上的传输线没有确切的具体定义，现在被大家普遍接受的约定如下：即当信号从驱动端到接收端的印制线上的延时大于等于上升或下降沿的l/ 时(即Tpd≥0.5Trist(Tfdl))。
这时就必须将此印制线当成传输线来分析，更为保守一点的定义是信号在走线上传播延时或。
1.2 PGB的板层材料和板层结构图2所示是一个标准6层PCB的断面层结构示意图，其它多层PCB的层设置与此相似。
pcb常用的专业术语
pcb常用的专业术语PCB常用的专业术语PCB，即印刷电路板，是电子产品中不可或缺的一部分。
在PCB制造过程中，有许多专业术语需要了解。
本文将从材料、工艺、设计等方面介绍PCB常用的专业术语。
一、材料1.基板（Substrate）基板是指印刷电路板上的主体部分，通常由玻璃纤维和树脂复合材料构成。
基板的质量直接影响着整个PCB的性能。
2.铜箔（Copper Foil）铜箔是印刷电路板上最重要的导电层材料，其厚度通常为18um至105um之间。
铜箔的质量和厚度对于PCB的导电性能和可靠性有着重要影响。
3.覆铜板（Copper Clad Board）覆铜板是指在基板表面涂覆一层铜箔而成，通常有单面、双面和多层三种形式。
不同类型的覆铜板适用于不同种类的电路设计需求。
4.阻焊（Solder Mask）阻焊是一种涂在印刷电路板上以保护未焊接区域免受污染和短路的材料。
阻焊通常为绿色、红色或蓝色，具有良好的耐高温性和化学稳定性。
5.沉金（ENIG）沉金是一种表面处理技术，可以在印刷电路板上形成一层金属保护层，提高PCB的可靠性和耐腐蚀性。
沉金通常用于高端PCB产品中。
二、工艺1.蚀刻（Etching）蚀刻是印刷电路板制造中最重要的工艺之一，其目的是去除不需要的铜箔以形成电路图案。
蚀刻过程需要使用化学溶液和光敏树脂等材料。
2.钻孔（Drilling）钻孔是指在印刷电路板上钻洞以安装元器件或连接不同层之间的导线。
钻孔需要使用高速钻头和自动化设备完成。
3.压合（Lamination）压合是指将多个覆铜板通过热压技术粘合在一起形成多层PCB结构。
压合过程需要控制温度、压力和时间等参数，确保PCB质量符合要求。
4.喷锡（Soldering）喷锡是一种表面处理技术，可以在印刷电路板上形成一层锡保护层，提高PCB的可靠性和耐腐蚀性。
喷锡通常用于中端PCB产品中。
5.贴片（SMT）贴片是指将元器件直接安装在印刷电路板上的一种技术。
PCB设计的阻抗控制和阻抗匹配
重要性，电路板出故障或问题的概率， 为一个电容（ 图 １ － １） 。
阻抗控制的精度就越低。
电路中信号的完整性，电路的 Ｅ Ｍ Ｉ 和
（４ ）容易造成焊锡短路，可能会增
ＥＭＣ 特性。但是随着产品的可靠性发展
加产品的成本。
和越来越受到重视，在设计时不再是
ＰＣＢ 的各层分布一般是对称的。不
简单的导线连接，必须考虑电路中信
Key words: Reliability; Characteristic Impedance; Impedance Controlling; Impedance match
CLC number: TN306
Document code:A
Article ID:1003-0107(2005)04-0029-03
４３００６８）
Huang Shuwei, Zhao Danling1
(Hubei University of Technology,
Wuhan 430068,China)
摘 要： 阻抗设计是 ＰＣＢ 可靠性设计的一个重要环节。本文从多层 ＰＣＢ 板叠层的设计原理、特性阻抗的
计算方法、严格的阻抗控制，来保证阻抗匹配，实现 Ｐ Ｃ Ｂ 的可靠性，使产品稳定的工作。
号完全相等。这就是说， 应将信号对称 别是在高频电路中，特性阻抗主要取 特性阻抗是否一致，是否匹配。因此，
地布线在内部地线层的两侧。这样做 决于连线的单位分布电容和单位分布 在 Ｐ Ｃ Ｂ 设计的可靠性设计中有两个概
的优点是容易控制阻抗和环流；缺点 电感带来的分布阻抗。理想传输线的 念是我们必须注意的。
印制电路板上导线的特性阻抗是
传输线的特性阻抗只与信号连线 电路板设计的一个重要指标，特别是
PCB生产流程-阻抗控制1
工序 控制要点 控制要求/方法 1.依照客户资料和生产制程能力指示设计制板结构、物料类型、阻抗 线宽等 新项目审查 新项目设计 资料评审 2. 根据以上设计资料使用POLAR软件进行模拟测试阻抗 示意图
3.跟进首板测量结果进行阻抗线宽补偿(附设计规范摘要) 1.用百倍镜测量MI要求在板面中的指定位置（即板面中线路密集处、 独立线及阻抗位置），且线宽测量时测量线底，线距为两线底间距。 线宽/ 线隙测量 2.对于阻抗模块线宽和线距测量左、中、右三个点并做记录； 对于单元内阻抗线、MI指定位置的线则测量板四个角及中间五个点的 线宽和线距并记录其最大值、最小值。 3.若生产中发现线宽、线隙、阻抗处于MI控制要求范围的上限或下限 时，需重新调整蚀刻速度，并重测线宽、线距及阻抗。
1. 线宽/ 线隙测介质层厚度
切片测量
0
流程控制概述
工序 控制要点 控制要求/方法 1.线宽测量:从MI中核对制板阻抗线宽要求,蚀刻后用100X 或200X镜 测量指定位置的线宽/线隙，按五点法测试,记录最大值和最小值，评 判标准以MI要求，线宽以线底为准（除客户有特别要求）,按RF线2% 抽查。 2.蚀刻后所有有阻抗要求的制板须用阻抗机测量模块，先从MI中核对 制板蚀刻后阻抗控制要求，按1%抽查。 1.使用阻抗测试机量测模块 白字高温后 阻抗模块抽测 2.IPQC按每LOT抽2%进行模块测试 1.使用阻抗测试机量测模块 2.QTA&样板全测模块 Outgoing QA 阻抗模块抽测 3.首次批量生产板抽测10PCS 4.其他生产板按照客户要求抽测监控 示意图
PCB阻抗控制
PCB阻抗PCB阻抗控制，在PCB设计中经常遇到阻抗计算，但是我不明白阻抗计算是计算整板PCB的阻抗还是几个部分的阻抗PCB阻抗，在PCB设计中经常遇到阻抗计算，但是我不明白阻抗计算是计算整板PCB的阻抗还是几个部分的阻抗：如我有差分阻抗，单线阻抗。
那到底该采用哪些数值呢？可能几个部分的阻抗都不一样在同一PCB板上？这样的话该计算哪个阻抗来作为PCB的阻抗呢！完整性最佳。
是不是每个地方阻抗不一样，我得告诉PCB厂商，这个地方阻抗做多少，哪个地方阻抗做多少啊，比如：USB2.0差分做成90欧姆，DDR与DSP连接线做成多少欧姆，和时钟线做成多少欧姆等等啊?这样的话是不是要详细说明多处的阻抗要求。
关键布线部分是要给出详细的设计要求的，设计时的阻抗大小，是通过仿真软件，使信号完整性达到最好状态下，得到的。
根据仿真结果，可以得到该信号线的线长，线宽，线间距，在那层布线，串接多大的匹配电阻等要求，然后仿真设计人员将此仿真结果交给PCB LAUOUT设计人员，PCB LAUOUT设计人员会根据此要求进行PCB布线设计，设计完毕后的PCB文件生成为GERBER文件，送给PCB制造厂商即可制造出相应的PCB。
1.阻抗控制是控制信号线的阻抗，不是整板PCB的阻抗2.差分阻抗是两条差分信号的阻抗，单线阻抗是单一信号的阻抗。
如USB 2.0要做差分90欧姆，射频信号线一般做单线50欧姆等等。
哪些线要做阻抗控制，控制为多少，一般每个硬件平台都有自己的要求。
3.没有PCB阻抗这种说法，只有信号的阻抗。
电路设计中，差分信号的两条差分线能不能交换顺序？题目说的有些笼统，主要是想知道哪些是可以交换的，为什么，哪些是不可以交换的，又是为什么？还有差分线之间跨加100ohm或12 0ohm的电阻的作用是什么，是阻抗匹配还是将电流转换为电压？各位大牛，ths了会变小。
差分信号实际传输是电压还是电流，什么差分信号，说的通俗一点,差分信号时属于数字信号吗进一步看是以电压为的标准的能量信号，若内阻小，就可以带多个负载（电流大）。
高速数字电路PCB设计中的阻抗控制
环测威官网：/阻抗控制技术在高速数字电路设计中非常重要，其中必须采用有效的方法来确保高速PCB 的优异性能。
PCB上高速电路传输线的阻抗计算及阻抗控制•传输线上的等效模型图1显示了传输线对PCB的等效影响，这是一种包括串联和多电容，电阻和电感（RLGC 模型）的结构。
串联电阻的典型值在0.25至0.55欧姆/英尺的范围内，并且多个电阻器的电阻值通常保持相当高。
随着PCB传输线中增加的寄生电阻，电容和电感，传输线上的总阻抗被称为特征阻抗（Z 0）。
在线直径大，线接近电源/接地或介电常数高的条件下，特征阻抗值相对较小。
图3示出了具有长度dz的传输线的等效模型，基于该模型，传输线的特征阻抗可以推导为公式：。
在这个公式中，L“传感线”是指传输线上每个单位长度的电感，而C是指传输线上每个单位长度的电容。
环测威官网：/在上面的公式中，Z 0表示阻抗（欧姆），W表示线的宽度（英寸），T表示线的粗细（英寸），H表示到地面的距离（英寸），是指衬底的相对介电常数，t PD是指延迟时间（ps / inch）。
•传输线的阻抗控制布局规则基于上述分析，阻抗和信号的单位延迟与信号频率无关，但与电路板结构，电路板材料的相对介电常数和布线的物理属性有关。
这一结论对于理解高速PCB和高速PCB设计非常重要。
而且，外层信号传输线的传输速度比内层传输速度快得多，因此关键线布局的排列必须考虑这些因素。
阻抗控制是实现信号传输的重要前提。
但是，根据传输线的电路板结构和阻抗计算公式，阻抗仅取决于PCB材料和PCB层结构，同一线路的线宽和布线特性不变。
因此，线路的阻抗在PCB的不同层上不会改变，这在高速电路设计中是不允许的。
本文设计了一种高密度高速PCB，板上大多数信号都有阻抗要求。
例如，CPCI信号线的阻抗应为650欧姆，差分信号为100欧姆，其他信号均为50欧姆。
根据PCB布线空间，必须使用至少十层布线，并确定16层PCB设计方案。
由于电路板的整体厚度不能超过2mm，因此在堆叠方面存在一些困难，需要考虑以下问题：1）。
PCB的阻抗控制要点
PCB的阻抗控制要点PCB布线中，阻抗控制是一个十分重要的问题。
在高速信号传输过程中，如果不控制好阻抗，将会导致信号反射、降低信号质量以及信号干扰，严重影响系统的性能。
因此，本文将介绍PCB布线中阻抗控制的要点。
什么是阻抗？阻抗是电路元件在交流电路中所表现出来的总阻力，它和电阻是不同的。
电阻是指电子通过一个导体时所需消耗的能量，而阻抗则是指电子在交流电路中产生的总消耗，包括电阻和电容的影响。
通常情况下，阻抗的性质决定了信号在传输线上的反射系数和传输特性。
因此，在高速布线中必须进行阻抗匹配来获得最佳的传输性能。
PCB阻抗控制要点PCB设计流程中的阻抗控制PCB板的阻抗由两个方面的因素影响：底层金属的尺寸和层和板材的介电常数。
因此，在PCB设计流程中，可以采用以下方法来控制阻抗。
•使用可控阻抗线（CPW）或微带线（MIL）进行布线：这两种线的阻抗可以通过线的宽度和间隙以及与参考层的距离等参数进行调节，以实现所需的阻抗特性。
•选择合适的板材和层数：通过选择合适的板材和层数，可以获得所需的介电常数，从而实现所需的阻抗特性。
如FR-4是一种常用的PCB板材，它的介电常数为4.2，因此它不适合高速布线。
而高介电常数板材可以更好地匹配高阻抗线。
•合理安排PCB布局：通过合理安排PCB布局，可以最大程度地减少信号的反射和串扰。
例如，通过避免布置信号线与边缘相邻，可以减少边缘效应的影响。
阻抗匹配方法阻抗匹配可以通过以下两种方法来实现。
•直接阻抗匹配：将阻抗为Z1的传输线直接连接到阻抗为Z2的电网上，可以采用电容、电感和输变比等方式来实现。
•变压器法：将阻抗为Z1的传输线和阻抗为Z2的电网之间加上一个变压器，变压器的变比可以根据阻抗比值确定。
在布线高频时，变压器法是最常用的阻抗匹配方式。
阻抗检查与测试在PCB设计中，阻抗控制成功与否需要进行阻抗检查和测试。
阻抗检查可以通过仿真软件进行，仿真结果应符合设计要求。
阻抗测试可以通过使用专业的测试设备进行，例如网络分析仪（Network Analyzer）。
PCB阻抗控制及设计说明
PCB 阻抗控制设计说明随着PCB 信号切换速度不断增长，当今的PCB 设计厂商需要理解和控制PCB 迹线的阻抗。
相应于现代数字电路较短的信号传输时间和较高的时钟速率，PCB 迹线不再是简单的连接，而是传输线。
在实际情况中，需要在数字边际速度高于1ns 或模拟频率超过300Mhz 时控制迹线阻抗。
PCB 迹线的关键参数之一是其特性阻抗 (即波沿信号传输线路传送时电压与电流的比值) 。
印制电路板上导线的特性阻抗是电路板设计的一个重要指标，特别是在高频电路的PCB 设计中，必须考虑导线的特性阻抗和器件或信号所要求的特性阻抗是否一致，是否匹配。
这就涉及到两个概念：阻抗控制与阻抗匹配，本文重点讨论阻抗控制和叠层设计的问题。
阻抗控制阻抗控制(eImpedance Controling) ，线路板中的导体中会有各种信号的传递，为提高其传输速率而必须提高其频率，线路本身若因蚀刻，叠层厚度，导线宽度等不同因素，将会造成阻抗值得变化，使其信号失真。
故在高速线路板上的导体，其阻抗值应控制在某一范围之内，称为“阻抗控制”。
PCB 迹线的阻抗将由其感应和电容性电感、电阻和电导系数确定。
影响PCB 走线的阻抗的因素主要有: 铜线的宽度、铜线的厚度、介质的介电常数、介质的厚度、焊盘的厚度、地线的路径、走线周边的走线等。
PCB 阻抗的范围是25 至120 欧姆。
在实际情况下，PCB 传输线路通常由一个导线迹线、一个或多个参考层和绝缘材质组成。
迹线和板层构成了控制阻抗。
PCB 将常常采用多层结构，并且控制阻抗也可以采用各种方式来构建。
但是，无论使用什么方式，阻抗值都将由其物理结构和绝缘材料的电子特性决定：信号迹线的宽度和厚度迹线两侧的内核或预填材质的高度迹线和板层的配置内核和预填材质的绝缘常数PCB 传输线主要有两种形式：微带线( Microstrip )与带状线( Stripline )。
微带线( Microstrip )微带线是一根带状导线，指只有一边存在参考平面的传输线，顶部和侧边都曝置于空气中（也可上敷涂覆层），位于绝缘常数Er 线路板的表面之上，以电源或接地层为参考。
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浅谈PCB的阻抗控制随着电路设计日趋复杂和高速，如何保证各种信号（特别是高速信号）完整性，也就是保证信号质量，成为难题。
此时，需要借助传输线理论进行分析，控制信号线的特征阻抗匹配成为关键，不严格的阻抗控制，将引发相当大的信号反射和信号失真，导致设计失败。
常见的信号，如PCI总线、PCI-E总线、USB、以太网、DDR内存、LVDS信号等，均需要进行阻抗控制。
阻抗控制最终需要通过PCB设计实现，对PCB板工艺也提出更高要求，经过与PCB厂的沟通，并结合EDA软件的使用，我对这个问题有了一些粗浅的认识，愿和大家分享。
多层板的结构：为了很好地对PCB进行阻抗控制，首先要了解PCB的结构：通常我们所说的多层板是由芯板和半固化片互相层叠压合而成的，芯板是一种硬质的、有特定厚度的、两面包铜的板材，是构成印制板的基础材料。
而半固化片构成所谓的浸润层，起到粘合芯板的作用，虽然也有一定的初始厚度，但是在压制过程中其厚度会发生一些变化。
通常多层板最外面的两个介质层都是浸润层，在这两层的外面使用单独的铜箔层作为外层铜箔。
外层铜箔和内层铜箔的原始厚度规格，一般有0.5OZ、1OZ、2OZ（1OZ约为35um或1.4mil）三种，但经过一系列表面处理后，外层铜箔的最终厚度一般会增加将近1OZ左右。
内层铜箔即为芯板两面的包铜，其最终厚度与原始厚度相差很小，但由于蚀刻的原因，一般会减少几个um。
多层板的最外层是阻焊层，就是我们常说的“绿油”，当然它也可以是黄色或者其它颜色。
阻焊层的厚度一般不太容易准确确定，在表面无铜箔的区域比有铜箔的区域要稍厚一些，但因为缺少了铜箔的厚度，所以铜箔还是显得更突出，当我们用手指触摸印制板表面时就能感觉到。
当制作某一特定厚度的印制板时，一方面要求合理地选择各种材料的参数，另一方面，半固化片最终成型厚度也会比初始厚度小一些。
下面是一个典型的6层板叠层结构：PCB的参数：不同的印制板厂，PCB的参数会有细微的差异，通过与上海嘉捷通电路板厂技术支持的沟通，得到该厂的一些参数数据：表层铜箔：可以使用的表层铜箔材料厚度有三种：12um、18um和35um。
加工完成后的最终厚度大约是44um、50um和67um。
芯板：我们常用的板材是S1141A，标准的FR-4，两面包铜，可选用的规格可与厂家联系确定。
半固化片：规格（原始厚度）有7628（0.185mm），2116（0.105mm），1080（0.075mm），3313（0.095mm ），实际压制完成后的厚度通常会比原始值小10-15um左右。
同一个浸润层最多可以使用3个半固化片，而且3个半固化片的厚度不能都相同，最少可以只用一个半固化片，但有的厂家要求必须至少使用两个。
如果半固化片的厚度不够，可以把芯板两面的铜箔蚀刻掉，再在两面用半固化片粘连，这样可以实现较厚的浸润层。
阻焊层：铜箔上面的阻焊层厚度C2≈8-10um，表面无铜箔区域的阻焊层厚度C1根据表面铜厚的不同而不同，当表面铜厚为45um时C1≈13-15um，当表面铜厚为70um时C1≈17-18um。
导线横截面：以前我一直以为导线的横截面是一个矩形，但实际上却是一个梯形。
以TOP层为例，当铜箔厚度为1OZ时，梯形的上底边比下底边短1MIL。
比如线宽5MIL，那么其上底边约4MIL，下底边5MIL。
上下底边的差异和铜厚有关，下表是不同情况下梯形上下底的关系。
介电常数：半固化片的介电常数与厚度有关，下表为不同型号的半固化片厚度和介电常数参数：板材的介电常数与其所用的树脂材料有关，FR4板材其介电常数为4.2—4.7，并且随着频率的增加会减小。
介质损耗因数：电介质材料在交变电场作用下，由于发热而消耗的能量称之谓介质损耗，通常以介质损耗因数tanδ表示。
S1141A的典型值为0.015。
能确保加工的最小线宽和线距：4mil/4mil。
阻抗计算的工具简介：当我们了解了多层板的结构并掌握了所需要的参数后，就可以通过EDA软件来计算阻抗。
可以使用Allegro来计算，但这里我向大家推荐另一个工具Polar SI9000，这是一个很好的计算特征阻抗的工具，现在很多印制板厂都在用这个软件。
无论是差分线还是单端线，当计算内层信号的特征阻抗时，你会发现Polar SI9000的计算结果与Allegro仅存在着微小的差距，这跟一些细节上的处理有关，比如说导线横截面的形状。
但如果是计算表层信号的特征阻抗，我建议你选择Coated模型，而不是Surface 模型，因为这类模型考虑了阻焊层的存在，所以结果会更准确。
下图是用Polar SI9000计算在考虑阻焊层的情况下表层差分线阻抗的部分截图：由于阻焊层的厚度不易控制，所以也可以根据板厂的建议，使用一个近似的办法：在Surface模型计算的结果上减去一个特定的值，我建议差分阻抗减去8欧姆，单端阻抗减去2欧姆PCB阻抗控制随着 PCB 信号切换速度不断增长，当今的 PCB 设计厂商需要理解和控制 PCB 迹线的阻抗。
相应于现代数字电路较短的信号传输时间和较高的时钟速率，PCB 迹线不再是简单的连接，而是传输线。
在实际情况中，需要在数字边际速度高于1ns或模拟频率超过300Mhz时控制迹线阻抗。
PCB 迹线的关键参数之一是其特性阻抗（即波沿信号传输线路传送时电压与电流的比值）。
印制电路板上导线的特性阻抗是电路板设计的一个重要指标，特别是在高频电路的PCB设计中，必须考虑导线的特性阻抗和器件或信号所要求的特性阻抗是否一致，是否匹配。
这就涉及到两个概念：阻抗控制与阻抗匹配，本文重点讨论阻抗控制和叠层设计的问题。
阻抗控制阻抗控制(eImpedance Controling)，线路板中的导体中会有各种信号的传递，为提高其传输速率而必须提高其频率，线路本身若因蚀刻，叠层厚度，导线宽度等不同因素，将会造成阻抗值得变化，使其信号失真。
故在高速线路板上的导体，其阻抗值应控制在某一范围之内，称为“阻抗控制”。
PCB 迹线的阻抗将由其感应和电容性电感、电阻和电导系数确定。
影响PCB走线的阻抗的因素主要有: 铜线的宽度、铜线的厚度、介质的介电常数、介质的厚度、焊盘的厚度、地线的路径、走线周边的走线等。
PCB 阻抗的范围是 25 至120 欧姆。
在实际情况下，PCB 传输线路通常由一个导线迹线、一个或多个参考层和绝缘材质组成。
迹线和板层构成了控制阻抗。
PCB 将常常采用多层结构，并且控制阻抗也可以采用各种方式来构建。
但是，无论使用什么方式，阻抗值都将由其物理结构和绝缘材料的电子特性决定：∙信号迹线的宽度和厚度∙∙迹线两侧的内核或预填材质的高度∙∙迹线和板层的配置∙∙内核和预填材质的绝缘常数∙PCB传输线主要有两种形式：微带线（Microstrip）与带状线（Stripline）。
微带线（Microstrip）：微带线是一根带状导线，指只有一边存在参考平面的传输线，顶部和侧边都曝置于空气中（也可上敷涂覆层），位于绝缘常数 Er 线路板的表面之上，以电源或接地层为参考。
如下图所示：注意：在实际的PCB制造中，板厂通常会在PCB板的表面涂覆一层绿油，因此在实际的阻抗计算中，通常对于表面微带线采用下图所示的模型进行计算：带状线（Stripline）：带状线是置于两个参考平面之间的带状导线，如下图所示，H1和H2代表的电介质的介电常数可以不同。
上述两个例子只是微带线和带状线的一个典型示范，具体的微带线和带状线有很多种，如覆膜微带线等，都是跟具体的PCB的叠层结构相关。
用于计算特性阻抗的等式需要复杂的数学计算，通常使用场求解方法，其中包括边界元素分析在内，因此使用专门的阻抗计算软件SI9000，我们所需做的就是控制特性阻抗的参数：绝缘层的介电常数Er、走线宽度W1、W2（梯形）、走线厚度T和绝缘层厚度H。
对于W1、W2的说明：此处的W=W1，W1=W2.规则：W1=W-AW—-设计线宽A—–Etch loss (见上表)走线上下宽度不一致的原因是：PCB板制造过程中是从上到下而腐蚀，因此腐蚀出来的线呈梯形。
走线厚度T与该层的铜厚有对应关系，具体如下：铜厚COPPER THICKNESSBase copper thk For inner layer For outer layerH OZ 0.6mil 1.8mil1 OZ 1.2MIL 2.5MIL2 OZ 2.4MIL 3.6MIL绿油厚度：*因绿油厚度对阻抗影响较小，故假定为定值0.5mil。
我们可以通过控制这几个参数来达到阻抗控制的目的，下面以安维的底板PCB为例说明阻抗控制的步骤和SI9000的使用：底板PCB的叠层为下图所示：第二层为地平面，第五层为电源平面，其余各层为信号层。
各层的层厚如下表所示：Layer Name Type Material Thinkness ClassSURFACE AIRTOP CONDUCTOR COPPER 0.5 OZ ROUTINGDIELECTRIC FR-4 3.800MILL2-INNER CONDUCTOR COPPER 1 OZ PLANEDIELECTRIC FR-4 5.910MILL3-INNER CONDUCTOR COPPER 1 OZ ROUTINGDIELECTRIC FR-4 33.O8MILL4-INNER CONDUCTOR COPPER 1 OZ ROUTINGDIELECTRIC FR-4 5.910MILL5-INNER CONDUCTOR COPPER 1 OZ PLANEDIELECTRIC FR-4 3.800MILBOTTOM CONDUCTOR COPPER 0.5 OZ ROUTINGSURFACE AIR说明：中间各层间的电介质为FR-4，其介电常数为4.2；顶层和底层为裸层，直接与空气接触，空气的介电常数为1。
需要进行阻抗控制的信号为：DDR的数据线，单端阻抗为50欧姆，走线层为TOP和L2、L3层，走线宽度为5mil。
时钟信号CLK和USB数据线，差分阻抗控制在100欧姆，走线层为L2、L3层，走线宽度为6mil，走线间距为6mil。
对于计算精度的说明:1、对于单端阻抗控制，计算值等于客户要求值；2、对于其他特性阻抗控制：对于其它所有的阻抗设计(包括差别和特性阻抗)*计算值与名义值差别应小于的阻抗范围的10%：例如：客户要求：60+/-10%ohm阻抗范围=上限66-下限54=12ohms阻抗范围的10%=12X10%=1.2ohms计算值必须在红框范围内。
其余情况类推。
下面利用SI9000计算是否达到阻抗控制的要求：首先计算DDR数据线的单端阻抗控制：TOP层：铜厚为0.5OZ，走线宽度为5MIL，距参考平面的距离为3.8MIL，介电常数为4.2。