8086微处理器引脚
8086引脚信号
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1). 数据和地址引脚
A19/S6～A16/S3（Address/Status）
地址/状态分时复用引脚，输出、三态 这些引脚在访问存储器的第一个时钟周期T1时刻输 出高4位地址A19～A16 在访问外设的第一个时钟周期全部输出低电平无效
ⅰ）S6为0，表明AD15~AD0作为数据线；
在总线周期的T2-T4时，这4条线作为输出CPU的状态信息。
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“引脚”小结
CPU引脚是系统总线的基本信号 可以分成三类信号： 16位数据线：D15～D0 20位地址线：A19～A0 控制线：
ALE、M/IO*、WR*、RD*、READY
INTR、INTA*、NMI，HOLD、HLDA
RESET、CLK、Vcc、GND
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系统总线的形成
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2). 读写控制引脚
M/IO*（Memory/Input and Output） 存储器或I/O访问，输出、三态 该引脚输出高电平时，表示CPU将访问 存储器，这时地址总线A19～A0提供20 位存储器地址 该引脚输出低电平时，表示CPU将访问 I/O端口，这时地址总线A15～A0提供16 位I/O口地址
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3). 中断请求和响应引脚
NMI（Non-Maskable Interrupt）
非屏蔽中断请求，输入、上升沿有效 有效时，表示外界向CPU申请不可屏蔽中断 该请求的优先级别高于INTR，并且不能在CPU 内被屏蔽 当系统发生紧急情况时，可通过他向CPU申请 不可屏蔽中断服务
主机与外设进行数据交换通常采用可屏蔽中断 不可屏蔽中断通常用于处理掉电等系统故障
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4). 总线请求和响应引脚
第3章2—8086微处理器总线周期及引脚
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第3章 80x86微处理器
第3章：I/O写总线周期
T1 CLK T2 T3 T4
T1状态——输出16位I/O地址A15 ~ A0 IO/M* IO/M*输出高电平，表示I/O操作； S6 ~ S 3 0000 A19/S6 ~ A16/S3 ALE输出正脉冲，表示复用总线输出地址 A15 ~ A8 A15 ~ A8 T2状态——输出控制信号WR*和数据D7 ~ D0 A7 ~ A0 输出数据 ADT3和Tw状态——检测数据传送是否能够完成 7 ~ AD0 T4状态——完成数据传送
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第3章 80x86微处理器
⑵ 总线写操作时序 总线写操作就是指CPU向存储器或I／O端口 写入数据。图3.4是8086在最小模式下的总线写 操作时序图。 总线写操作时序与总线读操作时序基本相 同，但也存在以下不同之处：
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第3章 80x86微处理器
T1 CLK M/IO ① 高为读内存 低为读IO ② ⑥ 状态输出 地址 ④ ⑧ BHE输出 ② ⑦ 地址输出 数据输出 ③ ⑨ ⑤ T2 T3 TW T4
⑵ 总线周期
8086CPU与外部交换信息总是通过总线进行的 。CPU的每一个这种信息输入、输出过程所需要 的时间称为总线周期(BusCycle)，一般一个总线 周期由四个时钟周期组成。
⑶ 时钟周期
时钟脉冲的重复周期称为时钟周期 (Clock Cycle)。时钟周期是CPU的时间基准，由计 算 机的主频决定。如8086的主频为5MHz，1个时钟 周期就是200ns。
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第3章 80x86微处理器
第3章：存储器写总线周期
T1 CLK IO/M* T2 T3 T4
T1状态——输出20位存储器地址A19 ~ A0 S6 ~ S 3 A19 ~ A16 A19/S6 ~ A16/S3 IO/M*输出低电平，表示存储器操作； ALE输出正脉冲，表示复用总线输出地址 A15 ~ A8 A15 ~ A8 T2状态——输出控制信号WR*和数据D7 ~ D0 A 7 ~ A0 输出数据 AD7 ~ AD0 T3和Tw状态——检测数据传送是否能够完成 T4状态——完成数据传送 ALE
微机系统-3 8086微处理器引脚特性共29页
56、书不仅是生活，而且是现在、过 去和未 来文化 生活的 源泉。 ——库 法耶夫 57、生命不可能有两次，但许多人连一 次也不 善于度 过。— —吕凯 特 58、问渠哪得清如许，为有源头活水来 。—— 朱熹 59、我的努力求学没有得到别的好处， 只不过 是愈来 愈发觉 自己的 无知。 ——笛 卡儿
微机系统-3 8086微处理器引脚特性
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38、若是没有公众舆论的支持，法律 是丝毫 没有力 量的。 ——菲 力普斯 39、一个判例造出另一个判例，它们 迅速累 聚，进 而变成 法律。 ——朱 尼厄斯
拉
60、生活的道路一旦选定，就要勇敢地
8086-8088的引脚信号和工作模式
M/IO
DT/R
SS0
1
0
0
1
0
1
1
1
0
1
1
1
0
0
0
0
0
1
0
1
0
0
1
1
性能 中断响应 读IO/M端口 写IO/M端口
暂停 取指 读存贮器 写存贮器 无作用
图2-7是8088在最小模式下的典型配置
8284A
CLK
RESET READY
MN / MX
ALE
BHE
A19~A16
AD15~AD0 8086
1．QSl和QS0指令队列状态信号 2．S2，S1，S0总线周期状态信号 3．LOCK总线封锁信号 4．RQ/GT1，RQ/GT0 总线请求信号输入／总线请求 允许信号输出
图2-8 8086最大工作模式的典型配置
READY RESET
8284A CLK
CLK
RESET READY
MN/ MX
BHE A19~A16
微机原理与应用
8086/8088的引脚信号和工作模式
1.1 最小模式和最大模式的概念 所谓最小模式，就是在系统中只有8086一个微处理器。
在这种系统中，所有的总线控制信号都直接由8086产生， 因此，系统中的总线控制逻辑电路被减到最少。
最大模式是相对最小模式而言，在此系统中，包含 两个或两个以上的微处理器，其中一个主处理器就是 8086，其他的处理器称为协处理器，它们是协助主处理 器工作的。和8086配合的协处理器有两个。一个是数值 运算协处理器8087，一个是输入／输出协处理器8089。
LOCK
CRQLCK ANYRQST
8086对io端口的编址方式
一、概述8086是一种微处理器，其功能强大，广泛应用于计算机系统中。
在实际应用中，8086需要通过输入输出端口与外部设备进行通信。
了解8086对io端口的编址方式是十分重要的。
二、8086对io端口的编址方式8086的io端口是通过两个连续的16位端口来进行编址的。
具体来说，io端口的编址方式可以分为两种：立即数方式和寄存器间接方式。
1. 立即数方式在立即数方式中，程序员直接给出io端口的位置区域。
8086的指令集中提供了in和out指令来实现对io端口的读写操作。
具体语法如下：- in dx, al：表示从端口位置区域为dx的io端口读入一个字节的数据到寄存器al中。
- out dx, al：表示将寄存器al中的一个字节的数据写到端口位置区域为dx的io端口中。
在实际编程中，程序员可以直接使用端口位置区域来进行io操作，这种方式简单直观，但需要程序员自行管理端口位置区域的分配和使用。
2. 寄存器间接方式在寄存器间接方式中，程序员将io端口的位置区域保存在特定的寄存器中，通过指令来间接访问io端口。
8086的寄存器间接方式包括两种形式：in和out指令以及REP指令的结合使用。
- in (dx), al：表示将io端口位置区域存储在寄存器dx中，然后通过in指令来从该io端口读入一个字节的数据到寄存器al中。
- out (dx), al：表示将io端口位置区域存储在寄存器dx中，然后通过out指令来将寄存器al中的一个字节的数据写到该io端口中。
- REP指令的结合使用：REP指令可以与in和out指令结合，通过重复执行in和out操作来实现对多个io端口的读写操作。
具体语法如下：REP INSB：表示从寄存器CX指向的io端口位置区域开始，连续输入字符串，长度由CX寄存器中的值来确定。
REP OUTSB：表示从寄存器CX指向的io端口位置区域开始，连续输出字符串，长度由CX寄存器中的值来确定。
微机原理与接口第3章2—8086微处理器总线周期及引脚资料
3.2.3 8086微处理器的总线时序 1. 总线时序
⑴ 指令周期
每条指令的执行由取指令、译码和执行 等操作组成，执行一条指令所需要的时间 称为指令周期(Instruction Cycle)，不同 指令的指令周期是不等长的，一个指令周 期由一个或若干个总线周期组成。
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第3章 80x86微处理器
– 4个时钟周期编号为T1、T2、T3和T4 – 总线周期中的时钟周期也被称作“T状态” – 时钟周期的时间长度就是时钟频率的倒数
• 当需要延长总线周期时插入等待状态Tw • CPU进行内部操作，没有对外操作时，其引脚就处
于空闲状态Ti
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第3章 80x86微处理器
第3章：3.2 8088的总线时序（续3）
(c)
3
第3章 80x86微处理器
⑴ 总线读操作时序
当8086 CPU 进行存储器或I/O端口读操作 时，总线进入读周期。基本的读周期由4个时 钟周期组成:T1、T2、T3和T4。CPU在T3到T4之间 从总线上接收数据。当所选中的存储器和外设 的存取速度较慢时，则在T3和T4之间将插入1个 或几个等待周期TW。图3.3是8086最小方式下的 总线读操作时序图。下面对图中表示的读操作 时序进行说明。
⑵ 总线周期
8086CPU与外部交换信息总是通过总线进行的 。CPU的每一个这种信息输入、输出过程所需要 的时间称为总线周期(BusCycle)，一般一个总线 周期由四个时钟周期组成。
⑶ 时钟周期
时钟脉冲的重复周期称为时钟周期 (Clock Cycle)。时钟周期是CPU的时间基准，由计算机 的主频决定。如8086的主频为5MHz，1个时钟周 期就是200ns。
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8086微处理器的引脚功能 - 陕西师范大学网络教育学院首页
8086微处理器的引脚功能一、有关引脚信号的一些基本知识（地址线、数据线、控制线、其它）1、认识一个引脚信号首先必须弄清该信号是高电平有效，还是低电平有效，特别是控制信号，认识其有效电平是至关重要的。
例如“写控制”信号WR 和“读控制”信号RD 等是低电平有效信号。
只有在WR 信号线为低电平时，才能将数据总线上的数据写入指定的内存单元或I ／O 端口；同样，只有在RD 信号线为低电平时，才能将数据总线上的数据读人CPU 。
低电平信号以信号的标识符（如WR 、RD ）上方加一横线（即WR 和RD ）表示之，也有以／WR 或"WR#”表示的。
而“地址锁存允许”信号ALE 则为高电平有效信号。
2、必须了解引脚信号是输入信号、输出信号还是双向信号。
在8086 CPU 中，输出信号线是CPU 用来控制内存或I ／O 接口工作的信号线，如WR 、RD 、DEN 、HLDA 、INTA 等；输入信号线是同CPU 进行数据传输的内存和I ／O 端口，或多处理器系统中的外部处理器向CPU 传送的控制信息或状态信息，用来控制CPU 工作的信号线，如READY 、RESET 、NMI 、INTR 、HOLD 、TEST 等。
另外，还有，些双向信号线，如0AD ～19AD 在传送数据信息时为双向信号线；RQ ／0GT 和RQ ／1GT （请求／允许总线访问控制信号）也为双向线，用作输入时为“请求总线访问”RQ 用作输出时为“允许总线访问”GT 。
3、输出信号线还有是否是“三态”信号的区别。
所谓“三态”信号是指，输出电平除“高电平”和“低电平”两种状态外，还有第三种状态——“高阻态”，处于高阻态的输出信号同外部负载连接时，相当于信号“开路”——即该信号线同负载的关系是：物理上是“连接”的，逻辑上是“断开”的。
8086 CPU 的输出信号中属于三态信号的有0AD ～15AD 、16A ／3S ～19AD ／6S 、BHE ／7S 、RD 、WR 、M ／IO 、DT ／R 、DEN 、LOCK 以及2S 、1S 、0S ，都是“三态”信号线。
8086与8088微处理器
2.1 8086/8088微处理器的结构 2.2 8086/8088的引脚信号及工作模式
2.3 8086的程序访问结构
2.1 8086/8088微处理器的结构
8086：16位微处理器 ，16根数据线、20根地址线，可
寻址1M字节；
8088：准16位微处理器 ，其内部寄存器、内部运算部 件以及内部操作均按 16位设计，但对外的数据总线只有 8条。 80 86 功 能 结 构 总线接口部件BIU
控 制 寄 存 器 组
指令指针IP
标志寄存器FR
2.1 8086/8088微处理器的结构
（2）标志寄存器 16位，只用了其中9位，唯一能按位操作的寄存器。 用于反映指令执行结果或控制指令执行形式。
D15 ..D12 D11 D10 D9 D8 D7 D6 D5 D4 D3 D2 D1 D0
OF DF IF TF SF SF、ZF、CF PF 、CF/、 AF ：进位 借位标志
PF：奇偶标志 作用：反映指令对数据作用之后，结果的状态，控制后续指令的执行。 CF=1：最高位需要向前产生进位/ AF：辅助进位标志 ZF：全零标志 PF=1: 结果的低8位中有偶数个1。 3位控制标志：DF、IF、 TF ：数据的第 借位。 AF=1 3。不包括进 位（半个字节） ZF=1：运算结果为全 0 PF=0: 结果的低 8位中有奇数个1。 CF=0：最高位不会向前产生进位 / 作用：值不由数据运算结果决定，由指令直接赋值，决定后续指令执 需要向前产生进位 /借位。 位的情况 影响全部状态标志 :加法、减法运算。 借位。 行情况。 AF=0 ：数据的第 3。 位（半个字节） ZF=0 ：运算结果不为 0 影响部分状态标志 :移位操作。 不会向前产生进位 /借位。 不影响任何状态标志 :数据传送指令。
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8086微处理器引脚（线）说明
﹡8086/8088微处理器采用40条引线双列直插(DIP)封装。
﹡ 8086/8088微处理器引线是对外前端总线及专用信号引线。
﹡ 8086/8088微处理器引线，在逻辑上可分为3类：地址总线信号、数据总线信号、控制总线信号。
还有一些专用信号：电源、地、时钟。
﹡ 8086/8088采用引线分时复用技术，一条引线不同时间代表不同信号,解决引线不够问题。
基本引脚信号
﹡AD15～AD0（I/O,三态）：地址/数据复用引脚。
﹡A19/S6 ～ A16/S3（O,三态）：地址/状态复用引脚。
﹡BHE# /S7 （O,三态）:高字节允许/状态复用引脚。
﹡NMI（In）：非屏蔽中断请求线，上升边触发。
﹡INTR (In) ：可屏蔽中断请求线，高电平有效。
﹡RD# (O,三态) ：读选通信号，低电平有效。
﹡CLK (In) : 时钟信号，处理器基本定时脉冲。
﹡RESET (In) :复位信号，高电平有效。
* WR# (O,三态)：写选通信号，低电平有效。
﹡READY (In)：准备好信号，高电平有效。
处理器与存储器及I/O接口速度同步的控制信号。
﹡TEST# (In): 测试信号，低电平有效。
处理器执行W AIT指令的控制信号。
﹡MN/MX# (In):最大/最小工作模式选择信号。
硬件设计者用来决定8086工作模式，MN/MX# =1 8086为最小模式， MN/MX# =0 8086为最大模式。
﹡Vcc (In): 处理器的电源引脚，接 +5V电源。
﹡GND :处理器的地线引脚，接系统地线
2）最小模式下的有关控制信号
﹡INTA# (O) :最小模式下的中断响应信号。
﹡ALE (O) :地址锁存允许信号。
﹡DEN# (O,三态) ：数据总线缓冲器允许信号。
﹡DT/R# (O,三态) ：数据总线缓冲器方向控制信号。
﹡M/IO# (O,三态) ：存储器或I/O接口选择信号。
﹡WR# (O,三态) ：写命令信号。
﹡HOLD (In) : 总线请求信号。
﹡HLDA (O) :总线请求响应信号。
（3）最大模式下的有关控制信号
﹡QS1、QS0 (O) :指令队列状态信号。
表明8086当前指令队列的状态。
﹡S2# ,S1# ,S0# (O,三态) :最大模式总线周期状态信号。
作为总线控制器8288的输入信号，8288输出各种控制信号。
﹡LOCK# (O,三态) :总线封锁信号。
信号有效时不允许其他主控部件占用总线。
﹡RQ#/GT#0, RQ#/GT#1 (I/O) :最大模式总线请求/总线响应信号，每条引线作为输入时是总线请求RQ信号，每条引线作为输出时是总线请求响应GT信号。