哈工大2013年数电期末试题 答案资料
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解：先画出 Y1 和 Y2 的卡诺图，根据与、或和异或运算规则直接画出 Y1 Y2 ， Y1 Y2 ， Y1 Y2 的卡诺图，再化简得到它们的逻辑表达式：
或 AB AC BC
(3) ABC ( × )
(2) F2 = ABCD ABD ACD AD
(4) F4 A B C ( A B C) ( A B C) A BC
(2) F2 AB BC BC AB
(4) F4 ABC ABD ACD CD ABC ACD AD
第 3 章 逻辑代数及逻辑门
【3-1】 填空 1、与模拟信号相比，数字信号的特点是它的 离散 性。一个数字信号只有两种取值分
别表示为 0 和 1 。 2、布尔代数中有三种最基本运算： 与 、 或 和 非 ，在此基础上又派生出五种
基本运算，分别为与非、或非、异或、同或和与或非。 3、与运算的法则可概述为：有“0”出 0 ，全“1”出 1；类似地或运算的法则为
(3)P3(A,B,C,D)= m(0,1,, 4, 6,8,9,10,12,13,14,15) AB BC AD BD
(4) P4 (A,B,C,D)= M1 M 7 A BC BC D
【3-5】用卡诺图化简下列带有约束条件的逻辑函数
（1） P1 A, B,C, D m(3, 6,8,9,11,12) d (0,1, 2,13,14,15) AC BD BCD(或ACD)
6．CMOS 门电路的特点：静态功耗极低（很大，极低）；而动态功耗随着工作频率的 提高而增加（增加，减小，不变）；输入电阻很大（很大，很小）；噪声容限高（高，低， 等）于 TTL 门 【4-2】电路如图 4.4(a)～(f)所示，试写出其逻辑函数的表达式。
数电期末考试题库及答案
数电期末考试题库及答案一、单项选择题（每题2分，共20分）1. 在数字电路中，最基本的逻辑运算是：A. 与运算B. 或运算C. 非运算D. 异或运算答案：A2. 下列哪个不是TTL逻辑门的类型？A. 与非门B. 或非门C. 与门D. 异或门答案：D3. 一个D触发器的输出Q在时钟脉冲的上升沿时：A. 翻转B. 保持不变C. 变为高电平D. 变为低电平答案：A4. 在数字电路中，一个4位二进制计数器的最大计数是：A. 8B. 16C. 15D. 145. 一个简单的RS触发器具有：A. 一个稳定的输出B. 两个稳定的输出C. 一个不稳定的输出D. 两个不稳定的输出答案：A6. 以下哪个是同步时序电路的特点？A. 存储单元的时钟输入是独立的B. 存储单元的时钟输入是共享的C. 存储单元的时钟输入是异步的D. 存储单元的时钟输入是随机的答案：B7. 在数字电路设计中，使用布尔代数的目的是：A. 简化逻辑表达式B. 增加电路复杂性C. 减少电路的功耗D. 提高电路的可靠性答案：A8. 一个8位移位寄存器可以存储多少位二进制数？A. 4B. 8C. 16D. 32答案：B9. 在数字电路中，一个三态输出门可以处于以下哪种状态？B. 低电平C. 高阻态D. 所有上述状态答案：D10. 一个二进制计数器在计数过程中，如果遇到一个无效的输入，它将：A. 停止计数B. 继续计数C. 重置为零D. 跳转到下一个有效状态答案：A二、多项选择题（每题3分，共15分）1. 下列哪些是数字电路中常用的逻辑门？A. 与门B. 或门C. 非门D. 异或门E. 与非门答案：ABCDE2. 数字电路中的触发器可以用于：A. 存储数据B. 计数C. 产生时钟信号D. 作为逻辑门E. 以上都不是答案：ABC3. 下列哪些是数字电路的优点？A. 高速度B. 高可靠性C. 易于集成D. 低功耗E. 以上都不是答案：ABCD4. 在数字电路中，同步电路与异步电路的区别在于：A. 同步电路的时钟信号是共享的B. 异步电路的时钟信号是独立的C. 同步电路的时钟信号是独立的D. 异步电路的时钟信号是共享的E. 以上都不是答案：AB5. 以下哪些因素会影响数字电路的性能？A. 温度B. 电源电压C. 信号传输延迟D. 噪声E. 以上都不是答案：ABCD三、简答题（每题5分，共20分）1. 简述数字电路与模拟电路的主要区别。
数字电路-期末考试复习题及答案
数字电路-期末考试复习题及答案题目1题目描述请简要解释什么是布尔代数。
答案布尔代数是一种数学结构和符号系统，用来分析和操作逻辑表达式和逻辑函数。
题目2题目描述请说明什么是逻辑门。
答案逻辑门是用来实现布尔代数运算的电子元件，根据输入信号的不同组合产生不同的输出信号。
题目3题目描述请列举并解释四种常见的逻辑门。
答案1. 与门 (AND Gate)：输出为真仅当所有输入都为真。
2. 或门 (OR Gate)：输出为真当至少有一个输入为真。
3. 非门 (NOT Gate)：输出为真当输入为假，反之亦然。
4. 异或门 (XOR Gate)：输出为真当输入中只有一个为真。
题目4题目描述请简述卡诺图的作用。
答案卡诺图是一种通过绘制格子状图表来简化逻辑函数的工具。
它可以帮助找到最简约的逻辑表达式，并减少数字电路的复杂性。
题目5题目描述请解释什么是时序逻辑和组合逻辑。
答案时序逻辑是一种根据输入信号的不同时间顺序产生不同输出的逻辑电路。
组合逻辑是仅根据输入信号的当前状态产生输出的逻辑电路。
题目6题目描述请说明同步电路和异步电路的区别。
答案同步电路中的各个部件在时钟信号的控制下按照一定的顺序工作。
异步电路中的各个部件则不受时钟信号的控制，可以独立工作。
题目7题目描述请列举至少三个常见的数字电路应用。
答案1. 计算机内存2. 数字时钟3. 数据传输和存储系统以上是数字电路期末考试复习题的部分内容，希望能帮助你进行复习。
哈工大数电课本课后习题答案
[00100011-00010010]补=[00100011]补+[-00010010]补=00010001=[00010001]补
00100011-00010010=00010001
(b) [00001100]补=00001100
[-00100000]补=11100000
[00001100-00100000]补=[00001100]补+[-00100000]补=11101100=[10010100]补
= AC + BC + AB
【3-12】解：
CD AB 00
CD AB 00 01 11 10
00
11 1
01 1 1 1 1
11 1 1
1
11 1 1
1
10 1 1 1 1
10 1 1 1 1
四种： F1 = AB + CD + AC + BD F2 = AB + CD + AD + BC
先画出 Y1 和 Y2 的卡诺图，根据与、或和异或运算规则直接画出 Y1 ⋅ Y2 ，Y1 + Y2 ，Y1 ⊕ Y2
的卡诺图，再化简得到它们的逻辑表达式：
CD AB 00 01 11 10
00
111
01
11
11 1 1 1 1
10
11
CD AB 00 01 11 10
00
11
01
1
11
1
10
111
00001100-00100000=10010100
(c) [01111100]补=01111100
[-01000011]补=10111101
[01111100-01000011]补=[01111100]补+[-01000011]补=00111001=[00111001]补
数电期末试卷与答案(共4套)
XX大学信息院《数字电子技术基础》期终考试试题（ 110 分钟） (第一套 )一、填空题：（每空 1 分，共 15 分）1．逻辑函数YABC 的两种标准形式分别为（）、（）。
2．将 2004 个“ 1”异或起来得到的结果是（）。
3 ．半导体存储器的结构主要包含三个部分，分别是（）、（）、（）。
4．8 位 D/A 转换器当输入数字量10000000 为 5v。
若只有最低位为高电平，则输出电压为（） v；当输入为 10001000，则输出电压为（）v。
5．就逐次逼近型和双积分型两种A/D 转换器而言，（）的抗干扰能力强，（）的转换速度快。
6．由 555 定时器构成的三种电路中，（）和（）是脉冲的整形电路。
7．与 PAL 相比，GAL 器件有可编程的输出结构，它是通过对（）进行编程设定其（）的工作模式来实现的，而且由于采用了（）的工艺结构，可以重复编程，使它的通用性很好，使用更为方便灵活。
二、根据要求作题：（共 15 分）1．将逻辑函数P=AB+AC 写成“与或非”表达式，并用“集电极开路与非门”来实现。
2．图 1、2 中电路均由 CMOS 门电路构成，写出 P、Q 的表达式，并画出对应 A 、B、C 的 P、Q 波形。
三、分析图 3 所示电路：（10 分）1）试写出 8 选 1 数据选择器的输出函数式；2）画出 A2、 A1、 A0 从 000~111连续变化时， Y 的波形图；3）说明电路的逻辑功能。
四、设计“一位十进制数”的四舍五入电路（采用8421BCD 码）。
要求只设定一个输出，并画出用最少“与非门”实现的逻辑电路图。
（15 分）五、已知电路及、4(a) (b)所示，设触发器的初态均为“ 0”，试CP A 的波形如图画出输出端 B 和 C 的波形。
（8 分）BC六、用 T 触发器和异或门构成的某种电路如图5(a)所示，在示波器上观察到波形如图 5(b)所示。
试问该电路是如何连接的？请在原图上画出正确的连接图，并标明 T 的取值。
数字电子技术期末考试题及答案(经典)
xxx~xxx学年第x学期《数字电子技术》期末复习题第一部分题目一、判断题（每题2分,共30分。
描述正确的在题号前的括号中打“√”，错误的打“×”）【】1、二进制有0 ~ 9十个数码，进位关系为逢十进一。
【】2、（325）8 ＞（225）10【】3、十进制数整数转换为二进制数的方法是采用“除2取余法”。
【】4、在二进制与十六进制的转换中，有下列关系：（100111010001）2=（9D1）16【】5、8421 BCD码是唯一能表示十进制数的编码。
【】6、十进制数85的8421 BCD码是101101。
【】7、格雷码为无权码，8421 BCD为有权码。
【】8、数字电路中用“1”和“0”分别表示两种状态,二者无大小之分。
【】9、逻辑变量的取值，１比０大。
【】10、在逻辑代数中，逻辑变量和函数均只有0和1两个取值，且不表示数量的大小。
【】11、逻辑运算1+1=1【】12、逻辑运算A+1+0=A【】13、因为逻辑表达式A+B+AB=A+B成立，所以AB=0成立。
【】14、在时间和幅度上均不连续的信号是数字信号，所以语音信号是数字信号。
【】15、逻辑函数的运算次序为：先算括号内，后算括号外；先求与，再求或，最后求非。
【】16、AB A C BC AB A C++=+【】17、逻辑函数表达式的化简结果是唯一的。
【】18、逻辑真值表、逻辑表达式、逻辑图均是逻辑关系的描述方法。
【】19、n个变量组成的最小项总数是2n个。
【】20、逻辑函数的化简方法主要有代数化简法和卡诺图化简法。
【】21、逻辑函数化简过程中的无关项一律按取值为0处理。
【】22、数字电路中晶体管工作在开关状态，即不是工作在饱和区，就是工作在截止区。
【】23、TTL或非门的多余输入端可以接高电平。
【】24、某一门电路有三个输入端A、B、C，当输入A、B、C不全为“1”时，输出Y为“0”，输入A、B、C全为高电平“1”时，输出Y为“1”，此门电路是或门电路。
数电课后题答案（哈工大版）课后习题答案
第6章 逻辑代数基础6.2 授课的几点建议6.2.1 基本逻辑关系的描述基本逻辑关系有“与”、“或”、“非”三种，在本教材中采用文字叙述和常开触点、常闭触点的串、并联等形式来加以描述。
还有一种描述逻辑关系的图，称为文氏图（V enn diagram ）。
图6.1(a)圆圈内是A ，圆圈外是A ；图6.1(b)圆圈A 与圆圈B 相交的部分是A 、B 的与逻辑，即AB ；图6.1(c)圆圈A 与圆圈B 所有的部分是A 、B 的或逻辑，即A +B 。
与逻辑AB 也称为A 与B 的交集（intersection ）；或逻辑A +B 也称为A 和B 的并集（union ）。
(a) 单变量的文氏图 (b) 与逻辑的文氏图 (c) 图6.1 文氏图6.2.2 正逻辑和负逻辑的关系正逻辑是将双值逻辑的高电平H 定义为“1”，代表有信号；低电平L 定义为“0”，代表无信号。
负逻辑是将双值逻辑的高电平H 定义为“0”，代表无信号；低电平L 定义为“1”，代表有信号。
正逻辑和负逻辑对信号有无的定义正好相反，就好象“左”、“右”的规定一样，设正逻辑符合现在习惯的规定，而负逻辑正好反过来，把现在是“左”，定义为“右”，把现在是“右”，定义为“左”。
关于正、负逻辑的真值表，以两个变量为例，见表6.1。
表6.1由表6.1可以看出，对正逻辑的约定，表中相当是与逻辑；对负逻辑约定，则相当是或逻辑。
所以正逻辑的“与”相当负逻辑的“或”；正逻辑的“或”相当负逻辑的“与”。
正与和负或只是形式上的不同，不改变问题的实质。
6.2.3 形式定理本书介绍了17个形式定理，分成五类。
需要说明的是，许多书上对这些形式定理有各自的名称，可能是翻译上的缘故，有一些不太贴切，为此，将形式定理分成5种形式表述，更便于记忆。
所以称为形式定理，是因为这些定理在逻辑关系的形式上虽然不同，但实质上是相等的。
形式定理主要用于逻辑式的化简，或者在形式上对逻辑式进行变换，它有以下五种类型：1．变量与常量之间的关系；2．变量自身之间的关系；3．与或型的逻辑关系；4．或与型的逻辑关系；5．求反的逻辑关系——摩根（Morgan ）定理。
数电期末考试题及答案
数电期末考试题及答案一、单项选择题（每题2分，共20分）1. 在数字电路中，最基本的逻辑运算是（）。
A. 与运算B. 或运算C. 非运算D. 异或运算答案：C2. 一个触发器可以存储（）位二进制信息。
A. 1B. 2C. 3D. 4答案：A3. 以下哪个不是组合逻辑电路的特点？（）A. 输出只依赖于当前输入B. 输出与输入之间存在时延C. 没有记忆功能D. 任何时刻输出仅由该时刻的输入决定答案：B4. 一个4位二进制计数器可以计数到（）。
A. 8B. 16C. 15D. 14答案：B5. 一个D触发器的特点是（）。
A. 有两个稳定状态B. 只有一个稳定状态C. 没有稳定状态D. 以上都不是答案：A6. 在数字电路中，以下哪个不是基本的门电路？（）。
A. 与门B. 或门C. 非门D. 异或门答案：D7. 一个3线-8线译码器可以译码（）种不同的输入。
A. 3B. 8C. 6D. 7答案：B8. 一个8位寄存器可以存储（）位二进制数。
A. 8B. 16C. 32D. 64答案：A9. 以下哪个是同步时序电路的特点？（）A. 电路的输出仅依赖于当前的输入B. 电路的输出依赖于当前的输入和电路的历史状态C. 电路的输出不依赖于输入D. 电路的输出仅依赖于电路的历史状态答案：B10. 一个JK触发器可以表示（）种不同的状态。
A. 1B. 2C. 3D. 4答案：B二、填空题（每题2分，共20分）1. 在数字电路中，一个基本的与门电路有_____个输入端和一个输出端。
答案：22. 一个4位二进制计数器的计数范围是从0到_____。
答案：153. 一个D触发器在时钟信号的上升沿到来时，其输出Q将与输入D保持_____。
答案：一致4. 在数字电路中，一个3线-8线译码器的输出是_____进制的。
答案：二5. 一个8位寄存器可以存储的最大十进制数是_____。
答案：2556. 一个JK触发器在J=0，K=0时，其状态将保持_____。
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哈工大 2013 年 秋 季学期数字电子技术基础试题（A ）Y '= 。
2．图1-2为CMOS 工艺数字逻辑电路，写出F 的表达式：F = 。
Fo /mVu u图1-2 图1-33．图1-3为4位 （逐次逼近型、双积分型、流水线型）A/D 转换器的转换示意图，转换结果为 。
4．对于一个8位D/A 转换器，若最小输出电压增量为0.01V ，当输入代码为01001101时，输出电压u o = V ，分辨率= 。
5．已知时钟脉冲频率为f cp ，欲得到频率为0.25f cp 的矩形波，哪种电路一定无法实现该功能（ ）A ．四进制计数器；B ．四位二进制计数器；C ．单稳态触发器；D ．施密特触发器。
6．某EPROM 有8条数据线，10条地址线，其存储容量为 字节。
一、（8分）每空1分1. ()A B CDC +；2. X A XB +或X B A F X ；3. 逐次逼近型，0101；4. 0.77V ，8121-或0.0039； 5. D ； 6. 2103210图2-1解： 3210F ABS ABS ABS ABS =⋅⋅⋅————————————————3分2．卡诺图化简：(),,,(0,1,2,3,5,8)P A B C D m =∑，约束条件为：0ABD BCD ABC ++= 解：AB CD000111100001111011ΦΦΦ0111001ΦΦ——————————2分P AD BD =+——————————————1分3．在图2-3中，用一片74LS160和一片74LS161，配合必要的逻辑门电路，构成128进制计数器。
要求：使用置数方式，且74LS160为低位芯片，74LS161为高位芯片。
Q D 74LS160RCO Q C Q B Q A ET EP D C B A CR LD CPQ D RCO Q C Q B Q A ET EP D C B A CR LDCP74LS161图2-3解：Q D 74LS160RCO Q C Q B Q A ET EP D C B A CR LDCPQ D RCO Q C Q B Q A ET EPD C B A CR LDCP74LS161111CP——4分三、(10分)一个保险箱有3个按键，当3个键都不按下时，保险箱关闭，不报警；当只有一个按键按下时，保险箱仍关闭，但报警；当有2个按键按下时，保险箱打开，不报警；当三个按键同时按下时，保险箱打开，但要报警。
试设计此逻辑电路。
要求：输入变量为A 、B 、C ，按键按下取值为“1”，否则取值为“0”。
输出变量分别为保险箱开锁信号X 和报警信号Y ，保险箱打开时X =1，关闭时X =0；报警时Y =1，不报警时Y =0。
1．列写真值表，并用输入变量A , B , C 最小项和的形式分别表示输出X 和Y （按照ABC 的顺序确定最小项下标）；2．在图3(a)中，用最小项译码器74LS138和与门实现该逻辑电路；3．在图3(b)中，用双4选1数据选择器74LS153和非门实现该逻辑电路（要求变量A , B 接入选择变量输入端）。
BIN/OCTB 1E 3E 2E 1B 2B 0Y 0Y 1Y 2Y 3Y 4Y 5Y 6Y 774LS138 2DEN 1MUX 1Y D 074LS1532Y EN 21DA 1A 0D 1D 2D 3D 0D 1D 2D 3图3(a) 图3(b)三、（10分） 1.2分 (,,)(3,5,6,7)X A B C m =∑————————1分(,,)(1,2,4,7)Y A B C m =∑—————————1分2.————————————————————3分4210),,(m m m m C B A X = 6530),,(m m m m C B A Y =3. ————————————————————3分ABCC AB C B A C B A m C B A X +++==∑)7,6,5,3(),,(ABC C B A C B A C B A m C B A Y +++==∑)7,4,2,1(),,(XY四、(8分)电路如图4所示，设电路均为TTL 工艺，74LS85为四位数码比较器。
其中A 4和B 4为高位；当[A 4A 3A 2A 1]=[B 4B 3B 2B 1]时，Y A =B =1，否则Y A =B =0。
1．说明虚线框中电路作为独立电路模块时的功能；2．若希望以[Q 4Q 3Q 2Q 1]作为输出，电路构成七进制计数器，则[I 4 I 3 I 2 I 1]应取多少？并画出完整的状态转换图，判断电路能否自启动。
J KJ KQJ KQ QJ KQ(A>B)iA 4A 3A 2A1CP 8574LS d R d R dR d R (A=B)i(A<B)iA<BA=B A>B A=BY Q 1Q 2Q 3Q 4B 4B 3B 2B 1I 4I 3I 2I 101011111图4四、（8分）1. 十六进制异步减法计数器————————2分2. 若I 4I 3I 2I 1 =1001————————————2分则当A 4A 3A 2A 1为1001时，1A B Y ==，d 0R =，计数器异步清零。
状态1001不能稳定存在，不是有效状态。
故该电路有7个有效状态，为七进制减法计数器。
其状态转换图为1514138765432101291110————————3该电路可以自启动。
——————————————————1五、由中规模16进制加法计数器74LS163和2/8分频异步计数器74LS93构成的电路如图5所示。
(10分) 1．给出虚线框内电路中74LS163的输出[Q d Q c Q b Q a ]的完整状态转换表和完整状态转换图，并说明构成几进制计数器；2．用D 触发器和必要的门电路实现虚框内的电路功能，给出最简与或形式的驱动方程即可，不必画出电路图；3．若图中时钟CP 的频率为1792Hz ，计算74LS163的输出Q d 的频率和占空比； 4．分别计算图中74LS93的输出D Q 和A Q 的频率。
图5五、（10分）1. ——————————————————————3分 状态转换表2. ——————————————————3分Q 3n Q 2n00011110000111100001Q 1n Q 0n001000000100010101101000011111011110000011111001101000001100状态方程： 13313032101221101110210102120n n n n n n n n nn n n n nn n n n n nn n n n n Q Q Q Q Q Q Q Q Q Q Q Q Q Q Q Q Q Q Q Q Q Q Q Q Q ++++=++=+=+=+驱动方程：3313032102211011021002120n n n n n n n nn n n nn n n nn n n n nD Q Q Q Q Q Q Q Q D Q Q Q Q D Q Q Q Q Q D Q Q Q Q =++=+=+=+3.——————————————————2分d 128Hz Q f =， 占空比D=50%。
4. ——————————————————2分D 16Hz Q f =；A 8Hz Q f =。
六、(10分)由2/5分频异步计数器74LS90和存储器构成的电路如图6(a)所示。
1．画出[Q D Q C Q B Q A ]的状态转换图（画出正常计数循环内的状态即可）； 2．设初始时刻[Q D Q C Q B ,Q A ]=[0 0 0 0 ]，给定时钟CP ，D 3、D 2、D 1、D 0的波形如图6(b)所示。
请用A 3、A 2、A 1、A 0的与或标准型分别表示D 3、D 2、D 1、D 0（按A 3A 2A 1A 0的顺序确定最小项编号），并在图6(a)中画出ROM 阵列中的存储内容。
3．图6(a)中检测电路的输入如图6(b)所示，D 3与D 2，D 1与D 0分别为两组方波信号，试设计该检测电路，要求当X 接D 0、Y 接D 1时，Z 稳定后输出为1；当X 接D 2，Y 接D 3时，Z 稳定后输出为0。
PC图6(a)CP D 0123456789101112131415D 1D 2D 3图6(b)六、（10分）1．————————————————2分2. ————————————————6分3(2,4,6,8)D m =∑ 2(1,4,6,8)D m =∑ 1(3,4,5,6)D m =∑ 0(1,2,3,4)D m =∑PC3 ————————————————2分YXZ还有X 、Y 颠倒，下降沿触发也对module circuit1(clk, Dsr, Q, Qsr); input clk, Dsr; output Qsr; output[4:1] Q;reg [4:1] Q;reg Qsr;always @(posedge clk)beginQ[1]<=Dsr; 图7-1 Q<=Q<<1; Qsr<= Q[4]; endendmodule2．根据下面的Verilog 语言描述的电路功能，在图7-2中画出Q 的波形（设起始时刻Q 为高电平）。
（3分）module circuit2(Q, clk, rst); input rst, clk; output Q; reg Q;always @(negdge clk) begin if(rst) Q<=0; elseQ<=~Q; end endmodulerst clk Q图7-2七、（6分）FF1FF2FF32. ——————————————3分rst clk Q八、图8所示是一个时钟发生电路。
设触发器的初始状态Q =0，二极管为理想二极管。
1．分析该电路中虚线框内为何种电路； 2．画出图中u 1、u 2及u 3的波形； 3．计算u 1、u 2及u 3的时钟频率。
（8分）u 2u 3图8八、1．555构成多谐振荡器；——————————————2分u112345678 u2u33．——————————————3分u1频率为50kHz；u2及u3的频率为25kHz。