实验四TTL集电极开路门和三态输出门测试_图文(精)
实验一 TTL、三态门电路参数测试(实验内容)_2013.04
实验一 TTL 和 三态门电路参数测试
杭州电子科技大学
电工电子实验中心
一、实验所用器件型号及管脚排列
VCC
14
4A
13
4B
12 &O &O
4Y
11
3A
10
3B
9 &O &O
3Y
8
VCC
14
4E
13
4A
12
1
EN EN
4Y
11
3E
10
3A
9
1
EN EN
3Y
8
1
1
1
2
3
4
5
6
7
0 1 0 1
4.用2输入与非门（74LS00）实现三人参加的
表决电路。
VoL 0 VI(V) VoFF VTH VoN Vo(V) VoH
90%*VoH
高电平噪声容限NH。
3、三态门功能测试
选用型号为74LS126的集
成电路，参考其引脚排列 及逻辑符号，按右边电路 图测试高阻状态，将实验 结果填入下表。
输入
输出Y(接上拉 电阻)
输出Y（接下拉电 阻）
E
A
Y
0 1
10K
&
V V
VI VO
0
0.3
0.5
0.85
0.9
0.95
1.0
1.05
1.1
1.15
1.2
1.3
1.4
1.5
TTL与非门参数测试
调节电位器,测出相应的输出电压,在坐标纸上画出电压传输特性
曲线,并在曲线中求得以下参数: 输出高电平VOH, 关门电平VOFF, 阈值电压VTH, 输出低电压VOL, 开门电平VON, 低电平噪声容限VNL,
实验三_集成逻辑门电路的功能及参数测试(精)
实验四
实验设备
示波器YB4320A 1台
三用表1只
逻辑电路设计实验箱1台
实验材料(在电阻箱上
74LS125 1片
74LS03 1片
电阻
1/8W 1K Ω8只
1/8W 5.1KΩ5只
1/8W 2.7K Ω4只
四、操作方法与实验步骤
实验三
1.验证74LS00“与非”门的逻辑功能
1.将芯片插入实验箱的IC插座中
4.从b端往a端缓慢调节电位器W ,观察Vi ,Vo两电压表的读数,并记录数据填入表格
5.根据表格数据画出曲线图,并求VON和VOFF
图表21开关门电平电路图
实验四
1.验证74LS125三态门的逻辑功能
1.高阻的测试方法:将控制端EN接高电平,输出分别接上拉电阻和下拉电阻,测量输出端Y的电压
图表22测量示意图
4.进一步建立信号传输有时间延时的概念
5.进一步熟悉示波器、函数发生器等仪器的使用
实验四
1.掌握三态门的逻辑功能及工作原理
2.了解三态门在计算机总线中的应用
3.熟悉集电极开路门的电路原理
4.掌握集电路开路门的使用方法
二、实验内容和原理
实验三
实验内容:
1.验证74LS00“与非”门的逻辑功能
2.验证CD4001“或非”门的逻辑功能
实验四1.验证74LS125三态门的逻辑功能图表32 74LS125逻辑功能测量结果EN A L Y上拉电阻Y下拉电阻5.07 5.07 0 0 H H L H实验结果表明接上拉电阻实现了正常的逻辑功能同时提高了驱动负载能力。而接下拉电阻三态门不能实现正常的逻辑功能。2.测量74LS125的四个三态门的输入输出电压图表33 74LS125输入输出电压ENi 0 0 Ai / V 4.99 0 4.97 0 4.97 0 4.98 0 Yi / V 4.04 0 3.99 0 4.02 0 4.03 0 Yi逻辑值1 0 1 0 1 0 1 0 0 0 0 0 0 0数据表明四个三态门都是正常的。2.用74LS125三态门构成1位2选1数据选择器图表34双向数据传送测量结果S0 0 1 D1 139.133HZ 5.10V(示波器139.420HZ 5.06V D0 5.06V Y 139.172HZ 4.19V无频率第16页/共18页
TTL门电路的逻辑功能和特性测试(精)
实训一 TTL 门电路的逻辑功能和特征测试一、实训目的1．熟习 TTL 与非门逻辑功能的测试方法；2．熟习 TTL 与非门特征参数的意义以及传输特征的测试方法；3．掌握 TTL 门电路的使用方法。
二、实训内容1．测试 TTL 与非门逻辑功能；2．测试 TTL 与非门的特征参数。
三、实训主要元件74LS00（四二输入“与非门”）外引线摆列图：74LS04（六反相器）外引线摆列图：四、实训原理 74LS32 ( 四二输入或门 )在系统电路设计时，常常要用到一些门电路，而门电路的一些特征参数的利害，在很大程度上影响整机工作的靠谱性。
门电路的参数往常分两种：静态参数和动向参数。
1． TTL 逻辑门的主要参数有：(1)扇入系数 Ni 和扇出系数 NO：能使电路正常工作的输入端数量和电路正常工作能带动的同型号门的数量。
(2)输出高电平 VOH ：一般为 VOH≥ 2.4V(3)输出低电平 VOL ：一般为 VOL≤ 0.4V(4)电压传输特征曲线、开门电平 VOn 和关门电平 Voff(5)输入短路电流 IIS：一个输入端接地，其余输入端悬空时，流过该接地输入端的电流为输入短路电流。
(6)空载导通功耗 Pon：指输入所有为高电平、输出为低电平且不带负载时的功率消耗。
(7)空载截止功耗 Poff；指输入有低电平、输出为高电平且不带负载时的功率消耗。
(8)抗扰乱噪声容限：电路可以保持正确的逻辑关系所同意的最大扰乱电压值。
(9)均匀传输延缓时间： t pd = (t pdl + t pdh ) / 2(10)输入漏电流 IIH ：指一个输入端接高电平，另一个输入端接地时，流过高电平输入端的电流。
. 2．“与非”门特征参数的丈量方法（1）空载导通功耗PccL是指输入全为高电平、输出为低电平且不接负载时的功率消耗。
PCCL=VCC ICCL 式中 : VCC ——电源电压； ICCL ——导通电源电流。
测试电路如图 1.1 所示，给输入端全高平，丈量电源电流值，将计算结果填入表4中。
集电极开路、漏极开路、推挽、上拉电阻、弱上拉、三态门、准双向口
集电极开路、漏极开路、推挽、上拉电阻、弱上拉、三态门、准双向口集电极开路输出的结构如图1所示，右边的那个三极管集电极什么都不接，所以叫做集电极开路；左边的三极管为反相之用，使输入为“0”时，输出也为“0”。
对于图 1，当左端的输入为“0”时，前面的三极管截止，所以5v电源通过1k电阻加到右边的三极管上，右边的三极管导通；当左端的输入为“1”时，前面的三极管导通，而后面的三极管截止。
我们将图1简化成图2的样子，很明显可以看出，当开关闭合时，输出直接接地，所以输出电平为0。
而当开关断开时，则输出端悬空了，即高阻态。
这时电平状态未知，如果后面一个电阻负载到地，那么输出端的电平就被这个负载拉到低电平了，所以这个电路是不能输出高电平的。
图3中那个1k的电阻即是上拉电阻。
如果开关闭合，则有电流从1k电阻及开关上流过，但由于开关闭和时电阻为0（方便我们的讨论，实际情况中开关电阻不为0，另外对于三极管还存在饱和压降），所以在开关上的电压为0，即输出电平为0。
如果开关断开，则由于开关电阻为无穷大（同上，不考虑实际中的漏电流），所以流过的电流为0，因此在1k 电阻上的压降也为0，所以输出端的电压就是5v了，这样就能输出高电平了。
但是这个输出的内阻是比较大的——即1k，如果接一个电阻为r的负载，通过分压计算，就可以算得最后的输出电压为5*r/(r+1000)伏，所以，如果要达到一定的电压的话，r就不能太小。
如果r 真的太小，而导致输出电压不够的话，那我们只有通过减小那个1k的上拉电阻来增加驱动能力。
但是，上拉电阻又不能取得太小，因为当开关闭合时，将产生电流，由于开关能流过的电流是有限的，因此限制了上拉电阻的取值。
另外还需要考虑到，当输出低电平时，负载可能还会给提供一部分电流从开关流过，因此要综合这些电流考虑来选择合适的上拉电阻。
如果我们将一个读数据用的输入端接在输出端，这样就是一个IO口了，51的IO口就是这样的结构，其中P0口内部不带上拉，而其它三个口带内部上拉。
实验四集电极开路门与三态门输出的应用
集电极开路门与三态门输出的应用一．实验内容与目的实验目的：进一步了解逻辑门的结构，熟悉OC 门和三态门的逻辑功能和用途，特别是集电极负载电阻R L 对OC 门的影响。
实验内容：1.用OC门74LS03验证OC门的“线与”功能。
2.测试输出电平的转换得出结论3.验证三态门74LS125的逻辑功能。
当E拔无效为高电平，三态门输出为高阻态时，输出Y对应开关K的状态（接+5V或地）为高电平或低电平；当E 拔有效为低电平时，Y=A。
4.测试上拉电阻的取值范围。
实验仪器：HBE硬件基础电路实验箱，数字万用表元器件：74LS00，74LS03,74LS06,74LS125二．实验过程与数据分析1.用OC门74LS03验证OC门的“线与”功能步骤：了解74LS03的引脚排列图：定位标志下的引脚1，然后逆时针开始引脚2,3…13,14共十四的引脚，其中下行为引脚1到引脚7，上行为引脚8到引脚14，引脚7接地，引脚14接点语言正极，引脚1引脚2为逻辑与非门的输入端，引脚3为其逻辑输出端，依次引脚4,5,6，引脚13,12,11，引脚10,9,8为一个独立的逻辑与非门，其中引脚6,11,8为各自的输出端。
然后按照引脚内部排列的各自功能接线：打开实验箱电源，找到实验箱上已经固定好的74LS03（这里在实验箱的IC15 DIP14），用导线把引脚7 接实验箱的接地插孔，引脚14用导线接实验箱的直流5V电源插孔。
然后在实验箱的十六位逻辑电平输出中选择两位用导线各自连接74LS03的引脚1，引脚2作为与非门的输入端，把74LS03的引脚3输出端用导线连接到十六位逻辑电平显示中的一个插孔中。
然后按下5V直流电源的开关。
开始测试。
实验连接的电路图如下：OC门74LS03的测量结果如下：分析：2.输出电平的转换测试OC门74LS03的输出电压，参考下图，输入A、B接逻辑电平输出信号，输出端Y接直流电压表。
VL接+5V，电阻RL为4.7千欧，观测输出与输入信号的逻辑关系，如果去掉RL，观测输出信号的变化。
(完整版)OC门及三态门解析
二、集成逻辑门电路的选用
若要求功耗低、抗干扰能力强，则应选用 工C根M作据O频S电率电路1路工M。作H其z要以中求下C和、M市驱O场S动4因0能0素0力等系要综列求合一不决般高定用的于 场合；HCMOS 常用于工作频率 20 MHz 以下、 要求较强驱动能力的场合。
若对功耗和抗干扰能力要求一般，可选用 TTL 电路。目前多用 74LS 系列，它的功 耗较小，工作频率一般可用至 20 MHz； 如工作频率较高，可选用 CT74ALS 系列， 其工作频率一般可至 50 MHz。
1. 电路、逻辑符号和工作原理 三态门的输出有0、1、高阻三种状态，故称三态门。
当出现高阻状态时，门电路的输出阻抗很大，使得输入 和输出之间呈现开路状态。
当 EN = 0 时，Y = AB， 三态门处于工作态；
当 EN = 1 时，三态门输出呈 EN 称使能信号或控制信号， 现高阻态，又称禁止态。 A、B 称数据信号。
注意：使用时， OC门公共输出端和电源 VCC 间接上拉电阻
三态门：输出0，输出1，输出高阻
注意：三态门输出端可并联使用，但同一时刻只能有一个 门工作，其他门输出处于高阻状态。
•TTL门电路的使用注意事项
EXIT
三、CMOS 数字集成电路应用要点
(一)CMOS 数字集成电路系列
CMOS4000 系列
EXIT
应用集成门电路时，应注意：
(1)电源电压的正确使用
TTL电路只能用＋5 V(74系列允许误差±5%)；CMOS 4000 系列可用 3 ~ 15 V；HCMOS系列可用 2 ~ 6 V； CTMOS 系列用 4.5 ~ 5.5 V。一般情况下，CMOS 门多 用 5 V，以便与 TTL 电路兼容。
三态门和集电极开路(OC)门实验报告
4、验证 74LS03 集成电机开路门的逻辑功能
接上拉电阻
不接上拉电阻
A/V
B/V
Y/V
A/V
B/V
Y/V
4.93
4.93
0.17
4.93
4.93
0
4.93
0
12.15
0
0
0
0
4.93
12.15
0
4.93
0
0
0
12.15
4.93
0
0
由上表可得，当不接上拉电阻时，Y 端始终为 0；当接上拉电阻时，Y 当且仅
ENi
Ai/V
Yi/V
0
4.92
3.65
0
0
0.12
当 EN=0V 时，Y 端的逻2、用 74LS125 三态门构成 1 位 2 选 1 数据选择器
S0
D0
D1
Y
0
1KHZ
1
3V
1KHZ, 2.8V
5V
4.2V
由上表可知，当 S0=0 时，Y=D0；当 S0=1 时，Y=D1。
• 分别在输出端接上拉电阻和不接上拉电阻的情况下，测量 74LS03的一个逻辑门的逻辑关系，并填入下表
• 注意：芯片电源电压必须是 5V！若接 12V 将导致器件烧毁！
5、74LS03 实现线与、电平转换功能
• 按右图VCC接5V，测量输入端A,B及 输出端Y 的电压值，填入下表
• 若将多个相同集电极开路门的输出连在 一起接上拉电阻，则只要有输出门为低 电平，输出端就为低电平，逻辑功能上 是与的关系，称为线与
2、用 74LS125 三态门构成 1 位 2 选 1 数据选择器
1. 用74LS125按右图连接电路
实验四 三态门逻辑功能测试
实验四三态门逻辑功能测试班级：计科三班学号：20100810323 姓名：夏雪一、实验准备（老师指导）1.测试5M脉冲信号能否使用将5M的脉冲信号加在实验箱上，输出显示在示波器上。
2.认识三态门的管脚记住三态门的管脚分配情况，便于实验进行：1使能，2输入，3输出；4使能，5输入，6输出；7接地；8使能，9输入，10输出；11使能，12输入，13输出；14接电源。
3.示波器中信号的合并一般示波器中波形的显示为信号与实间的关系，即为X—T（Y—T）关系图，如果要将示波器上两信号合并，则将显示选项改为X—Y。
4.对延迟时间的理解延迟时间的测试要用到示波器的延迟扫描，对波形展开放大后，观察波形上升点与下降点，上升10%开始记为上升时间，下降10%开始记为下降时间。
二、实验内容1.测试三态门的逻辑功能并测输入输出电压（静态测试）；2.测试三态门的传输特性，输入端接在CP端；3.测三态门的传输延迟；4.输入端接入函数发生器的三角波（最小值为0V，最大值不超过5V），将输入输出信号显示在示波器上，并将两信号合并；三、实验条件实验箱，74LS125芯片，导线，示波器，信号发生器，万用表四、实验电路1.测三态门的逻辑功能并测输入输出电压2.测三态门的传输特性（输入信号为实验箱内的CP）3.传输延迟4.信号合成CP5MHZ五、实验结果及结论1.三态门的逻辑功能测试使能端1和输入端2接逻辑信号，按下灯亮表示输入信号为高电平1，未按下灯不亮表示输入信号为低电平0，输出3接在发光二级管上，发光为黄色表示输出信号为低电平，为红色表示输出信号为高电平输入的逻辑信号为00，输出信号灯不亮（实验中为发光二极管，显示为黄色），表示输出为低电平，即为0。
输入端2的输入电压为0V，输出3电压为24.6mV。
输入的逻辑信号为01，输出信号灯亮（实验中为发光二极管，显示为红色），表示输出为高电平，即为1。
输入端2的输入电压为4.98V，输出电压3为4.99V。
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实验四 TTL 集电极开路门和三态输出门测试
一、实验目的
1 、掌握 TTL 集电极开路门 (OC 门的逻辑功能及应用。
2 、了解集电极负载电阻 RL 对集电极开路门的影响。
3 、掌握 TTL 三态输出门 (3S 门的逻辑功能及冈山。
二、实验原理
数字系统中有时需要把两个或两个以上集成逻辑门的输出端直接并接在一起完成一定的逻辑功能。
对于普通的 TTL 电路 , 由于输出级采用了推拉式输出电路 , 无论输出是高电平还是低电平 , 输出阻抗都很低。
因此 , 通常不允许将它们的输出端并接在一起使用 , 而集电极开路门和三态输出门是两种特殊的 TTL 门电路 , 它们允许把输出端直接并按在一起使用 , 也就是说 , 它们都具有 " 线与 " 的功能。
1 、 TTL 集电极开路门 (OC 门
本实验所用 OC 门型号为 2 输入四与非门 74LS03, 引脚排列见附录。
工作时 , 输出端必须通过一只外接电阻 RL 和电源 Ec 相连接 , 以保证输出电平符合电路要求。
OC 门的应用主要有下述三个方面 :
(l 电路的 " 线与 " 特性方便的完成某些特定的逻辑功能。
图4 · l 所示 , 将两个 OC 门输出端直接并接在一起 , 则它们的输出
F=FA·FB=A1A2·B1B2 =A1A2+B1B2
图 4-1 0C 与非门 " 线与 " 电路图 4-2 0C 与非门负载电阻 RL 的确定
即把两个 ( 或两个以上〉 OC 与非门 " 线与 " 可完成 " 与或非 " 的逻辑功能。
(2 实现多路信息采集 , 使两路以上的信息共用一个传输通道 ( 总线。
(3 实现逻辑电平转换 , 以推动荧光数码管、继电器、 MOS 器件等多种数字集成电路。
OC 门输出并联运用时负载电阻 RL 的选择 :
如图 43 所示 , 电路由 n 个 OC 与非门 " 线与 " 驱动有 m 个输入端的 N 个 TTL 与 1Hl, 为保证 OC 门输出电平符合逻辑要求 , 负载屯阻 RI 阻值的选抨范围为:
式中 :IOH 一一 -OC 门输出管截止时 ( 输出高电平 VOEf 〉的漏电流〈约为 50uA
ILM 一一一 OC 门输出低电平 VOL 时允许最大灌入负载电流 ( 约为 2OmA
ItH 一一 -负载门高电平输入电流 (<5011A
Itl, 一一负载门低电平输入电流 (<1.6mA
Ec 一 -RL 外接电源电压
n 一一 OC 门个数 N 一一负载门个数
M 一一接入电路的负载门输入端总个数
RL 值须小于 RLmax, 否则 VOEt 将下降 ,RL 值须大于 RLmiI1, 否则 VOL 将上升 , 又 RL
的大小会影响输出波形的边沿时间 , 在工作速度较高时 ,RL 应尽量选取接近 RIAin 。
2 、 TTL 三态输出门 (3S 门
TTL 三态输出门是一种特殊的门电路 , 它与普通的 TTL 门电路结构不同 , 它的输出端除了通常的高电平、低电平两种状态外 ( 这两种状态均为低阻状态〉 , 还有第三种输出状态一一高阻态 , 处于高阻态时 , 电路与负载之间相当于开路。
二态输出门按逻辑功能及控制方式来分有各种不同类型 , 本实验所周二态川的型号是74LSiEJ 二态输山山总线缓冲击 , 图 4-3 是三态输出四总线缓冲器的逻辑符号 , 它有一个控制端( 又称为禁止端或使能端 E ,E=0 为正常工作状态 , 实现 Y=A 的逻辑功能 :E 21 为禁止状态 , 输出 Y 是高阻态。
这种在控制端加低电平电路才能正常工作的方式称低电平使能。
74LSl25 的引脚排列见附录。
图 4-3(a 图 4-3(b
图4-3 三态四总线缓冲器逻辑符号
输入输出
/E A F
0 O
1 1
1 O 高阻
右表为 74LS125 的功能表
三态电路主要用途之一是实现总线传输 , 即用一个传输通道 ( 称总线〉 , 以选通方式传送多路信息。
使用时 , 要求只有需要传输信息的三态控制端处于使能态 (E =0 〉其余各门皆处于禁止状态 (E =1 〉。
由于三态门
输出电路结构与普通 TTL 电路相同 , 显然 , 若同时有两个或两个以上三态门的控制端处于使能态 , 将出现与普通π L 门 " 线与 " 运用时同样的问题 , 因而是绝对不允许的。
三、实验设备与器件
1 、数字逻辑电路实验板。
2 、数字逻辑电路实验板扩展板。
3 、双踪示波器 , 数字万用表。
4 、芯片74LSOO 、74LS03 、74LS04 、74LS10 、74LS125, 电阻 200 欧、 lOK 电位器。
5 、1Hz 的连续脉冲 , 单次脉冲。
四、实验内容及实验步骤
1.TTL 集电极开路与非门 74LS03 负载电阻 RL 的确定。
图 4-4 74LS03 负载电阻的确定
将数字逻辑电路实验板扩展板插在实验板相应位置 , 并固定好 , 找一个 14PIN 的插座插上芯片 74LS03, 并在 14PIN 插座的第 7 脚接上实验板的地 (GND, 第14 脚接上电源(VCC, 逻辑电平接拨位开关。
芯片的管脚分配请参考附录或其它资料。
用两个集电极开路与非门 " 线与 " 使用驱动一个 TTL 非门 , 按图 4-4 连接实验电路。
负载电阻由一个 200Q 电阻和一个 lOK 电位器串接而成 , 取
Ec=5V,Vott=3.5V,VOId =0.3Vo接通电源 , 用逻辑开关改变两个 OC 门的输入状
态 , 先使 OC 门 " 线与 " 输出高电平 , 调节 Rw 至使 Uoff=3.5V, 测得此时的RL 即为 RLmax' 再使电 ; 路输出低电平 VOL=0.3V, 测得此时的 RL 即为 RL Lmin
2. 集电极开路门的应用
用 OC 门实现 FzAB +CD +EF, 实验时输入变量允许用原变量和反变量 , 外接负
载电阻 RL 自取合适的值。
具体的连线方法同实验内容 1 。
3. 三态输出门
(1测试 74LS125 三态输出门的逻辑功能 : 将数字逻辑电路实验板扩展板插在实验板相应位置 , 并固定好 , 找一个 14PIN 的插座插上芯片 74LS125, 并在 14PIN 插座的第 7 脚接上实验板的地 (GND, 第 14 脚接上电源 (VCC 〉 , 三态门输入端接逻辑开关 , 控制端接单次脉冲源 , 输出接发光二极管 ( 逻辑电平显示。
逐个测试集成块中四个门的逻辑功能 , 记入表 4-1 中。
表 4-1 74LS125 三态输出门的逻辑功能
输入输出
E A
O O
1
1 O
1
(2 三态输出门的应用
将四个三态缓冲器按图 4-5 接线 , 输入端按图示加输入信号 , 控制端接逻辑开关 , 输出端接 LED, 先使四个三态门的控制端均为高电平 "1 气即处于禁止状态。
注意 , 应先使工作的三态门转换为禁止状态 , 再让另一个门开始传递数据。
记录实验结果。
图 4-5 用 74LS125 实现总线传输实验电路
图4-6 74LS125 引脚排列图
五、实验预习要求
1. 复习 TTL 集电极开路门和三态门工作原理。
2. 计算实验中各 RL 阻值 , 并从中确定实验所用 RL 值 ( 标称值。
3. 画出用OC 与非门实现实验内容 2 的逻辑图。
六、实验实验报告
1. 画出实验电路图 , 并标明有关外接元件值。
2. 整理分析实验结果 , 总结集电极开路门和三态输出门的优缺点。
3. 思考 : 在使用总线传输时 , 总线上能不能同时接有 OC 门与三态输出门 ? 为什么 ?。