四位二进制数可控加减法 上海交通大学电子技术实验大作业

《四位二进制数可控加减法》实验报告

实验名称: 四位二进制数可控加减法

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目录

一、实验方案 (3)

二、设计思路................................................................................ 错误!未定义书签。

三、程序代码................................................................................ 错误!未定义书签。

四、调试问题 (6)

五、心得感想 (7)

一、实验方案

1）基本功能

实现两个四位二进制数的加减法运算,能够在led灯和数码管显示出结果。

2）清零功能

利用一个微动开关，当微动开关按下时结果清零显示。

3）数码管显示

将结果转换为七段显示器显示。将运算结果输送到数码管中。利用到人的视觉误差和短暂延时显示四位运算结果。

4）溢出问题

若有溢出，则数码管显示“E”。

二、设计思路

基本功能中分为连个模块，主模块用来运算加减法以及记录溢出和结果，子模块用来进行七段数码管的显示。

扩展功能中数码管显示要利用暂留现象，因此利用时钟clk来进行设计。

三、程序代码

module show_sub(

input [1:0]num,

output reg [6:0] a_to_g );

always @(*)

case(num)

2'b00: a_to_g=7'b1000000;

2'b01: a_to_g=7'b1111001;

2'b10: a_to_g=7'b1111111;

2'b11: a_to_g=7'b0000110;

default: a_to_g=7'b0000110;

endcase

endmodule

module show_top(

input clk,clr,

input wire [7:0] sw,

input plus,sub,

output wire [6:0] a_to_g,

output reg [3:0] an,

output reg [3:0] led );

reg [15:0] clk_cnt;

wire [1:0]s;

reg [3:0] result; //运算结果

reg [1:0] res;

reg flag; //溢出标志

wire [3:0] data1;

wire [3:0] data2;

assign data1=sw[7:4];

assign data2=sw[3:0];

assign s=clk_cnt[15:14];

always @(posedge clk)

begin

clk_cnt=clk_cnt+1;

end

always@(posedge plus or posedge sub or posedge clr)