第六章 并行通信和接口技术8255A(备用)
6第六章可编程并行接口8255A

第六章并行通信和接口技术
【例题】设一个8086系统中有2个8255A芯片J1和J2,如下图所
示,试分析端口地址。 (戴P222)
第六章并行通信和接口技术
第六章并行通信和接口技术
J1:00E0H~ 00E6H J2:00E8H ~00EEH
第六章并行通信和接口技术
两片8255A(J1、J2)接口芯片的端口名称、端口地址和 工作方式如下表所示。
③ 置1/置0控制字的D3、D2、D1位决定了对C端口中
的哪一位进行操作。 ④ 置1/置0控制字的D6、D5、D4位可为1,也可为0,
它们不影响置1/置0操作。但D7位必须为0,它是对C端口
置1/置O控制字的标识符。
第六章并行通信和接口技术
四、8255A的工作方式与操作时序 (戴P224
1.方式0 (基本输入/输出方式点 ) (1)方式0的工作特点:
第六章并行通信和接口技术
★★★★★
这些数位和信号之间的对应关系是在对 端口设定工作方式时自动确定的,不需要程 序员干预;而且,一旦确定了某个端口工作 于方式1,程序员也就无法改变端口C的数位 与信号之间的对应关系,除非重新设置方式 选择控制字。
第六章并行通信和接口技术
二、并口的基本结构
为了协调CPU与外设间的矛盾,采取以下几种措施: 1.接口中均设置了数据寄存器或锁存器,解决了高速 主机与低速外设的矛盾。 2.接口中设置了命令寄存器或工作方式寄存器 3.接口电路中设置了状态寄存器和相应的握手线 4.接口中设置了中断申请电路
第六章并行通信和接口技术
A 1A A 1A A 1A A 1A
0 00 选中 A 端口 0 01 选中 B 端口 0 10 选中 C 端口 0 11 选中控制口
并行接口芯片8255A

8255A的结构框图 2
第六章 微机接口
2、A组和B组控制电路
主要作用是根据CPU送来的控制字用以决 定两组端口(A组为A口C口的高4位,B组为B 口和C口的低4位。)的工作方式,也可根据 控制字的要求对C口按位进行置位或复位。
3、数据总线缓冲器
8位、双向、三态。D7~D0与数据总线相连。 在16位系统中,若接在数据总线的低8位, 则用偶地址口来寻址8255A,若接在数据总 线的高8位,则使用奇地址口。
9
第六章 微机接口
在方式0,所有口输出均有锁存,输入只有缓 冲,但无锁存,C口还具有按位将其各位清0或 置1的功能。
(2)方式1
A口借用C口的一些信号线用作控制和状态 线,形成A组,B口借用C口的一些信号线用作 控制和状态线,组成B组。在方式1下,A口和B 口的输入输出均带有锁存。
10
第六章 微机接口
13
第六章 微机接口
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第六章 微机接口
2)方式1的输出
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第六章 微机接口
OBF:输出缓冲器满,输出,低有效。这是 8255A送给外设的控制信号,有效时表示数据 已送入到输出锁存器中,用该信号通知外设 将数据取走。该信号由CPU发出的WR置成低电 平(变为有效)而由外设来的ACK信号使其恢 复为高电平(无效)。 ACK:应答,输入,低有效。这是由外设送来的 信号,有效时将表示外设已经从端口输出线 上将数据取走。 INTR:中断请求,输出,高电平有效。只有当 ACK、OBF和INTE三者都为高电平时,INTR才 能被置为高电平1。
第六章 微机接口
INTE:中断允许。它是由内部的中断控制触发器 发出的允许中断或屏蔽中断的信号。INTE=l, 允许A口或B口向CPU申请中断,INTE=0,禁 止A口或B口向CPU申请中断。INTE没有外部引 出端,它是利用C口的按位置位/复位的功能 来使其置1或清0的,INTEA由PC4控制,INTEB 由PC2控制。需要指出的是,在方式1时,PC4 和PC2的置位/复位操作分别用于控制A口和B 口的中断允许信号,这是8255A的内部操作, 这一操作对PC4和PC2引脚用于A口和B口的数 据选通输入和的状态没有任何影响。
可编程并行接口芯片8255A

大规模控制系统的需求。
8255A与可编程逻辑器件的结合,可以实现高速、实时的数据
03
采集和控制。
在数据采集与控制系统中的应用
8255A在数据采集与控制系统中,可以作为数据传输的桥梁,实现快速、稳定的数 据传输。
通过8255A,可以实现多路数据的并行采集和处理,提高了数据处理的效率。
8255A在数据采集与控制系统中,可以作为主控制器,协调各个模块的工作,保证 系统的稳定运行。
微处理器可以通过8255A实现对 外部设备的控制,扩展了微处理
器的控制能力。
8255A可以作为微处理器的输入 /输出接口,实现人机交互和数据
采集。
与可编程逻辑器件连接的应用
01
8255A可以与可编程逻辑器件连接,实现复杂的逻辑控制和数 据处理。
02
通过8255A,可编程逻辑器件可以扩展其输入/输出端口,满足
根据实际需求,设定8255A的数据格式,包括数据位、停止位、 奇偶校验位等。
数据读写操作
通过数据传输编程实现对8255A的数据读写操作,包括读数据、 写数据、读写同时操作等。
PART 05
8255A的应用实例
与微处理器连接的应用
8255A与微处理器连接,可以实 现并行数据传输,提高数据传输
效率。
在现代嵌入式系统中,8255A芯片仍有一 定的应用,尤其在一些需要并行I/O接口的 场合,如人机界面、传感器等。
PART 02
8255A芯片的基本结构 与功能
芯片的基本组成
输入/输出端口
数据总线
8255A包含三个输入/输出端口,分别为 端口A、端口B和端口C。每个端口都有8 个位,可以独立配置为输入或输出模式。
控制信号生成
并行接口技术及接口芯片8255A的应用

方式1输入(端口B) INTE B
& PC0 INTRB PB7~0 PC2 PC1 D7~0 STBB IBFB
2
RD
I/O
2
STB:外设给8255A的“输入选通”信号,低电平有效。 IBF:8255A给外设的回答信号“输入缓冲器满”,高电平有效。 INTR:8255A给CPU的“中断请求”信号,高电平有效。
0
D6
D5
D4
D3
D2
D1
D0
特征 位
不 用 (写0)
位 选 择 000=C口0位 001=C口1位 … 111=C口7位
1=置位 (高电平) 0=复位 (低电平)
例2:若要把C口的PC2引脚置成高电平输出,
则命令字应该为00000101B或05H。
置位/复位命令字必须写入8255A的命令寄存器
其程序段为:MOV
code segment begin proc far assume cs:code push ds sub ax,ax push ax MOV DX,383H MOV AL,10000000B OUT DX,AL MOV AL,1 AGAIN:OUT DX,AL LOOP $ LOOP $
AND AL,0FEH OUT DX,AL ADD AL,3 AND AL,0FH PUSH AX MOV AH,11 INT 21H INC AL POP AX JNZ AGAIN ret begin endp code ends end begin
并行接口技术 及接口芯片8255A的应用
可编程并行接口
并行接口的特点:
1、在多根据数据线上以数据字节(字)为单位与I/O设备或 被控对象传送信息。 如: 打印机接口,A/D、D/A转换器接口,IEEE-488接口,
8255a并行接口芯片的基本结构及工作原理 -回复

8255a并行接口芯片的基本结构及工作原理-回复[8255a并行接口芯片的基本结构及工作原理]是指针对特定应用设计的一种集成电路芯片,用于实现计算机系统与外部设备之间的并行通信。
本文将逐步介绍8255a并行接口芯片的基本结构和工作原理。
一、引言随着电子技术的发展,计算机系统逐渐与外部设备进行连接,实现数据的输入和输出。
为了满足不同应用场景的需求,芯片设计者提出了各种接口芯片,其中并行接口芯片是其中之一。
并行接口芯片的作用是实现计算机系统和外部设备之间的高速数据传输,其基本结构和工作原理对于提高系统的数据传输效率具有重要作用。
二、基本结构8255a并行接口芯片是一种功能强大的集成电路芯片,基本结构包括以下组成部分:1. 端口组(Port Group):8255a芯片内部包含三个8位的端口组,分别为A、B、C端口组。
每个端口组都可由外部设备进行数据的输入和输出。
同时,每个端口组都包含了相关的控制寄存器,用来设置和控制端口的工作状态。
2. 控制寄存器(Control Register):8255a芯片中的每个端口组都有一个对应的控制寄存器,用于设置和控制端口的工作模式。
其中,控制寄存器的位数和功能根据不同的芯片型号而变化。
3. 数据寄存器(Data Register):8255a芯片中的每个端口组都有一个对应的数据寄存器,用于存放从外部设备中读取的数据或要写入到外部设备中的数据。
数据寄存器的位数根据芯片型号和端口组而定。
4. 模式控制寄存器(Mode Control Register):8255a芯片内部还包含一个模式控制寄存器,用于设置和控制端口组的工作模式。
该寄存器中的位数和功能根据不同的芯片型号而变化。
三、工作原理8255a并行接口芯片的工作原理主要包括以下几个方面:1. 初始化:在开始使用8255a芯片之前,需要对芯片进行初始化设置。
通过设置控制寄存器和模式控制寄存器,可以设置端口组的输入和输出模式,以及中断使能等参数。
8255a并行接口芯片的基本结构及工作原理 -回复

8255a并行接口芯片的基本结构及工作原理-回复8255A并行接口芯片的基本结构及工作原理引言随着计算机技术的不断发展,人们对于外设与计算机之间的数据传输速度和效率提出了更高的要求。
并行接口芯片作为计算机与外设之间传输数据的重要媒介,起到了至关重要的作用。
本文将详细介绍8255A并行接口芯片的基本结构及工作原理。
一、基本结构8255A是一款通用的并行接口芯片,其基本结构包括三部分:控制字寄存器、端口A/B/C以及控制逻辑。
1. 控制字寄存器控制字寄存器是8255A并行接口芯片的核心部件,用于控制输入输出的方向、模式以及数据格式等。
该寄存器由三个字节组成,分别是A口控制字寄存器(PC0-PC7)、B口控制字寄存器(PC8-PC15)和C口控制字寄存器。
其中,A口用于配置端口A的输入输出方式,B口用于配置端口B的输入输出方式,而C口则配置8255A芯片的工作模式和特殊功能。
2. 端口A/B/C端口A和端口B是8255A芯片的两个并行输入输出端口,每个端口由8个I/O线组成。
端口C包括PC0-PC3和PC4-PC7两部分,分别用于控制8255A的工作模式和特殊功能。
3. 控制逻辑控制逻辑是8255A芯片的控制单元,根据控制字寄存器中的设置,控制端口A/B的输入输出方式,以及控制芯片的特殊功能。
控制逻辑还负责监测和处理外部信号,将其与控制字寄存器中的设置进行匹配,确定8255A 芯片的工作模式和特殊功能。
二、工作原理8255A芯片的工作原理相对简单,通过控制字寄存器、端口A/B/C以及控制逻辑之间的相互配合,实现数据的传输与处理。
1. 配置工作模式首先,需要通过向控制字寄存器中写入相应的值来配置8255A芯片的工作模式。
控制字寄存器的配置主要包括端口A/B的输入输出方式、数据的格式以及芯片的特殊功能。
通过配置控制字寄存器,可以将端口A/B设置为输入或输出模式,并设置数据格式为8位、4位或2位。
此外,如果需要使用8255A芯片的特殊功能,也可以进行相应的配置。
微机原理与接口技术课件 第九讲 并口与8255A

数据,而是在外设提供响应信号ACK时才送出数
据
21
第二十一页,共31页。
CPU
I/O设备(shèbèi)
PA7~PA0
INTE1
PC6 PC7
ACKA
OBFA
INTE2 PC4
PC5
STBA IBFA
用PC6设置INTE1(输出用) 用PC4设置INTE2(输入用)
输入和输出中断通过(tōngguò)
号时,并不会改变中断允许触发器的状态。
17
第十七页,共31页。
方式(fāngshì)1输出引脚:A端 口
PA7~PA0
外设响应信号 表示外设已经接收(jiēshōu)到数据
INTEA
PC6 PC7
PC3
ACKA OBFA
INTRA
输出缓冲器满信号(xìnhào)
表示CPU已经输出了数据
中断允许触发器
微机系统中最基本的信息交换方法 例如:系统板上各部件之间,接口电路板上各部 件之间
3
第三页,共31页。
并行接口芯片(xīn piàn)8255A
具有多种功能的可编程并行I/O接口电路(diànlù)芯片 为Intel系列微处理器设计的配套电路,也可用于 其它微处理器系统中
在微型计算机系统中,用8255A作接口时,通常不需 要附加外部逻辑电路就可以为CPU与外设之间提供 数据通道,因此得到了极广泛的应用。
通过控制端口:向C端口写入“C口按位置位/复 位控制字”,使C端口的某个引脚输出1或0,或 置位/复位内部的中断允许触发器
26
第二十六页,共31页。
的说明 3.端口C
(shuōmíng)
④ 读端口C
读取的C端口数据有两种情况
第六章 IO接口和并行接口芯片8255A教材

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微型计算机原理与接口技术
第六章 I/O接口和并行接口芯片8255A
微型计算机原理与接口技术
第六章 I/O接口和并行接口芯片8255A
2. 内部结构
A组 控制逻辑
A组 端口 A
PA7~PA0
D7~D0
数据 总线 缓冲器
RD
WR A1 A0
RESET
读/写 控制 逻辑
CS 山东工商学院 高群
内部 数据总线
B组 控制逻辑
A组 端口 C 高4位
B组 端口 C 低4位
PC7~PC4 PC3~PC0
特点:接口电路简单,CPU利用率低(程序循环等待),接口需 向CPU提供查询状态。
适用场合:适用于CPU不太忙,传送速度要求不高的场合。各 种外设不能同时工作,外设处于被动状态。
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(比如A/D)
第六章 I/O接口和并行接口芯片8255A
初始化
读入状态
N 数据准备好 Y
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第六章 I/O接口和并行接口芯片8255A
特点:CPU的利用率高,外设具有申请CPU中断的主 动权, CPU和外设之间处于并行工作状态。但中断服 务需要保护断点和恢复断点(占用存储空间,降低速 度),CPU和外设之间需要中断控制器。
适用场合:适用于CPU的任务较忙、传送速度要求高 的场合,尤其适合实时控制中的紧急事件处理。
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根据方式0的基本功能定义,这四个端口的输入和输出有十六种不同的组 合,可适用于多种应用场合。
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8255A在方式0的输入时序下有以下要求。 A、读信号有效之前,应先发出地址信号。 B、输入数据要领先于读信号。
在整个读取期间,地址信号要保持有效; 输入数据必须保持到读信号结束后才消失; 要求读脉冲的宽度tRR至少为300ns。 tRR
tWW WR tDW D7~D0
CS、A1、A0
tWD tWA
tAW
数据有效
输出数据
数据有效
tWB
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方式0的输出时序
方式0的应用场合
同步传送:发送方和接收方的动作由同一时序信号来管理,
双方互相知道对方的动作,所以不需要应答信号,同步方
式下8255A的三个数据端口可以实现三路数据传输。 查询式传送:就需要应答信号了。但在方式0下,没有规 定固定的应答信号,就需用端口C来配合端口A和端口 B 进行输入/输出操作,即将端口 C的某 4位(高4位或低4
INTRA
STB— 选通输入,使数据送入输入锁存器 STROBE IBF— 输入缓冲器满(应答信号) INPUT BUFFER FULL INTR— STB=1,IBF=1,INTE=1 则INTR=1,RD清INTR REQUEST INTEA— 中断允许,PC4=1 INTEA=1 ENABLE INTEB— 中断允许,PC2=1 INTEB=1 CPU是通过软件对端口C的置1/置0方式选择实现对中断的控制,通过对 PC4 置0使INTEA 为0而使端口A处于中断屏蔽状态,也可通过对PC2 置0 使INTEB为0而使端口B处于中断屏蔽状态;相反地,由软件对PC4、PC2 置1则可使相应的端口处于中断允许状态。 2013-7-29 16
RD WR A0 A1 RESET CS
读 /写 控 制 逻辑
B组 控制
端口 B
PB7~PB0
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3
并行接口芯片8255A
(1)数据总线缓冲器:三态双向8位缓冲器用于连接8255与系统数据总 线,其发送或接收数据是靠CPU执行输入或输出指令而实现的。控制字和状 态信息也是通过这个数据总线缓冲器传送的。
8位的数据口既可作为输入又可作为输出。输入和输出均 可锁存;
4位的口用于传送8位的数据口的控制和状态信息。
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8255A的工作方式 方式1 输入:
PA7~PA0 INTEA PC4 PC5 PC3 STBA IBFA PB7~PB0 INTEB PC2 PC1 PC0 STBB IBFB INTRB
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8255A的工作方式 方式1 输入:
STB
tST tSIB
②
①
IBF
tSIT tRIB tRIT
③ ④
INTR RD
从外设来的 输入数据
tPH
tPS
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8255A的工作方式 方式1 输出:
PA7~PA0 INTEA PB7~PB0 ACKA OBFA INTRA INTEB PC2 PC1 ACKB OBFB
并行接口芯片8255A
计算机系统的信息交换有两种方式: 并行数据传输方式和串行数据传输方式。 并行数据传输方式是将一个字或一个字符的数据按位同时传输。 (1)适合于外设和微机之间近距离、大量和快速的信息交换。 例如:微机与并行接口打印机、磁盘驱动器、光盘驱动器等; (2)并行数据传输方式是微机系统中最基本的信息交换方式。 例如:主板上各个部件之间、I/O插槽上各个部件之间等的数据交换都是 并行传输。 不可编程的并行接口芯片(三态缓冲器和锁存器): 74LS244/245; 74LS273/373等 Intel 8282/8283(74LS373): 8位带锁存器的单向三态不反相/ 反相缓冲器。 Intel 8286/8287(74LS245):8位双向三态不反相/反相缓冲器。
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8255A的控制字 方式选择控制字
1
D6
D5
D4
A口: 0 -出 1 -入
D3
C上半口 0 -出 1 -入
D2
D1
D0
标 识 A组: 位 00-方式0; 01-方式1; 1×-方式2
B组: B口: C下半口: 0-方式 0 0 -出 0 -出 1-方式 1 1 -入 1 -入
PC6
PC7 PC3
PC0
INTRB
OBF— 输出缓冲器满,ACK使OBF=1 ACK— 外设接收到数据响应信号 INTEA— PC6=1 INTEA=1 INTEB— PC2=1 INTEB=1
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8255A的工作方式 方式1 输出:
WR ② OBF ① INTR
tAOB
A1 A0 0 0 1 0 1 0 端口 A口 B口 C口
1
1
控制寄存器
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8255A的基本操作
A1 0
0 1 0 0 1 1
A0 0
1 0 0 1 0 1
RD
WRபைடு நூலகம்
CS
端口 口A→数据总线
口B→数据总线 口C→数据总线 数据总线→口A 数据总线→口B 数据总线→口C 数据总线→控制寄存器
8255A的工作方式 1、 方式0——基本输入/输出方式: 在这种功能组态下,三个口中的任何一个都可提供简单的输入和输出 操作。不需要应答式联络信号,数据只是简单地写入指定的口,或从口中 读出。 方式0的基本功能定义如下: 两个8位的口和两个4位的口: 口A、口B、口C高四位、口C低四位 任何一个通道可以作为输入/输出; 输出时可锁存; 输入时不可锁存;
RD
tIR
输入数据
tHR
数据有效
tAR
tRA
CS、A1、A0
D7~D0 tRD
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数据有效
tDF
11
方式0的输入时序
参数 tRR tAR tIR 读脉冲的宽度
说明
8255A
最小时间
300ns 0 0
最大时间
地址稳定领先于读信号的时间 输入数据领先于RD 的时间
tHR
tRA tRD tDF tRY
tWOB
③ ④
tWIT
ACK
tAK tAIT
送往外设的数据
数据有效
tWB
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8255A的工作方式
3、方式2——双向传输方式
只有端口A能够工作于方式2。在此方式下,外设可以在8位数据线上 既往CPU发数据,又从CPU接收数据。和方式1类似,这时端口A占用了 端口C的5根口线为自己提供控制信号。
操作
输入操作 (读)
0
0 0 1 1 1 1
1
1 1 0 0 0 0
0
0 0 0 0 0 0
输出操作 (写)
×
1 ×
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×
1 ×
×
0 1
×
1 1
1
0 0
数据总线→三态
非法状态 数据总线→三态
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禁止功能
8255A的控制字 8255A的工作状态是由CPU用输出指令向控制寄存器送控制字来决定。 8255A的控制字分为两类: 一类是方式选择控制字,一类是端口C按位 置1/置0控制字。 方式选择控制字第七位总是为1,而端口C置1/置0控制字的第七位总 是为0。所以,第七位称为这两类控制字的标识符。 (1)方式选择控制字
方式选择控制字可以使8255A的3个数据端口工作在不同的工作方式。 该控制字总是将3个数据端口分为两组来设定工作方式,其中端口A和端 口C的高4位作为一组,端口B和端口C的低4位作为一组。
8255A可有三种基本工作方式: 方式0:基本输入/输出方式 方式1:带选通的输入/输出方式 方式2:双向传输方式
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并行接口芯片8255A
出
2013-7-29
共113页
2
并行接口芯片8255A
+5V 电源 GND A组 控制 端口 A PA7~PA0
数据总线
数 据 总 线 缓 冲 器
八 位 内 部 数 据 总 线
端口 C (高 4 位)
PC7~PC4
端口 C (低 4 位)
PC3~PC0
端口C置1/置0控制字
0
标识位
D6 D5 D4
× × ×
D3
D2
D1
D0
1 -置位; 0 -复位
位选择:000~111Bit0~Bit7
例:A口输入,B口输出,C口上半口输入,下半口输出,方式0 端口A可工作在3种工作态式中的任一种,端口B只能工作在方式0或方式 控制字:10011000b 1,端口C常用于配合端口A和端口B工作,为这两个端口的输入或输出提 I/O地址 250H~253H A1~A1,A0~A0 控制寄存器地址253H 供控制信号和状态信号,因此,端口C的各位应可以用置1/置0来单独设 MOV DX,253H 置。 MOV AL,98H OUT DX,AL 2013-7-29 9 共113页 例:A口输入,方式1,B口输出,方式0,C口输入 控制字:10111001b
PC3
PA7~0 INTRA
OBF 通知外设读取数据
PC7
INTEo PC6 INTEi PC4 PC5
OBF
PC6=1使能INTEo,输出中断 使8255 A口输出缓冲器开启,送出数据,其上升 沿是数据已经输出的回答