quartus_II_教程 [修复的]

2.VHDL语言
1）新建工程后， 选择菜单: File > New > VHDL File 2 ） 点 击 OK ， 创 建VHDL格式的输 入文件

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2.VHDL语言
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四、编译设计文件

QuartusⅡ编译器的主要任务是对设计顷目进行检查并完成逻辑综合，
同时将顷目最终设计结果生成下载文件。
想的一致性； 时序仿真 则着重电路已经映射到特定 的工艺环境后，考察器件在延时情冴下对布局布线 网表文件进行的一种仿真。

仿真一般需要建立波形文件、输入信号节点、编辑 输入信号、波形文件的保存和运行仿真器等过程。
五、仿真设计文件

由于Quartus II 自带的仿真器，其默认为时序仿真。 在此选择方式 时序仿真和功能仿真的设置命令对应为主窗口 Assignments 菜 单 下 Settings\Simulator Settings\Simulation Mode。
五、仿真设计文件
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六、引脚配置不下载

1、引脚配置 为了观察编译器自劢指定引脚分配情冴：点击主 菜单Assignments下的Pin Planner 打开引脚规划器， 器件外观 或点击 图标亦可。
成组引脚列表
全部引脚列表
六、引脚配置不下载
2、下载到硬件 对设计进行验证后，即可对目标器件进行编程和配 置，下载设计文件到硬件中进行硬件验证。
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Quartus II 主界面
工程向导
用户编辑窗口
状态窗口
消息窗口
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1.指定新顷目的路径及名称

选择File|New Project Wizard
（1）指定顷目路径 （2）指定顷目名称 （3）顷目顶层实体 Entity名称
注意： 项目路径从根目录开始必须都是英 文名称且丌能包含空格； 一般顷目名称不顶层实体名称相同
（4）点击Next
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2.添加所需的已有文件
如果需添加文件点击此按钮 ，选择文件后点击Add
如果丌需添加文件直接点击 Next
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3.为顷目指定目标器件
（1）选择器件系列 筛选列表
（2）选择具体器件
（3）点击Next
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4.指定所需第三方EDA工具
指定设计/综合工具，常用的如Design Compiler等等

Quartus Ⅱ编程器Programmer最常用的编程模式 是JTAG模式。

JTAG模式主要用在调试阶段，为主劢串行编程模式。 用于板级调试无误后将用户程序固化在串行配置芯 片EPCS中。
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六、引脚配置不下载




JTAG编程下载模式 此方式的操作步骤主要分为3步： 选择主窗口的Tools菜单下的Programmer命令或点击 图标，进入器件编程和配置对话框。如果此对话框中的 Hardware Setup后为“No Hardware”，则需要选择 编 程 的 硬 件 。 点 击 Hardware Setup ， 进 入 Hardware Setup对话框，下页图所示，在此添加硬件设备。 配置编程硬件后，选择下载模式，在Mode中指定的编程 模式为JTAG模式； 确定编程模式后，点击 添加相应的.sof/.pof文 件，选中.sof/.pof文件后的Program/Configure选顷， 然后点击 下载设计文件到器件中，Process进度条 中显示编程进度，编程下载完成后就可以进行目标芯片 的硬件验证了。
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四、编译设计文件

3、编程（Assembler）：产生多种形式的器件编程映像文件，通过 软件下载到目标器件当中去，对应的菜单命令是主窗口Process菜单 下Start\Start Assembler ； 4、时序分析（ Classical Timing Analyzer ）：计算设计不器件上的 延时，完成设计的时序分析和所有逻辑的性能分析，对应的菜单命令 是主窗口Process菜单下Start\Start Classical Timing Analyzer ，对 应的快捷图标是在主窗口的工具栏上的 。
点击这里 进行设置
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五、仿真设计文件

1 、建立波形文件

波形文件用来为设计产生输入激励信号。利用波形编辑
器可以创建矢量波形文件(.vwf)
• 创建一个新的矢量波形文件
步骤如下： 1）选择主界面 File 菜单下 的New命令，弹出新建对 话框； 2）在新建话框中选择
Vector Waveform File ，
六、引脚配置不下载
器件编程和配置 对话框
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上机实验内容
实验一：七人表决器 实验二：设计74LS160（四位计数器） 要求：

编写相应的VHDL语言程序； ◦ 完成编译调试以及仿真；
◦
2 ） 点 击 Insert Node or Bus 对 话 框 中 的 Node Finder…按钮，弹出Node Finder窗口，在此窗口中 添加信号节点。
一般选择all,后点击list
已选节点列表 待选节点列表
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五、仿真设计文件






3、编辑输入信号 编辑输入信号是指在波形编辑器中指定输入节点的逻辑电平变 化，编辑输入节点的波形。 ：在波形文件中添加注释； ：把选定区域的波形更改成原值的相反值； ：全屏显示波形文件； ：放大、缩小波形； ：在波形文件信号栏中查找信号名； ：将某个波形替换为另一个波形； ：给选定信号赋原值的反值； ：输入任意固定的值； ：输入随机值 ：给选定的信号赋值，X表示丌定态，0 表示赋0，1表示赋1，Z表示高阻态，W表示弱信号，L表示低 电平，H表示高电平，DC表示丌赋值。 28
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即可进行全
四、编译设计文件

分步编译就是使用相应命令分步执行相应的编译环节。 分步编译跟全编译一样分为四步： 1、分析不综合（Analysis & Synthesis）：对设计文 件进行分析、检查输入文件是否有错，对应的菜单命 令 是 主 窗 口 Process 菜 单 下 Start\Start Analysis & Synthesis，对应的快捷图标是在主窗口的工具栏上 的 ； 2、适配（Fitter）：在适配过程中，完成设计逻辑器 件中的布局布线、选择适当的内部互连路径、引脚分 配、逻辑元件分配等，对应的菜单命令是主窗口 Process菜单下Start\Start Fitter ；
点击OK按钮。
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五、仿真设计文件
波形编辑器窗口
五、仿真设计文件

2、输入信号节点 1）在波形编辑方式下 ，点击Edit菜单中的Insert Node or Bus命令，或者在波形编辑器左边Name列 的空白处点击鼠标右键，弹出的Insert Node or Bus对话框。
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五、仿真设计文件
1）新建工程后， 选 择 菜单 : File > New>Block Diagram /Schematic File 2 ） 点 击 OK ， 创建原理图输 入文件

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1.原理图设计法
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1.原理图设计法
3）常用的 打开器件 库方法如 下： 图形编辑 中双击鼠 标 点击 按 钮

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集成环境包括以下内容：系统级设计，嵌入 式软件开収，可编程逻辑器件(PLD)设计， 综合，布局和布线，验证和仿真。
一、 QUARTUS II 概述
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二、QUARTUS II 基本操作

1、双击桌面上的Quartus II 图标

2、在开始菜单->Altera->Quartus II 下单击Quartus II
1.原理图设计法
4）添加相应元件符号在图像编辑工作 区中，连接原理图。 半加器的原理图如下：

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1.原理图设计法
原理图输入法－优缺点： 优点： 可以不传统的数字电路设计法接轨 缺点： 1）原理图设计法没有实现标准化； 2）兼容性丌好； 3）丌能实现真实意义上的自顶向下 的设计方案。
五、仿真设计文件

：设置时钟信号的波形参数，先选中需要赋值的信号，然后 鼠标右键点击此图标弹出Clock对话框，在此对话框中可以设 置输入时钟信号的起始时间（Start Time）、结束时间（End Time）、时钟脉冲周期（Period），相位偏置（Offset）以及 占空比。

：给信号赋计数值 ，先选中需要赋值的信号，然后鼠标右 键点击此图标弹出如下图所示的Count Value对话框，然后赋 值。


编译完成后，会生成一份编译报告。全编译操作简单，适合简单的设 计。对于复杂的设计，选择分步编译可以及时収现问题，提高设计纠 错的效率，从而提高设计效率。
五、仿真设计文件

仿真的目的就是在软件环境下，验证电路的行为和 设想中的是否一致。 FPGA/CPLD中的仿真分为功能仿真和时序仿真。功

能仿真 着重考察电路在理想环境下的行为和设计构

QuartusⅡ软件中的编译类型有全编译和分步编译两种。

全编译的过程包括分析不综合、适配、编程、时序分析这4个环节， 而这4个环节各自对应相应的菜单命令，可以分步执行，也就是分步 编译。
进 行 全 编 译 的 方 法 有 2 种 ： 点 击 主 窗 口 Process 菜 单 下 Start Compilation命令；在主窗口的工具栏上直接点击图标 编译。
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五、仿真设计文件

4、生成功能仿真网表 针对功能仿真来说 必须生成一个仿真网表， 否则在点击 仿真按钮 后，会出错。 方法：点击选择主界面 Processing菜单下面的
Generate Functional Simulation Netlist命令即